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TD-SCDMA下行同步算法设计与FPGA实现
Design and Implementation of TD-SCDMA Downlink Synchronization Algorithm Based on FPGA作者机构：重庆邮电大学移动通信技术重庆市重点实验室重庆400065
出 版 物：《科学技术与工程》 (Science Technology and Engineering)
年 卷 期：2014年第22卷第7期
页 面：195-199页
学科分类：080904[工学-电磁场与微波技术] 0810[工学-信息与通信工程] 0809[工学-电子科学与技术（可授工学、理学学位）] 08[工学] 080402[工学-测试计量技术及仪器] 0804[工学-仪器科学与技术] 081001[工学-通信与信息系统]
基 金：国家自然科学基金(61301126) 重庆市基础与前沿研究计划项目(cstc2013jcyjA40041) 重庆邮电大学博士启动基金(A2012-33) 重庆邮电大学青年科学研究项目(A2012-77)资助
主 题：同步TD-SCDMA 功率比检测 FPGA
摘 要：针对TD-SCDMA系统下行同步快速高效需求,在分析TD-SCDMA物理帧结构的基础上,提出了一种利用功率比检测作为粗同步,并结合频域相关确定精确同步的TD-SCDMA下行同步算法与FPGA实现方案。利用Modelsim和Matlab对算法的可行性和有效性进行了仿真验证。最后在Altera Cyclone III FPGA硬件平台进行了板级调试和实时数据验证。结果表明该同步算法具有较好的实时性和较高的稳定度。
