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一种改进的高速Reed-Solomon译码算法及其FPGA实现
A modified algorithm for high speed Reed-Solomon decode and its FPGA implementation作者机构：西安交通大学电信学院陕西西安710049
出 版 物：《西安电子科技大学学报》 (Journal of Xidian University)
年 卷 期：2006年第33卷第6期
页 面：995-999页
核心收录：
学科分类：080903[工学-微电子学与固体电子学] 0809[工学-电子科学与技术（可授工学、理学学位）] 08[工学]
主 题：Reed—Solomon码 欧几里得算法 高速电路 现场可编程门阵列
摘 要：对欧几里得译码算法做了进一步的改进,根据新算法在解关键方程模块中采用了新颖的迭代流水线结构以提高电路工作速度、减小电路面积,设计了高速Reed-Solomon译码器.设计的流水线全并行有限域乘法器,有效解决了传统译码器的速度性能瓶颈.在新的译码器架构基础上,设计了译码器的门级电路,用Xilinx的VirtexII XC2V1000进行了实现和仿真,获得了理想的成果.
