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基于FPGA的No.7信令FISU过滤
No.7 Signaling FISU Filter Based on FPGA作者机构：重庆金美通信有限责任公司重庆400030
出 版 物：《计算机工程》 (Computer Engineering)
年 卷 期：2010年第36卷第6期
页 面：236-238页
核心收录：
学科分类：12[管理学] 1201[管理学-管理科学与工程(可授管理学、工学学位)] 08[工学] 081201[工学-计算机系统结构] 0812[工学-计算机科学与技术（可授工学、理学学位）]
主 题：No.7信令系统 初始定位过程 填充信号单元过滤 现场可编程门阵列
摘 要：针对CPU处理填充信号单元(FISU)存在的缺陷,分析No.7信令系统的初始定位和FISU处理过程,提出一种基于FPGA实现FISU过滤的设计方案,给出实现的原理框图、FPGA与CPU之间的通信机制和信号处理流程,使用ISE和ModelSim软件进行仿真。仿真结果表明该方案是正确、可行和有效的。
