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一种低硬件开销的高级加密标准设计
Design of Low Hardware-cost AES作者机构：南通大学江苏省专用集成电路设计重点实验室南通226007
出 版 物：《计算机工程》 (Computer Engineering)
年 卷 期：2005年第31卷第20期
页 面：165-167页
核心收录：
学科分类：0839[工学-网络空间安全] 08[工学] 081201[工学-计算机系统结构] 0812[工学-计算机科学与技术（可授工学、理学学位）]
基 金：上海市科委集成电路设计创新基金资助项目(027062011)
摘 要：在智能卡、PDA等便携式设备中,希望使用面积小的密码芯片。通过对AES算法进行结构优化,有效地减小了硬件实现时的开销。使用Verilog HDL语言设计并在Altera APEX20K器件中验证通过,设计集成了加密/解密模式及所有3种密钥长度,为进一步的VLSI实现提供了FPGA原形验证。
