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检索条件"任意字段=14th International Workshop on Power and Timing Modeling, Optimization and Simulation, PATMOS 2004"
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power-aware scheduling for hard real-time embedded systems using voltage-scaling enabled architectures
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15th international workshop on Integrated Circuit and System Design: power and timing modeling, optimization and simulation, patmos 2005
作者： Mohsen, Amjad Hofmann, Richard Department of Computer Science 7 University of Erlangen-Nürnberg 91058 Erlangen Germany
In this paper, we present a power-aware scheduling scheme for hard real-time embedded systems design. Our new approach can enhance the efficiency of both dynamic voltage scaling (DVS) and dynamic Vth scaling (DVTS). W... 详细信息
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Generating worst-case stimuli for accurate power grid analysis
Generating worst-case stimuli for accurate power grid analys...
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18th international workshop on power and timing modeling, optimization and simulation, patmos 2008
作者： Morgado, Pedro Marques Flores, Paulo F. Monteiro, José C. Silveira, L. Miguel INESC-ID IST TU Lisbon Portugal INESC-ID TU Lisbon Cadence Research Labs. Portugal
power distribution systems provide the voltages and currents that devices in a circuit need to operate properly and silicon success requires its careful design and verification. However, problems like voltage drop, gr... 详细信息
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