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  • 474 篇 中文
检索条件"作者=J·E·林斯塔特"
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命令/地址通道错误检测
命令/地址通道错误检测
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作者： j·e·林斯塔特 F·A·韦尔 美国加利福尼亚州
存储器组件和控制器彼此传输命令和数据。用以激活并且然后访问数据的命令、以及数据本身在不同时间处均在控制器与存储器组件之间被传输。控制器和存储器组件各自计算关于激活命令信息(例如，存储体地址和行地址)的相应的错误检测代码(... 详细信息
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具有输入/输出数据速率对齐的存储器部件
具有输入/输出数据速率对齐的存储器部件
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作者： F·A·韦尔 j·e·林斯塔特 T·帕尔奇 美国加利福尼亚州
在由核心存储阵列的数据输出带宽所约束的第一时间间隔上从存储器部件的核心存储阵列中读取第一数据。在从核心存储阵列中读取之后，在比第一时间间隔更短、并且与比核心存储阵列的数据输出带宽更大的数据传输带宽相对应的第二时间间隔... 详细信息
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混合存储器模块
混合存储器模块
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作者： F·A·韦尔 j·e·林斯塔特 K·L·赖特 美国加利福尼亚州
存储器模块包括相对快速且持久的动态随机存取存储器(DRAM)的高速缓存，用于服务于更大量的相对慢和磨损敏感的非易失性存储器。本地控制器管理DRAM高速缓存和非易失性存储器之间的通信，以适应不同的存取粒度，减少必要数目的存储器事... 详细信息
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具有输入/输出数据速率对齐的存储器部件
具有输入/输出数据速率对齐的存储器部件
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作者： F·A·韦尔 j·e·林斯塔特 T·帕尔奇 美国加利福尼亚州
在由核心存储阵列的数据输出带宽所约束的第一时间间隔上从存储器部件的核心存储阵列中读取第一数据。在从核心存储阵列中读取之后，在比第一时间间隔更短、并且与比核心存储阵列的数据输出带宽更大的数据传输带宽相对应的第二时间间隔... 详细信息
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具有DRAM高速缓存的非易失性物理存储器
具有DRAM高速缓存的非易失性物理存储器
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作者： F·A·韦尔 j·e·林斯塔特 H·克里斯托弗 美国加利福尼亚州
混合易失性/非易失性存储器模块采用相对快速、耐用并且昂贵的动态随机存取存储器(DRAM)高速缓存来存储来自更大量相对较慢并且廉价的非易失性存储器(NVM)的数据的子集。模块控制器对DRAM高速缓存的访问权限进行优先级排序以获得提高的... 详细信息
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具有DRAM高速缓存的非易失性物理存储器
具有DRAM高速缓存的非易失性物理存储器
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作者： F·A·韦尔 j·e·林斯塔特 H·克里斯托弗 美国加利福尼亚州
混合易失性/非易失性存储器模块采用相对快速、耐用并且昂贵的动态随机存取存储器(DRAM)高速缓存来存储来自更大量相对较慢并且廉价的非易失性存储器(NVM)的数据的子集。模块控制器对DRAM高速缓存的访问权限进行优先级排序以获得提高的... 详细信息
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具有高速缓存的存储器模块操作的存储器系统
具有高速缓存的存储器模块操作的存储器系统
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作者： F·A·韦尔 K·L·赖特 j·e·林斯塔特 C·汉佩尔 美国加利福尼亚州
公开了存储器控制器、设备、模块、系统和关联的方法。在一个实施例中，一种存储器模块包括用于耦合到总线的管脚接口。总线具有第一宽度。模块包括至少一个存储类存储器(SCM)部件和至少一个DRAM部件。存储器模块在利用所有第一宽度的... 详细信息
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具有高速缓存的存储器模块操作的存储器系统
具有高速缓存的存储器模块操作的存储器系统
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作者： F·A·韦尔 K·L·赖特 j·e·林斯塔特 C·汉佩尔 美国加利福尼亚州
本申请的各实施例涉及具有高速缓存的存储器模块操作的存储器系统。公开了存储器控制器、设备、模块、系统和关联的方法。在一个实施例中，一种存储器模块包括用于耦合到总线的管脚接口。总线具有第一宽度。模块包括至少一个存储类存储... 详细信息
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用于存储器模块的动态随机存取存储器(DRAM)部件
用于存储器模块的动态随机存取存储器(DRAM)部件
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作者： F·A·韦尔 e·特塞恩 j·e·林斯塔特 T·j·乔瓦尼尼 K·L·赖特 美国加利福尼亚州
本公开的实施例涉及用于存储器模块的动态随机存取存储器(DRAM)部件。该存储器模块包括模块接口；第一存储器部件堆叠，包括第一数据接口，被耦合到模块接口；以及第二数据接口；第二存储器部件堆叠，包括第三数据接口，被耦合到第一堆... 详细信息
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具有刷新间隔的主字线粒度的DRAM刷新控制
具有刷新间隔的主字线粒度的DRAM刷新控制
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作者： T·沃吉尔桑 T·帕尔奇 B·S·豪克尼斯 j·e·林斯塔特 美国加利福尼亚州
DRAM单元需要被周期性地刷新，以保持被存储在DRAM单元中的电荷。对于所有DRAM单元，保留时间通常不相同，但是遵循具有最高电荷损失的单元的保留时间与具有最低电荷损失的单元的保留时间之间具有多个数量级的大小差异的分布。基于单元... 详细信息
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