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文字说明：

T=题名（书名、题名），A=作者（责任者），K=主题词，P=出版物名称，PU=出版社名称，O=机构（作者单位、学位授予单位、专利申请人），L=中图分类号，C=学科分类号，U=全部字段，Y=年（出版发行年、学位年度、标准发布年）

检索规则说明：

AND代表“并且”；OR代表“或者”；NOT代表“不包含”；(注意必须大写,运算符两边需空一格)

检索范例：

范例一：(K=图书馆学 OR K=情报学) AND A=范并思 AND Y=1982-2016
范例二：P=计算机应用与软件 AND (U=C++ OR U=Basic) NOT K=Visual AND Y=2011-2016

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文献类型

30 篇 专利

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30 篇 电子文献
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机构

3 篇 苏州锴威特半导体...
3 篇 北京时代民芯科技...
2 篇 中国人民解放军国...
2 篇 中国人民解放军信...
2 篇 东南大学
2 篇 格兰菲智能科技有...
2 篇 中国科学院微电子...
2 篇 重庆邮电大学
2 篇 西安奇芯光电科技...
2 篇 中国科学院西安光...
2 篇 成都甄识科技有限...
2 篇 北京微电子技术研...
2 篇 上海寒武纪信息科...
1 篇 无锡金橘科技有限...
1 篇 中国科学院深圳先...
1 篇 上海交通大学
1 篇 深圳市中兴通讯股...
1 篇 哈尔滨工业大学
1 篇 中国航天时代电子...
1 篇 电子科技大学

作者

3 篇 陈雷
3 篇 谭在超
3 篇 涂才根
3 篇 罗寅
3 篇 丁国华
3 篇 张胜
2 篇 谭文若
2 篇 魏福山
2 篇 孙巍
2 篇 赵振岩
2 篇 胡梅
2 篇 李学武
2 篇 布兰特·埃弗雷特·...
2 篇 支天
2 篇 郭琨
2 篇 张子龙
2 篇 刘波
2 篇 罗伊·戴维森
2 篇 卞仁玉
2 篇 郭磊

语言

30 篇 中文

检索条件"主题词=乘法器结构"

共 30 条记录，以下是1-10 订阅

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详细简洁

排序：

数据处理方法、计算机设备、存储介质和乘法器结构

数据处理方法、计算机设备、存储介质和乘法器结构

引用

作者：曾耀辉卞仁玉张淮声 200135 上海市浦东新区中国(上海)自由贸易试验区金科路2557号201室

本申请涉及一种数据处理方法、计算机设备、存储介质和乘法器结构。所述方法包括：获取两个输入数据的数据格式；两个输入数据的数据格式相同；从多个预设的数据转换算法中确定和数据格式匹配的目标数据转换算法，并采用目标数据转换算... 详细信息

标准号: CN115827555A

本申请涉及一种数据处理方法、计算机设备、存储介质和乘法器结构。所述方法包括：获取两个输入数据的数据格式；两个输入数据的数据格式相同；从多个预设的数据转换算法中确定和数据格式匹配的目标数据转换算法，并采用目标数据转换算法，对两个输入数据进行数据格式转换，得到至少两个目标输入数据；采用乘法器对至少两个目标输入数据进行处理，得到初步运算结果；确定两个输入数据对应的截取位宽，根据截取位宽对初步运算结果进行处理，得到两个输入数据对应的乘法运算结果。采用本方法能够降低设备处理乘法运算的资源消耗，从而提高设备性能。

关键词：数据格式初步运算结果目标数据转换算法截取乘法运算结果数据格式转换数据转换算法乘法器结构计算机设备乘法运算存储介质降低设备设备性能资源消耗数据处理乘法器位宽预设匹配申请

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数据处理方法、计算机设备、存储介质和乘法器结构

数据处理方法、计算机设备、存储介质和乘法器结构

引用

作者：曾耀辉卞仁玉张淮声 200135 上海市浦东新区中国(上海)自由贸易试验区金科路2557号201室

标准号: CN115827555B

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一种改进的Booth 2乘法器结构

一种改进的Booth 2乘法器结构

引用

作者：陈雷赵元富姜爽 100076 北京市丰台区东高地四营门北路2号

一种改进的Booth2乘法器结构，包括两个硬件实现的部分积及对两个部分积相加的加法器，在所述的两个部分积电路的最高两位分别各添加一个添位电路，使乘法器的各个部分积位数一样长，同时部分积数目不增加。本发明具有电路面积小、结构... 详细信息

标准号: CN101126974B

一种改进的Booth2乘法器结构，包括两个硬件实现的部分积及对两个部分积相加的加法器，在所述的两个部分积电路的最高两位分别各添加一个添位电路，使乘法器的各个部分积位数一样长，同时部分积数目不增加。本发明具有电路面积小、结构简单规则、对电路性能影响小的特点。

关键词：电路乘法器结构电路面积电路性能简单规则硬件实现乘法器加法器

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用于HEVC标准下DCT/IDCT电路的乘法器结构

用于HEVC标准下DCT/IDCT电路的乘法器结构

引用

作者：洪亮朱惠何卫锋李琛毛志刚 200240 上海市闵行区东川路800号

本发明涉及一种用于HEVC标准下DCT/IDCT电路的乘法器结构，包括依次串联连接的预处理运算模块、第一级移位加运算模块和第二级移位加运算模块，所述的预运算单元设有输入数据端口和输入参数端口，所述的第二级移位加运算模块设有运算结... 详细信息

标准号: CN103092559A

本发明涉及一种用于HEVC标准下DCT/IDCT电路的乘法器结构，包括依次串联连接的预处理运算模块、第一级移位加运算模块和第二级移位加运算模块，所述的预运算单元设有输入数据端口和输入参数端口，所述的第二级移位加运算模块设有运算结果输出端口。与现有技术相比，本发明具有可满足系统功能并具有更小的硬件资源占用和更快的运行周期等优点。

关键词：运算模块移位预处理乘法器结构输入参数数据端口系统功能硬件资源运算单元运算结果串联电路连接

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近似乘法器设计方法、近似乘法器和FIR滤波器

近似乘法器设计方法、近似乘法器和FIR滤波器

引用

作者：杨志玺杨道宁杨俊谭文若胡梅赵振岩刘思力 410073 湖南省长沙市开福区德雅路109号

本申请涉及一种近似乘法器设计方法、近似乘法器和FIR滤波器。所述方法包括：剔除精确4:2压缩器的进位输入和进位输出逻辑，根据预设的平均绝对误差值约束条件修改精确4:2压缩器的求和输出真值表，获得近似压缩逻辑，根据该近似压缩逻... 详细信息

标准号: CN111695313A

本申请涉及一种近似乘法器设计方法、近似乘法器和FIR滤波器。所述方法包括：剔除精确4:2压缩器的进位输入和进位输出逻辑，根据预设的平均绝对误差值约束条件修改精确4:2压缩器的求和输出真值表，获得近似压缩逻辑，根据该近似压缩逻辑设计近似压缩器。根据预设的乘数位宽、被乘数位宽、计算精度约束条件和资源占用约束条件，设计近似乘法器。上述方法剔除了部分乘积压缩过程中的传输延迟，根据预设的平均绝对误差值约束条件设计出有误差约束的近似压缩器，基于该近似压缩器，选择误差性能和资源占用性能最均衡的乘法器结构设计近似乘法器，能够确保基于压缩计算逻辑修改的近似乘法器的计算精确度和资源利用效率。

关键词：近似压缩器乘法器约束条件预设平均绝对误差资源占用进位位宽剔除逻辑设计资源利用效率乘法器结构乘法器设计压缩传输延迟计算逻辑精度约束输出逻辑压缩过程压缩逻辑被乘数真值表乘数求和均衡输出申请

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一种基于布斯编码的16*8近似乘法器片上动态计算系统

一种基于布斯编码的16*8近似乘法器片上动态计算系统

引用

作者：刘波张子龙王梓羽王学涛钱俊逸蔡浩杨军时龙兴 210096 江苏省南京市玄武区四牌楼2号

本发明公开了一种基于布斯编码的16*8近似乘法器片上动态计算系统，属于计算、推算或计数的技术领域。本发明中，输入的运算数据经过数据预加载模块读出有效位宽；将读到的有效位宽再输入相应的数据计算模式动态预解析模块，根据有效位... 详细信息

标准号: CN112612446A

本发明公开了一种基于布斯编码的16*8近似乘法器片上动态计算系统，属于计算、推算或计数的技术领域。本发明中，输入的运算数据经过数据预加载模块读出有效位宽；将读到的有效位宽再输入相应的数据计算模式动态预解析模块，根据有效位宽将输入数据分为不同的类型，并作为配置近似方案的重要依据；将此前得到的数据位宽输入容许误差计算模块，计算最大容许误差；近似乘法器结构动态配置运算模块根据数据类型给出基础近似方案；比较该方案对应误差与最大容许误差，根据比较结果不断调整近似方案，最终得到最适合的方案，算出近似结果。在误差容许范围内找到最适合的近似配置方案，实时对乘法运算进行动态配置，使精度和功耗的选择更加灵活。

关键词：近似容许误差有效位宽动态配置乘法器结构乘法运算动态计算计算模块解析模块近似结果模式动态数据计算数据类型数据位宽误差容许运算模块运算数据乘法器预加载功耗配置读出推算灵活

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稀疏加速单元、计算方法及稀疏神经网络硬件加速系统

稀疏加速单元、计算方法及稀疏神经网络硬件加速系统

引用

作者：伍元聪罗敏西贝与非金正权 610041 四川省成都市成都高新区益州大道中段1800号1栋7层704号

本发明公开了一种稀疏加速单元、计算方法及稀疏神经网络硬件加速系统。所述稀疏加速单元，包括N个计算单元和i级稀疏加法树，所述计算单元为乘法器结构，所述稀疏加法树采用二叉树结构连接，即：上一级稀疏加法树的稀疏加法器数量是下... 详细信息

标准号: CN116187408B

本发明公开了一种稀疏加速单元、计算方法及稀疏神经网络硬件加速系统。所述稀疏加速单元，包括N个计算单元和i级稀疏加法树，所述计算单元为乘法器结构，所述稀疏加法树采用二叉树结构连接，即：上一级稀疏加法树的稀疏加法器数量是下一级的两倍，上一级的每两个稀疏加法器同时连接下一级的一个稀疏加法器；第一级稀疏加法树的稀疏加法器数量为N/2；各级稀疏加法树的稀疏加法器数据位宽依次递增1bit。所述稀疏神经网络硬件加速系统，包括多个所述稀疏加速单元，可兼容多种稀疏神经网络算法模型。本发明还公开了一种稀疏加速计算方法，基于稀疏加速单元硬件架构解决了稀疏矩阵不规则计算问题，同时在不损失效率下兼容密集型矩阵运算加速。

关键词：稀疏加法器加法树加速单元神经网络硬件计算单元加速系统兼容神经网络算法乘法器结构二叉树结构矩阵运算数据位宽稀疏矩阵依次递增硬件架构不规则第一级

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检错比特并行脉动阵列移位多项式基乘法器及其构造方法

检错比特并行脉动阵列移位多项式基乘法器及其构造方法

引用

作者：范淑琴王震王小哲李磊曾光魏福山程庆丰马传贵 450002 河南省郑州市金水区俭学街7号

本发明涉及信息安全技术中的一种乘法器结构，特别是涉及一种具备检错能力的比特并行脉动阵列移位多项式基乘法器。该乘法器针对一类被国际标准广泛采纳的有限域——不可约三项式定义的域GF(2m)设计，其设计原理清晰，结构规则化模块化... 详细信息

标准号: CN101968732B

本发明涉及信息安全技术中的一种乘法器结构，特别是涉及一种具备检错能力的比特并行脉动阵列移位多项式基乘法器。该乘法器针对一类被国际标准广泛采纳的有限域——不可约三项式定义的域GF(2^m)设计，其设计原理清晰，结构规则化模块化，适合大规模集成电路设计，且因该设计采用脉动阵列结构，适合连续乘法计算，计算效率非常高。另外，借助汉明编码理论，在低开销的代价下乘法器引入并行检错功能，能够较大程度上保证计算结果的正确性，进而能够有效抵抗故障分析攻击，为密码体制的实现提供更可靠的安全保证。

关键词：乘法器大规模集成电路设计脉动阵列结构信息安全技术乘法器结构安全保证编码理论多项式基故障分析计算效率检错功能检错能力结构规则脉动阵列密码体制设计原理低开销模块化有限域乘法法器移位正确性国际标准抵抗攻击

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一种基于CSD编码动态可配置的常数乘法器实现方法

一种基于CSD编码动态可配置的常数乘法器实现方法

引用

作者：刘连胜孙皓彭宇刘大同 150001 黑龙江省哈尔滨市南岗区西大直街92号

本发明提出一种基于CSD编码动态可配置的常数乘法器实现方法，所述方法包括以下步骤：步骤一：数据分析，步骤二：数据预编码，步骤三：乘法器结构实现。所述实现方法能够实现低资源消耗的基于CSD编码的乘法器，能够支持在结构不变的情... 详细信息

标准号: CN117992012A

本发明提出一种基于CSD编码动态可配置的常数乘法器实现方法，所述方法包括以下步骤：步骤一：数据分析，步骤二：数据预编码，步骤三：乘法器结构实现。所述实现方法能够实现低资源消耗的基于CSD编码的乘法器，能够支持在结构不变的情况下实现运行时可配置的效果，并支持多种窗函数、滤波器系数和旋转因子，能够应用于多种场景。

关键词：可配置的常数乘法器乘法器结构滤波器系数数据预编码数据分析旋转因子资源消耗乘法器窗函数运行时场景应用

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一种基于波长路由的光子矩阵向量乘法器及其运算方法

一种基于波长路由的光子矩阵向量乘法器及其运算方法

引用

作者：徐之光程东赵卫姚宏鹏杜炳政布兰特·埃弗雷特·李特尔罗伊·戴维森 710119 陕西省西安市高新区新型工业园信息大道17号

本发明提供一种基于波长路由的光子矩阵向量乘法器及其运算方法，解决现有光矩阵向量乘法器无法实现较大的规模以及不具备可行性的问题。该光子矩阵向量乘法器包括依次设置的多波长光源单元、第一光调制器阵列、功分器阵列、第二光调制... 详细信息

标准号: CN113126693B

本发明提供一种基于波长路由的光子矩阵向量乘法器及其运算方法，解决现有光矩阵向量乘法器无法实现较大的规模以及不具备可行性的问题。该光子矩阵向量乘法器包括依次设置的多波长光源单元、第一光调制器阵列、功分器阵列、第二光调制器阵列、阵列波导光栅和探测器阵列；第一光调制器阵列包括N个第一调制器，功分器阵列包含N个功分器，第二光调制器阵列包括N个第二调制器，阵列波导光栅包括依次设置的输入衍射区、阵列波导和输出衍射区，探测器分别与输出衍射区的M个输出口一一对应连接。与传统空间光学直接映射到平面的方案相比，本发明所提出的乘法器结构具有高性能、高可实现性、易于集成等优势。

关键词：光调制器阵列功分器衍射矩阵向量乘法器阵列波导光栅依次设置调制器光子乘法器结构多波长光源探测器阵列向量乘法器波长路由传统空间阵列波导直接映射输出光矩阵平面的输出口探测器运算

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