检索结果-内蒙古大学图书馆

小型微型计算机系统 2016年第1期37卷 178-185页

作者：王恩东陈继承王洪伟倪璠唐士斌史宏志浪潮集团有限公司北京100085 高效能服务器与存储技术国家重点实验室北京100085

体系结构模拟技术在计算机体系结构研究和系统设计中发挥着重要作用.通过对计算机系统的建模、仿真及评估,科研人员可以验证新型体系结构设计;将该技术导入产品设计则可以优化系统方案、降低设计风险并提升开发效率.随着半导体工艺的迅... 详细信息

体系结构模拟技术在计算机体系结构研究和系统设计中发挥着重要作用.通过对计算机系统的建模、仿真及评估,科研人员可以验证新型体系结构设计;将该技术导入产品设计则可以优化系统方案、降低设计风险并提升开发效率.随着半导体工艺的迅速提升,分布式共享内存计算机系统已步入千核时代,处理器微结构、存储层次、片间互连及cache一致性协议等对系统性能的影响愈发复杂,对体系结构模拟技术也提出更高挑战.本文依据计算机体系结构模拟技术特征,从精度、速度、可用性和易用性四个方面对现有体系结构模拟技术进行了分析、总结.针对计算机系统发展趋势与当前模拟器存在的问题,归纳了体系结构模拟技术面临的挑战,进而提出了未来体系结构模拟技术发展的4A理论.

关键词：体系结构模拟模拟器精度速度可用性易用性

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众核体系结构模拟研究进展

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高性能计算技术 2013年第1期 11-18页

作者：谢向辉郝子宇李宏亮陆晓亮张昆张健江南计算技术研究所无锡 214000

众核处理器巨大的设计空间和复杂的设计方案为体系结构模拟提出了新的挑战,包括模拟结构复杂、模拟计算量大、宿主环境复杂等.为了应对这些挑战,需要开发出新的模拟技术、工具和模拟器,以降低模拟复杂度和实现难度、提高运行速度、增强... 详细信息

众核处理器巨大的设计空间和复杂的设计方案为体系结构模拟提出了新的挑战,包括模拟结构复杂、模拟计算量大、宿主环境复杂等.为了应对这些挑战,需要开发出新的模拟技术、工具和模拟器,以降低模拟复杂度和实现难度、提高运行速度、增强模拟可配置性、提升模拟器易用性/通用性.本文展示了当前众核处理器体系结构模拟研究进展,包括各种模拟技术、模拟工具和模拟器实现,为众核体系结构模拟器理解、研究和实现提供参考.

关键词：体系结构模拟众核模拟技术模拟工具模拟器

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服务器体系结构模拟技术研究

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高性能计算技术 2011年第3期 8-15页

作者：郝子宇谢向辉吴东李达哲钱磊张鲁飞江南计算技术研究所无锡214000

快速发展的商业应用不仅推动了服务器性能的不断提高,同时也促使服务计算领域不断吸收各种先进计算技术,来拓展服务器体系结构的设计空间.因此需要更加有效的评测手段,以保证准确的性能评估和预测,从而快速地选择最优体系结构设计.本文... 详细信息

快速发展的商业应用不仅推动了服务器性能的不断提高,同时也促使服务计算领域不断吸收各种先进计算技术,来拓展服务器体系结构的设计空间.因此需要更加有效的评测手段,以保证准确的性能评估和预测,从而快速地选择最优体系结构设计.本文分析了各种服务器体系结构模拟技术,包括全系统模拟、软硬件检测、分析建模,以及当前对多(众)核结构的建模和模拟.最后,描述了服务器体系结构模拟技术的发展前景.

关键词：服务器性能评价体系结构模拟分析建模

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嵌入式微处理器体系结构模拟与软件调试工具的设计与实现

嵌入式微处理器体系结构模拟与软件调试工具的设计与实现

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第七届计算机工程与工艺学术年会

作者：熊志辉张鲁峰赵文辉李思昆国防科学技术大学计算机学院(长沙)

本文介绍了我们新开发的嵌入式微处理器体系结构模拟与软件调试工具的设计与实现技术.该工具作为SOC软硬件协同设计环境中的一个重要组成部分,能支持嵌入式微处理器的体系结构模拟以及嵌入式微处理器的软件调试.

关键词：嵌入式微处理器体系结构模拟嵌入式软件调试软硬件协同设计系统芯片

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试论计算机体系结构软件的模拟技术

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景德镇学院学报 2018年第3期33卷 80-83页

作者：王振华闽江学院软件学院福州350108

目前,计算机系统的设计与开发中,用体系结构软件的模拟技术已经成为分析的重要环节,其优势是可减少成本的使用,缩短了设计花费的时间,但因为模拟技术的操作较为复杂,影响了技术在实际操作中的有效性,给出了优化的方案,但模拟技术的设计... 详细信息

目前,计算机系统的设计与开发中,用体系结构软件的模拟技术已经成为分析的重要环节,其优势是可减少成本的使用,缩短了设计花费的时间,但因为模拟技术的操作较为复杂,影响了技术在实际操作中的有效性,给出了优化的方案,但模拟技术的设计与操作中,很多问题还未解决,需进一步完善。

关键词：体系结构模拟模拟器量子计算机体系结构

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多核结构下片内存储系统的模型模拟技术研究

多核结构下片内存储系统的模型模拟技术研究

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作者：刘佳国防科学技术大学

学位级别：硕士

多核(CMP)处理器的流行以及集成电路制造工艺的发展使得存储系统的设计面临空前的压力。如何更好的支持多个处理器核对存储器的并发访问,同时有效降低纳米级工艺下芯片内部的线延迟及功耗,是今后相当长的一段时期内片上缓存系统有待解... 详细信息

多核(CMP)处理器的流行以及集成电路制造工艺的发展使得存储系统的设计面临空前的压力。如何更好的支持多个处理器核对存储器的并发访问,同时有效降低纳米级工艺下芯片内部的线延迟及功耗,是今后相当长的一段时期内片上缓存系统有待解决的主要难题。片上缓存系统面临的困境给作为处理器设计中重要组成部分的体系结构模拟技术提出了新的挑战。现有的各种体系结构模拟器缺乏对CMP结构片上缓存的有效分析和性能模拟。对于片上缓存在延迟、功耗方面的动态模拟,现有的模型还不够深入细致。针对这些问题,本文对CMP结构下片上缓存系统的模型模拟进行了研究,并设计了CMP结构片上缓存性能模型和多尺度模型。本文所描述的片上缓存性能模型针对FT系列多核处理器的模拟需求,能够完成针对片上缓存系统的体系结构级性能模拟。CMP结构相比于传统单核超标量处理器在片上缓存系统的规模和复杂性上都大大增加,因此缓存性能模型的设计中也涵盖了缓存模块、缓存控制模块、一致性协议等诸多部分。尽量细致而真实的反应缓存的行为特征、使用高效的数据结构和算法、采用模块化的设计并且提供可扩展能力,这些设计思想在模型中被充分的尊重并加以利用。为了验证模型的正确性和可用性,本文利用SPEC2000标准测试程序进行了模拟执行,模拟实验的结果同时也显示了体系结构模拟技术本身的优势,即方便、快捷地显示各种结构参数对于目标系统性能的影响。近年来的许多研究表明,在微体系结构级进行芯片面积、延迟、功耗等指标的优化与电路级相比具有更大的挖掘空间。基于此,本文在研究片上缓存系统的性能模型的同时,参考CACTI和Wattch模型的设计方法,创建了缓存的多尺度模型。作为链接结构模型和底层电路实现与工艺的开放平台,多尺度模型能够依据不同的工艺标准以及结构参数对缓存的面积、延迟、功耗进行快捷而有效地估算。通过进一步与性能模型相结合,多尺度模型可以真实地模拟程序执行过程中片上缓存延迟、功耗指标的动态数值。初步的研究表明,本文所阐述的片上缓存性能模型和多尺度模型能够较好的完成CMP体系结构下对于片上缓存的各种模拟,在相关的科研以及工程领域发挥一定作用。

关键词：多核片上缓存体系结构模拟多尺度模拟

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