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文字说明：

T=题名（书名、题名），A=作者（责任者），K=主题词，P=出版物名称，PU=出版社名称，O=机构（作者单位、学位授予单位、专利申请人），L=中图分类号，C=学科分类号，U=全部字段，Y=年（出版发行年、学位年度、标准发布年）

检索规则说明：

AND代表“并且”；OR代表“或者”；NOT代表“不包含”；(注意必须大写,运算符两边需空一格)

检索范例：

范例一：(K=图书馆学 OR K=情报学) AND A=范并思 AND Y=1982-2016
范例二：P=计算机应用与软件 AND (U=C++ OR U=Basic) NOT K=Visual AND Y=2011-2016

分类表

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文献类型

103 篇 专利
1 篇 学位论文

馆藏范围

104 篇 电子文献
0 种 纸本馆藏

日期分布

学科分类号

1 篇 工学
- 1 篇 仪器科学与技术
- 1 篇 信息与通信工程
- 1 篇 软件工程

主题

1 篇 写数据操作
1 篇 读数据操作
1 篇 中断
1 篇 fpga
1 篇 spi总线

机构

6 篇 苏州浪潮智能科技...
6 篇 华为技术有限公司
3 篇 深圳曦华科技有限...
3 篇 大唐高鸿信安信息...
3 篇 阿里巴巴集团控股...
2 篇 合芯科技有限公司
2 篇 联想有限公司
2 篇 飞天诚信科技股份...
2 篇 中国移动通信集团...
2 篇 济南浪潮数据技术...
2 篇 南京中兴新软件有...
2 篇 浙江工商大学
2 篇 中科院微电子研究...
2 篇 芯创智微电子有限...
2 篇 武汉斗鱼网络科技...
2 篇 深圳忆数存储技术...
2 篇 珠海格力电器股份...
2 篇 北京飘石科技有限...
2 篇 武汉噢易云计算股...
2 篇 沈阳中科数控技术...

作者

4 篇 马亚奇
3 篇 陈锋
3 篇 张海越
3 篇 梁思谦
3 篇 郑驰
3 篇 白颂荣
2 篇 贺坤
2 篇 王晓征
2 篇 陈俊
2 篇 郭岳
2 篇 谭永明
2 篇 黄亮东
2 篇 刘吉林
2 篇 夏方健
2 篇 周肃
2 篇 陈秋华
2 篇 周乾
2 篇 韩杰
2 篇 杨善松
2 篇 许轶骏

语言

104 篇 中文

检索条件"主题词=写数据操作"

共 104 条记录，以下是1-10 订阅

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详细简洁

排序：

测距与通信处理模块接口设计与实现

测距与通信处理模块接口设计与实现

引用

作者：孙韬华中科技大学

学位级别：硕士

接口处理模块为高精度星间相对测量与通信一体化设备信号处理模块的ARM与FPGA之间提供通信功能。本文从现有的总线技术和流行总线特点分析并结合课题中通信数据特点以及硬件芯片结构选择SPI总线作为接口总线。本文中详细介绍了SPI总线... 详细信息

接口处理模块为高精度星间相对测量与通信一体化设备信号处理模块的ARM与FPGA之间提供通信功能。本文从现有的总线技术和流行总线特点分析并结合课题中通信数据特点以及硬件芯片结构选择SPI总线作为接口总线。本文中详细介绍了SPI总线技术时序特点和FIFO存储器的读写时序仿真为后面的接口设计开发做了先导。同时也对通信帧的帧格式做了简要说明。在接口设计过程中从ARM对数据的读和写两方面进行了详细的讨论,并对这两个方面的控制逻辑做了详细的讲解。同时引出ARM读写时的冲突问题,这个问题是课题研发中的一个重点也是难点。本文中针对读写冲突设置了避免读写冲突的控制逻辑,完好的实现ARM的读写控制。根据ARM的读写操作对应为读数据操作模块和写数据操作模块两个对等结构进行实现。读数据操作模块主要负责将FPGA的数据信息传送给ARM,课题根据总线特点选择了INT中断模式通知ARM。在接口内部则是选择多路选通器对不同的中断请求进行处理。读数据操作模块内部对不同功能进行了分割实现,一共七个子模块。写数据操作模块完成ARM的数据信息传送给FPGA。写数据操作模块包括三子个模块。总线通过读数据操作模块和写数据操作模块的协力合作完好的完成了ARM与FPGA之间的通信功能。整个总线工作可靠稳定,在设计中充分的考虑了重用性和可扩展性。

关键词： SPI总线 FPGA 中断读数据操作写数据操作

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一种数据ECC编解码计算电路

一种数据ECC编解码计算电路

引用

作者：葛领驰王勇李林车德亮李娜刘力行高杨杨鄢志成孙竹贤熊开利张奇荣 100076 北京市丰台区东高地四营门北路2号

本发明涉及一种数据ECC编解码计算电路，属于集成电路设计领域。包括控制逻辑模块、ECC编码模块、ECC解码模块。控制逻辑模块处理读数据与写数据操作的数据分配，使读写数据时可以复用模块，提升电路性能。本发明同时对数据与地址进行EC... 详细信息

标准号: CN116798503A

本发明涉及一种数据ECC编解码计算电路，属于集成电路设计领域。包括控制逻辑模块、ECC编码模块、ECC解码模块。控制逻辑模块处理读数据与写数据操作的数据分配，使读写数据时可以复用模块，提升电路性能。本发明同时对数据与地址进行ECC编码算法，编码时地址信息可为存储器数据提供额外的编码信息，具有更高的安全性能、计算效率高、占用资源少，适用于存储器的数据安全设计。该计算电路结构简单、可靠、易于与其它功能部件配合，便于在芯片上实现。

关键词：控制逻辑模块计算电路集成电路设计存储器数据写数据操作存储器安全性能编码信息地址信息读写数据复用模块功能部件计算效率数据安全数据分配提升电路占用资源编解码读数据算法芯片配合

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一种数据的存储方法及设备

一种数据的存储方法及设备

引用

作者：李小杰 518129 广东省深圳市龙岗区坂田华为总部办公楼

本申请实施例公开了一种数据的存储方法及设备，应用于数据存储技术领域，该方法包括：在轮式移动设备(如智能汽车、自动驾驶汽车、网联汽车等)上部署双节点构成的数据存储服务系统，第一节点为主节点，第二节点为备节点，第一节点和第... 详细信息

标准号: CN112513832B

本申请实施例公开了一种数据的存储方法及设备，应用于数据存储技术领域，该方法包括：在轮式移动设备(如智能汽车、自动驾驶汽车、网联汽车等)上部署双节点构成的数据存储服务系统，第一节点为主节点，第二节点为备节点，第一节点和第二节点上分别运行第一进程和第二进程，当第一节点接收到写数据请求时，第一节点先通过第一进程调用第一数据库引擎向第一节点上的第一存储模块写数据，再阻塞式使得第二节点通过第二进程调用第二数据库引擎向第二节点上的第二存储模块进行同样的写数据操作，从而在轮式移动设备上部署两个节点前提下，通过强一致性的数据同步流程实现数据实时备份，保障了数据可靠性，同时降低了轮式移动设备的硬件成本。

关键词：轮式移动数据库引擎存储模块进程调用写数据数据存储服务数据存储技术数据实时备份数据可靠性写数据操作节点接收数据同步硬件成本智能汽车自动驾驶备节点双节点阻塞式汽车部署存储进程申请应用

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FIFO读写控制电路、芯片、电子设备及数据传输方法

FIFO读写控制电路、芯片、电子设备及数据传输方法

引用

作者：刘君 523860 广东省东莞市长安镇乌沙海滨路18号

本申请公开了一种FIFO读写控制电路、芯片、电子设备及数据传输方法。包括：FIFO缓存单元，其设置有多个写数据接口和多个读数据接口，写数据控制单元，其与FIFO缓存单元连接，用于从多个写数据接口中选取至少一个写数据接口作为目标写... 详细信息

标准号: CN111783167A

本申请公开了一种FIFO读写控制电路、芯片、电子设备及数据传输方法。包括：FIFO缓存单元，其设置有多个写数据接口和多个读数据接口，写数据控制单元，其与FIFO缓存单元连接，用于从多个写数据接口中选取至少一个写数据接口作为目标写数据接口，并通过目标写数据接口执行写数据操作，读数据控制单元，其与FIFO缓存单元连接，用于从多个读数据接口中选取至少一个读数据接口作为目标读数据接口，并通过目标读数据接口执行读数据操作。本申请通过设置多个写数据接口和多个读数据接口，并从中选择一定数量的数据接口进行数据读写，从而可以降低FIFO读写控制电路针对数据处理的硬件成本，并提升数据处理速度。

关键词：读数据接口写数据接口读写控制电路目标写数据单元连接数据处理读数据控制单元读数据操作写数据操作电子设备数据传输数据读写数据接口硬件成本写数据申请芯片

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图像数据读写控制的方法及相关装置

图像数据读写控制的方法及相关装置

引用

作者：白颂荣张海越陈锋 518000 广东省深圳市南山区西丽深圳国际创新谷三期7栋D座2层

本申请实施例中提供了一种应用于芯片的图像数据读写控制方法及相关装置，芯片包括数据处理模块VIDC、数据获取模块LCDC、缓存模块FB和缓存控制模块，FB包括第一缓存模块FB1和第二缓存模块FB2；缓存控制模块判断FB1是否执行读数据操作... 详细信息

标准号: CN114189732B

本申请实施例中提供了一种应用于芯片的图像数据读写控制方法及相关装置，芯片包括数据处理模块VIDC、数据获取模块LCDC、缓存模块FB和缓存控制模块，FB包括第一缓存模块FB1和第二缓存模块FB2；缓存控制模块判断FB1是否执行读数据操作；若未执行，则VIDC向FB1写入第一数据，以及在写入完成后，VIDC转入FB2写第二数据；缓存控制模块判断FB1是否执行写数据操作；若未执行，则判断第一数据是否被读取；若未被读取，则LCDC从FB1读取第一数据，以及在第一数据被写入完成后，VIDC转入FB2写第二数据。本申请实施例通过引入双缓存和相应的控制机制确保图像能正常显示，避免了图像撕裂的出现。

关键词：第一数据读取缓存模块缓存控制模块写入芯片缓存转入数据处理模块数据获取模块读数据操作写数据操作读写控制控制机制控制模块图像数据图像撕裂相关装置正常显示申请图像引入应用

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基于分布式存储系统的虚拟磁盘存储方法及装置

基于分布式存储系统的虚拟磁盘存储方法及装置

引用

作者：臧林劼 250000 山东省济南市(山东)自由贸易试验区济南片区浪潮路1036号浪潮科技园S05楼S311室

本发明涉及计算机存储技术领域，提供一种基于分布式存储系统的虚拟磁盘存储方法及装置，该方法包括：写数据操作，写数据操作包括：将写数据请求发送至虚拟磁盘的回写缓存中，回写缓存用于将写数据请求作为日志缓存；并将至少一个写数... 详细信息

标准号: CN117707437B

本发明涉及计算机存储技术领域，提供一种基于分布式存储系统的虚拟磁盘存储方法及装置，该方法包括：写数据操作，写数据操作包括：将写数据请求发送至虚拟磁盘的回写缓存中，回写缓存用于将写数据请求作为日志缓存；并将至少一个写数据请求依次存储在以日志命名的请求对象序列中；将请求对象序列缓存在本地磁盘的物理块存储区域的写缓存中；将写数据请求对应的待写入数据由虚拟磁盘的回写缓存写入至本地磁盘的物理块存储区域的写缓存中；在物理块存储区域的写缓存中的待写入数据达到预定数量时，按请求对象序列中写数据请求的顺序，将写数据请求对应的待写入数据以数据对象的形式写入服务器端的存储器。本发明避免了存储过程中数据丢失的问题。

关键词：写数据缓存待写入数据存储区域请求对象虚拟磁盘物理块写缓存回写写数据操作磁盘分布式存储系统计算机存储技术写入服务器存储过程请求发送日志缓存数据丢失数据对象依次存储存储器日志写入存储

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一种解决STT-RAM缓存写失败的方法

一种解决STT-RAM缓存写失败的方法

引用

作者：章铁飞 310018 浙江省杭州市下沙高教园区学正街18号

本发明提供一种解决STT‑RAM缓存写失败的方法，在纠错码的纠错能力与存储代价之间取得平衡。本发明包括如下步骤:S1、发起写数据操作时，确定将写的目标缓存块后，读出目标缓存块的旧数据按位与新数据按位比较后，计算统计当前数据位对... 详细信息

标准号: CN111580750A

本发明提供一种解决STT‑RAM缓存写失败的方法，在纠错码的纠错能力与存储代价之间取得平衡。本发明包括如下步骤:S1、发起写数据操作时，确定将写的目标缓存块后，读出目标缓存块的旧数据按位与新数据按位比较后，计算统计当前数据位对应的STT‑RAM单元将发生0到1的切换的总数据位数n；S2、比较n与阀值K_th，如果n大于K_th，则采用扩展纠错码进行纠错，如果n小于等于K_th，则采用默认纠错码进行纠错；S3、写缓存块时，设置目标缓存块标签的标志位，标识目标缓存块的纠错码类型；S4、读取缓存块数据时，同时读取缓存块标签的标志位，根据标志位确定所采用的纠错码类型，将缓存块发往对应的纠错码解码器纠错。

关键词：缓存块纠错码标志位纠错读取目标缓存标签纠错码解码器写数据操作标识目标存储代价读出目标纠错能力旧数据写缓存新数据平衡失败统计

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一种存储器可靠性仿真验证方法、装置及存储介质

一种存储器可靠性仿真验证方法、装置及存储介质

引用

作者：吴汉明朱敏 201203 上海市浦东新区自由贸易试验区金科路2966号1幢310室

本发明公开了一种存储器可靠性仿真验证方法、装置及存储介质，方法包括：S100、基于局部工艺偏差参数，通过蒙特卡洛模拟方法获取存储器的各单元的晶体管的阈值电压偏差值；S200、基于全局工艺偏差参数和各单元的晶体管的阈值电压偏差... 详细信息

标准号: CN110895643B

本发明公开了一种存储器可靠性仿真验证方法、装置及存储介质，方法包括：S100、基于局部工艺偏差参数，通过蒙特卡洛模拟方法获取存储器的各单元的晶体管的阈值电压偏差值；S200、基于全局工艺偏差参数和各单元的晶体管的阈值电压偏差值，对存储器在各种工艺角下的读数据操作和写数据操作分别进行模拟，得到模拟结果；S300、当确定模拟结果为存储器在各种工艺角下的读数据操作和写数据操作均为正常状态时，确定存储器具备可靠性。本发明在局部范围采用蒙特卡洛模拟，获得存储器的各单元晶体管的阈值电压偏差值，并在全局范围各种特定工艺角下进行仿真模拟时代入，验证存储器的可靠性，既保证了模拟的精度，又提高了模拟速度。

关键词：存储器阈值电压偏差工艺角读数据操作写数据操作模拟结果晶体管存储器可靠性单元晶体管验证存储器存储介质仿真模拟仿真验证工艺偏差局部工艺偏差参数全局保证

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一种面向嵌入式系统的总线匹配实现方法

一种面向嵌入式系统的总线匹配实现方法

引用

作者：刘钊武南王品何平陈文婧冯金闪 110168 辽宁省沈阳市东陵区南屏东路16-2号

本发明涉及嵌入式领域，具体地说是一种面向嵌入式系统的总线匹配实现方法，包括以下步骤：1)分别匹配主站芯片和从站芯片的数据线和地址线：2)计算特殊匹配的地址线或数据线的数据：3)在通信总线进行读和写数据操作时，根据设定的时序... 详细信息

标准号: CN114595181B

本发明涉及嵌入式领域，具体地说是一种面向嵌入式系统的总线匹配实现方法，包括以下步骤：1)分别匹配主站芯片和从站芯片的数据线和地址线：2)计算特殊匹配的地址线或数据线的数据：3)在通信总线进行读和写数据操作时，根据设定的时序操作地址总线和数据总线，实现总线匹配。本发明实现了不同总线位数芯片之间的通信，并减少了开发成本和开发时间。

关键词：匹配总线芯片地址线数据线嵌入式领域嵌入式系统写数据操作时序操作地址数据总线通信总线总线位数从站主站开发通信

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一种面向逻辑设备的驱动设计方法和系统

一种面向逻辑设备的驱动设计方法和系统

引用

作者：付琦芮彭志航隋平礼刘岳宁王辰曦刘娇建刘亮 100086 北京市海淀区知春路63号51楼6层602

本发明公开了一种面向逻辑设备的驱动设计方法和系统，其中，该方法包括配置逻辑设备驱动，所述逻辑设备驱动通过在文件系统中创建设备文件的方式向应用层提供操作接口；逻辑设备驱动再根据应用读/写数据操作底层硬件外设，可以解决相... 详细信息

标准号: CN117331540A

本发明公开了一种面向逻辑设备的驱动设计方法和系统，其中，该方法包括配置逻辑设备驱动，所述逻辑设备驱动通过在文件系统中创建设备文件的方式向应用层提供操作接口；逻辑设备驱动再根据应用读/写数据操作底层硬件外设，可以解决相关技术中，嵌入式领域ADC数据采集时，多外设之间协同工作操作复杂，代码与硬件平台耦合度较高，可移植性差的技术问题。

关键词：逻辑设备驱动外设嵌入式领域写数据操作操作接口创建设备底层硬件可移植性配置逻辑设备驱动文件系统硬件平台应用层耦合度采集协同应用

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