检索结果-内蒙古大学图书馆

作者：胡勇华谢安星程奥博汤卓悠 411201 湖南省湘潭市雨湖区湖南科技大学

本发明公开一种面向超长指令字加单指令多数据流架构的软件流水自动生成方法，该方法包括：指令信息分析；软件流水指令调度分析；功能单元冲突分析；软件流水代码生成。本发明能为支持超长指令字架构的处理器自动生成软件流水调度指令... 详细信息

标准号: CN118132148A

本发明公开一种面向超长指令字加单指令多数据流架构的软件流水自动生成方法，该方法包括：指令信息分析；软件流水指令调度分析；功能单元冲突分析；软件流水代码生成。本发明能为支持超长指令字架构的处理器自动生成软件流水调度指令，通过并行执行来自不同循环体的指令来加快循环程序的执行速度，能给改善指令并行度提供更多的优化机会等特点。

关键词：软件流水超长指令字指令架构单指令多数据流自动生成软件并行执行冲突分析代码生成功能单元流水调度循环程序指令调度指令信息自动生成并行度循环体处理器分析优化

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基于单指令多数据流的数据运算方法、装置、介质和设备

基于单指令多数据流的数据运算方法、装置、介质和设备

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作者：陈亮 100080 北京市海淀区中关村大街1号3层318

公开了一种基于单指令多数据流的数据运算方法、装置、介质和设备。其中的方法包括：根据参与同一类型运算的至少一组待运算数据，生成运算数组，其中一组待运算数据包括：参与所述同一类型运算中的同一运算的待运算数据，运算数组包括... 详细信息

标准号: CN112148371B

公开了一种基于单指令多数据流的数据运算方法、装置、介质和设备。其中的方法包括：根据参与同一类型运算的至少一组待运算数据，生成运算数组，其中一组待运算数据包括：参与所述同一类型运算中的同一运算的待运算数据，运算数组包括：至少一个用于表示待运算数据的符号位和尾数的第一定点数、以及至少一个用于表示待运算数据的指数的第二定点数；调用与同一类型运算涉及到的针对尾数和指数的运算对应的SIMD接口函数，根据运算数组中的元素确定SIMD接口函数的输入参数；根据SIMD接口函数基于输入参数的运算结果，生成至少一组待运算数据分别对应的运算结果。本公开有利于提高基于SIMD的接口函数的适用范围以及非定点数运算的效率。

关键词：运算待运算数据接口函数数组尾数输入参数运算结果定点数单指令多数据流数据运算符号位点数调用

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一种基于单指令多数据流的软件实现QC-LDPC译码方法

一种基于单指令多数据流的软件实现QC-LDPC译码方法

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作者：王闻今徐益徐振吴体昊石丁李灵瑄高西奇 211189 江苏省南京市江宁区东南大学路2号

本发明提出了一种基于单指令多数据流的软件实现QC‑LDPC译码方法。一方面，通过水平分层的译码方法和块内并行策略使QC‑LDPC译码过程可以在x86通用处理器上并行实现。另一方面，该译码方法采用SIMD指令集，译码器的并行度获得了大幅地... 详细信息

标准号: CN110380735B

本发明提出了一种基于单指令多数据流的软件实现QC‑LDPC译码方法。一方面，通过水平分层的译码方法和块内并行策略使QC‑LDPC译码过程可以在x86通用处理器上并行实现。另一方面，该译码方法采用SIMD指令集，译码器的并行度获得了大幅地提高，并在根据指令集在掩码处理方面的新特性对内存读写过程和预处理过程进行优化。本发明解决了QC‑LDPC译码器在x86平台上处理时延高及吞吐量不足的问题，在保证低时延的前提下，有效地提高了QC‑LDPC译码的吞吐量。

关键词：译码吞吐量译码器单指令多数据流通用处理器预处理过程并行策略并行实现处理时延软件实现水平分层掩码处理并行度低时延有效地指令集读写优化保证

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集成单指令多数据流架构人工智能模块的系统芯片

集成单指令多数据流架构人工智能模块的系统芯片

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作者：连荣椿王海力马明 100080 北京市海淀区知春路63号卫星大厦9层901-903

一种集成FPGA和单指令多数据流架构的人工智能模块的FPGA系统芯片。系统芯片包括：至少一个FPGA模块；至少一个人工智能AI模块，采用单指令多数据流SIMD的架构；接口模块，用于将至少一个FPGA模块和至少一个AI模块连通，以便至少一个FPG... 详细信息

标准号: CN109933369B

一种集成FPGA和单指令多数据流架构的人工智能模块的FPGA系统芯片。系统芯片包括：至少一个FPGA模块；至少一个人工智能AI模块，采用单指令多数据流SIMD的架构；接口模块，用于将至少一个FPGA模块和至少一个AI模块连通，以便至少一个FPGA模块向至少一个AI模块发送指令并且相互交换数据；其中，FPGA模块则为AI模块提供单指令多数据流所用的指令和AI模块所需的数据；AI模块对所述数据执行和指令有关的运算。在芯片上同时集成FPGA模块和具有SIMD架构的AI模块的系统芯片可以用同一个框架胜任不同的应用需求。

关键词：单指令多数据流人工智能架构系统芯片芯片指令发送指令交换数据接口模块数据执行应用需求连通运算

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基于单指令多数据流的数据运算方法、装置、介质和设备

基于单指令多数据流的数据运算方法、装置、介质和设备

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作者：陈亮 100080 北京市海淀区中关村大街1号3层318

标准号: CN112148371A

关键词：运算待运算数据接口函数数组尾数输入参数运算结果定点数单指令多数据流数据运算符号位点数调用

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集成单指令多数据流架构人工智能模块的系统芯片

集成单指令多数据流架构人工智能模块的系统芯片

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作者：连荣椿王海力马明 100080 北京市海淀区知春路63号卫星大厦9层901-903

标准号: CN109933369A

关键词：单指令多数据流人工智能架构系统芯片芯片指令发送指令交换数据接口模块数据执行应用需求连通运算

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一种基于单指令多数据流的软件实现QC-LDPC译码方法

一种基于单指令多数据流的软件实现QC-LDPC译码方法

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作者：王闻今徐益徐振吴体昊石丁李灵瑄高西奇 211189 江苏省南京市江宁区东南大学路2号

标准号: CN110380735A

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面向申威众核处理器的规则处理优化技术

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计算机研究与发展 2024年第1期61卷 66-85页

作者：张振东王彤刘鹏浙江大学信息与电子工程学院杭州310027 之江实验室智能超算研究中心杭州311100 数学工程与先进计算国家重点实验室江苏无锡214125

高性能口令恢复系统是申威众核处理器的重要应用场景之一,规则处理是主流口令恢复工具中被广泛应用的一种口令生成方式.现有相关研究工作缺少对规则处理算法的优化,导致申威处理器上基于规则的口令生成速度成为口令恢复系统的性能瓶颈.... 详细信息

高性能口令恢复系统是申威众核处理器的重要应用场景之一,规则处理是主流口令恢复工具中被广泛应用的一种口令生成方式.现有相关研究工作缺少对规则处理算法的优化,导致申威处理器上基于规则的口令生成速度成为口令恢复系统的性能瓶颈.通过分析规则处理算法的多层次可并行性,提出了面向申威众核处理器的线程级、数据级优化方案.在线程级优化方案中,探索了规则处理算法的最优任务映射方式,设计了主从核任务分配机制、从核缓冲区配比优化机制、负载均衡机制、变长规则存储机制等技术以提高并行效率;在数据级优化方案中,分析了规则处理算法中规则函数的计算模式,并通过申威SIMD指令集对规则函数进行向量优化以提高执行效率.在SW26010处理器上的实验结果表明,上述优化方案有效解除了规则处理的性能瓶颈,使规则模式下的口令恢复速度提升了30~101倍.

关键词：申威众核处理器口令恢复规则处理异构计算单指令多数据流

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基于FT-M7002的复数域行向量矩阵乘法移植与优化

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计算机科学 2023年第S02期50卷 827-832页

作者：莫尚丰周振芬胡勇华徐敏敏毛春献袁钰迪湖南科技大学计算机科学与工程学院湖南湘潭411201 服务计算与软件服务新技术湖南省重点实验室湖南湘潭411201

FT-M7002是我国自主研发的高性能DSP,具有强大的向量处理能力。为有效地发挥它的性能优势,亟待优化移植面向FT-M7002的高效VSIP函数库。复数域行向量矩阵乘法是VSIP库中频繁使用的算法,在数字通信、图像处理等应用领域中大量使用。文中... 详细信息

FT-M7002是我国自主研发的高性能DSP,具有强大的向量处理能力。为有效地发挥它的性能优势,亟待优化移植面向FT-M7002的高效VSIP函数库。复数域行向量矩阵乘法是VSIP库中频繁使用的算法,在数字通信、图像处理等应用领域中大量使用。文中在FT-M7002 DSP上研究优化复数域行向量矩阵乘法算法,通过改变计算矩阵列向量为计算矩阵行向量、向量化、循环展开和软件流水等手段提升算法性能。测试结果表明:优化后的向量C算法相比VSIP库函数获得了6.2~20.6的加速比,汇编优化算法相比向量C算法获得了3.4~14.3的加速比,加速效果明显。

关键词：矩阵乘法数字信号处理器单指令多数据流 VSIPL

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面向国产高性能众核处理器的编程模型

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计算机应用 2023年第11期43卷 3517-3526页

作者：陈虎周鹏灵华南理工大学软件学院广州510006 广东省高性能计算重点实验室广州510033

在国产高性能众核处理器上编程时,需要直接使用最底层的接口开发软件,这使编程和调试非常困难;并且各自平台的高性能软件编程模型较为基础,计算软件不能通用,造成了重复性开发。针对以上问题,实现了通用编程模型以及所对应的支撑库:一... 详细信息

在国产高性能众核处理器上编程时,需要直接使用最底层的接口开发软件,这使编程和调试非常困难;并且各自平台的高性能软件编程模型较为基础,计算软件不能通用,造成了重复性开发。针对以上问题,实现了通用编程模型以及所对应的支撑库:一方面基于消息队列机制开发国产高性能众核处理器的线程级并行机制;另一方面基于单指令多数据流(SIMD)编程模型开发从核上的数据级并行性。首先,对国产高性能众核处理器体系结构进行抽象;其次,设计模型的消息队列机制,并为程序员提供一套异构并行编程接口,如系统参数接口、从核线程控制接口、消息队列接口、SIMD抽象接口;最后,在上述基础上形成全新的高性能计算软件开发模型和方法,方便用户开发基于国产高性能众核处理器的并行计算软件。性能传输测试结果表明,在国产众核处理器上,当启动核数较少时,所提模型的传输带宽普遍达到了峰值直接内存访问(DMA)带宽的90%;当启动的核数较多时,消息队列模型的传输带宽普遍达到了峰值DMA带宽的70%。在矩阵乘法实验中,与系统原语传输矩阵并计算的性能相比,所提模型的性能达到前者的90%;在口令猜测系统中,所提模型的代码性能与直接使用最底层的接口开发的代码性能基本持平。所提通用编程模型和支撑框架使高性能计算(HPC)软件开发更简易,并且具有更好的可移植性,可为促进国产自主HPC软件研发提供帮助。

关键词：国产众核处理器单指令多数据流并行编程模型 SW26010 消息队列模型

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