检索结果-内蒙古大学图书馆

循环倾斜是程序优化中一种循环变换的手段,它改变空间迭代形式,将循环存在的跨迭代的并行用传统的并行标识出来,使得循环可以并行执行。但是循环倾斜后,并行执行的数据在内存中是离散的,而且每次迭代执行的次数是不一致的。为了更有效地利用SIMD,本文提出一种基于全局数据重组的循环倾斜优化方法。首先分析循环倾斜优化,针对数据离散的问题实现全局数据重组,改善数据局部性,循环易于向量化操作;针对迭代执行次数不一致问题,实现非满载向量操作,使尾循环得以向量执行。最后选择wavefront程序进行测试,优化后,程序计算可以获得平均10.73倍的加速效果。

关键词：单指令多数据流循环倾斜数据重组非满载向量化

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K8挑战Itanium——64位CPU谁主沉浮

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电脑技术——Hello-IT 2002年第11期 28-32页

Intel与AMD在32位处理器市场的争夺已经日趋白热化,这点无论是在高端市场或是低端市场都已经表现得淋漓尽致。然而,为了占据新的制高点,并从根本上超越对手,这两位略显疲态的巨人都不约而同地将战火延续到64位处理器市场。在这全新的舞... 详细信息

Intel与AMD在32位处理器市场的争夺已经日趋白热化,这点无论是在高端市场或是低端市场都已经表现得淋漓尽致。然而,为了占据新的制高点,并从根本上超越对手,这两位略显疲态的巨人都不约而同地将战火延续到64位处理器市场。在这全新的舞台,Intel与AMD将展开一场新世纪之战。对此,整个业界都予以充分的关注……

关键词： K8 Itanium 64位CPU 微处理器单指令多数据流指令系统

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32位SIMD结构IALU部件的设计与验证

32位SIMD结构IALU部件的设计与验证

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第十八届全国半导体集成电路、硅材料学术会议

作者：杨秀杰雷元武彭元喜陈书明国防科技大学计算机学院长沙 410073

在数字信号处理器(Digital Signal Processor,DSP)中,定点数据之间的运算是最常用的基本操作.本文设计了一款基于SIMD(Single Instruction Multiple Data)结构的32位定点算术逻辑单元(Integer Arithmetic Logic Unit,IALU),主要实现32位和2×16位带饱和处理的加减运算、比较操作、逻辑操作以及求绝对值、求前导零、数据搬移等定点数据之间的运算.在加法器的设计上,本文采用了进位选择和Kogge-Stone树相结合的方法,在具体实现上,采用加减法共用一套异或逻辑等结构来实现.比较操作采用了两个16位的自主设计的专用比较器来完成.最后使用Cadence公司的NC-Verilog对该IALU进行了全面的验证.采用45nm CMOS工艺库,在Synopsys公司的Design Compiler (DC)下进行了综合,结果表明设计频率达到1.5GHZ.

关键词：定点算术逻辑部件模块设计加法器比较器单指令多数据流

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基于SIMD部件的四倍精度浮点乘加器设计

基于SIMD部件的四倍精度浮点乘加器设计

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第四届全国智能信息处理学术会议

作者：何军黄永勤朱英上海高性能集成电路设计中心上海 201204

如何减少四倍精度浮点运算的硬件开销和延迟是需要解决的重要问题.为减少四倍精度乘加器的硬件开销,基于支持64位×4的双精度浮点SIMD FMA部件,设计并实现了一种新的四倍精度浮点乘加器(QPFMA),来支持4种浮点乘加运算和乘法、加减... 详细信息

如何减少四倍精度浮点运算的硬件开销和延迟是需要解决的重要问题.为减少四倍精度乘加器的硬件开销,基于支持64位×4的双精度浮点SIMD FMA部件,设计并实现了一种新的四倍精度浮点乘加器(QPFMA),来支持4种浮点乘加运算和乘法、加减法、比较运算,运算延迟为7拍.通过将四倍精度113位×113位尾数乘法器分解为4个57位×57位乘法器来共享双精度浮点SIMD FMA部件的53位×53位乘法器,显著减少了实现QPFMA的硬件开销.基于65nm工艺的逻辑综合结果表明,该QPFMA频率可达1.1GHz,面积是常规QPFMA设计的42.71％,仅与一个双精度浮点乘加器相当.与现有的QPFMA设计相比,相当工艺和频率下,其运算延迟减少了3拍,门数减少了65.96％.

关键词：乘加器四倍精度浮点运算单指令多数据流优化设计

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基于定点与浮点复用的SIMD乘法器设计与实现

基于定点与浮点复用的SIMD乘法器设计与实现

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第十八届全国半导体集成电路、硅材料学术会议

作者：韩珊珊彭元喜雷元武林宗华邹晓峰国防科技大学计算机学院湖南长沙 410073

本文基于XDSP设计实现了一种定点浮点乘法复用的64位SIMD乘法器.该乘法器由四个32×32乘法器组成,可以实现双32位SIMD定点、64位定点乘法和单/双精度浮点尾数乘法.通过对设计的乘法器进行模块级、系统级和形式化等验证表明,设计的... 详细信息

本文基于XDSP设计实现了一种定点浮点乘法复用的64位SIMD乘法器.该乘法器由四个32×32乘法器组成,可以实现双32位SIMD定点、64位定点乘法和单/双精度浮点尾数乘法.通过对设计的乘法器进行模块级、系统级和形式化等验证表明,设计的乘法器功能正确,在40nm工艺下对乘法器进行综合,结果表明定点浮点复用乘法器后,乘法器总面积减少了49.3％,时序满足1.5GHz的要求.

关键词：乘法器结构设计单指令多数据流定点计算浮点计算

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SW-VML:基于神威蓝光处理器的向量数学软件包

SW-VML:基于神威蓝光处理器的向量数学软件包

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2013全国高性能计算学术年会

作者：解庆春张云泉鲁永泉李焱杨飞王靖中国传媒大学高性能计算中心北京100024 中国科学院软件研究所并行软件与计算科学实验室北京100190 中国传媒大学高性能计算中心北京100024 中国科学院计算技术研究所计算机体系结构国家重点实验室北京100190 中国传媒大学高性能计算中心北京100024 中国科学院软件研究所并行软件与计算科学实验室北京100190

首先,本文介绍了SIMD扩展技术,并分析了使用SIMD扩展的三种方式,认为通过调用特定目标平台优化的第三方库是应用领域软件开发者快速开发高效并行程序的较好的方式:其次,介绍了国产神威处理器SW-1600平台,并利用SIMD扩展和循环展开等技... 详细信息

首先,本文介绍了SIMD扩展技术,并分析了使用SIMD扩展的三种方式,认为通过调用特定目标平台优化的第三方库是应用领域软件开发者快速开发高效并行程序的较好的方式:其次,介绍了国产神威处理器SW-1600平台,并利用SIMD扩展和循环展开等技术开发了SW-VML(SW Vector Math Library),开发过程中提出了访存对界、简化向量条件分支的优化方法,解决了非对界访存、向量与标量数组转换影响性能的问题,并根据SW编译器对0penMP的支持,开发了多线程0penMp版.最后,在SW-1600平台上采用不同向量规模对SW-VML进行了测试,测试结果显示SIMD向量化相对于串行程序加速比为2.08,4线程相对单线程平均加速比为2,***-VML是国产神威系列处理器上开发的常用向量函数软件包,SW-VML可以用作在神威蓝光高性能计算平台开发高性能程序的基础软件工具包.

关键词：向量数学软件包神威蓝光处理器单指令多数据流性能测试

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