检索结果-内蒙古大学图书馆

电子技术应用 2018年第2期44卷 6-9页

作者：赵旸梁步阁杨德贵赵党军中南大学航空航天学院湖南长沙410083

针对当前SOC内部时钟越来越复杂、接口越来越多以及亚稳态、漏信号等常见的各种问题,分析了以往的优化方法的优缺点,然后从电路的角度出发,提出了一种新的SOC跨时钟域同步电路设计的方法。这种方法电路简单,可靠性高,通过仿真实验和实... 详细信息

针对当前SOC内部时钟越来越复杂、接口越来越多以及亚稳态、漏信号等常见的各种问题,分析了以往的优化方法的优缺点,然后从电路的角度出发,提出了一种新的SOC跨时钟域同步电路设计的方法。这种方法电路简单,可靠性高,通过仿真实验和实测实验验证,能够在多时钟系统中适应最小输入脉宽、不漏信号、避免误触发和多触发,且很好地解决了亚稳态等问题。

关键词：多时钟系统跨时钟域同步电路信号

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异步多时钟系统的同步设计技术

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电子工程师 2005年第5期31卷 33-37页

作者：谢修祥王广生北京工业大学电子信息与控制工程学院北京市100022

对多时钟系统的同步问题进行了讨论,提出了亚稳态的概念及其产生机理和危害;叙述了控制信号和数据通路在多时钟域之间的传递;讨论了控制信号的输出次序对同步技术的不同要求;重点论述了常用的数据通路同步技术———用FIFO实现同步的原... 详细信息

对多时钟系统的同步问题进行了讨论,提出了亚稳态的概念及其产生机理和危害;叙述了控制信号和数据通路在多时钟域之间的传递;讨论了控制信号的输出次序对同步技术的不同要求;重点论述了常用的数据通路同步技术———用FIFO实现同步的原理及其实现思路。

关键词：多时钟系统亚稳态控制信号同步技术数据同步技术格雷码计数器 FIFO

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多时钟约束的协同无人驾驶系统的建模与验证的实现方法

多时钟约束的协同无人驾驶系统的建模与验证的实现方法

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作者：黄志球王金永谢健王飞 210016 江苏省南京市秦淮区御道街29号

本发明公开了面向多时钟约束的协同无人驾驶系统建模与验证的实现方法，包括：给出协同无人驾驶系统的框架，建立了协同无人驾驶系统的领域建模概要文件SysML Profile，抽取对于协同无人驾驶系统的专业术语，关系及其操作；定义单时钟... 详细信息

标准号: CN112329208B

本发明公开了面向多时钟约束的协同无人驾驶系统建模与验证的实现方法，包括：给出协同无人驾驶系统的框架，建立了协同无人驾驶系统的领域建模概要文件SysML Profile，抽取对于协同无人驾驶系统的专业术语，关系及其操作；定义单时钟与多时钟系统，给出时钟相关的定义和关系语义；根据模型驱动系统开发流程对协同无人驾驶系统进行建模和验证；设计了自动超车的案例，提供了系统的自然语言需求，构建了系统的状态机模型，然后将其转化为相应的CCSL模型，并在时钟约束规约语言的专用仿真平台TimeSquare进行验证。该方法安全有效，且建模与验证同时进行，可推广应用在多时钟约束系统的其他安全攸关建模领域中。

关键词：无人驾驶系统建模协同验证多时钟自然语言规约多时钟系统状态机模型仿真平台概要文件关系语义领域建模模型驱动系统开发约束系统专业术语单时钟超车构建攸关抽取安全语言转化

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多时钟约束的协同无人驾驶系统的建模与验证的实现方法

多时钟约束的协同无人驾驶系统的建模与验证的实现方法

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作者：黄志球王金永谢健王飞 210016 江苏省南京市秦淮区御道街29号

标准号: CN112329208A

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应用于无线传感器网络节点芯片的时钟系统设计

应用于无线传感器网络节点芯片的时钟系统设计

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作者：李高华中科技大学

学位级别：硕士

无线传感器网络是新一代的传感器网络,具有广泛的应用前景,作为无线传感器网络的承载基础,无线传感器网络节点技术至关重要。基于电池供电的传感器网络可能应用在恶劣甚至危险的环境之中,从而导致网络节点的电源更换或再充电等工作通常... 详细信息

无线传感器网络是新一代的传感器网络,具有广泛的应用前景,作为无线传感器网络的承载基础,无线传感器网络节点技术至关重要。基于电池供电的传感器网络可能应用在恶劣甚至危险的环境之中,从而导致网络节点的电源更换或再充电等工作通常无法进行,因此,保障其安全可靠运行的低功耗电源模式和时钟系统非常关键。随着技术发展,系统时钟也由单一的外部时钟输入发展到外接晶体振荡时钟源、内部振荡时钟源。本课题围绕一款无线传感器网络节点芯片内多模式可配置时钟系统的功耗模式设计以及时钟源电路设计展开研究。本文在研究中外文献多时钟系统、晶体振荡器和各种时钟产生电路的基础上,设计了一个模式可调的多时钟系统,通过在不同模式下控制芯片内各个模块的开关以达到省功耗的目的;设计了一个32 MHz的皮尔斯晶体振荡电路,为系统提供全速模式工作下的高精度时钟信号;设计了一个带振幅检测功能的32.768 KHz的晶体振荡电路,为系统提供低功耗慢速时钟信号;设计了高速16 MHz片内RC振荡器,使振荡器快速启动;设计了低速32.768 KHz片内RC振荡器,利用LDO加入70 nA的电流源做参考确保频率稳定。本设计基于华虹NEC的0.25μm CMOS工艺。对电路仿真分析表明,本文设计的多时钟系统符合设计要求,通过动态时钟管理较好的达成了省功耗之目的。现已应用于一块无线传感器节点芯片,并已流片。

关键词：多时钟系统功耗模式晶体振荡器 RC振荡器振幅控制

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四位高速低功耗微控制器芯片的设计研究

四位高速低功耗微控制器芯片的设计研究

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作者：庞科天津大学

学位级别：硕士

在论文中,我们设计了一款高速低功耗的四位微控制器(简称MCU4)。它不仅具有性能高,速度快,功耗低和应用广泛的优点,而且具有丰富的资源,良好的指令集和先进的开发工具,因而其产品的功能更强大,编程难度也降低,产品开发也就更加容易,更... 详细信息

在论文中,我们设计了一款高速低功耗的四位微控制器(简称MCU4)。它不仅具有性能高,速度快,功耗低和应用广泛的优点,而且具有丰富的资源,良好的指令集和先进的开发工具,因而其产品的功能更强大,编程难度也降低,产品开发也就更加容易,更加快捷。该款芯片能完全实现原进口遥控器芯片的功能,起到替代进口芯片的作用。本课题采用自顶向下(top-down)的设计方法,经过划分模块,模块设计,指令系统及执行安排,系统综合,布局布线和后仿真等一系列工作,实现了这款高速低功耗的四位单片机。在设计中,我们借鉴了PIC、MCS-51、KS等系列单片机的优点,其指令系统与PIC16C5X系列相似,并采用了RISC技术等技术,使系统具有高速低功耗的特点。该芯片采用四套时钟,有三种工作状态(正常状态、睡眠、停止),其时钟周期为机器周期的2倍。它的ROM为4K×8,RAM为512×4,还设计了强大的外围接口功能,例如:具有电平触发的中断系统可方便地用于键盘扫描,完整的液晶扫描控制电路可以几乎不需要什么附加电路就能完成液晶显示。此外,借鉴于三星的KS系列,我们引入了参考指令(REF),即当程序中有较多的重复指令时,可以将它们放在ROM中的一个特定区域,由一字节的参考指令进行读取,如此可以有效地节约ROM空间,相对地增加了程序的长度。MCU4有104条指令,其中有48条与参考指令相关。在本文中,首先介绍了MCU4的系统设计思想,之后简单地对单片机的各个模块的结构和设计进行了说明,其中着重说明了作者承担的工作:数据处理系统、定时/计数系统和LCD驱动电路的设计,以及系统综合和布局布线。目前,该款四位微控制器已经完成了其核心部分的设计与实现。从仿真验证的结果来看,所设计的芯片实现了预期的功能,达到了设计的要求。

关键词：微控制器高速低功耗设计多时钟系统哈佛结构流水线结构综合布局布线

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实时时钟RTC的IP研究

实时时钟RTC的IP研究

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作者：贾维西安电子科技大学

学位级别：硕士

随着集成电路向着深亚微米的制造、设计技术的发展,集成电路已经步入高速发展的SOC时代。顺应信息产业的发展和市场需求,人们对芯片系统的性能提出了更高的要求,片上系统的规模越来越大。此时的设计问题已不再是单个芯片是否有能力容纳... 详细信息

随着集成电路向着深亚微米的制造、设计技术的发展,集成电路已经步入高速发展的SOC时代。顺应信息产业的发展和市场需求,人们对芯片系统的性能提出了更高的要求,片上系统的规模越来越大。此时的设计问题已不再是单个芯片是否有能力容纳系统设计,而是设计如何跟上芯片设计复杂性的增长步伐,以及如何满足激烈的市场竞争对产品上市时间越来越苛刻的要求。在片上系统设计变得异常复杂的今天,基于芯核的设计已经成为EDA发展的必然趋势。开发具有自主知识产权的IP核则更具有广泛的应用前景。本文在智能监控SOC系统芯片平台下,对该SOC中的一个子IP模块实时时钟的IP核设计进行了深入研究。在介绍IP核的特点及可复用型IP核的设计方法及设计中的关键技术的基础上,对RTC模块进行了可复用IP软核的设计。将整个实时时钟系统划分为多个功能模块,介绍了各个子模块各自要实现的功能和部分模块的算法。通过对SOC设计中低功耗设计方法和可综合代码编写规则的研究,采用IP核重用技术和当前流行的VerilogHDL硬件描述语言设计,使用高层综合的方法对各个模块进行设计描述,利用EDA工具对系统进行了仿真综合,完成了RTC模块的软IP核的设计。本文研究的重点是基于该RTC IP软核设计的基础,结合设计中出现的相关问题,对RTC模块设计中的关键技术方法即多时钟域设计技术的研究。详细介绍了数字电路设计中的各种时钟和多时钟系统中常常碰到的亚稳态问题及解决方案。考虑到系统的稳定性和避免多时钟域中亚稳态现象的产生,重点研究了异步控制信号和数据通路的同步技术,给出了多种同步的电路设计方法和RTL实现方法,对不同时钟域信号做了分类描述并比较了各自特点,归纳总结了SOC设计中的时钟设计策略。这成为本文的创新点。

关键词： IP核设计 VerilogHDL代码多时钟系统信号同步低功耗

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实时时钟RTC的IP设计

实时时钟RTC的IP设计

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作者：马玉韬上海交通大学

学位级别：硕士

本文的主要工作。本文首先对当前IC设计行业中IP复用的状况做了介绍，对实时时钟RTC模块的分类、功能和应用做了说明，介绍了本论文设计研究工作的背景。然后对IP的分类、特点和设计开发流程及IP设计的关键技术做了归纳，对数字集成电... 详细信息

本文的主要工作。本文首先对当前IC设计行业中IP复用的状况做了介绍，对实时时钟RTC模块的分类、功能和应用做了说明，介绍了本论文设计研究工作的背景。然后对IP的分类、特点和设计开发流程及IP设计的关键技术做了归纳，对数字集成电路的设计基本规则做了总结。接着对RTC模块设计中的关键技术方法，即多时钟域设计和对异步信号的同步技术和方法做了较为深入的研究和探索。对CMOS电路的功耗组成和SOC中的低功耗设计方法进行了较全面的概述。在利用SYNOPSYS公司的综合工具Design Compiler对RTC模块IP的代码进行了综合，并对可综合的Verilog代码风格进行了研究总结后，完成了RTC模块的软IP设计。本文还研究了进一步增加I2C接口以提高IP的通用性的可能性，并给出了整体设计方案。\n 本文的创新点是：结合实时时钟RTC模块的IP设计，深入地研究了多时钟系统的设计和对异步信号的同步化设计方法。对不同时钟域信号的握手做了分类描述，并比较了各自的特点。

关键词：多时钟系统集成电路 IP设计代码风格

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高速异步FIFO的实现

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西华大学学报（自然科学版） 2005年第4期24卷 77-79页

作者：阳小明西华大学电气信息学院四川成都610039

采用一种新颖的异步FIFO设计方案,解决FPGA多时钟系统中不同时钟域传输数据的问题。该FIFO实现方案比传统方式简单,工作速度频率高,如设计采用了VerilogHDL硬件语言描述还具有良好的移植性。

关键词： FIFO 异步电路多时钟系统亚稳态

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四位低功耗嵌入式微控制器的设计与实现

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电子器件 2004年第1期27卷 91-93页

作者：庞科张生才李树荣胡泽军金鹏天津大学专用集成电路设计中心天津300072

介绍了一个低功耗嵌入式微控制器的电路结构及其VLSI的实现,该芯片利用EDA辅助设计实现了多时钟系统、哈佛结构、两级流水线结构以及内置液晶驱动电路,其指令集采用了类似通用八位机PIC16C5X的精简指令集。通过采用各种有效的措施,在0.5... 详细信息

介绍了一个低功耗嵌入式微控制器的电路结构及其VLSI的实现,该芯片利用EDA辅助设计实现了多时钟系统、哈佛结构、两级流水线结构以及内置液晶驱动电路,其指令集采用了类似通用八位机PIC16C5X的精简指令集。通过采用各种有效的措施,在0.5μm的CMOS工艺条件下,其功耗大大降低。

关键词：微控制器低功耗设计多时钟系统哈佛结构流水线结构

来源：评论

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