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T=题名（书名、题名），A=作者（责任者），K=主题词，P=出版物名称，PU=出版社名称，O=机构（作者单位、学位授予单位、专利申请人），L=中图分类号，C=学科分类号，U=全部字段，Y=年（出版发行年、学位年度、标准发布年）

检索规则说明：

AND代表“并且”；OR代表“或者”；NOT代表“不包含”；(注意必须大写,运算符两边需空一格)

检索范例：

范例一：(K=图书馆学 OR K=情报学) AND A=范并思 AND Y=1982-2016
范例二：P=计算机应用与软件 AND (U=C++ OR U=Basic) NOT K=Visual AND Y=2011-2016

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文献类型

8 篇 专利
2 篇 期刊文献

馆藏范围

10 篇 电子文献
0 种 纸本馆藏

日期分布

学科分类号

2 篇 经济学
- 2 篇 应用经济学

主题

2 篇 存储器界面
2 篇 denali公司
2 篇 verisilicon公司
1 篇 解决方案
1 篇 gdsⅱ核

机构

3 篇 联发科技股份有限...
1 篇 威盛电子股份有限...
1 篇 开曼群岛威睿电通...
1 篇 晨星半导体股份有...
1 篇 株式会社东芝
1 篇 上海捷硕微电子有...

作者

2 篇 陈尚斌
2 篇 谢博伟
1 篇 助川博
1 篇 黄怡智
1 篇 李运清
1 篇 王挺光
1 篇 叶丁坤
1 篇 穆罕默德·艾佛沙
1 篇 田中智晴
1 篇 简元德
1 篇 李明宪
1 篇 王岐
1 篇 彭俊方
1 篇 阿朗·沙多

语言

10 篇 中文

检索条件"主题词=存储器界面"

共 10 条记录，以下是1-10 订阅

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详细简洁

排序：

执行电子装置中存储器界面校准的方法、相关装置以及相关存储器控制器

执行电子装置中存储器界面校准的方法、相关装置以及相关存储器控...

引用

作者：陈尚斌谢博伟中国台湾新竹科学工业园区新竹市笃行一路一号

本发明提供执行电子装置中存储器界面校准的方法以及相关装置。执行电子装置中存储器界面校准的方法应用于电子装置的存储器控制器中，包含有：控制该储器控制器的数字端上的信号以在多个电平之间切换，其中数字端耦接于电子装置的存储... 详细信息

标准号: CN104715786A

本发明提供执行电子装置中存储器界面校准的方法以及相关装置。执行电子装置中存储器界面校准的方法应用于电子装置的存储器控制器中，包含有：控制该储器控制器的数字端上的信号以在多个电平之间切换，其中数字端耦接于电子装置的存储器；以及检测该信号，将该信号的逻辑状态校准为与多个电平中的一个电平对应。上述执行电子装置中存储器界面校准的方法以及相关装置能够提高电子装置内部组件的灵活性，并且保证电子装置的性能。

关键词：电子装置校准存储器界面相关装置存储器控制器逻辑状态内部组件存储器控制器储器端耦检测

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执行电子装置中存储器界面校准的方法、相关装置以及相关存储器控制器

执行电子装置中存储器界面校准的方法、相关装置以及相关存储器控...

引用

作者：陈尚斌谢博伟中国台湾新竹科学工业园区新竹市笃行一路一号

标准号: CN104715786B

关键词：电子装置校准存储器界面于电子装置相关装置存储器控制器储器控制器存储器逻辑状态内部组件耦接检测保证

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Verisilicon和Denali合作提供存储器界面解决方案

引用

集成电路应用 2004年第6期21卷 71-71页

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Verisilicon和Denali合作提供存储器界面解决方案

引用

中国集成电路 2004年第6期13卷 5-5页

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丢弃错误的逻辑传输单元的方法与装置

丢弃错误的逻辑传输单元的方法与装置

引用

作者：阿朗·沙多穆罕默德·艾佛沙英属西印度群岛开曼群岛

本发明为一种丢弃错误的逻辑传输单元的方法与装置，包含一逻辑电路、一比较电路、一控制电路以及一存储器界面的装置，该逻辑电路针对一具有一连串逻辑传输单元(LTUs)的一数据信号及一第一控制信号产生一检查信号。比较电路针对检查信... 详细信息

标准号: CN1326345C

本发明为一种丢弃错误的逻辑传输单元的方法与装置，包含一逻辑电路、一比较电路、一控制电路以及一存储器界面的装置，该逻辑电路针对一具有一连串逻辑传输单元(LTUs)的一数据信号及一第一控制信号产生一检查信号。比较电路针对检查信号与数据信号产生一比较信号。控制电路针对一数据有效信号与比较信号产生一第一控制信号以及指示每一逻辑传输单元是有效或是无效状态的一第二控制信号。存储器界面针对第二控制信号产生一输出数据信号，且其通常只储存具有一有效状态的逻辑传输单元。

关键词：逻辑传输单元控制信号电路比较信号控制电路数据信号存储器界面输出数据无效状态有效信号有效状态存储器丢弃检查储存

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命令控制型存储器功能仿真系统

命令控制型存储器功能仿真系统

引用

作者：王岐 201103 上海市古北新区荣华东道126号

本发明提供了一种程控型/命令控制型存储器功能仿真系统，包含：置于一块PFGA中的USB控制器，模式设置逻辑，侦错逻辑，置于另一块PFGA中的可配置存储器界面/内部存储器阵列，以及一个USB通讯口元件。本发明的程控型/命令控制型存储器... 详细信息

标准号: CN1169048C

本发明提供了一种程控型/命令控制型存储器功能仿真系统，包含：置于一块PFGA中的USB控制器，模式设置逻辑，侦错逻辑，置于另一块PFGA中的可配置存储器界面/内部存储器阵列，以及一个USB通讯口元件。本发明的程控型/命令控制型存储器功能仿真系统用于存储器的功能仿真，解决了目前存储器功能仿真领域中需要根据实际应用修改仿真系统的问题。

关键词：存储器功能仿真系统命令控制型程控内部存储器阵列存储器界面存储器仿真领域功能仿真控制器通讯口侦错

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抑制双倍数据率同步动态随机存取存储器信号的电磁辐射干扰的电路结构

抑制双倍数据率同步动态随机存取存储器信号的电磁辐射干扰的电路...

引用

作者：简元德王挺光中国台湾新竹县竹北市台元街26号4楼之1

本发明提供一种抑制电磁辐射干扰的电路结构，应用于一双倍数据率同步动态随机存取存储器的存储器界面单元，包含：一第一导线，耦接至一参考电位；一第二导线，平行于该第一导线，耦接至该参考电位；一第三导线，介于该第一导线及该第... 详细信息

标准号: CN106158007A

本发明提供一种抑制电磁辐射干扰的电路结构，应用于一双倍数据率同步动态随机存取存储器的存储器界面单元，包含：一第一导线，耦接至一参考电位；一第二导线，平行于该第一导线，耦接至该参考电位；一第三导线，介于该第一导线及该第二导线之间并且平行于该第一导线及该第二导线，用来传输一信号，其中该第一导线、第二导线与第三导线位于同一平面；以及一连接元件，具有两端点，其中一端点电性连接该第一导线，另一端点电性连接该第二导线，该连接元件跨越该第三导线且与该第三导线绝缘。

关键词：参考电位连接元件点电性耦接平行同步动态随机存取存储器电磁辐射干扰存储器界面电路结构双倍数据绝缘传输应用

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非易失性半导体存储装置

非易失性半导体存储装置

引用

作者：田中智晴助川博日本东京都

本发明提供一种可抑制成本增加的非易失性半导体存储封装和可分离存储装置，其中非易失性半导体存储封装包括：具有包含多个非易失性半导体存储单元的存储单元阵列的存储装置；控制上述存储装置的控制部；可与网络连接的网络界面；与上... 详细信息

标准号: CN1555064B

本发明提供一种可抑制成本增加的非易失性半导体存储封装和可分离存储装置，其中非易失性半导体存储封装包括：具有包含多个非易失性半导体存储单元的存储单元阵列的存储装置；控制上述存储装置的控制部；可与网络连接的网络界面；与上述网络界面连接的、独立地管理来自上述网络的数据文件与上述存储单元阵列的地址之间的关系的文件管理部；以及与上述文件管理部连接的、把来自上述文件管理部的信号转换成上述控制部可使用的信号的存储器界面。

关键词：文件管理存储单元阵列存储装置网络界面封装半导体存储半导体存储单元存储器界面分离存储数据文件网络连接信号转换连接网络管理

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多通道存储器系统及相关功率管理方法

多通道存储器系统及相关功率管理方法

引用

作者：李明宪李运清黄怡智彭俊方中国台湾新竹市新竹科学工业园区笃行一路一号

本发明提供一种多通道存储器系统，其具有存储装置、多个通道、及控制电路。所述存储装置具有多个存储器存储空间。所述通道分别耦合到所述存储器存储空间，其中所述通道中的每一个通道均用以充当存储器界面以独立地访问对应的存储器存... 详细信息

标准号: CN105573664A

本发明提供一种多通道存储器系统，其具有存储装置、多个通道、及控制电路。所述存储装置具有多个存储器存储空间。所述通道分别耦合到所述存储器存储空间，其中所述通道中的每一个通道均用以充当存储器界面以独立地访问对应的存储器存储空间。所述控制电路分别控制所述通道上的时钟的时钟频率。在同一时刻，所述通道包括至少第一通道及第二通道，在同一时刻，所述第一通道以由所述控制电路设定的第一时钟频率工作，所述第二通道则以由所述控制电路设定的第二时钟频率工作，且所述第二时钟频率不同于所述第一时钟频率。

关键词：时钟频率控制电路存储器存储存储装置第二通道第一通道同一时刻设定多通道存储器存储器界面多个通道分别控制独立地耦合到一种对应工作访问

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具有共用存储器存取装置的光盘控制芯片与其存储器存取方法

具有共用存储器存取装置的光盘控制芯片与其存储器存取方法

引用

作者：叶丁坤台湾省台北县新店市中正路533号8楼

一种共用存储器存取装置的光盘控制芯片与其存储器存取方法，包含至少一同步动态随机存取存储器，用以暂存处理器工作所需的大量数据，以及高速处理时的缓冲。至少一快闪存储器，用以储存处理器所要执行的程序、固件以及使用者预设值；... 详细信息

标准号: CN1234116C

一种共用存储器存取装置的光盘控制芯片与其存储器存取方法，包含至少一同步动态随机存取存储器，用以暂存处理器工作所需的大量数据，以及高速处理时的缓冲。至少一快闪存储器，用以储存处理器所要执行的程序、固件以及使用者预设值；其中该同步动态随机存取存储器与该快闪存储器的地址与数据脚位分别共用同一总线，且该同步动态随机存取存储器与快闪存储器不会同时被存取；一存储器界面，用以连结该同步动态随机存取存储器与该快闪存储器分别共用的地址与数据总线；其中该存储器界面还包含有一仲裁器，根据存取指令要求的优先顺序决定何者存取要求需先被执行，同时对欲存取的存储器的选择脚位致能，且每次只有一个存储器的选择脚位会被致能。

关键词：随机存取存储器快闪存储器同步动态存取存储器界面存储器存储器存取方法存储器存取装置光盘控制芯片储存处理器存取指令大量数据高速处理数据总线优先顺序总线仲裁器缓冲

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