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文字说明：

T=题名（书名、题名），A=作者（责任者），K=主题词，P=出版物名称，PU=出版社名称，O=机构（作者单位、学位授予单位、专利申请人），L=中图分类号，C=学科分类号，U=全部字段，Y=年（出版发行年、学位年度、标准发布年）

检索规则说明：

AND代表“并且”；OR代表“或者”；NOT代表“不包含”；(注意必须大写,运算符两边需空一格)

检索范例：

范例一：(K=图书馆学 OR K=情报学) AND A=范并思 AND Y=1982-2016
范例二：P=计算机应用与软件 AND (U=C++ OR U=Basic) NOT K=Visual AND Y=2011-2016

分类表

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限定检索结果

文献类型

70 篇 专利

馆藏范围

70 篇 电子文献
0 种 纸本馆藏

日期分布

机构

16 篇 英特尔公司
14 篇 微软技术许可有限...
7 篇 国际商业机器公司
6 篇 arm有限公司
5 篇 arm 有限公司
4 篇 安谋科技有限公司
3 篇 飞思卡尔半导体公...
2 篇 上海贝岭股份有限...
2 篇 森蒂彼得塞米有限...
2 篇 高通股份有限公司
2 篇 北欧半导体公司
2 篇 波士顿科学医学有...
1 篇 圣图尔科技公司
1 篇 英特尔有限公司
1 篇 北京百度网讯科技...
1 篇 格芯公司
1 篇 惠普公司
1 篇 山东浪潮科学研究...
1 篇 nxp股份有限公司
1 篇 超威半导体公司

作者

12 篇 d·c·伯格
12 篇 a·l·史密斯
4 篇 g·l·格思里
4 篇 d·e·威廉斯
3 篇 c·-k·卢
3 篇 t·p·施派尔
3 篇 v·尚伯格
3 篇 g·罗尼
2 篇 西蒙·约翰·克拉斯...
2 篇 d·鲍姆
2 篇 托马斯·克里斯托弗...
2 篇 j·c·梅加
2 篇 b.布拉纳
2 篇 y·金
2 篇 e.阿达
2 篇 乔纳森·弗里德曼
2 篇 s·鲁滨逊
2 篇 r·加伯
2 篇 蒂莫西·哈拉
2 篇 g.格思里

语言

70 篇 中文

检索条件"主题词=存储器访问指令"

共 70 条记录，以下是51-60 订阅

全选清除本页清除全部题录导出标记到"检索档案"

详细简洁

排序：

用于包括屏障指令的指令序列的处理器性能改进

用于包括屏障指令的指令序列的处理器性能改进

引用

作者： D·E·威廉斯 G·L·格思里 W·斯塔克美国纽约阿芒克

一种用于处理指令序列的技术，该指令序列包括屏障指令、在屏障指令之前的加载指令和跟随屏障指令的随后存储器访问指令，该技术包括：由处理器内核基于由处理器内核接收到用于对应于加载指令的读操作的良好组合响应以及用于加载指令的... 详细信息

标准号: CN104106043A

一种用于处理指令序列的技术，该指令序列包括屏障指令、在屏障指令之前的加载指令和跟随屏障指令的随后存储器访问指令，该技术包括：由处理器内核基于由处理器内核接收到用于对应于加载指令的读操作的良好组合响应以及用于加载指令的数据中的最早的一个来确定加载指令被解决。该技术还包括：如果随后存储器访问指令的执行未在屏障指令的完成之前被发起，则由处理器内核响应于确定完成的屏障指令来发起随后存储器访问指令的执行。该技术进一步包括：如果随后存储器访问指令的执行在屏障指令的完成之前被发起，则由处理器内核响应于确定完成的屏障指令来中断关于无效对随后存储器访问指令的追踪。

关键词：指令存储器访问指令屏障处理器内核加载指令序列响应读操作追踪中断

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用于跨距剖析软件应用的方法和设备

用于跨距剖析软件应用的方法和设备

引用

作者： G·罗尼 C·-K·卢美国加利福尼亚州

本发明的名称是“用于跨距剖析软件应用的方法和设备”。公开了一种用于跨距剖析软件应用的方法和设备。示例性的系统使用硬件性能计数器来报告与由某个事件(诸如数据高速缓存器未命中)所触发的存储器访问指令相关联的数据地址和指令地... 详细信息

标准号: CN102681947B

本发明的名称是“用于跨距剖析软件应用的方法和设备”。公开了一种用于跨距剖析软件应用的方法和设备。示例性的系统使用硬件性能计数器来报告与由某个事件(诸如数据高速缓存器未命中)所触发的存储器访问指令相关联的数据地址和指令地址。当相同的指令地址被与一个以上的数据地址相关联时，记录在两个数据地址之间的差异。当对于相同的指令记录了这些数据地址差异中的两个或更多时，该系统确定与所述指令相关联的跨距是所述两个或更多差异的最大公约数。此跨距可以由编译器用来优化数据高速缓存器预取。另外，通过在审查阶段和跳跃阶段之间循环可以降低与监视数据高速缓存器未命中的地址相关联的任何开销。在审查阶段期间比在跳跃阶段期间监视更多的数据高速缓存器未命中。

关键词：数据地址相关联跨距两个数据高速缓存器高速缓存器软件应用审查阶段跳跃阶段指令地址未命中存储器访问指令硬件性能计数器最大公约数剖析监视数据系统确定优化数据指令记录编译器示例性触发相同一种预取开销监视指令记录公开

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基于存储区的数据预取的处理器和方法

基于存储区的数据预取的处理器和方法

引用

作者： J·-W·范德瓦尔德特荷兰艾恩德霍芬

随着微处理器速度的提高，处理器的性能越来越受到数据访问操作的影响。当由于数据取出时间较慢，使得处理器在执行过程中需要等待数据时，这被称为处理器停顿，定量地来说，称之为处理器停顿周期。可以预料，从RAM存储器中实现预取数... 详细信息

标准号: CN100371886C

随着微处理器速度的提高，处理器的性能越来越受到数据访问操作的影响。当由于数据取出时间较慢，使得处理器在执行过程中需要等待数据时，这被称为处理器停顿，定量地来说，称之为处理器停顿周期。可以预料，从RAM存储器中实现预取数据是为了减少处理器停顿周期，在基于处理器的系统中进行预取的目的是减少处理器停顿周期中引起的处理时间拖延。提供一种软件和硬件组合控制的预取方法是非常有利的，因为：通过限制程序流中附加指令的数量，可以不牺牲指令带宽，并可使附加硬件资源的数量最小化。不象以前的技术中那样要利用软件或硬件检测存储器访问的规律性，硬件和软件控制的预取技术在执行时，程序流中没有明显的预取指令，并且占用最少量的附加芯片面积。为使处理器的指令带宽最小化，硬件和软件控制的预取技术使用位于处理器体系层中的附加寄存器，以规定预取区域，和每个区域使用的预取步距。有利的是，对处理器执行指令的指令带宽的影响，仅限于包含在应用程序中的用于设置这些寄存器的那些附加指令。这里，利用包含在应用程序中的存储器访问指令的间距来控制预取操作的出现频率。

关键词：预取处理器处理器停顿周期指令带宽硬件和软件存储器附加指令应用程序程序流最小化存储器访问指令附加硬件资源数据访问操作微处理器速度处理器体系附加寄存器软件和硬件附加芯片技术使用预取指令组合控制寄存器规律性指令检测软件牺牲

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多重无效

多重无效

引用

作者： D·C·伯格 A·L·史密斯美国华盛顿州

公开了用于使在无效指令的目标字段中标识的存储器存储指令和一个或多个寄存器无效的装置和方法。在所公开的技术的一些示例中，一种装置可以包括存储器，以及一个或多个基于块的处理器核，所述一个或多个基于块的处理器核被配置为取回... 详细信息

标准号: CN108112269A

公开了用于使在无效指令的目标字段中标识的存储器存储指令和一个或多个寄存器无效的装置和方法。在所公开的技术的一些示例中，一种装置可以包括存储器，以及一个或多个基于块的处理器核，所述一个或多个基于块的处理器核被配置为取回并且执行多个指令块。核其中之一可以包括控制单元，所述控制单元至少部分基于接收到无效指令而被配置为基于无效指令的第一目标字段和第二目标字段来获取多个存储器访问指令中的存储器访问指令的指令标识和多个寄存器中的至少一个寄存器的寄存器标识。使与指令标识相关联的至少一个寄存器和存储器访问指令无效。基于无效的存储器访问指令，来执行后续存储器访问指令。

关键词：存储器访问指令寄存器无效指令字段处理器核指令标识存储器存储指令寄存器标识存储器配置取回关联指令

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在单指令多数据(SIMD)数据处理器中提供扩展寻址模式

在单指令多数据(SIMD)数据处理器中提供扩展寻址模式

引用

作者：威廉·C·莫耶美国得克萨斯

由N比特处理器(14)执行具有更新的第一存储器访问指令包括：访问多个寄存器(34)中的至少一个源寄存器，其中，所述访问包括访问第一寄存器，其中，多个寄存器中的每个寄存器包括N比特的主部分和M比特的扩展部分，其中，第一寄存器的主... 详细信息

标准号: CN102124443B

由N比特处理器(14)执行具有更新的第一存储器访问指令包括：访问多个寄存器(34)中的至少一个源寄存器，其中，所述访问包括访问第一寄存器，其中，多个寄存器中的每个寄存器包括N比特的主部分和M比特的扩展部分，其中，第一寄存器的主部分包括第一地址操作数。执行第一指令还包括：使用第一地址操作数形成存储器访问地址；使用存储器访问地址作为用于进行存储器访问的地址；产生更新地址操作数；以及将更新地址操作数写入第一寄存器的主部分。产生包括：访问至少一个源寄存器中的源寄存器的扩展部分以获得修改信息，并且在产生更新地址操作数时使用修改信息。

关键词：寄存器地址操作数存储器访问地址存储器访问指令比特处理器存储器扩展指令

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用于识别治疗部位的方法和装置

用于识别治疗部位的方法和装置

引用

作者：桑德拉·纳加勒布莱恩·克拉克何丁胜琳内·斯旺森丹尼斯·维尔纳蒂莫西·哈拉美国明尼苏达州

公开了用于识别治疗部位的方法和装置。该方法可以包括使多个电极与患者的内壁上或邻近患者的内壁的多个位置接合。该方法还可以包括通过多个电极的第一配对来生成起搏刺激并测量所产生的电活动。该方法还可以包括基于产生的电活动来识... 详细信息

标准号: CN107427226B

公开了用于识别治疗部位的方法和装置。该方法可以包括使多个电极与患者的内壁上或邻近患者的内壁的多个位置接合。该方法还可以包括通过多个电极的第一配对来生成起搏刺激并测量所产生的电活动。该方法还可以包括基于产生的电活动来识别至少一个治疗部位。装置可以包括被配置为执行这些方法的元件。该装置包括：多个电极；存储器装置，其被配置为存储用于评估电活动的指令；以及处理器，其被配置为：从存储器访问指令；使用该指令来引导电能源以通过多个电极的第一配对生成起搏刺激；使用该指令来测量在多个电极中的一个或多个处的所产生的电活动；并且使用该指令来基于所产生的电活动识别至少一个治疗部位。处理器还被配置为使用该指令来发起对至少一个治疗部位的治疗，诸如射频能量、超声能量、激光能量、冷冻消融、微波消融、肉毒杆菌毒素注射、神经溶解剂、光能、不可逆电穿孔和水凝胶注射。

关键词：电极电活动治疗部位指令配置处理器内壁起搏配对消融注射测量存储器访问指令肉毒杆菌毒素存储器装置方法和装置超声能量激光能量射频能量接合不可逆电穿孔电能源溶解剂水凝胶刺激光能冷冻微波存储邻近神经评估治疗

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智能电表主控芯片和安全加密方法

智能电表主控芯片和安全加密方法

引用

作者：陶庆新 200233 上海市徐汇区宜山路810号

本发明提供了一种智能电表主控芯片，包括内部总线以及连接到所述内部总线上的主处理器模块、数据存储模块和包括计量模块在内的至少一个应用模块，该芯片内还集成有安全控制模块，其连接到所述内部总线上并配置为提供安全加密功能，该... 详细信息

标准号: CN103679062A

本发明提供了一种智能电表主控芯片，包括内部总线以及连接到所述内部总线上的主处理器模块、数据存储模块和包括计量模块在内的至少一个应用模块，该芯片内还集成有安全控制模块，其连接到所述内部总线上并配置为提供安全加密功能，该芯片还包括连接在所述主处理器模块和所述内部总线之间并被配置为对非法的存储器访问指令进行屏蔽的存储保护模块。通过将安全控制模块内置于主控芯片并以内部总线连接到中央处理模块，能够有效地避免智能电表终端的应用软件旁路安全控制芯片的安全漏洞，同时降低生产测试成本。本发明还提供了基于该智能电表主控芯片和证书授权中心的安全加密方法，进一步保证了电力系统的安全。

关键词：内部总线智能电表主控芯片连接处理器模块芯片存储器访问指令安全控制模块数据存储模块证书授权中心中央处理模块安全加密安全控制安全漏洞测试成本存储保护电力系统计量模块加密功能控制模块提供安全应用模块应用软件有安全旁路屏蔽终端

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用于进行预取的数据处理方法和装置

用于进行预取的数据处理方法和装置

引用

作者：干纳施·苏亚那拉亚安·达斯卡鲁纳·霍姆英国剑桥

本公开涉及用于进行预取的数据处理方法和装置。一种数据处理设备包括处理电路(20)，其用于执行针对存储器设备(40)的第一地址的第一存储器访问指令和针对存储器设备(40)的第二地址的第二存储器访问指令，其中第一地址不同于第二地址。... 详细信息

标准号: CN104572026A

本公开涉及用于进行预取的数据处理方法和装置。一种数据处理设备包括处理电路(20)，其用于执行针对存储器设备(40)的第一地址的第一存储器访问指令和针对存储器设备(40)的第二地址的第二存储器访问指令，其中第一地址不同于第二地址。数据处理设备还包括基于跨步长度(70)从存储器设备40预取数据的预取电路(30)和用于确定第一地址和第二地址之间的差值的指令分析电路(50)。跨步求精电路(60)还被提供以基于跨步长度的因数和由指令分析电路(50)计算得出的差值的因数对跨步长度进行求精。

关键词：存储器设备跨步长度数据处理设备指令分析电路因数存储器访问指令数据处理方法第二存储器处理电路地址不同访问指令预取电路预取数据跨步一种预取电路计算进行公开涉及确定执行

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空指令的动态生成

空指令的动态生成

引用

作者： D·C·伯格 A·L·史密斯美国华盛顿州

装置和方法被公开用于存储器访问指令(诸如存储器存储指令)的动态无效。在所公开的技术的一些示例中，一种装置可以包括存储器和一个或多个基于块的处理器核。核之一可以包括被配置为执行存储器访问指令的执行单元，存储器访问指令包括... 详细信息

标准号: CN108027734A

装置和方法被公开用于存储器访问指令(诸如存储器存储指令)的动态无效。在所公开的技术的一些示例中，一种装置可以包括存储器和一个或多个基于块的处理器核。核之一可以包括被配置为执行存储器访问指令的执行单元，存储器访问指令包括指令块中包含的多个存储器加载和/或存储器存储指令。核还可以包括硬件结构，硬件结构存储用于指令块中的至少一个断言指令的数据，该数据标识如果断言指令的条件被满足则存储器存储指令中的一个或多个是否将发出。核可以进一步包括控制单元，控制单元被配置为至少部分地基于硬件结构数据来控制存储器访问指令向执行单元的发出。

关键词：存储器存储指令存储器访问指令指令存储器硬件结构断言硬件结构数据控制存储器处理器核访问指令数据标识加载配置存储

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用于跨距剖析软件应用的方法和设备

用于跨距剖析软件应用的方法和设备

引用

作者： G·罗尼 C·-K·卢美国加利福尼亚州

本发明公开了一种用于跨距剖析软件应用的方法和设备。示例性的系统使用硬件性能计数器来报告与由某个事件(诸如数据高速缓存器未命中)所触发的存储器访问指令相关联的数据地址和指令地址。当相同的指令地址被与一个以上的数据地址相关... 详细信息

标准号: CN102681947A

本发明公开了一种用于跨距剖析软件应用的方法和设备。示例性的系统使用硬件性能计数器来报告与由某个事件(诸如数据高速缓存器未命中)所触发的存储器访问指令相关联的数据地址和指令地址。当相同的指令地址被与一个以上的数据地址相关联时，记录在两个数据地址之间的差异。当对于相同的指令记录了这些数据地址差异中的两个或更多时，该系统确定与所述指令相关联的跨距是所述两个或更多差异的最大公约数。此跨距可以由编译器用来优化数据高速缓存器预取。另外，通过在审查阶段和跳跃阶段之间循环可以降低与监视数据高速缓存器未命中的地址相关联的任何开销。在审查阶段期间比在跳跃阶段期间监视更多的数据高速缓存器未命中。

关键词：数据地址高速缓存器未跨距关联指令地址存储器访问指令硬件性能计数器监视高速缓存器软件应用优化数据指令记录编译器触发预取开销指令

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