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文字说明：

T=题名（书名、题名），A=作者（责任者），K=主题词，P=出版物名称，PU=出版社名称，O=机构（作者单位、学位授予单位、专利申请人），L=中图分类号，C=学科分类号，U=全部字段，Y=年（出版发行年、学位年度、标准发布年）

检索规则说明：

AND代表“并且”；OR代表“或者”；NOT代表“不包含”；(注意必须大写,运算符两边需空一格)

检索范例：

范例一：(K=图书馆学 OR K=情报学) AND A=范并思 AND Y=1982-2016
范例二：P=计算机应用与软件 AND (U=C++ OR U=Basic) NOT K=Visual AND Y=2011-2016

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文献类型

13 篇 专利

馆藏范围

13 篇 电子文献
0 种 纸本馆藏

日期分布

机构

7 篇 成都忆芯科技有限...
2 篇 中国航天科技集团...
1 篇 三星电子株式会社
1 篇 普冉半导体股份有...

作者

7 篇 黄好城
7 篇 兰彤
7 篇 沈飞
7 篇 伍德斌
7 篇 王祎磊
2 篇 张洵颖
2 篇 陈子祺
2 篇 肖建青
2 篇 田甲
2 篇 赵翠华
2 篇 裴茹霞
2 篇 崔媛媛
1 篇 文栋煜
1 篇 陈相华
1 篇 金民镐
1 篇 池洙荣
1 篇 于超

语言

13 篇 中文

检索条件"主题词=存储器访问模块"

共 13 条记录，以下是1-10 订阅

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详细简洁

排序：

加速器、存储装置和虚拟现实系统

加速器、存储装置和虚拟现实系统

引用

作者：池洙荣金民镐文栋煜陈相华韩国京畿道

提供了加速器、存储装置和虚拟现实系统。所述加速器包括：存储器访问模块，其被配置为从输入装置获取用于生成VR图像的多个原始图像，VR图像即虚拟现实图像；以及计算模块，其包括拼接区域检测器、拼接处理器、图像处理器和组合处理器... 详细信息

标准号: CN117314722A

提供了加速器、存储装置和虚拟现实系统。所述加速器包括：存储器访问模块，其被配置为从输入装置获取用于生成VR图像的多个原始图像，VR图像即虚拟现实图像；以及计算模块，其包括拼接区域检测器、拼接处理器、图像处理器和组合处理器。存储器访问模块被配置为：向拼接区域检测器发送多个原始图像。拼接区域检测器被配置为：通过对从存储器访问模块接收到的多个原始图像中的每一个原始图像执行检测处理，从多个原始图像中的每一个原始图像中检测至少一个拼接区域和图像区域，将至少一个拼接区域提供给拼接处理器，并且将图像区域提供给图像处理器。拼接处理器被配置为生成至少一个后处理的拼接区域。

关键词：拼接区域原始图像存储器访问模块检测器拼接处理器图像处理器图像区域配置加速器图像虚拟现实图像虚拟现实系统组合处理器存储装置计算模块输入装置后处理检测发送

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PCIe控制器与使用PCIe控制器的密钥更新

PCIe控制器与使用PCIe控制器的密钥更新

引用

作者：黄好城沈飞王祎磊伍德斌兰彤 610041 四川省成都市高新区九兴大道10号1幢

本申请公开了PCIe控制器与使用PCIe控制器的环回通路进行密钥更新。所公开的PCIe控制器，包括：传输层发送模块、传输层接收模块、存储器访问模块、外发DMA模块、收取DMA模块、加密模块、解密模块与存储器；传输层发送模块包括第一环回... 详细信息

标准号: CN109558347B

本申请公开了PCIe控制器与使用PCIe控制器的环回通路进行密钥更新。所公开的PCIe控制器，包括：传输层发送模块、传输层接收模块、存储器访问模块、外发DMA模块、收取DMA模块、加密模块、解密模块与存储器；传输层发送模块包括第一环回控制模块，传输层接收模块包括第二环回控制模块，第一环回控制模块耦合到第二环回控制模块；存储器访问模块耦合到传输层发送模块与传输层接收模块，存储器访问模块还耦合到存储器；外发DMA模块耦合到解密模块，外发DMA模块还耦合到传输层发送模块；收取DMA模块耦合到加密模块，收取DMA模块还耦合到传输层接收模块；加密模块与解密模块分别还耦合到PCIe控制器外部的DRAM。

关键词：传输层耦合到环回控制模块发送模块接收模块存储器访问模块加密模块解密模块存储器环回通路密钥更新外部申请

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执行确定性推理的组合处理装置、芯片和方法

执行确定性推理的组合处理装置、芯片和方法

引用

作者：陈子祺田甲 100097 北京市海淀区常青园北里6号楼903

本申请涉及执行确定性推理的组合处理装置，包括指令提取模块、指令预解码模块、指令解码模块、指令执行模块、存储器访问模块和寄存器回写模块；指令提取模块从指令存储器中读取指令，并更新程序计数器以指向下一条指令；指令预解码模... 详细信息

标准号: CN111027690B

本申请涉及执行确定性推理的组合处理装置，包括指令提取模块、指令预解码模块、指令解码模块、指令执行模块、存储器访问模块和寄存器回写模块；指令提取模块从指令存储器中读取指令，并更新程序计数器以指向下一条指令；指令预解码模块会将压缩指令解码为本机指令，指令解码模块访问寄存器堆并确定分支控制；指令执行模块将为指令执行向量计算或标量计算得到结果，为Load/Store指令访问已访问的内存，并计算分支和跳转并根据其预期结果进行检查；在存储器访问模块中，流水线的内存访问完成；寄存器回写模块将执行阶段的结果写入寄存器堆。本申请还涉及包含上述组合处理装置的确定性神经网络算法的运算装置、计算芯片及其应用。

关键词：指令解码存储器访问模块指令预解码模块指令执行模块组合处理装置指令提取寄存器回写确定性结果写入寄存器指令神经网络算法计数器指令存储器标量计算读取指令分支控制更新程序寄存器堆计算芯片模块访问内存访问向量计算预期结果运算装置指令访问指令执行跳转推理流水线申请内存指向压缩应用检查访问

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PCIe控制器

PCIe控制器

引用

作者：黄好城沈飞王祎磊伍德斌兰彤 610000 四川省成都市高新区九兴大道10号1幢

本申请公开了PCIe控制器，该PCIe控制器包括传输层发送模块、传输层接收模块、存储器访问模块、收取DMA模块、加密模块、存储器以及CPU子系统；传输层发送模块包括第一环回控制模块，传输层接收模块包括第二环回控制模块，第一环回控制... 详细信息

标准号: CN116340218A

本申请公开了PCIe控制器，该PCIe控制器包括传输层发送模块、传输层接收模块、存储器访问模块、收取DMA模块、加密模块、存储器以及CPU子系统；传输层发送模块包括第一环回控制模块，传输层接收模块包括第二环回控制模块，第一环回控制模块耦合到第二环回控制模块；存储器访问模块耦合到传输层发送模块与传输层接收模块，存储器访问模块还耦合到存储器；收取DMA模块耦合到加密模块，收取DMA模块还耦合到传输层接收模块；加密模块还耦合到PCIe控制器外部的DRAM；存储器与CPU子系统耦合。

关键词：传输层耦合到环回控制模块接收模块存储器访问模块存储器发送模块加密模块耦合外部申请

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一种支持多外设同时请求的DMA系统及其实现方法

一种支持多外设同时请求的DMA系统及其实现方法

引用

作者：于超 201210 上海市浦东新区中国(上海)自由贸易试验区申江路5005弄1号9层整层(实际楼层8楼)

本申请公开了一种支持多外设同时请求的DMA系统及其实现方法，其中所述DMA系统具体包括：存储器访问模块，用于通道仲裁及通道传输；通道匹配模块，用于接收外设的请求，置位对应通道的请求使能和对应外设总线的时钟控制信号；所述通道... 详细信息

标准号: CN117435531A

本申请公开了一种支持多外设同时请求的DMA系统及其实现方法，其中所述DMA系统具体包括：存储器访问模块，用于通道仲裁及通道传输；通道匹配模块，用于接收外设的请求，置位对应通道的请求使能和对应外设总线的时钟控制信号；所述通道匹配模块，还用于接收由存储器访问模块反馈的第一响应信号，并将所述第一响应信号转换为宽度能被所述目标外设采样的第二响应信号；对来自所述存储器访问模块的不同通道的响应信号正确映射到不同外设。以便所述目标外设接收所述第二响应信号后，清零所述请求信号。本申请的DMA系统可以支持不同工作频率的多个外设同时请求，并产生正确的响应信号。

关键词：响应信号外设存储器访问模块匹配模块时钟控制信号工作频率请求信号通道传输外设总线采样清零使能映射置位申请仲裁反馈转换

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执行确定性推理的组合处理装置、芯片和方法

执行确定性推理的组合处理装置、芯片和方法

引用

作者：陈子祺田甲 100097 北京市海淀区常青园北里6号楼903

标准号: CN111027690A

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一种RISC处理器的浮点处理单元集成电路及方法

一种RISC处理器的浮点处理单元集成电路及方法

引用

作者：赵翠华张洵颖裴茹霞肖建青崔媛媛 710068 陕西省西安市太白南路198号

本发明一种RISC处理器的浮点处理单元集成电路，包括七级的定点流水线和六级的浮点流水线，以及与门；其中集成方法包括，对处理器流水线停顿的控制管理的步骤；对浮点流水线各流水级的执行控制步骤。通过浮点流水线的对应设置，以及对... 详细信息

标准号: CN104951283B

本发明一种RISC处理器的浮点处理单元集成电路，包括七级的定点流水线和六级的浮点流水线，以及与门；其中集成方法包括，对处理器流水线停顿的控制管理的步骤；对浮点流水线各流水级的执行控制步骤。通过浮点流水线的对应设置，以及对定点流水线中存储器访问模块访问控制逻辑和异常处理模块对异常情况的处理逻辑的共用，使得浮点集成结构清楚，在充分利用原定点处理器逻辑的同时，对原定点流水线设计逻辑改动小，并减少了浮点流水线的控制逻辑，降低了功耗；集成方法具有通用性，实现定点和浮点流水线协同工作，共同实现定点和浮点指令执行，在一个时钟周期内完成两个源操作数的读取和一个运算结果的写入操作，且无其他特殊等待周期，效率高。

关键词：流水线浮点存储器访问模块处理器流水线访问控制逻辑浮点处理单元异常处理模块读取处理器逻辑流水线设计处理逻辑等待周期浮点指令集成结构控制步骤控制管理控制逻辑时钟周期写入操作源操作数运算结果流水级功耗与门集成电路停顿协同

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一种RISC处理器的浮点处理单元集成电路及方法

一种RISC处理器的浮点处理单元集成电路及方法

引用

作者：赵翠华张洵颖裴茹霞肖建青崔媛媛 710068 陕西省西安市太白南路198号

标准号: CN104951283A

关键词：浮点流水线集成方法原定点流水线存储器访问模块读取处理器流水线访问控制逻辑浮点处理单元异常处理模块处理器逻辑流水线设计处理逻辑等待周期对应设置浮点指令集成结构控制管理控制逻辑时钟周期协同工作写入操作异常情况源操作数运算结果执行控制流水级效率高浮点功耗两个七级一种与门集成电路改动停顿特殊减少执行完成

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PCIe控制器及其数据传输方法

PCIe控制器及其数据传输方法

引用

作者：黄好城沈飞王祎磊伍德斌兰彤 610000 四川省成都市高新区九兴大道10号1幢

本申请公开了PCIe控制器及数据传输方法，涉及存储控制器领域，实现了在控制器内部建立数据通路的方法。本申请的控制器，包括：传输层发送模块、传输层接收模块、CPU子系统、存储器访问模块与存储器；传输层发送模块包括第一环回控制... 详细信息

标准号: CN111797046B

本申请公开了PCIe控制器及数据传输方法，涉及存储控制器领域，实现了在控制器内部建立数据通路的方法。本申请的控制器，包括：传输层发送模块、传输层接收模块、CPU子系统、存储器访问模块与存储器；传输层发送模块包括第一环回控制模块，传输层接收模块包括第二环回控制模块，第一环回控制模块耦合到第二环回控制模块；存储器访问模块耦合到传输层发送模块与传输层接收模块，存储器访问模块还耦合到存储器；存储器与CPU子系统耦合。

关键词：传输层环回控制模块存储器访问模块存储器发送模块接收模块耦合到控制器存储控制器数据传输数据通路耦合申请

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PCIe控制器与使用PCIe控制器的环回数据通路

PCIe控制器与使用PCIe控制器的环回数据通路

引用

作者：黄好城沈飞王祎磊伍德斌兰彤 610041 四川省成都市高新区九兴大道10号1幢

本申请公开了PCIe控制器与使用PCIe控制器的环回通路，涉及存储控制器领域，实现了在控制器内部建立数据通路的方法。本申请的控制器，包括：传输层发送模块、传输层接收模块、存储器访问模块与存储器；传输层发送模块包括第一环回控制... 详细信息

标准号: CN107643992B

本申请公开了PCIe控制器与使用PCIe控制器的环回通路，涉及存储控制器领域，实现了在控制器内部建立数据通路的方法。本申请的控制器，包括：传输层发送模块、传输层接收模块、存储器访问模块与存储器；传输层发送模块包括第一环回控制模块，传输层接收模块包括第二环回控制模块，第一环回控制模块耦合到第二环回控制模块；存储器访问模块耦合到传输层发送模块与传输层接收模块，存储器访问模块还耦合到存储器。

关键词：传输层环回控制模块存储器访问模块发送模块接收模块耦合到存储器控制器存储控制器环回通路数据通路申请

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