检索结果-内蒙古大学图书馆

作者：张梦蝶东南大学

学位级别：硕士

在现代电子系统中,无线通信技术占有重要地位,频率综合器是其中关键电路之一,频率综合器可以为射频收发机提供本地振荡频率,也可以为数字系统提供所需要的时钟信号。当今时代信息技术飞速发展,电子系统性能需求越来越高,这促使频率综合... 详细信息

在现代电子系统中,无线通信技术占有重要地位,频率综合器是其中关键电路之一,频率综合器可以为射频收发机提供本地振荡频率,也可以为数字系统提供所需要的时钟信号。当今时代信息技术飞速发展,电子系统性能需求越来越高,这促使频率综合器朝着更微小、低相噪、低功耗、低杂散的方向发展。目前应用的频率综合器主要分为三种:锁相环频率综合器、直接频率综合器、查表型频率综合器。由于锁相环频率综合器具有结构简单、低功耗并且容易集成等优点,所以应用最广泛。该结构是在锁相环电路的反馈回路中引入可编程分频器来实现不同分频比,进而控制整个系统的输出频率。由于整数型频率综合器的频率分辨率有限,进一步引入Sigma-Delta调制器进行小数分频,但是Sigma-Delta调制器会引起频率合成器输出杂散,恶化相位噪声性能。论文分析了在小数频率合成器中产生杂散的机理和杂散的位置,构建了锁相环路行为级模型。研究了MASH类型的Sigma-Delta调制器抑制小数杂散的原理,并构建了仿真模型。对基于增大输出序列周期长度的经典抑制杂散方法进行了分析,构建了随机加扰结构和整形最低位抖动结构,研究了此结构的有效抖动位宽;构建了可以实现最大输出序列的HK-MASH结构;构建了可以实现输入输出均值完全匹配无误差的SP-MASH结构。以上三种结构经过仿真验证可以有效抑制由于输出序列周期性导致的杂散分量。然而,在频率综合器环路中,可能会出现电荷泵上下电流失配、泄露、VCO输出信号和参考信号之间的谐波寄生耦合等情况,这些非线性问题会影响调制器的性能,使得高频噪声被折叠到低频,从而引入非线性因素产生杂散。这种类型的杂散需要通过修改调制器输出累积量化噪声的概率重分布函数进行抑制。概率分布塑形方法可将原三阶MASH结构调制器的输出累积量化噪声的范围从[-2,2]扩展到[-4,4]的分布,实现在抑制周期性引起杂散的基础上进一步抑制非线性引起的杂散,可以有效抑制锁相环路的三阶非线性杂散。论文完成了概率分布塑形结构的行为级建模与仿真,基于0.18μm CMOS工艺设计了电路并进行了逻辑综合与布局布线,在此基础上完成了概率分布塑形电路的仿真验证与版图设计。经后仿验证其功能正确,逻辑综合总面积约为0.036mm2,动态功耗约为11.5mW。经频率综合器环路仿真验证,结果表明改进后的概率重分布结构可以有效抑制MASH调制器结构中由非线性引起的小数杂散。

关键词：锁相环小数频率综合器 Sigma-Delta调制器小数杂散非线性

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一种基于新型自适应校准技术的小数频率综合器的设计

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微电子学 2023年第2期53卷 247-254页

作者：郑立博解昊炜王贵宇赵科伟郭宇锋刘轶南京邮电大学电子与光学工程学院南京210003 南京邮电大学射频集成与微组装国家地方联合工程实验室南京210003

基于EPC Class-1 Generation-2协议规定,对工作于全球UHF RFID频段的频率综合器的设计指标进行了分析。采用标准0.18μm CMOS工艺,集成自适应频率校准模块设计了一种新颖的低相位噪声、快速锁定的小数频率综合器。其中,LC-VCO基于无尾... 详细信息

基于EPC Class-1 Generation-2协议规定,对工作于全球UHF RFID频段的频率综合器的设计指标进行了分析。采用标准0.18μm CMOS工艺,集成自适应频率校准模块设计了一种新颖的低相位噪声、快速锁定的小数频率综合器。其中,LC-VCO基于无尾电流源式设计,利用二次谐波滤波技术显著降低了带内相位噪声;自适应频率校准电路则区别于传统的二进制比较法,基于新颖的逐次比较法以减小VCO的4位数控逻辑电压的比较次数,因而可以快速确定VCO的控制字并缩短锁定时间。仿真结果表明,自适应校准阶段的时间仅约6.3μs,环路整体锁定时间低于23.2μs,100 kHz频偏处的相位噪声性能为-106.3 dBc/Hz,1 MHz频偏处为-126.1 dBc/Hz,整体功耗为84 mW。与最近发布的先进的CMOS小数频率综合器的性能相比,所设计的小数频率综合器实现了更优的相位噪声性能,同时能以较短的锁定时间以及较低的功耗工作。

关键词：小数频率综合器自适应校准电路混合集成电路

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小数频率综合器与整数频率综合器性能比较

小数频率综合器与整数频率综合器性能比较

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2006制导与引信专业信息网学术交流会

作者：张健上海航天技术研究院八0二所上海

在无线通信系统中,频率综合器的性能直接影响到系统的性能.文章分析了小数频率综合器与整数频率综合器相位噪声、锁定时间和杂散抑制等方面的性能.

关键词：小数频率综合器整数频率综合器相位噪声锁定时间杂散抑制

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应用于短距离接收发机中Σ-Δ小数频率综合器的研究

应用于短距离接收发机中Σ-Δ小数频率综合器的研究

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作者：齐骋华侨大学

学位级别：硕士

短距离无线通信设备工作在无需许可的工业、科学和医疗频段（IndustrySeienee Medieal, ISM），已广泛地应用于远程抄表，无线安防，设备管理以及监控等领域。频率综合器是短距离无线收发机中的关键模块之一，其性能决定了整个收发机的... 详细信息

短距离无线通信设备工作在无需许可的工业、科学和医疗频段（IndustrySeienee Medieal, ISM），已广泛地应用于远程抄表，无线安防，设备管理以及监控等领域。频率综合器是短距离无线收发机中的关键模块之一，其性能决定了整个收发机的性能。与整数型频率综合器相比，小数型频率综合器解决了传统整数频率综合器存在的环路带宽与信道间隔之间的矛盾，但是存在由于分频比周期性变化引起的小数杂散问题，这可通过采用Σ-Δ调制技术加以解决。本文主要针对Σ-Δ小数频率合成器展开研究，并完成了其中各模块电路的设计。文章首先介绍了频率综合器基本原理及相关参数，对采用Σ-Δ调制技术消除杂散输出的小数频率综合器进行了深入研究。通过分析单环高阶Σ-Δ调制器和MASH1-1-1Σ-Δ调制器结构，选取单环高阶Σ-Δ调制器结构设计了一个输入为17位，输出为三位的三阶数字Σ-Δ调制器，并通过加入一位伪随机信号，抑制输出极限环，电路采用VerilogHDL语言设计实现。频率综合器中VCO的设计采用了多频带LC-VCO结构，用5组二进制加权电容阵列将VCO输出频带划分为32个子频带，在满足系统宽调谐范围的同时，避免调谐增益过高使VCO对控制线输入噪声过于敏感，并且用限流电阻阵列代替传统结构中的电流源为VCO提供电流通路，可精确调控VCO输出摆幅，使其工作在电流限制区与电压限制区边界，优化相位噪声与功耗之间的折中。本文也对频率综合器中其他电路模块进行了设计改进，在鉴频鉴相器复位路径中引入延时单元，并可控制产生两种不同延时，防止因为工艺偏差带来的影响；在电荷泵电路中采用传输门开关和4条电流通路，保证电流源的时时开启，并引入反馈调节机制使电荷泵充放电电流动态匹配，较好的消除了电荷泵电路中的非理想因素；多模可编程分频器采用了基于高速双模预分频器的结构，其中双模分频器选用相位选择技术，并对工作在最高频率的正交二分频器进行了设计改进，可编程分频器可实现分频比在228到272连续可调。最后设计了用于产生参考频率的晶体振荡电路，并完成模拟部分的版图设计。本文所设计的频率综合器主要应用于800MHz频段的短距离窄带数字对讲机中，经仿真测试，各电路模块功能实现正常，性能都达到了系统所需要求，对整个系统使用Verilog-A建模仿真得到其上电锁定时间为935.9s。

关键词：小数频率综合器 Σ-Δ调制器电荷泵锁相环多频带LC压控振荡器分频器相位噪声

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无线接收机中小数分频频率综合器关键模块设计

无线接收机中小数分频频率综合器关键模块设计

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作者：刘舒平东南大学

学位级别：硕士

本文主要研究并设计了一种应用于可穿戴医疗设备领域的短距离无线接收机中的低功耗、高性能的小数频率综合器。从理论分析和建模、系统设计和指标划分、具体电路和版图实现、功能仿真和验证等方面对小数频率综合器的设计进行了深入的研... 详细信息

本文主要研究并设计了一种应用于可穿戴医疗设备领域的短距离无线接收机中的低功耗、高性能的小数频率综合器。从理论分析和建模、系统设计和指标划分、具体电路和版图实现、功能仿真和验证等方面对小数频率综合器的设计进行了深入的研究和分析。首先对锁相环的分类、工作原理、组成模块以及设计指标进行了介绍,对各个模块的基本原理和其在锁相环中的作用进行了分析。给出了锁相环的线性环路模型,在整个系统层面上对锁相环进行了梳理。接下来,对小数频率综合器中的小数分频器进行了分析和设计。介绍了Δ-Σ调制技术的原理和设计过程,对Δ-Σ调制的行为进行了抽象和建模。分析了几种高阶Δ-Σ调制器的结构、原理并通过在Simulink中建立行为级模型,从包括稳定性、噪声整形能力、输出序列随机性等方面对其性能进行对比,确定采用SS-FF33结构的Δ-Σ调制器,给出了数字实现方法,并通过Modelsim对其功能进行验证。然后,在锁相环的线性环路模型的基础上,利用离散采样系统模型对小数频率综合器进行建模,特别是对PFD和分频器从离散采样行为的角度进行分析。该模型是理解和分析Δ-Σ调制器的噪声传输模型的基础,也是对小数频率综合器的噪声特性进行建模的前提。通过对该模型的分析获得了一个更接近实际的PLL系统的数学模型。根据短距离无线接收机系统指标规划了小数频率综合器锁相环各模块的指标,分析和总结了锁相环环路参数的设计方法。特别对三阶环路滤波器的环路参数与相位裕度、环路带宽、噪声特性的关系进行了分析,由此提出了一个确定三阶环路滤波器的电阻、电容参数的设计方案,并根据此设计方案完成了能够自动完成三阶环路滤波器的电阻、电容参数计算的Matlab脚本。根据确定的环路参数对各个模块电路进行设计,包括VCO、PFD、电荷泵和分频器等电路,从工作原理、结构选型、设计分析以及功能仿真等方面进行了详细的介绍。其中,采用了4级环形压控振荡器以实现正交信号的输出;结合伺服环路和电流转向结构提出了一种高性能电荷泵结构实现了良好的电流匹配;采用TSPC逻辑电路的预分频器在满足工作速度要求的情况下具有较低功耗。最后,采用SMIC 0.18μm CMOS工艺,设计了小数频率综合器的版图,提取版图寄生参数并进行后仿真。其中Δ-Σ调制器等数字部分采用Design Complier工具进行综合,并采用Astro工具完成自动布局布线。根据仿真数据对小数频率综合器的噪声特性进行建模,分析其相位噪声性能。经过仿真验证,小数频率综合器实现了高精度本振信号输出,频率分辨率为10kHz,功耗为3.5 mW,输出相位噪声在1MHz小于-100.79dBc/Hz,锁定时间小于15us。满足了预期设计要求。

关键词：电荷泵锁相环小数频率综合器 Δ-Σ调制器可编程多模分频器

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多模CMOS频率综合器关键模块设计及其整体优化

多模CMOS频率综合器关键模块设计及其整体优化

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作者：孙天慧东南大学

学位级别：硕士

随着无线通信模式的不断涌现,将多种通信制式集成在一个移动终端上已成为目前无线通信技术发展的趋势,支持多模式、多标准、多频段的射频收发机也因此成为人们研究的热点。而作为射频收发机的核心组成模块之一,频率综合器是决定整个收... 详细信息

随着无线通信模式的不断涌现,将多种通信制式集成在一个移动终端上已成为目前无线通信技术发展的趋势,支持多模式、多标准、多频段的射频收发机也因此成为人们研究的热点。而作为射频收发机的核心组成模块之一,频率综合器是决定整个收发机性能的关键之一。本文对多模CMOS频率综合器关键模块及其整体优化进行研究与设计。本文首先介绍了电荷泵锁相环型小数频率综合器的基本原理和各个子模块,推导出系统传递函数并建立线性化模型,然后根据其线性化模型分析了环路的稳定性、动态特性和噪声性能,并给出了小数频率综合器的系统结构框图。本文设计的小数分频器主要包括高速二分频器、可编程整数分频器和Δ-Σ调制器。高速二分频器采用源级耦合逻辑结构的触发器实现,在进行二分频功能的同时产生四相正交本振信号。可编程整数分频器包括四分频器和2/3分频器链,其中2/3分频器链采用5级2/3分频器级联而成,并加入逻辑门实现分频比的扩展。A-Σ调制器用于实现量化噪声的整形,采用了改进型MASH 1-1-1结构,可以增加输出序列长度以减小小数杂散。本文设计的自动频率校准单元(AFC)基于频率比较法,主要包括最优控制字搜索模块和环路带宽校准模块。最优控制字搜索利用二进制搜索算法和最小值存储来实现,环路带宽校准则根据当前分频比和压控振荡器的调谐增益来调节电荷泵电流,以实现环路带宽的恒定。基于混合型FIR滤波的量化噪声抑制技术,本文对小数频率综合器进行了系统优化设计。A-Σ调制器的输出控制信号经过延迟单元后,分别通过8路并行的可编程整数分频器和鉴频鉴相器,最后由一个8输入可编程电荷泵在模拟域进行电荷相加。混合型FIR滤波器能够实现全定制的量化噪声整形,并且恒定的单位直流增益避免了噪声放大的问题。基于TSMC 0.18μm RF CMOS工艺进行了电路设计和版图设计,整个小数频率综合器的版图面积为1.22x1.07mm2。其中A-∑调制器和自动频率校准单元采用半定制设计方法,其余模块均采用全定制设计方法。后仿真结果表明,在最差情况下小数分频器的工作范围为0.4～8.0GHz,分频比范围为32～504,最高频率下的工作电流为7.65mA。自动频率校准单元的校准时间约为16.2μs,频率分辨率为5MHz,平均工作电流小于0.5mA。整个小数频率综合器的仿真结果表明,输出频率范围为0.923～7.681GHz,频率分辨率为20Hz,锁定时间小于40μs,工作电流小于23mA。本次设计的小数频率综合器能够满足设计指标要求。

关键词：多模多标准小数频率综合器小数分频器自动频率校准混合型FIR滤波器

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超宽带射频芯片中的频率综合器设计

超宽带射频芯片中的频率综合器设计

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作者：郭诗塔中国科学技术大学

学位级别：硕士

随着无线通信技术的快速发展,超宽带技术吸引了越来越多的关注。为了给使用者提供更多的方便,超宽带无线通信系统的集成技术逐渐成为当前无线通信系统的研究热点。作为无线射频发收机最重要的模块,频率综合器能给射频发收机提供低相噪... 详细信息

随着无线通信技术的快速发展,超宽带技术吸引了越来越多的关注。为了给使用者提供更多的方便,超宽带无线通信系统的集成技术逐渐成为当前无线通信系统的研究热点。作为无线射频发收机最重要的模块,频率综合器能给射频发收机提供低相噪的、稳定的、可编程的本振信号,同时给数字电路提供时钟信号。因此频率综合器的性能往往决定了整个无线通信系统的性能。本文以脉冲体制超宽带无线通信系统中的频率综合器作为目标,系统地研究了正交小数频率综合器的设计和实现。首先,本文介绍了频率综合器的工作原理,以及主要的性能指标和设计挑战。第二,研究了频率综合器系统级设计方法。首先根据系统指标的要求设计了适用于脉冲体制超宽带无线射频前端的频率综合器的结构,然后研究了频率综合器环路的线性相位域模型,分析了相位噪声在该模型中的传输特性,接下来研究了系统级环路参数的设计方法,同时给出了一些常见的系统级仿真方法。在此基础上,完成了脉冲体制超宽带无线射频前端统频率综合器的系统级环路参数设计和仿真验证。第三,研究了小数分频器的设计和常用的小数调制技术。对双模预分频器进行了基于注入锁定原理的频域建模,对可编程吞脉冲计数器结构和原理、∑-△调制器的结构和量化噪声,进行了详细的分析和研究。在此基础上,设计了宽工作频率范围、高输入灵敏度的双模预分频器、多位可编程的高速吞脉冲计数器和多位量化的单环∑-△调制器,分别进行了上述三个电路模块的流片和测试。测试结果与理论设计上的分析十分吻合,满足系统的指标要求。第四,研究了正交小数频率综合器中的鉴频鉴相器、电荷泵、正交压控振荡器及模8分频器的电路设计,实现了一个用于脉冲体制超宽带无线射频前端的正交小数频率综合器,通过流片和测试,验证了设计的正确性,并结合测试结果分析了影响相位噪声性能的主要原因和改进措施。

关键词：超宽带频率综合器锁相环相位噪声频谱杂散整数频率综合器小数频率综合器正交压控振荡器 ∑-△调制器双模预分频器注入锁定分频器锁定范围输入灵敏度

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超高频射频识别阅读器集成技术研究

超高频射频识别阅读器集成技术研究

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作者：张润曦华东师范大学

学位级别：博士

传统的条形码技术曾经在自动识别领域引起深刻变革并已得到广泛应用,但有限的数据容量、需可视读取的要求及易被篡改等缺点使得它愈来愈无法满足当前人们对于大容量、高安全性自动识别的需求。当射频电子标签的价格逐渐降低至与条形码... 详细信息

传统的条形码技术曾经在自动识别领域引起深刻变革并已得到广泛应用,但有限的数据容量、需可视读取的要求及易被篡改等缺点使得它愈来愈无法满足当前人们对于大容量、高安全性自动识别的需求。当射频电子标签的价格逐渐降低至与条形码可比拟时,超高频射频识别系统以其较高的数据传输速率、较远的通信距离及灵活的编码系统得到愈来愈多的关注而逐渐成为一个研究热点。超高频射频识别系统通常由标签、阅读器及数据处理终端构成。其中,作为无线数据传输桥梁的超高频射频识别阅读器一般采用离散元件以混合技术构建,设备成本高、功耗大、移动性差,很大程度上制约了超高频射频识别技术的进一步推广。随着混合信号集成电路工艺技术的不断成熟,过去两年中出现了以BiCMOS或CMOS工艺实现的低成本、低功耗、单芯片超高频射频识别阅读器,并逐渐成为超高频射频识别阅读器的技术发展方向。本文研究了860-960MHz UHF波段CMOS单芯片超高频射频识别阅读器的实现,完成了从系统规划、电路设计到原型芯片测试的整个过程。首先,根据EPC C1G2超高频射频识别国际标准,ETSI 302 208-1欧洲规范和中国超高频射频识别技术应用试行规定及本文所提出的正交直接变频无线收发机架构,分析多阅读器环境中接收、发射射频前端、本地频率综合器和基带等模块的指标要求,并通过系统仿真模型验证其正确性,作为电路设计的依据。第二,研究阅读器接收路径存在大信号本地馈通时的线性度与噪声系数折衷策略。不同于仅注重“监听”模式下噪声系数或“读”模式下线性度的传统方法,提出了兼具低噪声、高线性度特点的三级紧凑式射频前端。采用该射频前端的接收机在“监听”模式与“读”模式下的噪声系数分别达到27dB、36dB,输入IP3达到13dBm。第三,研究本地振荡信号路径在收、发两种工作模式时的相位噪声需求。提出了基于多重滤波技术低相位噪声压控振荡器和3阶3比特数字增量一总和调制器的小数分频频率综合器。芯片验证表明,锁相环各频带内噪声抑制明显,在距载波200kHz、1MHz的频偏处分别获得-92dBc/Hz与-125dBc/Hz的相位噪声,RMS相位抖动小于6.7pS,残留FM小于4.5kHz。第四,研究超高频射频识别系统中标签背散射机制所导致的功率需求。结合所采用的直流耦合信号发射路径特点,提出了支持DSB-ASK,SSB-ASK,PR-ASK三种调制方式的可变增益多模发射前端。第五,提出接收、发射基带数字可调谐信道选择滤波器与可编程增益放大器。为适应不同速率的数据通信要求,接收基带滤波器带宽在0.3-1.3MHz范围内可变,内建5kHz反馈直流消除电路能同时满足链路建立时间与解调信噪比需要。最后,基于上述系统、电路指标及设计技术,进行超高频射频识别阅读器芯片的流片验证。该芯片以IBM 0.18μm CMOS工艺实现,总面积为4×4mm2,电源电压为3.3V,发射功率-4.4dBm时,总功耗为584mW。以Xilinx Virtex-4 xe4vx35FPGA、片外功率放大器与环形器等离散元件构建测试平台。当发射数据速率为Tari=25μS时,输出信号频谱能够满足EPC C1G2密集阅读器环境的发射功率规范。当接收机输入端带内阻塞信号达-4.4dBm时,接收机灵敏度达到-65dBm,满足短距离便携式超高频射频识别应用的需求。本论文研究受上海市科学技术委员会AM基金《便携式超高频射频识别接收机前端关键技术研究》（07SA04）资助。

关键词：射频识别阅读器单芯片直接变频线性度噪声系数相位噪声建立时间小数频率综合器增量-总和调制器数字调谐信道选择滤波多模式

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多模多标准射频接收机中小数分频器和AFC的设计

多模多标准射频接收机中小数分频器和AFC的设计

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作者：罗汀东南大学

学位级别：硕士

无线通信技术的高速发展和数据流量的不断提升,对系统的性能和集成度提出了日趋严苛的要求,而在一个芯片上集成多种模式的无线通信系统具有广泛的应用前景,因此支持多模式多标准的射频收发机成为了人们的研究热点。而高精度、高频谱纯... 详细信息

无线通信技术的高速发展和数据流量的不断提升,对系统的性能和集成度提出了日趋严苛的要求,而在一个芯片上集成多种模式的无线通信系统具有广泛的应用前景,因此支持多模式多标准的射频收发机成为了人们的研究热点。而高精度、高频谱纯度和宽输出频率范围的频率综合器对多模式多标准射频收发机具有重要意义。本文将对小数分频器和自动频率校准频率综合器中必不可少的模块进行研究与设计。本文首先介绍了小数频率综合器的基本原理,分析了各个子模块及其线性模型,推导了锁相环系统的传递函数,并且根据线性模型研究了锁相环环路的稳定性和相位噪声模型。在此基础上,完成了一个宽带小数频率综合器的系统结构设计。根据指标要求设计了小数分频器,主要包括高速二分频器、0.5步进可编程分频器和△-Σ调制器。高速二分频器使用电流模逻辑实现,在进行二分频的同时生成四相正交本振信号。0.5步进的分频比由0.5步进可编程分频器中的相位切换电路实现,而整数可编程分频器由2/3分频器级联实现。△-Σ调制器采用了改进结构的MASH1.1.1结构,能够增加输出序列长度以减小小数杂散,A-Σ调制器使用半定制的设计方法实现。另外还设计了基于频率比较法的自动频率校准单元以实现最优控制字搜索和环路带宽校准。最优控制字通过二进制搜索和最小值比较来实现,环路带宽校准则通过测量实际压控振荡器的调谐增益来调节电荷泵的电流以使环路带宽近似为常数。小数分频器和自动频率校准单元基于TSMC 0.18μm RF CMOS工艺下进行了设计,包含焊盘的小数分频器版图总面积为***0.58mm,自动频率校准单元面积为0.17mmx0.18mm,后仿真结果表明：在最差情况下小数分频器能够在0.4GHz-8GHz频率范围内正常分频,且分频比范围为121～1016,总电流为9.51mA,满足设计指标要求。而自动频率校准单元的平均工作电流小于0.5mA,频率分辨率为5MHz,总校准时间为16.6μs。自动频率校准单元和小数分频器已经应用于一个宽带频率综合器中,有待进一步测试验证。

关键词：多模多标准小数频率综合器小数分频器自动频率校准相位切换

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《固体电子学研究与进展》2010年(第30卷)第1～4期总目次

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固体电子学研究与进展 2010年第4期30卷 I0001-I0007页

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