检索结果-内蒙古大学图书馆

作者：林伟斌崔超赵云肖勇蔡梓文 510663 广东省广州市萝岗区科学城科翔路11号J1栋3、4、5楼及J3栋3楼

本发明公开了一种并行总线数据传输方法和装置，涉及通过并行总线通信连接的第一主终端和待传输终端，通过第一主终端响应用户输入的第一PUF激励信号和第一随机数组，采用复合型PUF结构生成第一密钥；发送第一密钥和第一预设数据选取规... 详细信息

标准号: CN112699393B

本发明公开了一种并行总线数据传输方法和装置，涉及通过并行总线通信连接的第一主终端和待传输终端，通过第一主终端响应用户输入的第一PUF激励信号和第一随机数组，采用复合型PUF结构生成第一密钥；发送第一密钥和第一预设数据选取规则到待传输终端；当第一主终端接收到第一待加密明文时，采用第一密钥对第一待加密明文进行加密，生成第一加密数据并沿并行总线传输到待传输终端；通过待传输终端采用第一密钥对第一加密数据进行解密，生成第一解密数据；按照第一预设数据选取规则筛选第一解密数据，生成第一目标明文，从而避免国际密码算法可能存在后门所带来的安全隐患，提高数据传输安全性。

关键词：传输终端密钥主终端待加密明文并行总线加密数据解密数据选取规则预设数据数据传输安全性并行总线传输国际密码算法方法和装置安全隐患激励信号数据传输随机数组通信连接解密明文后门加密发送筛选响应

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一种并行总线数据传输方法和装置

一种并行总线数据传输方法和装置

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作者：林伟斌崔超赵云肖勇蔡梓文 510663 广东省广州市萝岗区科学城科翔路11号J1栋3、4、5楼及J3栋3楼

标准号: CN112699393A

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基于S3C44B0X的大型LED显示系统设计

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单片机与嵌入式系统应用 2006年第2期6卷 59-61,64页

作者：粟梅林旷中南大学

介绍基于S3C44B0X控制的大型LED显示系统。数据传输采用并行总线方式,并提出将LED显示模块及显示锁存单元虚拟地视为一段连续的存储单元,利用S3C44B0X内部DMA控制器进行数据传输和控制,节省使用指令传输数据额外的软件开销,使其具有传... 详细信息

介绍基于S3C44B0X控制的大型LED显示系统。数据传输采用并行总线方式,并提出将LED显示模块及显示锁存单元虚拟地视为一段连续的存储单元,利用S3C44B0X内部DMA控制器进行数据传输和控制,节省使用指令传输数据额外的软件开销,使其具有传输速度快、效率高的特点,以达到用单CPU系统代替多机系统控制LED显示系统的目的。

关键词： ARMTTDMI S3C44B0X DMA LED显示系统并行总线传输

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多路隔离串口控制器

多路隔离串口控制器

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作者：钟景华刘金海 210013 江苏省南京市鼓楼区古平岗4号

本实用新型涉及一种多路隔离串口控制器，包括嵌入式集成芯片ARM、串口扩展芯片UART、数字隔离器，嵌入式集成芯片ARM与计算机进行通讯链接，嵌入式集成芯片ARM解析接收到的指令或数据，通过8bits并行总线传输到8路串口扩展芯片UART，2... 详细信息

标准号: CN205563554U

本实用新型涉及一种多路隔离串口控制器，包括嵌入式集成芯片ARM、串口扩展芯片UART、数字隔离器，嵌入式集成芯片ARM与计算机进行通讯链接，嵌入式集成芯片ARM解析接收到的指令或数据，通过8bits并行总线传输到8路串口扩展芯片UART，2n个串口扩展芯片UART支持8n路异步串口；8n路异步串口分别经过数字隔离器连接到量仪器，其中n大于等于1的整数。本实用新型控制器的设计实现计算机与多台设备仪器需在隔离条件下的通讯，并支持不同通讯标准协议间的转换。

关键词：串口扩展芯片嵌入式集成本实用新型数字隔离器异步串口芯片并行总线传输串口控制器多路隔离多台设备隔离条件通讯标准通讯链接控制器计算机解析指令转换通讯

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FPGA内并行总线数据采样窗口的校准方法、装置

FPGA内并行总线数据采样窗口的校准方法、装置

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作者：邬刚陈永 311100 浙江省杭州市余杭区余杭街道文一西路1818-1号5G创新园J1层-103M

本发明提出了一种FPGA内并行总线数据采样窗口的校准方法、装置，方法包括：并行总线传输第一时钟信号和校准信号；延时采样单元负责采样各个数据通道通传输的校准信号和第一时钟信号；解析采样数据，得到各通道之间通过并行总线传输校... 详细信息

标准号: CN114826503B

本发明提出了一种FPGA内并行总线数据采样窗口的校准方法、装置，方法包括：并行总线传输第一时钟信号和校准信号；延时采样单元负责采样各个数据通道通传输的校准信号和第一时钟信号；解析采样数据，得到各通道之间通过并行总线传输校准信号到达延时单元的时间差；综合时间校准延时单元，以使各个通道传输的数据同时到达接口采样单元，且采样时钟的采样节点始终位于并行总线数据采样窗口的稳定区域。本发明方案可实现并行总线数据采样窗口的校准，校准速度快、校准精度高，校准成本低，采样时钟的采样节点始终位于并行总线数据采样窗口的稳定区域，借助FPGA的硬件资源即可实现校准，无需额外的硬件。

关键词：校准并行总线数据采样校准信号并行总线传输采样节点采样时钟时钟信号稳定区域延时单元采样单元采样数据时间校准数据通道通道传输延时采样硬件资源时间差采样解析传输

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烧录设备及其数据传输控制方法、装置

烧录设备及其数据传输控制方法、装置

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作者：钟华 430223 湖北省武汉市东湖新技术开发区光谷大道58号1栋H01133(自贸区武汉片区)(一址多照)

本申请公开了一种烧录设备及其数据传输控制方法、装置。所述的数据传输控制方法包括：ARM芯片根据待烧录数据所属的数据类型，将其中的指令数据经并行总线传输至FPGA芯片，将其中的编程数据经MMC总线传输至FPGA芯片；FPGA芯片将并行总... 详细信息

标准号: CN112732281A

本申请公开了一种烧录设备及其数据传输控制方法、装置。所述的数据传输控制方法包括：ARM芯片根据待烧录数据所属的数据类型，将其中的指令数据经并行总线传输至FPGA芯片，将其中的编程数据经MMC总线传输至FPGA芯片；FPGA芯片将并行总线和MMC总线接收到的数据合路转存至预设的第三写缓冲区；FPGA芯片根据先进先出原则，从第三写缓冲区中读取出数据以将其写入至待烧录芯片。本申请提供的数据传输控制方法烧录数据具有高速、安全的特点，同时降低采用该数据传输控制方法的数据传输控制装置以及烧录设备的成本。

关键词：数据传输控制烧录设备烧录数据写缓冲区数据传输控制装置并行总线传输读取编程数据并行总线数据合路数据类型指令数据总线传输总线烧录预设转存申请写入芯片安全

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FPGA内并行总线数据采样窗口的校准方法、装置

FPGA内并行总线数据采样窗口的校准方法、装置

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作者：邬刚陈永 311100 浙江省杭州市余杭区余杭街道文一西路1818-1号5G创新园J1层-103M

标准号: CN114826503A

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一种局部总线结构及数据交互方法

一种局部总线结构及数据交互方法

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作者：黄松石桂连齐敏张春雷陈乃奎 100094 北京市海淀区永丰路5号院5号楼101

本发明提供一种用于核电仪控系统的多FPGA之间数据可靠通讯的局部总线结构，包括主FPGA，两个及两个以上从FPGA，所述主FPGA与从FPGA之间通过全双工并行总线传输数据，其特征在于，所述主FPGA和从FPGA为内嵌黑盒IP核的FPGA；所述主FPGA... 详细信息

标准号: CN105068955B

本发明提供一种用于核电仪控系统的多FPGA之间数据可靠通讯的局部总线结构，包括主FPGA，两个及两个以上从FPGA，所述主FPGA与从FPGA之间通过全双工并行总线传输数据，其特征在于，所述主FPGA和从FPGA为内嵌黑盒IP核的FPGA；所述主FPGA包括设有CRC(循环冗余校验)的数据处理模块，总线数据收发控制器，I/O模块，从FPGA包括设有CRC的数据处理模块，接收数据双口RAM，发送数据双口RAM，I/O模块。采用本发明的总线结构和方法，解决了多FPGA之间的数据可靠通信的问题，还自定义的总线方式，总线控制器自行编写，满足了核电行业不能用黑盒IP的特定要求。

关键词：数据处理模块双口RAM 黑盒并行总线传输核电仪控系统循环冗余校验总线数据收发总线控制器核电行业接收数据局部总线可靠通信可靠通讯总线方式总线结构控制器全双工自定义内嵌

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