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文字说明：

T=题名（书名、题名），A=作者（责任者），K=主题词，P=出版物名称，PU=出版社名称，O=机构（作者单位、学位授予单位、专利申请人），L=中图分类号，C=学科分类号，U=全部字段，Y=年（出版发行年、学位年度、标准发布年）

检索规则说明：

AND代表“并且”；OR代表“或者”；NOT代表“不包含”；(注意必须大写,运算符两边需空一格)

检索范例：

范例一：(K=图书馆学 OR K=情报学) AND A=范并思 AND Y=1982-2016
范例二：P=计算机应用与软件 AND (U=C++ OR U=Basic) NOT K=Visual AND Y=2011-2016

分类表

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限定检索结果

文献类型

13 篇 专利

馆藏范围

13 篇 电子文献
0 种 纸本馆藏

日期分布

机构

2 篇 华中科技大学
2 篇 上海红神信息技术...
2 篇 浙江驰拓科技有限...
2 篇 天津市滨海新区信...
2 篇 苏州雄立科技有限...
2 篇 武汉虹识技术有限...
2 篇 天津芯海创科技有...
1 篇 青岛中星微电子有...
1 篇 桂林电子科技大学
1 篇 上海红阵信息科技...
1 篇 江苏拟态极算信息...
1 篇 北京比特大陆科技...
1 篇 深圳云豹智能有限...

作者

3 篇 马贤
2 篇 王乾
2 篇 邬江兴
2 篇 刘波
2 篇 闫振林
2 篇 宋克
2 篇 魏来
2 篇 刘冬生
2 篇 吕平
2 篇 魏帅
2 篇 张贤斌
2 篇 托马斯·费尔兰德斯...
2 篇 姜海斌
2 篇 高彦钊
2 篇 高俊雄
2 篇 朱珂
2 篇 张帆
2 篇 王盼
2 篇 杜延康
2 篇 刘子龙

语言

13 篇 中文

检索条件"主题词=总线互联模块"

共 13 条记录，以下是1-10 订阅

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详细简洁

排序：

总线互联模块的集成方法、装置以及验证方法和装置

总线互联模块的集成方法、装置以及验证方法和装置

引用

作者：李树杰 266109 山东省青岛市高新区智力岛路1号创业大厦C座6层

本发明提供一种系统芯片中总线互联模块的集成方法、装置以及验证方法和装置。所述系统芯片中总线互联模块的集成方法，包括：获取系统芯片中总线互联模块的设计属性列表文件；根据所述设计属性列表文件，自动生成集成所述总线互联模块... 详细信息

标准号: CN103150281B

本发明提供一种系统芯片中总线互联模块的集成方法、装置以及验证方法和装置。所述系统芯片中总线互联模块的集成方法，包括：获取系统芯片中总线互联模块的设计属性列表文件；根据所述设计属性列表文件，自动生成集成所述总线互联模块的代码。所述系统芯片中总线互联模块的验证方法，包括：获取系统芯片中总线互联模块的设计属性列表文件；根据所述设计属性列表文件，自动生成测试所述总线互联模块的代码。本发明能够提供系统芯片中总线互联模块的集成和验证效率。

关键词：总线互联模块列表文件设计属性系统芯片获取系统集成方法验证方法自动生成芯片提供系统验证效率一种测试

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命令处理方法、装置、系统

命令处理方法、装置、系统

引用

作者：陈永光黄勇平 518000 广东省深圳市前海深港合作区前湾一路1号A栋201室(入驻深圳市前海商务秘书有限公司)

本发明公开了一种命令处理方法、装置、系统，该方法包括：在主机模块的当前待使用信用值满足命令发送条件的情况下，向总线互联模块发送待处理命令，以通过总线互联模块将待处理命令发送至从机模块；接收并根据总线互联模块发送的第一... 详细信息

标准号: CN116150051A

本发明公开了一种命令处理方法、装置、系统，该方法包括：在主机模块的当前待使用信用值满足命令发送条件的情况下，向总线互联模块发送待处理命令，以通过总线互联模块将待处理命令发送至从机模块；接收并根据总线互联模块发送的第一信号和/或从机模块发送的第二信号更新当前待使用信用值，第一信号表示总线互联模块已响应待处理命令，第二信号表示从机模块已响应目标命令，目标命令为待处理命令或缓存在主机模块与从机模块之间的链路上的其他待处理命令，其他待处理命令的时间发送先于待处理命令的发送时间值。通过本技术方案，有效了降低人力成本和时间成本，提高了迭代效率，并且能够精确控制主机模块命令发送。

关键词：处理命令总线互联模块从机模块发送第二信号主机模块控制主机命令处理命令发送模块命令目标命令人力成本时间成本时间发送响应目标信用迭代响应更新

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一种基于AXI协议的总线通信方法及装置

一种基于AXI协议的总线通信方法及装置

引用

作者：王乾闫振林 215000 江苏省苏州市工业园区金鸡湖大道1355号国际科技园二期E-502-1

本申请提供的一种基于AXI协议的总线通信方法及装置，支持多数据同时访问，利用存储控制模块对访问数据进行缓存。利用第一多路选择器和第二多路选择器为数据选择输入端口或输出端口。利用第一总线互联模块和第二总线互联模块对数据传... 详细信息

标准号: CN114416621B

本申请提供的一种基于AXI协议的总线通信方法及装置，支持多数据同时访问，利用存储控制模块对访问数据进行缓存。利用第一多路选择器和第二多路选择器为数据选择输入端口或输出端口。利用第一总线互联模块和第二总线互联模块对数据传输顺序进行限定，同时根据寄存器内储存的从设备编号对目标数据进行校验保证了数据传输的有序性和准确性。结合存储控制模块中设置的预取空间与仲裁器内置的数据传输优先级判断规则省去了主设备在访问从设备时，需要等待访问数据结果回执再进行下一次访问的步骤，提升了数据交换的效率。

关键词：总线互联模块多路选择器访问数据数据传输从设备存储控制模块数据传输顺序缓存优先级判断结合存储控制模块目标数据输出端口输入端口数据交换数据选择总线通信访问校验寄存器仲裁器主设备内置预取回执储存申请保证

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一种基于FDMA DDR存储器读写设计

一种基于FDMA DDR存储器读写设计

引用

作者：许川佩马贤王阳 541004 广西壮族自治区桂林市金鸡路1号

本发明提供的是一种基于FDMA DDR存储器块读写设计。其特征是：它是由FDMA读写控制模块1、DMA模块2、AXI4总线互联模块3、MIG IP模块4、DDR存储器模块5、XDMA6、中断控制模块7、PC机8组成。使用FDMA(Quest Direct Memory Access，快速... 详细信息

标准号: CN116431539A

本发明提供的是一种基于FDMA DDR存储器块读写设计。其特征是：它是由FDMA读写控制模块1、DMA模块2、AXI4总线互联模块3、MIG IP模块4、DDR存储器模块5、XDMA6、中断控制模块7、PC机8组成。使用FDMA(Quest Direct Memory Access，快速直接存储器访问)模式和AXI4总线读写DDR存储器能够尽可能的提高读写数据的速率和可靠性。同时对AXI4‑FULL总线接口进行了封装，同时定义了简单的APP接口提供用户调用AXI4总线实现数据交互。本发明可用于高速数据采集、高速数据传输等领域。

关键词：读写直接存储器访问读写控制模块高速数据采集高速数据传输中断控制模块总线互联模块读写数据接口提供数据交互总线接口总线实现速率和总线可用调用封装

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芯片制造方法及芯片结构

芯片制造方法及芯片结构

引用

作者：王逵 100192 北京市海淀区宝盛南路1号院25号楼2层

本公开公开了一种芯片制造方法及芯片结构。所述方法包括：在第一晶圆上制作多个第一掩膜单元，第一掩膜单元包括处理器簇群、第一存储器、存储通道、串行通道、控制器和总线接口模块中的一种或多种；在第一晶圆上制作第一连接点；在第... 详细信息

标准号: CN112805820A

本公开公开了一种芯片制造方法及芯片结构。所述方法包括：在第一晶圆上制作多个第一掩膜单元，第一掩膜单元包括处理器簇群、第一存储器、存储通道、串行通道、控制器和总线接口模块中的一种或多种；在第一晶圆上制作第一连接点；在第二晶圆上制作多个第二掩膜单元，第二掩膜单元包括第二存储器、扩展模块和总线互联模块中的一种或多种；在第二晶圆上制作第二连接点；将第一晶圆和第二晶圆通过第一连接点和第二连接点键合在一起，对晶圆进行切割，切割得到的芯片尺寸与第二掩膜单元的尺寸相同。本公开技术方案可以大大节省芯片生产时产生的一次性费用，不仅能够节省时间和人力成本，还能够降低每个单一规格或性能产品的生产风险和生产成本。

关键词：晶圆掩膜单元连接点制作切割总线互联模块总线接口模块第二存储器一次性费用处理器簇串行通道存储通道扩展模块人力成本芯片结构芯片生产芯片制造性能产品存储器控制器键合生产成本芯片生产

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总线结构实现方法及装置

总线结构实现方法及装置

引用

作者：高俊雄易开军托马斯·费尔兰德斯张贤斌 430000 湖北省武汉市东湖新技术开发区高新大道999号

本发明提供一种总线结构实现方法及装置，涉及计算机技术领域，该方法包括：获取总线输入数据的数据标识信息，对数据标识信息和预先设置的设备标识信息进行匹配；若数据标识信息和设备标识信息匹配成功，接收总线输入数据。通过获取总... 详细信息

标准号: CN109471818A

本发明提供一种总线结构实现方法及装置，涉及计算机技术领域，该方法包括：获取总线输入数据的数据标识信息，对数据标识信息和预先设置的设备标识信息进行匹配；若数据标识信息和设备标识信息匹配成功，接收总线输入数据。通过获取总线输入数据的数据标识信息，对数据标识信息和预先设置的设备标识信息进行匹配；若数据标识信息和设备标识信息匹配成功，接收总线输入数据。对接收的总线输入数据进行处理，使得主从设备合为一个设备，不需要通过总线互联模块进行解析和仲裁，提高了总线输入数据传输之间的效率。

关键词：数据标识信息总线设备标识信息匹配成功预先设置匹配计算机技术领域总线互联模块主从设备总线结构解析仲裁传输

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面向生物特征任务的拟态一体化处理系统与方法

面向生物特征任务的拟态一体化处理系统与方法

引用

作者：尤文杰谢光伟邬锡敏 201100 上海市闵行区联航路1588号3幢A501室

本发明公开了面向生物特征任务的拟态一体化处理系统与方法，涉及生物识别技术领域，包括：多业务模块，用于向总线互联模块发送下行数据，以及从总线互联模块接收上行数据；拟态一体化处理模块，用于对接收到的多个业务进行识别处理，... 详细信息

标准号: CN111913834A

本发明公开了面向生物特征任务的拟态一体化处理系统与方法，涉及生物识别技术领域，包括：多业务模块，用于向总线互联模块发送下行数据，以及从总线互联模块接收上行数据；拟态一体化处理模块，用于对接收到的多个业务进行识别处理，并识别系统中可以利用的处理资源，进行执行判决，根据判决结果通过总线互联模块向对应的异构执行组合分发任务，以及接收异构执行组合反馈的上行数据。本发明通过设置的拟态一体化处理模块和异构计算资源模块，实现了当系统发生攻击、故障等意外事件时，可以容忍错误、屏蔽异常，保证任务的正常执行，提高生物特征数据安全性以及网络安全可靠性。

关键词：总线互联模块一体化处理上行数据异构一体化处理系统生物识别技术生物特征数据异构计算资源处理资源判决结果生物特征识别系统网络安全系统发生下行数据意外事件多业务屏蔽分发发送反馈攻击判决保证

来源：评论

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拟态工控处理器及数据处理方法

拟态工控处理器及数据处理方法

引用

作者：谭力波邬江兴吕平刘勤让朱珂沈剑良宋克张兴明魏帅高彦钊张帆王盼董春雷姜海斌杜延康 300450 天津市滨海新区滨海-中关村科技园荣晟广场4号楼702-7

本发明公开了一种拟态工控处理器及数据处理方法，涉及工控处理器领域，包括：多个CPU内核、总线互连模块、拟态功能模块和多个处理器接口，拟态功能模块单元，实现处理器输入或者输出数据的拟态化计算与处理，当向处理器接口输出数据... 详细信息

标准号: CN109408452A

本发明公开了一种拟态工控处理器及数据处理方法，涉及工控处理器领域，包括：多个CPU内核、总线互连模块、拟态功能模块和多个处理器接口，拟态功能模块单元，实现处理器输入或者输出数据的拟态化计算与处理，当向处理器接口输出数据时，对接收到的多个下行数据进行拟态判决，根据判决结果向处理器接口输出正确状态的下行数据；当接收处理器接口输入数据时，确定流量处理能力满足预设条件的CPU内核的内核标识，再通过总线互联模块将接收到的上行数据发送给与上行数据携带的内核标识所对应的CPU内核。本发明的一种拟态工控处理器，可以对各个CPU内核的输出数据进行判决，输出正确结果，并引入拟态数据流量均衡机制，实现不同异构CPU内核的负荷性能均衡。