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文字说明：

T=题名（书名、题名），A=作者（责任者），K=主题词，P=出版物名称，PU=出版社名称，O=机构（作者单位、学位授予单位、专利申请人），L=中图分类号，C=学科分类号，U=全部字段，Y=年（出版发行年、学位年度、标准发布年）

检索规则说明：

AND代表“并且”；OR代表“或者”；NOT代表“不包含”；(注意必须大写,运算符两边需空一格)

检索范例：

范例一：(K=图书馆学 OR K=情报学) AND A=范并思 AND Y=1982-2016
范例二：P=计算机应用与软件 AND (U=C++ OR U=Basic) NOT K=Visual AND Y=2011-2016

分类表

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文献类型

41 篇 专利
4 篇 期刊文献

馆藏范围

45 篇 电子文献
0 种 纸本馆藏

日期分布

学科分类号

4 篇 工学
- 2 篇 计算机科学与技术...
- 1 篇 机械工程
- 1 篇 电子科学与技术（可...
- 1 篇 控制科学与工程
- 1 篇 软件工程
1 篇 管理学
- 1 篇 管理科学与工程(可...

主题

4 篇 总线效率
1 篇 现场总线
1 篇 ahb
1 篇 拓扑结构
1 篇 总线
1 篇 公平仲裁
1 篇 总线负载率
1 篇 总线速度
1 篇 as5643
1 篇 乱序操作
1 篇 1553b总线
1 篇 集成电路设计
1 篇 sram

机构

3 篇 烽火通信科技股份...
2 篇 成都成电光信科技...
2 篇 钜泉光电科技股份...
2 篇 南京国电南自轨道...
2 篇 西安智多晶微电子...
2 篇 上海高清数字科技...
2 篇 深圳市航顺芯片技...
2 篇 杭州旗捷科技有限...
2 篇 山东神戎电子股份...
2 篇 山东云海国创云计...
2 篇 硅谷数模半导体有...
1 篇 国微技术有限公司
1 篇 上海登临科技有限...
1 篇 赛丽电子系统有限...
1 篇 威盛电子股份有限...
1 篇 集成电路与微系统...
1 篇 北京航天航空大学
1 篇 国网上海市电力公...
1 篇 杭州国芯科技有限...
1 篇 中国航空工业集团...

作者

2 篇 邱昆
2 篇 郑成根
2 篇 王白羽
2 篇 范三龙
2 篇 刘国兴
2 篇 王翔
2 篇 李瑞
2 篇 黄戈
2 篇 王绮卉
2 篇 韦嵚
2 篇 梁伟强
2 篇 吕俊杰
2 篇 马孔明
2 篇 张林
2 篇 赵璠
2 篇 张红荣
2 篇 张涛
2 篇 高国敬
2 篇 郭浩军
2 篇 解军

语言

45 篇 中文

检索条件"主题词=总线效率"

共 45 条记录，以下是11-20 订阅

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详细简洁

排序：

DRAM存储控制方法及装置

DRAM存储控制方法及装置

引用

作者：冯波张涛陶志飞 430074 湖北省武汉市东湖开发区关东科技园东信路5号

本发明公开了一种DRAM存储控制方法及装置，该方法包括：A10、对读、写请求解码，并根据BANK地址重新排列成多个基于各BANK的读、写请求队列；A20、分别对读、写请求进行仲裁；A30、分别生成各自的读、写请求命令以及激活命令和/或预充... 详细信息

标准号: CN101788963A

本发明公开了一种DRAM存储控制方法及装置，该方法包括：A10、对读、写请求解码，并根据BANK地址重新排列成多个基于各BANK的读、写请求队列；A20、分别对读、写请求进行仲裁；A30、分别生成各自的读、写请求命令以及激活命令和/或预充电命令；A40、将读、写请求命令送至命令总线，并在满足DRAM读、写保护时限的前提下，在该BANK读、写请求队列中的读、写命令请求命令之前插入其他BANK读、写请求队列中的读、写命令请求的激活命令和/或预充电命令。本发明，将激活指令和预充电指令可以完全隐藏在数据传输过程中，表面上DRAM数据总线一直在进行数据传输，因此大大提高了DRAM的总线效率。

关键词：队列充电命令命令请求激活存储控制方法数据传输过程解码充电指令命令总线数据传输数据总线总线效率写保护排列仲裁时限指令

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一种适用于总线架构的多协议兼容通信方法和系统

一种适用于总线架构的多协议兼容通信方法和系统

引用

作者：王素唐玉建郭明星陈河张春雁窦真兰吕冉刘瑞赵晨晨葛涛黄波李明秦晓敏李阳顾佳康侯智子徐杨丽 200122 上海市浦东新区自由贸易试验区源深路1122号

本发明涉及一种适用于总线架构的多协议兼容通信方法和系统，用于主机和多个从机之间的通信，方法包括：在主机中设置主机总线协议层软件，从机中设置从机总线协议层软件，主机中设有多个应用程序，从机中设有一个或多个从机功能块；当... 详细信息

标准号: CN118301224A

本发明涉及一种适用于总线架构的多协议兼容通信方法和系统，用于主机和多个从机之间的通信，方法包括：在主机中设置主机总线协议层软件，从机中设置从机总线协议层软件，主机中设有多个应用程序，从机中设有一个或多个从机功能块；当主机上的应用程序需要向从机功能块发送数据时，应用程序将数据报文发送至主机总线协议层软件，主机总线协议层软件生成对应从机功能块的CANid地址，并与接收到的数据报文构成数据包，发送至对应的从机；收到数据包的从机的从机总线协议层软件根据数据包解析到CANid地址和数据报文，由CANid地址对应的从机功能块处理相应的报文内容。与现有技术相比，本发明实现了交互过程解耦，提高了总线效率，提高了数据帧中有效数据占比。

关键词：协议层软件功能块主机应用程序主机总线从机总线数据报文数据包数据报文发送数据包解析报文内容地址对应交互过程有效数据总线架构总线效率多协议数据帧解耦通信兼容发送

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卷积交织/解交织的实现方法及装置

卷积交织/解交织的实现方法及装置

引用

作者：黄戈梁伟强王白羽钱宏达李瑞郑成根江陶柯仙胜薛亚萍 200125 上海市浦东新区东三里桥路1018号B座8楼高清

本发明提出了一种提高总线效率和降低DDR带宽的卷积交织/解交织实现方法和装置，其至少包括：根据发送/接收系统交织传输速率计算出DDR最小占用带宽；根据卷积交织参数计算出最小占用带宽时所需DDR存储空间；根据DDR参数、AXI总线参数... 详细信息

标准号: CN103916140B

本发明提出了一种提高总线效率和降低DDR带宽的卷积交织/解交织实现方法和装置，其至少包括：根据发送/接收系统交织传输速率计算出DDR最小占用带宽；根据卷积交织参数计算出最小占用带宽时所需DDR存储空间；根据DDR参数、AXI总线参数、交织参数计算出数据整形存储器参数以及产生Local地址、AXI总线连读或连写长度范围；根据产生的数据整形存储器参数,local地址规则，转换到AXI总线地址，完成和DDR的数据交互；该方法以降低DDR带宽和提高总线效率为优先考量，对存储规则和读写地址进行特殊设计，使得将交织对DDR带宽的占用最小化，同时大幅提高总线的读写效率。

关键词：带宽存储器参数卷积交织总线效率占用整形传输速率计算方法和装置参数计算存储规则地址规则读写地址交织参数接收系统数据交互总线解交织最小化读写发送转换

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一种基于对等结构的多节点数据交互方法

一种基于对等结构的多节点数据交互方法

引用

作者：边庆程俊强段小虎周啸王博段宇博 710065 陕西省西安市雁塔区高新区锦业二路15号

本发明一种基于对等结构的多节点数据交互方法,属于高可靠容错计算机技术领域。该方法采用多节点对等结构、高速串行总线方式和双端口存储模式，提供多处理器间或处理器与I/O接口高速传输能力，在有限任务周期内完成多节点间数据交互，... 详细信息

标准号: CN111045966A

本发明一种基于对等结构的多节点数据交互方法,属于高可靠容错计算机技术领域。该方法采用多节点对等结构、高速串行总线方式和双端口存储模式，提供多处理器间或处理器与I/O接口高速传输能力，在有限任务周期内完成多节点间数据交互，多节点间通信相互独立，构建一个多处理器组成的容错计算机。多个容错计算机间可灵活配置余度模式，实现具有高可靠性、高安全性和可配置的容错计算机系统。本发明的优点是多节点间为点对点对等方式传输、多条链路可以同时传输、有效提高使总线效率、简化硬件设计、不占用处理器资源，并且从系统角度整合资源，提高容错计算机系统综合化、通用性水平。

关键词：容错计算机多节点容错计算机系统对等结构多处理器多节点间通信高速串行总线处理器资源多节点数据双端口存储传输对等方式多条链路高安全性高可靠性高速传输简化硬件可配置的灵活配置任务周期数据交互总线效率点对点高可靠综合化处理器构建整合占用

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一种DDR2/3内存控制器的命令重排方法

一种DDR2/3内存控制器的命令重排方法

引用

作者：王艳敏石志垚贾弘翊韦嶔张红荣 710075 陕西省西安市高新区科技二路72号西安软件园零壹广场裙楼DEF101

本发明提供了一种DDR2/3内存控制器的命令重排方法，应用于FPGA，本发明的方法使用了多个缓存队列来缓存其他模块的命令，以便在命令重排模块中实现多级流水。命令重排模块对输入进来的命令进行命令重排，根据重排结果将命令输出或缓存... 详细信息

标准号: CN116893992A

本发明提供了一种DDR2/3内存控制器的命令重排方法，应用于FPGA，本发明的方法使用了多个缓存队列来缓存其他模块的命令，以便在命令重排模块中实现多级流水。命令重排模块对输入进来的命令进行命令重排，根据重排结果将命令输出或缓存至缓冲器，以减少不必要的内存激活或者预充电的命令操作，从而提高记忆总线效率，可以满足不同的客户需求进而提高记忆总线效率。

关键词：重排缓存总线效率缓冲器内存控制器多级流水方法使用缓存队列客户需求命令操作命令输出预充电内存激活应用

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一种分段总线架构的帧处理模块

一种分段总线架构的帧处理模块

引用

作者：马佩军王宇史江义潘伟涛季冠捷郭志文杨浩 710071 陕西省西安市太白南路2号

本发明提供了一种分段总线架构的帧处理模块，包括通路选择模块、帧信息收集模块、动作码解析模块、数据缓存FIFO模块和总线控制模块。本发明采用分段总线形式替换原先的单一总线，并根据分段总线对处理模块的要求，重新设计了数据帧处... 详细信息

标准号: CN118301105A

本发明提供了一种分段总线架构的帧处理模块，包括通路选择模块、帧信息收集模块、动作码解析模块、数据缓存FIFO模块和总线控制模块。本发明采用分段总线形式替换原先的单一总线，并根据分段总线对处理模块的要求，重新设计了数据帧处理的电路逻辑，可以提高数据帧在处理过程中的总线效率。由于对数据帧的处理会涉及对其中数据内容的增删改操作，导致数据在总线段上的分布产生变化，重新分配数据在分段总线中的位置。本发明可以提高数据帧传输的安全性，且可以适应不同的场景的数据帧传输。

关键词：分段数据帧传输总线数据帧通路选择模块总线控制模块数据帧处理帧处理模块处理模块单一总线电路逻辑解析模块收集模块数据缓存数据内容重新分配重新设计总线架构总线效率总线形式动作码帧信息总线段替换场景

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一种指令搬移方法、系统、设备以及介质

一种指令搬移方法、系统、设备以及介质

引用

作者：马孔明赵璠马恒王振 250000 山东省济南市中国(山东)自由贸易试验区济南片区浪潮路1036号浪潮科技园S01楼35层

本发明公开了一种指令搬移方法，包括以下步骤：响应于接收到主机下发到IO请求，根据所述请求中携带的指令的地址参数更新对应任务中的第一指针信息；检测每一个任务中的第一指针信息是否达到预设值；响应于检测到第一指针信息达到预设... 详细信息

标准号: CN114816566B

本发明公开了一种指令搬移方法，包括以下步骤：响应于接收到主机下发到IO请求，根据所述请求中携带的指令的地址参数更新对应任务中的第一指针信息；检测每一个任务中的第一指针信息是否达到预设值；响应于检测到第一指针信息达到预设值，置位相应任务的第一标记和第二标记；响应于检测到第一标记置位且当前没有其他任务的第二标记处于置位状态，根据所述第一指针信息搬移对应的连续指令；响应于所述连续指令搬移完成，恢复已置位的第一标记和第二标记。本发明还公开了一种系统、计算机设备以及可读存储介质。本发明提出的方案可以实现连续指令的搬移，相较于传统的单指令搬移有着更高的总线效率，在空间局部性好的程序中，性能提升明显。

关键词：搬移指针信息连续指令响应预设置位检测指令可读存储介质计算机设备空间局部性标记置位地址参数性能提升置位状态总线效率传统的单指令主机携带更新恢复

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卷积交织/解交织的实现方法及装置

卷积交织/解交织的实现方法及装置

引用

作者：黄戈梁伟强王白羽钱宏达李瑞郑成根江陶柯仙胜薛亚萍 200125 上海市浦东新区东三里桥路1018号

标准号: CN103916140A

关键词：带宽交织总线存储器参数参数计算数据整形总线效率读写发送/接收系统长度范围传输速率存储空间地址规则数据交互特殊设计总线地址连写对存储解交织最小化转换

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DRAM存储控制方法及装置

DRAM存储控制方法及装置

引用

作者：冯波张涛陶志飞 430074 湖北省武汉市东湖开发区关东科技园东信路5号

本发明公开了一种DRAM存储控制方法及装置，该方法包括：A10、对读、写请求解码，并根据BANK地址重新排列成多个基于各BANK的读、写请求队列；A20、分别对读、写请求进行仲裁；A30分别生成各自的读、写请求命令以及激活命令和/或预充电... 详细信息

标准号: CN101788963B

本发明公开了一种DRAM存储控制方法及装置，该方法包括：A10、对读、写请求解码，并根据BANK地址重新排列成多个基于各BANK的读、写请求队列；A20、分别对读、写请求进行仲裁；A30分别生成各自的读、写请求命令以及激活命令和/或预充电命令；A40、将读、写请求命令送至命令总线，并在满足DRAM读、写保护时限的前提下，在该BANK读、写请求队列中的读、写命令请求命令之前插入其他BANK读、写请求队列中的读、写命令请求的激活命令和/或预充电命令。本发明，将激活指令和预充电指令可以完全隐藏在数据传输过程中，表面上DRAM数据总线一直在进行数据传输，因此大大提高了DRAM的总线效率。

关键词：队列充电命令命令请求激活存储控制方法数据传输过程解码充电指令命令总线数据传输数据总线总线效率写保护排列仲裁时限指令

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一种指令处理方法、CPU交互系统及采用该系统的耗材芯片

一种指令处理方法、CPU交互系统及采用该系统的耗材芯片

引用

作者：刘天翔 310000 浙江省杭州市滨江区滨安路1180号1幢4层421室

一种指令处理方法、CPU交互系统及采用该系统的耗材芯片，属于数据处理技术领域。方法用于CPU交互系统，CPU交互系统包括连接于总线上的主交互模块、从交互模块、任务处理模块。CPU交互系统还包括探测模块；方法包括：当主交互模块访问... 详细信息

标准号: CN109460254A

一种指令处理方法、CPU交互系统及采用该系统的耗材芯片，属于数据处理技术领域。方法用于CPU交互系统，CPU交互系统包括连接于总线上的主交互模块、从交互模块、任务处理模块。CPU交互系统还包括探测模块；方法包括：当主交互模块访问从交互模块时，探测模块探测指令空隙；指令空隙为相邻指令之间的空闲期；探测模块针对指令空隙匹配主交互模块于指令空隙内可执行的任务指令，并将匹配到任务指令反馈给主交互模块；主交互模块根据探测模块反馈的任务指令分时访问任务处理模块。耗材芯片采用上述CPU交互系统。本发明在不影响常用指令执行过程下充分利用指令空隙执行额外的工作指令，提高总线效率和CPU利用率。

关键词：主交互模块交互系统探测模块任务指令指令任务处理模块耗材芯片交互模块匹配数据处理技术指令执行过程反馈分时访问工作指令探测指令相邻指令指令处理总线效率可执行空闲期总线访问

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