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文字说明：

T=题名（书名、题名），A=作者（责任者），K=主题词，P=出版物名称，PU=出版社名称，O=机构（作者单位、学位授予单位、专利申请人），L=中图分类号，C=学科分类号，U=全部字段，Y=年（出版发行年、学位年度、标准发布年）

检索规则说明：

AND代表“并且”；OR代表“或者”；NOT代表“不包含”；(注意必须大写,运算符两边需空一格)

检索范例：

范例一：(K=图书馆学 OR K=情报学) AND A=范并思 AND Y=1982-2016
范例二：P=计算机应用与软件 AND (U=C++ OR U=Basic) NOT K=Visual AND Y=2011-2016

分类表

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文献类型

103 篇 专利

馆藏范围

103 篇 电子文献
0 种 纸本馆藏

日期分布

机构

17 篇 三星电子株式会社
8 篇 美光科技公司
6 篇 深圳市明微电子股...
5 篇 航天长征火箭技术...
5 篇 北京遥测技术研究...
4 篇 京东方科技集团股...
4 篇 赛普拉斯半导体公...
3 篇 爱思开海力士有限...
3 篇 浙江一舟电子科技...
3 篇 三星显示有限公司
2 篇 华中科技大学
2 篇 安凯微电子技术有...
2 篇 惠科股份有限公司
2 篇 上海贝岭股份有限...
2 篇 中国电子科技集团...
2 篇 东芯半导体股份有...
2 篇 苏州普源精电科技...
2 篇 佳世达科技股份有...
2 篇 恩智浦美国有限公...
2 篇 成都国腾实业集团...

作者

6 篇 李照华
6 篇 吕苏谊
6 篇 陈克勇
6 篇 石磊
5 篇 吴台荣
5 篇 李炫柳
5 篇 罗霞
5 篇 河庆洙
5 篇 郑建君
5 篇 金康永
4 篇 金始弘
4 篇 c·济特劳
4 篇 a·罗尚曼
4 篇 金荣勋
4 篇 y·贝瑟尔
4 篇 s·罗斯纳
4 篇 k·达农
3 篇 王发明
3 篇 李国添
3 篇 符传汇

语言

103 篇 中文

检索条件"主题词=数据时钟信号"

共 103 条记录，以下是21-30 订阅

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详细简洁

排序：

显示装置和驱动显示装置的方法

显示装置和驱动显示装置的方法

引用

作者：朴彩嬉金锺洙金白李智叡郑永昔韩国京畿道

提供了显示装置和驱动显示装置的方法。该显示装置包括：时序控制器，配置为在第一初始化时段期间通过数据时钟信号线供给调整选项值，并且在数据时段期间基于第一数据和控制信号生成第二数据并通过数据时钟信号线供给第二数据；数据驱... 详细信息

标准号: CN116153236A

提供了显示装置和驱动显示装置的方法。该显示装置包括：时序控制器，配置为在第一初始化时段期间通过数据时钟信号线供给调整选项值，并且在数据时段期间基于第一数据和控制信号生成第二数据并通过数据时钟信号线供给第二数据；数据驱动器，配置为在第一初始化时段期间基于调整选项值生成调整值，并且在数据时段期间基于调整值和第二数据生成第三数据并基于第三数据生成数据信号；以及像素，配置为基于数据信号显示图像。

关键词：数据时钟信号数据生成数据时段显示装置初始化选项配置控制信号生成驱动显示装置数据信号显示时序控制器数据驱动器第一数据数据信号像素图像

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数据提取电路

数据提取电路

引用

作者：李思曼 230011 安徽省合肥市经济开发区空港工业园兴业大道388号

本申请提提供一种数据提取电路，包括：第一输入电路，其输入端在第一数据时钟信号的触发下建立第一输入数据及在第二数据时钟信号的触发下建立第二输入数据，用于在锁存时钟信号的触发下锁存第一输入数据和第二输入数据；第二输入电路... 详细信息

标准号: CN116453557A

本申请提提供一种数据提取电路，包括：第一输入电路，其输入端在第一数据时钟信号的触发下建立第一输入数据及在第二数据时钟信号的触发下建立第二输入数据，用于在锁存时钟信号的触发下锁存第一输入数据和第二输入数据；第二输入电路，其输入端在第一数据时钟信号的触发下建立第一标识数据及在第二数据时钟信号的触发下建立第二标识数据，用于在锁存时钟信号的触发下锁存第一标识数据和第二标识数据，输出电路，其设有第一输出端和第二输出端，其与第一输入电路连接，还与第二输入电路连接，用于在第一标识数据和第二标识数据的控制下，在第一输出端输出第一输入数据，并在第二输出端同步输出第二输入数据，以实现对两个周期数据的区分。

关键词：标识数据触发输入电路输出端数据时钟信号锁存时钟信号第一数据时钟信号输入端锁存数据提取电路输出电路周期数据输出申请

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具有存储体分配的多端口非易失性存储器设备以及相关系统和方法

具有存储体分配的多端口非易失性存储器设备以及相关系统和方法

引用

作者： Y·贝瑟尔 C·济特劳 S·罗斯纳 K·达农 A·罗尚曼美国加利福尼亚州

一种非易失性存储器设备可以包括：串行端口，其包括：至少一个串行时钟输入；以及至少一个串行数据输入/输出(I/O)，其被配置为与至少一个串行时钟输入同步地接收命令、地址和写入数据。至少一个并行端口可以包括：多个命令地址输入，... 详细信息

标准号: CN116049050A

一种非易失性存储器设备可以包括：串行端口，其包括：至少一个串行时钟输入；以及至少一个串行数据输入/输出(I/O)，其被配置为与至少一个串行时钟输入同步地接收命令、地址和写入数据。至少一个并行端口可以包括：多个命令地址输入，其被配置为以并行位的组接收命令和地址数据；以及多个单向数据输出，其被配置为在数据时钟信号的上升沿和下降沿并行地输出读取数据。多个存储体中的每一个可以包括非易失性存储器单元，并且能够被配置用于由串行端口或并行端口访问。当存储体被配置用于由串行端口访问时，存储体不能由至少一个并行端口访问。还公开了相关方法和系统。

关键词：并行端口串行端口存储体配置串行时钟并行非易失性存储器单元非易失性存储器串行数据输入数据时钟信号单向数据地址数据接收命令命令地址输出读取输入同步写入数据输出访问上升沿下降沿组接收

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用于高时间数字转换器（TDC）分辨率的校准方法和设备

用于高时间数字转换器（TDC）分辨率的校准方法和设备

引用

作者：迪迪埃·萨莱奥利弗·文森特·多阿尔克里斯蒂安·帕瓦奥-莫雷拉比拉玛·贡巴拉美国德克萨斯州

提供了一种时间数字转换器装置，包括：包括多个缓冲器的中等分辨率延迟单元，其被配置成接收参考时钟信号和数据时钟信号作为输入，并且被配置成输出多个延迟的数据时钟信号，其中所述多个延迟的数据时钟信号之间的延迟是中等分辨率延... 详细信息

标准号: CN107294530B

提供了一种时间数字转换器装置，包括：包括多个缓冲器的中等分辨率延迟单元，其被配置成接收参考时钟信号和数据时钟信号作为输入，并且被配置成输出多个延迟的数据时钟信号，其中所述多个延迟的数据时钟信号之间的延迟是中等分辨率延迟值；包括多个核心的高分辨率延迟单元，其被配置成接收来自所述中等分辨率延迟单元的所述参考时钟信号和所述多个延迟的数据时钟信号作为输入，其中，所述多个核心包括：被配置成接收所述多个所述延迟的数据时钟信号中的一者的第一组延迟，被配置成接收所述参考时钟信号的第二组延迟；以及连接到所述第一组延迟和所述第二组延迟的输出的快速触发器，其中所述快速触发器的输出用于检查相位对准。

关键词：数据时钟信号延迟组延迟中等分辨率延迟单元配置参考时钟信号触发器输出缓冲器时间数字转换器接收参考时钟高分辨率相位对准检查

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具有存储体分配的多端口非易失性存储器设备以及相关系统和方法

具有存储体分配的多端口非易失性存储器设备以及相关系统和方法

引用

作者： Y·贝瑟尔 C·济特劳 S·罗斯纳 K·达农 A·罗尚曼美国加利福尼亚州

标准号: CN114207720B

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半导体存储器装置和包括半导体存储器装置的存储器系统

半导体存储器装置和包括半导体存储器装置的存储器系统

引用

作者：尹镐俊赵英喆崔荣暾俞昌植崔桢焕韩国京畿道水原市

公开了半导体存储器装置和包括半导体存储器装置的存储器系统。所述半导体存储器装置包括正交误差校正电路、时钟生成电路和数据输入/输出(I/O)缓冲器。正交误差校正电路通过调节基于数据时钟信号生成的第一时钟信号至第四时钟信号的偏... 详细信息

标准号: CN115223616A

公开了半导体存储器装置和包括半导体存储器装置的存储器系统。所述半导体存储器装置包括正交误差校正电路、时钟生成电路和数据输入/输出(I/O)缓冲器。正交误差校正电路通过调节基于数据时钟信号生成的第一时钟信号至第四时钟信号的偏移和占空比误差来执行锁定操作以生成第一校正时钟信号和第二校正时钟信号，并且响应于重新锁定信号执行重新锁定操作以将第二校正时钟信号锁定到第一校正时钟信号。时钟生成电路基于第一校正时钟信号和第二校正时钟信号来生成输出时钟信号和选通信号。数据I/O缓冲器通过基于输出时钟信号对来自存储器单元阵列的数据进行采样来生成数据信号，并且将数据信号和选通信号发送到存储器控制器。

关键词：校正时钟信号半导体存储器装置缓冲器时钟生成电路输出时钟信号锁定时钟信号校正电路选通信号正交误差存储器单元阵列存储器控制器数据时钟信号存储器系统占空比误差生成数据数据信号锁定信号数据I/O 偏移采样输出响应

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存储器装置、存储器系统和用于操作存储器系统的方法

存储器装置、存储器系统和用于操作存储器系统的方法

引用

作者：白济赫金惠兰孟旼浩赵成龙崔雯喆韩国京畿道水原市

提供一种存储器装置、存储器系统和用于操作存储器系统的方法。存储器系统包括：存储器装置；和存储器控制器，被配置为将命令和地址(CA)信号和数据时钟(WCK)信号发送到存储器装置，将数据(DQ)信号发送到存储器装置，或者从存储器装置接... 详细信息

标准号: CN117219150A

提供一种存储器装置、存储器系统和用于操作存储器系统的方法。存储器系统包括：存储器装置；和存储器控制器，被配置为将命令和地址(CA)信号和数据时钟(WCK)信号发送到存储器装置，将数据(DQ)信号发送到存储器装置，或者从存储器装置接收DQ信号。存储器装置可包括：时钟分配网络，被配置为根据数据时钟信号生成用于对CA信号进行采样的第一分频时钟信号和用于对DQ信号进行采样的第二分频时钟信号；CA采样器，被配置为基于第一分频时钟信号对CA信号进行采样；和CA奇偶校验电路系统，被配置为响应于CA信号发生奇偶校验错误而输出奇偶校验错误信号，并且存储器控制器可包括：处理电路系统，被配置为响应于接收到奇偶校验错误信号而进入CA训练。

关键词：存储器装置分频时钟信号采样配置奇偶校验错误信号存储器控制器存储器系统奇偶校验处理电路系统时钟分配网络数据时钟信号操作存储器电路系统数据时钟响应采样器输出

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包括具有固定延迟数据输出的内存块的内存装置

包括具有固定延迟数据输出的内存块的内存装置

引用

作者： D·斯克达美国加利福尼亚

本发明涉及包括具有固定延迟数据输出的内存块的内存装置。内存块包括内存电路和时钟产生单元。内存电路可以响应于被具有可选延迟的时钟信号时钟控制而输出读数据，可选延迟可以取决于在内存块处接收到读命令之后通过内存磁芯输出读数... 详细信息

标准号: CN102939631A

本发明涉及包括具有固定延迟数据输出的内存块的内存装置。内存块包括内存电路和时钟产生单元。内存电路可以响应于被具有可选延迟的时钟信号时钟控制而输出读数据，可选延迟可以取决于在内存块处接收到读命令之后通过内存磁芯输出读数据所用的时间。时钟产生单元可以响应于被选定数据时钟信号时钟控制而使读数据被提供为内存块的输出。数据时钟信号可以从通过系统时钟的若干个时钟边沿之一产生的若干个时钟边沿之一来选择，使得不管系统时钟的频率如何，在内存块处接收到读命令之后的预定的时间量，通过内存块提供读数据。

关键词：内存读数据时钟产生单元时钟信号时钟内存电路系统时钟延迟数据时钟信号固定延迟内存装置数据输出选定数据时间量响应磁芯

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信号校准电路、信号校准方法、存储装置及模组设备

信号校准电路、信号校准方法、存储装置及模组设备

引用

作者：李乾男李敏增王嵩谈杰 710075 陕西省西安市高新区丈八街办高新六路38号A座4楼

本申请公开了一种信号校准电路、信号校准方法、存储装置及模组设备，该信号校准电路包括：控制器，用于输出命令时钟信号和数据时钟信号，以及基于采样电路输出的采样信号对数据时钟信号的上升沿或下降沿进行调整；采样电路，接收命令... 详细信息

标准号: CN117059142A

本申请公开了一种信号校准电路、信号校准方法、存储装置及模组设备，该信号校准电路包括：控制器，用于输出命令时钟信号和数据时钟信号，以及基于采样电路输出的采样信号对数据时钟信号的上升沿或下降沿进行调整；采样电路，接收命令时钟信号和数据时钟信号；利用数据时钟信号对命令时钟信号进行采样，得到第一采样信号，利用反相数据时钟信号对命令时钟信号进行采样，得到第二采样信号，根据反相数据时钟信号或数据时钟信号的值选择性将第一采样信号或第二采样信号作为采样信号输出至控制器。通过上述方式，本申请中的信号校准电路能够合理选择正确的采样信号反馈给控制器，以确保能够有效实现数据和命令的同步。

关键词：采样信号数据时钟信号时钟信号信号校准电路控制器命令时钟信号采样电路反相数据采样存储装置接收命令输出命令信号校准有效实现输出上升沿下降沿模组申请反馈

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与时钟同步有关的存储系统

与时钟同步有关的存储系统

引用

作者：黄奎栋尹相植韩国京畿道

一种存储系统，包括：存储器控制器和存储器件。存储器控制器通过提供系统时钟信号、数据时钟信号和芯片选择信号而访问存储器件，以及在访问存储器件之后向存储器件提供数据时钟使能信号。存储器件基于系统时钟信号、数据时钟信号和数... 详细信息

标准号: CN116662227A

一种存储系统，包括：存储器控制器和存储器件。存储器控制器通过提供系统时钟信号、数据时钟信号和芯片选择信号而访问存储器件，以及在访问存储器件之后向存储器件提供数据时钟使能信号。存储器件基于系统时钟信号、数据时钟信号和数据时钟使能信号与存储器控制器通信。

关键词：存储器控制器存储器件数据时钟信号系统时钟信号访问存储器使能信号数据时钟芯片选择信号存储系统通信

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