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T=题名（书名、题名），A=作者（责任者），K=主题词，P=出版物名称，PU=出版社名称，O=机构（作者单位、学位授予单位、专利申请人），L=中图分类号，C=学科分类号，U=全部字段，Y=年（出版发行年、学位年度、标准发布年）

检索规则说明：

AND代表“并且”；OR代表“或者”；NOT代表“不包含”；(注意必须大写,运算符两边需空一格)

检索范例：

范例一：(K=图书馆学 OR K=情报学) AND A=范并思 AND Y=1982-2016
范例二：P=计算机应用与软件 AND (U=C++ OR U=Basic) NOT K=Visual AND Y=2011-2016

分类表

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限定检索结果

文献类型

103 篇 专利

馆藏范围

103 篇 电子文献
0 种 纸本馆藏

日期分布

机构

17 篇 三星电子株式会社
8 篇 美光科技公司
6 篇 深圳市明微电子股...
5 篇 航天长征火箭技术...
5 篇 北京遥测技术研究...
4 篇 京东方科技集团股...
4 篇 赛普拉斯半导体公...
3 篇 爱思开海力士有限...
3 篇 浙江一舟电子科技...
3 篇 三星显示有限公司
2 篇 华中科技大学
2 篇 安凯微电子技术有...
2 篇 惠科股份有限公司
2 篇 上海贝岭股份有限...
2 篇 中国电子科技集团...
2 篇 东芯半导体股份有...
2 篇 苏州普源精电科技...
2 篇 佳世达科技股份有...
2 篇 恩智浦美国有限公...
2 篇 成都国腾实业集团...

作者

6 篇 李照华
6 篇 吕苏谊
6 篇 陈克勇
6 篇 石磊
5 篇 吴台荣
5 篇 李炫柳
5 篇 罗霞
5 篇 河庆洙
5 篇 郑建君
5 篇 金康永
4 篇 金始弘
4 篇 c·济特劳
4 篇 a·罗尚曼
4 篇 金荣勋
4 篇 y·贝瑟尔
4 篇 s·罗斯纳
4 篇 k·达农
3 篇 王发明
3 篇 李国添
3 篇 符传汇

语言

103 篇 中文

检索条件"主题词=数据时钟信号"

共 103 条记录，以下是41-50 订阅

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详细简洁

排序：

执行命令总线训练的装置和方法

执行命令总线训练的装置和方法

引用

作者：金荣勋金始弘吴台荣河庆洙韩国京畿道水原市

公开了执行命令总线训练的装置和方法。执行命令总线训练(CBT)操作的动态随机存取存储器(DRAM)装置包括：时钟端子，接收时钟信号；数据时钟端子，接收数据时钟信号；第一数据端子，接收第一数据信号；多个命令/地址端子，在CBT操作期... 详细信息

标准号: CN113053431A

公开了执行命令总线训练的装置和方法。执行命令总线训练(CBT)操作的动态随机存取存储器(DRAM)装置包括：时钟端子，接收时钟信号；数据时钟端子，接收数据时钟信号；第一数据端子，接收第一数据信号；多个命令/地址端子，在CBT操作期间接收CBT图案，CBT图案包括多个命令/地址信号；多个第二数据端子，在CBT操作期间与所述多个命令/地址信号一一对应；CBT控制逻辑，在数据时钟信号的上升沿和下降沿之一确定第一数据信号的逻辑电平，当确定第一数据信号的第一逻辑电平时进入CBT模式；在时钟信号的上升沿和下降沿之一确定CBT图案的逻辑电平，通过所述多个第二数据端子输出确定的CBT图案；当确第一数据信号的第二逻辑电平时退出CBT模式。

关键词：第一数据图案操作期间地址信号逻辑电平命令总线时钟信号数据端子上升沿下降沿动态随机存取存储器数据时钟信号地址端子接收时钟接收数据控制逻辑时钟端子输出确定数据时钟退出

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系统级时序预算改进

系统级时序预算改进

引用

作者： K-Y·金美国爱达荷州

本申请涉及系统级时序预算改进。描述了用于系统级时序预算改进的方法、系统和装置。存储器装置中的每个存储器裸片可确定其系统时钟信号与其数据时钟信号之间的偏移。所述存储器装置中的每个存储器裸片的所述偏移可不同；例如，具有不... 详细信息

标准号: CN110880341B

本申请涉及系统级时序预算改进。描述了用于系统级时序预算改进的方法、系统和装置。存储器装置中的每个存储器裸片可确定其系统时钟信号与其数据时钟信号之间的偏移。所述存储器装置中的每个存储器裸片的所述偏移可不同；例如，具有不同量值和/或极性。所述存储器装置中的存储器裸片可以一延迟调整其自身的数据时钟信号，所述延迟是基于所述装置中的两个或更多个存储器裸片的所述偏移。所述存储器裸片可通过设置所述存储器裸片上的延迟调整器中的熔丝来调整其数据时钟信号。调整所述数据时钟信号可使第一存储器裸片的偏移与第二存储器裸片的偏移匹配。

关键词：存储器裸片偏移数据时钟信号存储器装置时序系统级系统时钟信号第二存储器延迟调整器延迟调整裸片熔丝预算匹配延迟改进申请

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动态模糊改善与不闪烁的显示方法及显示装置

动态模糊改善与不闪烁的显示方法及显示装置

引用

作者：陈旻志 215011 江苏省苏州市高新区珠江路169号

本发明公开一种动态模糊改善与不闪烁的显示方法及显示装置，显示方法包括：由多个显示模式中选择显示模式；取得垂直同步信号及数据时钟信号；以及依据该显示模式，设定背光驱动信号在垂直遮没区间以及数据扫描区间的波形，以使动态模... 详细信息

标准号: CN110379377B

本发明公开一种动态模糊改善与不闪烁的显示方法及显示装置，显示方法包括：由多个显示模式中选择显示模式；取得垂直同步信号及数据时钟信号；以及依据该显示模式，设定背光驱动信号在垂直遮没区间以及数据扫描区间的波形，以使动态模糊的效果符合显示模式；其中，依据显示模式，产生电压调节控制信号，在动态画面显示模式时，将电压调节控制信号的占空比设定为第一占空比；在静态画面显示模式时，将电压调节控制信号的占空比设定为第二占空比，该背光驱动信号的背光驱动电流通过该电压调节控制信号产生，背光的设置电流端口产生定电流。本发明能通过简化背光源控制线路的显示方式来达成来改善动态模糊的现象。

关键词：显示模式电压调节控制占空比动态模糊背光驱动信号背光背光驱动电流垂直同步信号垂直遮没区间数据时钟信号选择显示模式背光源控制电流端口动态画面静态画面数据扫描显示方式显示装置信号产生定电流闪烁

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用于支持命令总线训练模式的存储装置及操作其的方法

用于支持命令总线训练模式的存储装置及操作其的方法

引用

作者：金荣勋金始弘吴台荣河庆洙韩国京畿道水原市

公开了一种用于支持命令总线训练模式的存储装置及操作其的方法。提供了一种用于支持命令总线训练(CBT)模式的存储装置及操作所述存储装置的方法。存储装置被配置为：响应于第一数据信号的逻辑电平而进入CBT模式或从CBT模式退出，其中... 详细信息

标准号: CN109817252B

公开了一种用于支持命令总线训练模式的存储装置及操作其的方法。提供了一种用于支持命令总线训练(CBT)模式的存储装置及操作所述存储装置的方法。存储装置被配置为：响应于第一数据信号的逻辑电平而进入CBT模式或从CBT模式退出，其中，第一数据信号不包括在用于在CBT模式下输出CBT图案的与命令/地址信号一一对应的第二数据信号中。存储装置还被配置为在CBT模式下进行以下操作：根据由与第二数据信号相关联的端子接收的第二参考电压设置代码来改变参考电压值，将命令/地址信号或一对数据时钟信号终结到与存储在模式寄存器中的片上终结(ODT)代码设置相应的电阻值，并且关闭数据信号的ODT。

关键词：存储装置数据信号参考电压地址信号第一数据命令总线终结数据时钟信号模式寄存器代码设置逻辑电平训练模式电阻配置存储图案关联输出退出响应

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数字信号并行输入转串行输出电路

数字信号并行输入转串行输出电路

引用

作者：王海军张辉李丹张辉 200233 上海市徐汇区宜山路810号

本发明公开了数字信号并行输入转串行输出电路，将至少两个并转串数据处理单元、帧时钟产生单元、数据时钟产生单元以及同步单元组建形成。将并行数字信号划分为至少两组并行数据，再将上述至少两组并行数据进行转换处理形成串行数据输... 详细信息

标准号: CN108121676B

本发明公开了数字信号并行输入转串行输出电路，将至少两个并转串数据处理单元、帧时钟产生单元、数据时钟产生单元以及同步单元组建形成。将并行数字信号划分为至少两组并行数据，再将上述至少两组并行数据进行转换处理形成串行数据输出，将数字信号划分成至少两组进行并转串使得串行输出数据不再受到现有技术中LVDS接口速度的限制，利用具有完全同步时序的至少两组串行数据、具有完全时序同步的帧时钟信号以及具有完全同步时序的数据时钟信号，实现了并行输入转串行输出过程中对时序的调整，使得外部接受单元能够准确地、快速地实现并行数字信号的接收，避免了现有技术中外部接收单元接收数据困难、接收过程容易出现时序错误等问题的出现。

关键词：两组并行数字信号时序并行数据数字信号同步时序并行串行输出电路串行输出数据串行数据输出时钟产生单元数据处理单元数据时钟信号帧时钟信号产生单元串行数据接收单元接收过程接收数据时序同步输出过程数据时钟同步单元转换处理外部组建

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存储器设备

存储器设备

引用

作者：李东建河庆洙黄炯烈韩国京畿道

提供存储器设备。存储器设备包括：时钟缓冲器，用于接收主时钟信号并提供内部主时钟信号；数据时钟缓冲器，用于接收数据时钟信号；和延迟控制电路，被配置为基于数据时钟信号产生延迟信息并将延迟信息提供给数据输入/输出电路。延迟... 详细信息

标准号: CN111009270A

提供存储器设备。存储器设备包括：时钟缓冲器，用于接收主时钟信号并提供内部主时钟信号；数据时钟缓冲器，用于接收数据时钟信号；和延迟控制电路，被配置为基于数据时钟信号产生延迟信息并将延迟信息提供给数据输入/输出电路。延迟控制电路包括：分频器，被配置为基于数据时钟信号产生二分频时钟信号；分频器，被配置为基于第一组二分频时钟信号产生四分频时钟信号；第一同步检测器，被配置为输出指示第二组二分频时钟信号是否与数据时钟信号同步的二分频对准信号；和延迟选择器，被配置为基于二分频对准信号检测四分频时钟信号的相位并且基于相位调整主时钟信号的延迟。

关键词：二分频时钟信号数据时钟信号主时钟信号配置分频时钟信号延迟控制电路存储器设备对准信号延迟信息二分频分频器缓冲器时钟缓冲器同步检测器延迟选择器接收数据时钟信号输出电路输出指示数据时钟相位调整同步的延迟检测

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半导体器件

半导体器件

引用

作者：郭康燮韩国京畿道

本发明提供了一种半导体器件。半导体器件包括相位差检测电路和内部电路。相位差检测电路通过将同步于时钟信号从命令/地址信号产生的相位检测时钟信号的相位与通过根据操作模式对数据时钟信号的频率进行分频而产生的分频时钟信号和内... 详细信息

标准号: CN111383677A

本发明提供了一种半导体器件。半导体器件包括相位差检测电路和内部电路。相位差检测电路通过将同步于时钟信号从命令/地址信号产生的相位检测时钟信号的相位与通过根据操作模式对数据时钟信号的频率进行分频而产生的分频时钟信号和内部分频时钟信号的相位进行比较，来产生第一相位差检测信号和第二相位差检测信号。内部电路根据第一相位差检测信号和第二相位差检测信号的逻辑电平组合来识别分频时钟信号和内部分频时钟信号的相位。

关键词：相位差检测信号时钟信号相位差检测电路分频时钟信号半导体器件内部电路数据时钟信号操作模式地址信号逻辑电平相位检测分频

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包含用于半导体存储器的存储器命令的设备及方法

包含用于半导体存储器的存储器命令的设备及方法

引用

作者：金康永李炫柳 J·D·波特美国爱达荷州

本发明描述包括用于半导体存储器的存储器命令的设备及方法。一种实例方法包括：响应于接收时序命令而接收数据时钟信号；响应于接收与所述时序命令相关联的存取命令而执行存取操作；基于所述数据时钟信号来提供存取数据时钟信号；及基... 详细信息

标准号: CN111164692A

本发明描述包括用于半导体存储器的存储器命令的设备及方法。一种实例方法包括：响应于接收时序命令而接收数据时钟信号；响应于接收与所述时序命令相关联的存取命令而执行存取操作；基于所述数据时钟信号来提供存取数据时钟信号；及基于所述数据时钟信号来提供存取数据时钟信号。所述存取命令可与所述相关联时序命令在时间上间隔系统时钟信号的至少一个时钟周期。在一些实例中，所述存取命令可在所述相关联时序命令之前或可在所述相关联时序命令之后。在一些实例中，所述存取命令可紧接在所述相关联时序命令之后或所述相关联时序命令之前。

关键词：时序命令存取命令时钟信号关联数据时钟信号存取数据半导体存储器存储器命令存取操作间隔系统接收时序接收数据时钟周期响应

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系统级时序预算改进

系统级时序预算改进

引用

作者： K-Y·金美国爱达荷州

标准号: CN110880341A

关键词：存储器裸片偏移数据时钟信号存储器装置时序系统级系统时钟信号第二存储器延迟调整器延迟调整裸片熔丝预算匹配延迟改进申请

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多行扫高刷新率的全彩LED驱动芯片及驱动方法

多行扫高刷新率的全彩LED驱动芯片及驱动方法

引用

作者：雷鑑铭秦腾祥程崇源张焱魁 430074 湖北省武汉市洪山区珞喻路1037号

本发明公开了一种多行扫高刷新率的全彩LED驱动芯片及驱动方法，属于全彩LED驱动芯片设计领域，包括：同步控制器、移位寄存器、状态寄存器、SRAM缓冲器、灰度时钟生成模块、驱动模块、预充电电路以及模拟输出模块；灰度时钟生成模块用... 详细信息

标准号: CN110277052B

本发明公开了一种多行扫高刷新率的全彩LED驱动芯片及驱动方法，属于全彩LED驱动芯片设计领域，包括：同步控制器、移位寄存器、状态寄存器、SRAM缓冲器、灰度时钟生成模块、驱动模块、预充电电路以及模拟输出模块；灰度时钟生成模块用于根据指令信息，对数据时钟信号DCLK进行倍频/分频处理，以生成用于控制灰度等级的灰度时钟信号GCLK；驱动模块用于对灰度时钟信号GCLK计数以得到各行像素数据所对应的灰度计数，并在每次扫描过程中利用连续N行像素数据及对应的灰度计数生成各行像素数据所对应的PWM信号的输出波形，从而实现多行扫描；模拟输出模块用于接收PWM信号并配合预充电电路产生恒流驱动LED灯珠。本发明能够提高刷新率，并支持更多的扫描行数。

关键词：灰度模拟输出模块时钟生成模块预充电电路驱动模块驱动芯片时钟信号像素数据全彩LED 刷新率缓冲器数据时钟信号素数同步控制器移位寄存器状态寄存器多行扫描分频处理恒流驱动扫描过程扫描行数输出波形指令信息倍频多行驱动配合

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