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T=题名（书名、题名），A=作者（责任者），K=主题词，P=出版物名称，PU=出版社名称，O=机构（作者单位、学位授予单位、专利申请人），L=中图分类号，C=学科分类号，U=全部字段，Y=年（出版发行年、学位年度、标准发布年）

检索规则说明：

AND代表“并且”；OR代表“或者”；NOT代表“不包含”；(注意必须大写,运算符两边需空一格)

检索范例：

范例一：(K=图书馆学 OR K=情报学) AND A=范并思 AND Y=1982-2016
范例二：P=计算机应用与软件 AND (U=C++ OR U=Basic) NOT K=Visual AND Y=2011-2016

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文献类型

43 篇 专利

馆藏范围

43 篇 电子文献
0 种 纸本馆藏

日期分布

机构

3 篇 中国航空无线电电...
2 篇 苏州浪潮智能科技...
2 篇 中国人民解放军国...
2 篇 山东华芯半导体有...
2 篇 西安交通大学
2 篇 中车大连电力牵引...
2 篇 中国石油集团测井...
2 篇 西安电子科技大学
2 篇 之江实验室
2 篇 电子科技大学
2 篇 北京航空航天大学
2 篇 华南理工大学
2 篇 北京遥感设备研究...
2 篇 浙江大学
2 篇 公安部上海消防研...
1 篇 深圳问道以芯科技...
1 篇 东南大学
1 篇 国家超级计算深圳...
1 篇 安世数擎信息科技...
1 篇 北京智芯半导体科...

作者

5 篇 刘刚
3 篇 张锋烽
3 篇 葛成
3 篇 徐丁海
2 篇 朱江
2 篇 刘大铕
2 篇 楼薇
2 篇 王荷兰
2 篇 曹成
2 篇 吴沙
2 篇 陈飞
2 篇 余牧溪
2 篇 曾华菘
2 篇 赵文哲
2 篇 潘国腾
2 篇 吴伟
2 篇 铁俊波
2 篇 杜振环
2 篇 周海亮
2 篇 史帅

语言

43 篇 中文

检索条件"主题词=数据流控制模块"

共 43 条记录，以下是1-10 订阅

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详细简洁

排序：

一种基于FPGA的数据流控制模块、控制方法及电路

一种基于FPGA的数据流控制模块、控制方法及电路

引用

作者：王凯 450018 河南省郑州市郑东新区心怡路278号16层1601室

本发明实施例公开了一种基于FPGA的数据流控制模块、控制方法及电路，属于芯片设计领域。基于FPGA的数据流控制模块，包含外围设备总线接口、随机存取存储器、随机存取存储器控制器、主端重配置模块、流控制门控逻辑模块。通过读取数据... 详细信息

标准号: CN108227614A

本发明实施例公开了一种基于FPGA的数据流控制模块、控制方法及电路，属于芯片设计领域。基于FPGA的数据流控制模块，包含外围设备总线接口、随机存取存储器、随机存取存储器控制器、主端重配置模块、流控制门控逻辑模块。通过读取数据流控制模块所连接从设备的身份及状态信息，并将身份及状态信息映射在内部的随机存取存储器对应的区域内；根据内部读取的从设备状态信息判断从设备是否可能发生数据堵塞，或根据传输的从设备信号判断从设备是否数据将要溢出或将要空闲，从而需要改变传输速率。本发明解决了外设接口端堵塞或闲置状态的产生，有效的提高外设总线的利用率；具有能根据实际传输情况，调节传输速率，降低功耗的优点。

关键词：从设备数据流控制模块随机存取存储器传输读取外围设备总线状态信息判断连接从设备降低功耗门控逻辑配置模块数据堵塞外设接口外设总线闲置状态芯片设计信号判断控制器流控制映射身份溢出空闲电路堵塞

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一种基于存内计算的混合基快速傅里叶变换计算电路

一种基于存内计算的混合基快速傅里叶变换计算电路

引用

作者：黄科杰刘润沈海斌 310058 浙江省杭州市西湖区余杭塘路866号

本发明公开了一种基于存内计算的混合基快速傅里叶变换计算电路。存内计算阵列和电路中的存储模块相连接；地址生成模块和存储模块相连接，生成不同的地址数据控制存储模块中数据送入存内计算阵列中进行计算；数据流控制模块产生控制信... 详细信息

标准号: CN113378109B

本发明公开了一种基于存内计算的混合基快速傅里叶变换计算电路。存内计算阵列和电路中的存储模块相连接；地址生成模块和存储模块相连接，生成不同的地址数据控制存储模块中数据送入存内计算阵列中进行计算；数据流控制模块产生控制信号，通过与地址生成模块和存储模块的连接，控制整个系统中数据流的流动时序；存内计算阵列接收从存储模块中传入数据，经过计算后输出结果至存储模块中。本发明有效地利用存内计算低功耗和乘累加计算的特点，解决了传统快速傅里叶变换电路设计中高功耗，高延迟的技术问题。

关键词：存储模块快速傅里叶变换地址生成模块数据流控制模块产生控制信号控制存储模块数据流时序地址数据电路设计计算电路累加计算输出结果阵列接收低功耗高功耗混合基有效地延迟电路送入流动

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一种加解密系统、方法、处理器和服务器

一种加解密系统、方法、处理器和服务器

引用

作者：赵新宇孙旭周玉龙刘刚 215100 江苏省苏州市吴中区吴中经济开发区郭巷街道官浦路1号9幢

本发明涉及一种加解密系统、方法、处理器和服务器。加解密系统中，控制器连接数据流控制模块，将待运算数据传输给数据流控制模块；数据流控制模块将待运算数据分组发送给算法引擎核模块，算法引擎核模块内部集成了能独立完成各自的算... 详细信息

标准号: CN115549911B

本发明涉及一种加解密系统、方法、处理器和服务器。加解密系统中，控制器连接数据流控制模块，将待运算数据传输给数据流控制模块；数据流控制模块将待运算数据分组发送给算法引擎核模块，算法引擎核模块内部集成了能独立完成各自的算法运算的SM4算法引擎与AES算法引擎，数据流控制模块判断执行算法种类后控制算法引擎核模块启动相应算法引擎，算法引擎核模块利用数据流控制模块提供的待运算数据和寄存器堆模块中配置的加解密运算所需要的密钥和初始向量进行加解密运算并将运算结果反馈给数据流控制模块，数据流控制模块通过控制器将运算结果数据输出，实现对SM4算法和AES算法兼容的加解密处理。

关键词：数据流控制模块算法引擎核模块待运算数据加解密系统加解密运算算法引擎寄存器堆模块运算结果数据加解密处理控制器连接初始向量控制算法内部集成算法运算运算结果控制器配置的处理器密钥服务器兼容反馈分组输出

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一种基于ZYNQ的卷积神经加速器实现装置及方法

一种基于ZYNQ的卷积神经加速器实现装置及方法

引用

作者：刘洪源张俊举袁昊许震东胡文宾 210094 江苏省南京市孝陵卫200号

本身请提供一种基于ZYNQ的卷积神经加速器实现装置及方法，装置基于ZYNQ异构芯片实现；卷积神经网络加速器实现装置包括加速子系统、控制子系统和存储子系统；加速子系统包含卷积运算模块、采样运算模块；控制子系统包含数据流控制模块... 详细信息

标准号: CN118095377A

本身请提供一种基于ZYNQ的卷积神经加速器实现装置及方法，装置基于ZYNQ异构芯片实现；卷积神经网络加速器实现装置包括加速子系统、控制子系统和存储子系统；加速子系统包含卷积运算模块、采样运算模块；控制子系统包含数据流控制模块、驱动模块和参数配置模块；存储子系统包括片外存储模块和片内存储模块；其中，控制子系统与加速子系统相接，控制子系统与存储系统相接，存储子系统与加速子系统相接。本申请提高了指令集构建速度。

关键词：控制子系统存储子系统实现装置加速器数据流控制模块参数配置模块卷积神经网络卷积运算模块片外存储模块存储模块存储系统驱动模块芯片实现运算模块指令集采样构建卷积异构神经申请

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一种卫星数据通道控制系统及方法

一种卫星数据通道控制系统及方法

引用

作者：陈绍山江涛钟卫强蔡霖腾徐琪嵇誉史纪元 200032 上海市徐汇区平江路48号

本发明公开了一种卫星数据通道控制系统及方法，包括：一数据协议转换设备，其中，所述数据协议转换设备具体包括：控制接口模块，用于生成控制帧，并通过数据通道发往宽带卫星收发信机中的数据接口单元；数据流控制模块，用于对控制帧... 详细信息

标准号: CN116131901A

本发明公开了一种卫星数据通道控制系统及方法，包括：一数据协议转换设备，其中，所述数据协议转换设备具体包括：控制接口模块，用于生成控制帧，并通过数据通道发往宽带卫星收发信机中的数据接口单元；数据流控制模块，用于对控制帧和数据帧在网络底层进行合路传输的控制；控制帧接收队列，用于接收并存储来自宽带卫星收发信机方向的控制帧，控制帧发送队列，用于存储发往宽带卫星收发信机和数据流控制模块的控制帧。本发明提高了对卫星收发信机数据通道动态控制的速度，使其能适应卫星链路快速变化的情况，提升整体数据传输效率和可靠性。

关键词：控制帧宽带卫星收发信机数据流控制模块数据协议转换数据通道存储控制接口模块数据接口单元通道控制系统卫星收发信机传输效率动态控制发送队列接收队列快速变化生成控制网络底层卫星链路卫星数据整体数据数据帧合路传输

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用于PXI测试板卡的FPGA芯片调度系统

用于PXI测试板卡的FPGA芯片调度系统

引用

作者：马国军李明泽张奕凡段云龙曾庆军顾琪伟 212100 江苏省镇江市丹徒区长晖路666号

本发明公开了一种用于PXI测试板卡的FPGA芯片调度系统，包括：PXI通信接口、调度指令模块和数据流控制模块，其中：调度指令模块包括状态机和运算电路，状态机包括调度优先级信号接口，用于接收外设接口的优先级信号，状态机优先进入优... 详细信息

标准号: CN114036011A

本发明公开了一种用于PXI测试板卡的FPGA芯片调度系统，包括：PXI通信接口、调度指令模块和数据流控制模块，其中：调度指令模块包括状态机和运算电路，状态机包括调度优先级信号接口，用于接收外设接口的优先级信号，状态机优先进入优先级最高的外设接口状态；在当前外设接口状态下，状态机发送提取对应的外设接口输出的数据的指令；运算电路用于接收外设接口的优先级信号，运算电路分别计算当前外设接口状态的优先级信号与其他优先级信号之间的差值，并输入状态机，在差值为预定数值时，状态机进入计算得到差值的优先级信号对应的外设接口状态。采用上述技术方案，上位机的数据读取等待时间较短或没有，避免读取无效数据，显著提高芯片测试效率。

关键词：外设接口优先级信号状态机调度指令运算电路数据流控制模块读取输入状态机测试板卡调度系统数据读取通信接口无效数据芯片测试和运算上位机电路调度发送指令输出

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一种统计数据0和1翻转比特数的装置和方法

一种统计数据0和1翻转比特数的装置和方法

引用

作者：朱苏雁刘大铕王彬曹成 250101 山东省济南市高新区新泺大街1768号齐鲁软件园大厦B座二层

本发明公开一种统计数据0和1翻转比特数的装置和方法，所述装置包括配置模块、命令FIFO、应答FIFO、数据流控制模块、加法器、master接口1和master接口2，数据流控制模块包括命令处理模块和数据处理模块，配置模块与控制总线相连，用于... 详细信息

标准号: CN110888765B

本发明公开一种统计数据0和1翻转比特数的装置和方法，所述装置包括配置模块、命令FIFO、应答FIFO、数据流控制模块、加法器、master接口1和master接口2，数据流控制模块包括命令处理模块和数据处理模块，配置模块与控制总线相连，用于接收外部CPU通过控制总线写入的配置信息和启动信号，命令FIFO连接于配置模块与命令处理模块之间，用于接收、存储配置模块写入的配置信息并将配置信息写入命令处理模块。本发明采用两个master接口同时取数，不必额外开辟空间对中间数据进行存储，简化设计。同时本装置支持多条命令，支持大数量操作，大大提升整体系统效率，节约测试时间。

关键词：配置模块配置信息数据流控制模块命令处理模块控制总线写入数据处理模块整体系统效率处理模块存储配置启动信号统计数据写入命令中间数据外部CPU 翻转比特数加法器应答存储测试节约

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一种粗粒度动态可重构数据规整控制单元结构

一种粗粒度动态可重构数据规整控制单元结构

引用

作者：葛伟曹鹏马俊刘波杨锦江徐凯杨军王超卜爱国 211189 江苏省南京市江宁区东南大学路2号

本发明公开了一种粗粒度动态可重构数据规整控制单元结构，其数据流控制模块包括三个部分：矢量加载模块，矢量移相模块，解包分发模块。三个模块通过双缓冲寄存器实现多层次的复合两级流水线，并通过硬件握手实现流水线的同步。其中，... 详细信息

标准号: CN103761075B

本发明公开了一种粗粒度动态可重构数据规整控制单元结构，其数据流控制模块包括三个部分：矢量加载模块，矢量移相模块，解包分发模块。三个模块通过双缓冲寄存器实现多层次的复合两级流水线，并通过硬件握手实现流水线的同步。其中，矢量加载模块通过动态重构配置实现对不同数据地址空间的访问，完成数据从存储器到矢量数据寄存器文件的加载。矢量移相模块通过动态可重构配置的方式实现对数据流的移位，拼接等操作，输出数据写入矢量相移寄存器文件。解包分发模块通过配置实现寄存器数据的分发操作，满足阵列对计算数据并发输入的需求。这种粗粒度动态可重构数据规整控制单元结构有效解决了数据加载过程中的非对齐存取和数据规整的问题。

关键词：动态可重构规整矢量控制单元结构分发模块移相模块粗粒度矢量加解包矢量数据寄存器数据流控制模块寄存器数据寄存器文件两级流水线存储器数据流动态重构计算数据输出数据数据地址数据加载有效解决非对齐寄存器配置的双缓冲移位加载配置相移流水线拼接存取并发分发写入复合握手访问

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基于FPGA的相位噪声数据流处理装置及方法

基于FPGA的相位噪声数据流处理装置及方法

引用

作者：黄武煌谭峰吴伟廖霜史帅杨扩军邱渡裕张沁川王厚军 611731 四川省成都市高新区(西区)西源大道2006号

本发明公开了一种基于FPGA的相位噪声数据流处理装置及方法，该装置包括数据处理模块、时钟管理模块、控制模块、数据流控制模块和FFT模块；数据处理模块包括多级抽取滤波单元，对输入相位噪声信号抽取滤波产生多级不同采样率的相位噪... 详细信息

标准号: CN111722027A

本发明公开了一种基于FPGA的相位噪声数据流处理装置及方法，该装置包括数据处理模块、时钟管理模块、控制模块、数据流控制模块和FFT模块；数据处理模块包括多级抽取滤波单元，对输入相位噪声信号抽取滤波产生多级不同采样率的相位噪声数据流；时钟管理模块用于产生各级抽取滤波单元所需的时钟信号；控制模块用于产生控制各级抽取滤波单元的复位信号；数据流控制模块用于调整每一级相位噪声数据流输入FFT模块的数据长度和时钟频率；FFT模块用于计算各级相位噪声数据流的频域信息。本发明在FPGA内部实现了抽取滤波和数据处理的设计，提高了相位噪声数据的处理速度，减少了数据传输过程中的延迟与发生传输错误的可能性，同时还减低了系统复杂度。

关键词：抽取滤波相位噪声数据流数据流控制模块时钟管理模块数据处理模块控制模块数据流处理装置数据传输过程相位噪声数据系统复杂度复位信号频域信息时钟频率时钟信号输入相位数据处理噪声信号采样率每一级延迟传输

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一种用于实现EXMC与VME通信的总线桥装置

一种用于实现EXMC与VME通信的总线桥装置

引用

作者：刘晨曦杜振环张立斌 116000 辽宁省大连市旅顺经济开发区浩洋北街1号

本发明公开了一种用于实现EXMC与VME通信的总线桥装置，包括CPU模块和FPGA模块；FPGA模块包括顶层模块、时钟管理模块、寄存器管理模块、EXMC总线控制模块、数据宽度控制模块和数据流控制模块。利用顶层模块、时钟管理模块、寄存器管理... 详细信息

标准号: CN114064548A

本发明公开了一种用于实现EXMC与VME通信的总线桥装置，包括CPU模块和FPGA模块；FPGA模块包括顶层模块、时钟管理模块、寄存器管理模块、EXMC总线控制模块、数据宽度控制模块和数据流控制模块。利用顶层模块、时钟管理模块、寄存器管理模块、EXMC总线控制模块、数据宽度控制模块和数据流控制模块的模块拼接进而完成对EXMC总线和VME总线接口信号的实例化，实现EXMC总线和VME总线双向数据流的控制。

关键词：数据流控制模块时钟管理模块总线控制模块寄存器管理顶层模块宽度控制总线双向数据流模块拼接实例化总线桥通信

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