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T=题名（书名、题名），A=作者（责任者），K=主题词，P=出版物名称，PU=出版社名称，O=机构（作者单位、学位授予单位、专利申请人），L=中图分类号，C=学科分类号，U=全部字段，Y=年（出版发行年、学位年度、标准发布年）

检索规则说明：

AND代表“并且”；OR代表“或者”；NOT代表“不包含”；(注意必须大写,运算符两边需空一格)

检索范例：

范例一：(K=图书馆学 OR K=情报学) AND A=范并思 AND Y=1982-2016
范例二：P=计算机应用与软件 AND (U=C++ OR U=Basic) NOT K=Visual AND Y=2011-2016

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文献类型

6 篇 专利

馆藏范围

6 篇 电子文献
0 种 纸本馆藏

日期分布

机构

5 篇 长鑫存储技术有限...
1 篇 美光科技公司

作者

3 篇 林峰
2 篇 黄克琴
2 篇 冀康灵
1 篇 荒井実成
1 篇 中村耕平

语言

6 篇 中文

检索条件"主题词=数据选通时钟信号"

共 6 条记录，以下是1-10 订阅

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详细简洁

排序：

时钟电路以及存储器

时钟电路以及存储器

引用

作者：林峰 230601 安徽省合肥市经济技术开发区空港工业园兴业大道388号

本发明实施例提供一种时钟电路以及存储器，时钟电路包括：数据选通时钟模块，用于接收数据选通时钟信号并传输所述数据选通时钟信号，所述数据选通时钟信号用于控制数据信号的接收和/或发送；系统时钟模块，用于接收系统时钟信号并传... 详细信息

标准号: CN114187942B

本发明实施例提供一种时钟电路以及存储器，时钟电路包括：数据选通时钟模块，用于接收数据选通时钟信号并传输所述数据选通时钟信号，所述数据选通时钟信号用于控制数据信号的接收和/或发送；系统时钟模块，用于接收系统时钟信号并传输所述系统时钟信号，所述系统时钟信号用于控制命令信号的接收；其中，所述系统时钟模块包括至少两条第一信号传输路径，并被配置为，根据所述数据信号的接收和/或发送速率的不同，采用不同的第一信号传输路径以传输所述系统时钟信号。

关键词：系统时钟信号数据选通时钟信号系统时钟模块传输路径时钟电路传输控制命令信号控制数据信号数据选通时钟选通时钟信号发送存储器接收数据接收系统时钟信号数据信号配置

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一种时钟电路、时钟对齐系统和时钟对齐方法

一种时钟电路、时钟对齐系统和时钟对齐方法

引用

作者：黄克琴冀康灵 230601 安徽省合肥市经济技术开发区空港工业园兴业大道388号

本申请实施例提供了一种时钟电路、时钟对齐系统和时钟对齐方法，该时钟电路包括：该时钟电路包括信号接收端、均衡电路和模拟测试电路；信号接收端，用于接收数据选通时钟信号和系统时钟信号；均衡电路，用于对数据选通时钟信号和系统... 详细信息

标准号: CN116486852B

本申请实施例提供了一种时钟电路、时钟对齐系统和时钟对齐方法，该时钟电路包括：该时钟电路包括信号接收端、均衡电路和模拟测试电路；信号接收端，用于接收数据选通时钟信号和系统时钟信号；均衡电路，用于对数据选通时钟信号和系统时钟信号进行对齐处理，确定候选调整值；模拟测试电路，用于接收目标数据选通时钟信号，利用目标数据选通时钟信号和系统时钟信号进行握手测试，以确定目标数据选通时钟信号和系统时钟信号是否握手成功。这样，通过对目标数据选通时钟信号和系统时钟信号进模拟测试，保证目标数据选通时钟信号和系统时钟信号能够握手成功，提高了时钟电路的对齐精度。

关键词：系统时钟信号选通时钟信号目标数据时钟电路数据选通时钟信号模拟测试电路信号接收端均衡电路时钟对齐握手对齐处理接收目标接收数据模拟测试对齐测试成功申请保证

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一种时钟电路、时钟对齐系统和时钟对齐方法

一种时钟电路、时钟对齐系统和时钟对齐方法

引用

作者：黄克琴冀康灵 230601 安徽省合肥市经济技术开发区空港工业园兴业大道388号

标准号: CN116486852A

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时钟电路以及存储器

时钟电路以及存储器

引用

作者：林峰 230601 安徽省合肥市经济技术开发区空港工业园兴业大道388号

标准号: CN114187942A

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时钟电路以及存储器

时钟电路以及存储器

引用

作者：林峰 230601 安徽省合肥市经济技术开发区空港工业园兴业大道388号

本实用新型实施例提供一种时钟电路以及存储器，时钟电路包括：数据选通时钟模块，用于接收数据选通时钟信号并传输所述数据选通时钟信号，所述数据选通时钟信号用于控制数据信号的接收和/或发送；系统时钟模块，用于接收系统时钟信号... 详细信息

标准号: CN212484941U

本实用新型实施例提供一种时钟电路以及存储器，时钟电路包括：数据选通时钟模块，用于接收数据选通时钟信号并传输所述数据选通时钟信号，所述数据选通时钟信号用于控制数据信号的接收和/或发送；系统时钟模块，用于接收系统时钟信号并传输所述系统时钟信号，所述系统时钟信号用于控制命令信号的接收；其中，所述系统时钟模块包括至少两条第一信号传输路径，并被配置为，根据所述数据信号的接收和/或发送速率的不同，采用不同的第一信号传输路径以传输所述系统时钟信号。

关键词：系统时钟信号数据选通时钟信号系统时钟模块传输路径时钟电路传输控制命令信号控制数据信号数据选通时钟选通时钟信号发送本实用新型存储器接收数据接收系统时钟信号数据信号配置

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用于数据选通写入定时的设备、系统和方法

用于数据选通写入定时的设备、系统和方法

引用

作者：中村耕平荒井実成美国爱达荷州

本公开提供了用于数据选通写入定时的设备、系统和方法。存储器装置可在写操作期间接收数据选通时钟信号和串行写数据。所述存储器的解串行器电路可使用基于所述数据选通时钟信号的定时将所述串行写数据转换为并行写数据。例如，一或多... 详细信息

标准号: CN113808631A

本公开提供了用于数据选通写入定时的设备、系统和方法。存储器装置可在写操作期间接收数据选通时钟信号和串行写数据。所述存储器的解串行器电路可使用基于所述数据选通时钟信号的定时将所述串行写数据转换为并行写数据。例如，一或多个内部信号可基于所述数据选通时钟信号而生成并用于激活所述解串行器电路的各种操作。所述数据选通时钟信号还可用于激活所述存储器装置的位线，以便沿着那些激活的位线将所述并行写数据写入存储器单元。所述存储器还可接收与所述数据选通时钟信号分离的系统时钟，所述系统时钟可用于所述存储器的其它操作。例如，在读操作中，可以基于所述系统时钟的定时来激活所述位线。

关键词：数据选通时钟信号存储器系统时钟激活位线串行写数据存储器装置解串行器写数据可用并行写入电路选通时钟信号存储器单元接收数据内部信号数据选通写操作转换

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