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文字说明：

T=题名（书名、题名），A=作者（责任者），K=主题词，P=出版物名称，PU=出版社名称，O=机构（作者单位、学位授予单位、专利申请人），L=中图分类号，C=学科分类号，U=全部字段，Y=年（出版发行年、学位年度、标准发布年）

检索规则说明：

AND代表“并且”；OR代表“或者”；NOT代表“不包含”；(注意必须大写,运算符两边需空一格)

检索范例：

范例一：(K=图书馆学 OR K=情报学) AND A=范并思 AND Y=1982-2016
范例二：P=计算机应用与软件 AND (U=C++ OR U=Basic) NOT K=Visual AND Y=2011-2016

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限定检索结果

文献类型

489 篇 专利

馆藏范围

489 篇 电子文献
0 种 纸本馆藏

日期分布

机构

78 篇 京东方科技集团股...
17 篇 武汉华星光电技术...
15 篇 惠科股份有限公司
14 篇 合肥鑫晟光电科技...
13 篇 北京京东方显示技...
13 篇 三星电子株式会社
10 篇 友达光电股份有限...
10 篇 长鑫存储技术有限...
8 篇 深圳市华星光电技...
8 篇 鄂尔多斯市源盛光...
8 篇 上海猎芯半导体科...
7 篇 重庆京东方光电科...
7 篇 深圳市华星光电半...
7 篇 北京京东方光电科...
7 篇 合肥京东方光电科...
7 篇 三星显示有限公司
6 篇 乐金显示有限公司
5 篇 西安电子科技大学
5 篇 华为技术有限公司
5 篇 牛芯半导体有限公...

作者

14 篇 王志冲
8 篇 赵卫军
8 篇 牟加伟
8 篇 杨红祥
8 篇 余冰
8 篇 王小保
8 篇 赵莽
8 篇 商广良
8 篇 郑皓亮
7 篇 曹尚操
6 篇 韩承佑
6 篇 李荣荣
6 篇 姚星
6 篇 韩明夫
6 篇 袁丽君
5 篇 张波
5 篇 马睿
5 篇 戴荣磊
5 篇 请求不公布姓名
5 篇 颜尧

语言

489 篇 中文

检索条件"主题词=时钟信号输出"

共 489 条记录，以下是31-40 订阅

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详细简洁

排序：

存储器控制器及其操作方法

存储器控制器及其操作方法

引用

作者：金贤燮朴珥领李东燮韩国京畿道

本申请涉及一种存储器控制器以及操作存储器控制器的方法。该存储器控制器可以控制存储器装置。存储器装置可以通过通道联接到存储器控制器。存储器控制器可以包括空闲时间监控器和时钟信号生成器。空闲时间监控器可以输出存储器装置的... 详细信息

标准号: CN112908374A

本申请涉及一种存储器控制器以及操作存储器控制器的方法。该存储器控制器可以控制存储器装置。存储器装置可以通过通道联接到存储器控制器。存储器控制器可以包括空闲时间监控器和时钟信号生成器。空闲时间监控器可以输出存储器装置的空闲时间间隔。空闲时间间隔可以在存储器装置的先前操作的结束时间与当前操作的开始时间之间。时钟信号生成器可以基于空闲时间间隔生成时钟信号，并且通过通道将时钟信号输出到存储器装置以执行当前操作。

关键词：存储器控制器空闲时间间隔存储器装置时钟信号生成器时间监控器空闲时钟信号输出操作存储器控制存储器输出存储器时钟信号控制器申请

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真随机数发生器和真随机数的生成方法

真随机数发生器和真随机数的生成方法

引用

作者：孙旭赵新宇周玉龙刘刚李拓 250000 山东省济南市高新区港西路2177号港盛大厦4层401室

本申请实施例提供了一种真随机数发生器和真随机数的生成方法，其中，该真随机数发生器包括：随机控制模块，用于将第一时钟信号输出到锁相环中，其中，所述第一时钟信号用于调整所述锁相环的工作状态；所述锁相环，与所述随机控制模块... 详细信息

标准号: CN118363565A

本申请实施例提供了一种真随机数发生器和真随机数的生成方法，其中，该真随机数发生器包括：随机控制模块，用于将第一时钟信号输出到锁相环中，其中，所述第一时钟信号用于调整所述锁相环的工作状态；所述锁相环，与所述随机控制模块连接，用于在根据所述第一时钟信号确定所述工作状态为失锁状态的情况下，输出第二时钟信号与第三时钟信号至触发器中，其中，所述第二时钟信号为低频时钟信号，所述第三时钟信号为高频时钟信号；所述触发器，与所述锁相环连接，用于对所述第二时钟信号和所述第三时钟信号进行处理，以生成第一真随机数。

关键词：时钟信号锁相环真随机数发生器随机控制真随机数触发器低频时钟信号高频时钟信号时钟信号输出模块连接失锁输出申请

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发送器及包括其的收发器

发送器及包括其的收发器

引用

作者：陈泰荣金俊达金铉秀闵庚律朴东愿裵钟晩韩国京畿道龙仁市

本发明公开了发送器及包括其的收发器，本发明的发送器包括：发送控制器，通过原始数据通道输出原始数据；编码器，将所述原始数据编码为编码数据，并通过编码数据通道输出所述编码数据；以及发送驱动器，通过收发接口以M(M为大于0的实... 详细信息

标准号: CN116896392A

本发明公开了发送器及包括其的收发器，本发明的发送器包括：发送控制器，通过原始数据通道输出原始数据；编码器，将所述原始数据编码为编码数据，并通过编码数据通道输出所述编码数据；以及发送驱动器，通过收发接口以M(M为大于0的实数)Gbps(Gigabits per second)的速度输出所述编码数据，所述发送驱动器向所述编码器提供与输出速度对应的第一时钟信号，所述编码器向所述发送控制器提供具有小于所述第一时钟信号的第一频率的第二频率的第二时钟信号，所述发送控制器基于所述第二时钟信号输出所述原始数据，所述编码器基于所述第一时钟信号输出所述编码数据。

关键词：编码数据编码器发送控制器时钟信号原始数据时钟信号输出发送驱动器通道输出发送器原始数据编码输出收发接口实数收发器

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一种实现占空比调整的装置

一种实现占空比调整的装置

引用

作者：杨亚风申雄杰 518055 广东省深圳市南山区西丽街道留仙大道中兴工业园

一种实现占空比调整的装置，包括：时钟转换和占空比调整电路、单端转差分电路和占空比检测和控制电路；其中，时钟转换和占空比调整电路用于，接收单端电流型逻辑电路(CML)时钟信号和来自占空比检测和控制电路的控制信号，输出单端互... 详细信息

标准号: CN109428567B

一种实现占空比调整的装置，包括：时钟转换和占空比调整电路、单端转差分电路和占空比检测和控制电路；其中，时钟转换和占空比调整电路用于，接收单端电流型逻辑电路(CML)时钟信号和来自占空比检测和控制电路的控制信号，输出单端互补金属氧化物半导体(CMOS)时钟信号；单端转差分电路的输入端与时钟转换和占空比调整电路的输出端连接，单端转差分电路的输出端与占空比检测和控制电路的输入端连接，用于根据来自时钟转换和占空比调整电路的单端CMOS时钟信号输出差分CMOS时钟信号；占空比检测和控制电路用于：输出控制信号。本发明实施例实现了适用于低电压工作域下高速时钟占空比调整的电路。

关键词：单端占空比调整电路占空比检测控制电路时钟转换时钟信号分电路转差占空比调整互补金属氧化物半导体电流型逻辑电路时钟信号输出输出端连接输入端连接高速时钟控制信号输出控制低电压工作域输出端输入端电路输出

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一种通信总线结构及通信方法

一种通信总线结构及通信方法

引用

作者：黄金煌 100000 北京市海淀区王庄路1号清华同方科技大厦D座15层1511-05号

本申请公开了一种通信总线结构及通信方法，所述通信总线结构包括主设备和至少一个从设备；所述主设备包括第一输入接口、第一输出接口、时钟信号输出接口以及第一片选接口；所述从设备包括第二输出接口、第二输入接口、时钟信号输入接... 详细信息

标准号: CN115580507A

本申请公开了一种通信总线结构及通信方法，所述通信总线结构包括主设备和至少一个从设备；所述主设备包括第一输入接口、第一输出接口、时钟信号输出接口以及第一片选接口；所述从设备包括第二输出接口、第二输入接口、时钟信号输入接口以及第二片选接口；所述第一输入接口与所述第二输出接口相连，所述第一输出接口与所述第二输入接口相连，所述时钟信号输出接口与所述时钟信号输入接口相连，以及所述第一片选接口与所述第二片选接口相连；其中，所述第一片选接口和所述第二片选接口为开漏输出。由于所述第二片选接口为开漏输出，从设备可通过对第二片选接口的信息输出的控制，可使主设备与从设备建立通信窗口，从而可由所述从设备给所述主设备发送数据。

关键词：片选接口从设备输出接口输入接口主设备时钟信号输出时钟信号输入通信总线主设备发送数据输出建立通信信息输出通信申请

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具有时钟信号分发的芯粒封装芯片

具有时钟信号分发的芯粒封装芯片

引用

作者：邹兴奇邓良策张亚林 201306 上海市浦东新区中国(上海)自由贸易试验区临港新片区业盛路188号A-522室

本发明公开了一种具有时钟信号分发的芯粒封装芯片，涉及集成电路封装技术，包括：封装基板；封装基板位于PCB基板上；PCB基板包括第一时钟源；封装基板上封装有多个芯粒；相邻的两个芯粒通过片间互联接口连接；每个芯粒包括输入时钟缓... 详细信息

标准号: CN116093088A

本发明公开了一种具有时钟信号分发的芯粒封装芯片，涉及集成电路封装技术，包括：封装基板；封装基板位于PCB基板上；PCB基板包括第一时钟源；封装基板上封装有多个芯粒；相邻的两个芯粒通过片间互联接口连接；每个芯粒包括输入时钟缓冲器、输出时钟缓冲器和至少一个片间互联接口；输入时钟缓冲器将时钟信号输出至所在芯粒内的每个片间互联接口和输出时钟缓冲器；多个芯粒包括一个第一芯粒和至少一个第二芯粒；第一时钟源与第一芯粒的输入时钟缓冲器连接；第二芯粒的输入时钟缓冲器与相邻芯粒的输出时钟缓冲器连接，相邻芯粒为第一芯粒或第二芯粒；第一芯粒和第二芯粒的输出时钟缓冲器与相邻的第二芯粒的输入时钟缓冲器连接。

关键词：芯粒缓冲器输入时钟输出时钟封装基板互联接口时钟源集成电路封装时钟信号输出封装芯片时钟信号分发

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低压差线性稳压器及其控制方法和电源管理系统

低压差线性稳压器及其控制方法和电源管理系统

引用

作者：柳奕名孙立平陈凯 310012 浙江省杭州市黄姑山路4号

公开了一种低压差线性稳压器及其控制方法和电源管理系统，低压差线性稳压器包括：主功率管和误差放大器，误差放大器根据基准电压和输出电压调节主功率管的控制端的电压以调节输出电压；时钟信号处理电路，将接收的第一时钟信号延时第... 详细信息

标准号: CN117806405A

公开了一种低压差线性稳压器及其控制方法和电源管理系统，低压差线性稳压器包括：主功率管和误差放大器，误差放大器根据基准电压和输出电压调节主功率管的控制端的电压以调节输出电压；时钟信号处理电路，将接收的第一时钟信号延时第一时间得到第三时钟信号，并根据第一时钟信号和第三时钟信号输出窗口信号，尾电流补偿电路，根据接收到的窗口信号控制自身的导通和关断来调节误差放大器的尾电流，以在第一时钟信号的有效边沿产生后的第一时间内增大误差放大器的尾电流。该低压差线性稳压器获取与负载电流有关的时钟信号，并在负载电流产生的时间段内增大误差放大器的尾电流，以提升静态电流，在节省功耗的同时加快瞬态响应。

关键词：误差放大器时钟信号尾电流低压差线性稳压器窗口信号负载电流主功率管时钟信号处理电路电源管理系统调节输出电压时钟信号输出时钟信号延时输出电压调节补偿电路基准电压静态电流瞬态响应有效边沿时间段导通功耗关断

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信号采样方法、逻辑装置和网络设备

信号采样方法、逻辑装置和网络设备

引用

作者：林贝贝林晖方春飞徐俊杰 230001 安徽省合肥市高新区创新大道2800号创新产业园二期J1楼A座5-9层

本公开提供一种信号采样方法、逻辑装置以及网络设备，为了解决现有技术中逻辑装置进位链级数过高的问题。本公开所提供的信号采样方法，通过时钟管理模块产生多个同频不同相位的采样时钟信号，并将上述多个同频但不同相位的时钟信号输... 详细信息

标准号: CN111181551B

本公开提供一种信号采样方法、逻辑装置以及网络设备，为了解决现有技术中逻辑装置进位链级数过高的问题。本公开所提供的信号采样方法，通过时钟管理模块产生多个同频不同相位的采样时钟信号，并将上述多个同频但不同相位的时钟信号输出至不同的采样模块，使得采样模块按照其接收到的时钟信号对通过延时链延时后的多个待采样信号进行采样，由于延时模块的数量由采样时钟周期、每一级延时模块产生的延时、以及采样时钟并行的数量确定，在存在多个采样时钟并行进行采样的情况下，可以使得延时链的级数得到降低。与现有技术相比，在精度不变的情况下，可以适应更低的采样时钟频率。

关键词：采样模块采样时钟逻辑装置信号采样延时模块延时链采样同频延时并行采样时钟频率采样时钟信号采样时钟周期时钟管理模块时钟信号输出采样信号时钟信号数量确定网络设备进位链每一级

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基于FPGA的旁路攻击功耗曲线采集同步时钟系统

基于FPGA的旁路攻击功耗曲线采集同步时钟系统

引用

作者：陆海宁宋安王伟嘉王凌云 200241 上海市闵行区东川路555号4号楼303B

一种基于FPGA的旁路攻击功耗曲线采集同步时钟系统，包括：同步时钟设备、工作时钟信号线通路、采集时钟信号线通路和采集信号线通路，其中：工作时钟信号线通路与待测设备相连并接收待测设备在旁路攻击的采集阶段输出的时钟信号，经过... 详细信息

标准号: CN110022201B

一种基于FPGA的旁路攻击功耗曲线采集同步时钟系统，包括：同步时钟设备、工作时钟信号线通路、采集时钟信号线通路和采集信号线通路，其中：工作时钟信号线通路与待测设备相连并接收待测设备在旁路攻击的采集阶段输出的时钟信号，经过分压处理后将时钟信号输出至同步时钟设备；采集时钟信号线通路与同步时钟设备相连并接收同步时钟设备的时钟信号，经过分压处理后输出至采集设备；采集信号线通路与待测设备相连，将运行中的待测设备的功耗信息输出至采集设备通过对时钟信号的倍频处理和同步处理，使得功耗信息实现精确同步，用于旁路攻击精确检测。本发明通过本装置使待测设备的时钟与采集设备的时钟相位一致，从而显著提高旁路攻击过程中功耗曲线的采集质量，增强旁路攻击效果。

关键词：待测设备旁路线通路采集设备时钟信号同步时钟攻击采集时钟信号工作时钟信号采集信号线功耗曲线功耗信息采集分压时钟信号输出同步时钟系统输出倍频处理接收同步阶段输出时钟设备时钟相位同步处理检测

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源极驱动器集成电路及其驱动方法、以及定时控制器

源极驱动器集成电路及其驱动方法、以及定时控制器

引用

作者：郑熙润吴雄镇崔正珉韩国大田广域市

本申请涉及源极驱动器集成电路及其驱动方法、以及定时控制器。提供了一种源极驱动器IC，该源极驱动器IC在以低功率模式操作时能够通过从定时控制器接收单独的时钟信号来消除输出偏移，该源极驱动器IC包括接收电路、控制电路、以及输出... 详细信息

标准号: CN118072681A

本申请涉及源极驱动器集成电路及其驱动方法、以及定时控制器。提供了一种源极驱动器IC，该源极驱动器IC在以低功率模式操作时能够通过从定时控制器接收单独的时钟信号来消除输出偏移，该源极驱动器IC包括接收电路、控制电路、以及输出缓冲器电路，该输出缓冲器电路被配置为在以正常模式操作时输出与图像数据相关的数据电压，并且在以低功率模式操作时维持数据电压的输出，其中，该输出缓冲器电路被配置为在以正常模式操作时根据第一时钟信号输出数据电压，而在以低功率模式操作时根据第二时钟信号输出数据电压。

关键词：数据电压输出缓冲器电路低功率模式源极驱动器时钟信号输出定时控制器正常模式接收电路控制电路驱动器IC 时钟信号输出偏移图像数据输出种源配置集成电路驱动申请

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