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T=题名（书名、题名），A=作者（责任者），K=主题词，P=出版物名称，PU=出版社名称，O=机构（作者单位、学位授予单位、专利申请人），L=中图分类号，C=学科分类号，U=全部字段，Y=年（出版发行年、学位年度、标准发布年）

检索规则说明：

AND代表“并且”；OR代表“或者”；NOT代表“不包含”；(注意必须大写,运算符两边需空一格)

检索范例：

范例一：(K=图书馆学 OR K=情报学) AND A=范并思 AND Y=1982-2016
范例二：P=计算机应用与软件 AND (U=C++ OR U=Basic) NOT K=Visual AND Y=2011-2016

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文献类型

37 篇 专利
1 篇 学位论文

馆藏范围

38 篇 电子文献
0 种 纸本馆藏

日期分布

学科分类号

1 篇 工学
- 1 篇 电子科学与技术（可...

主题

1 篇 抖动敏感度
1 篇 误码率
1 篇 电路设计
1 篇 时钟数据恢复模块
1 篇 串行接口

机构

4 篇 青岛海信宽带多媒...
3 篇 上海坤锐电子科技...
2 篇 中国人民解放军国...
2 篇 tcl华星光电技术有...
2 篇 南京观海微电子有...
2 篇 电子科技大学
2 篇 北京理工大学
2 篇 成都振芯科技股份...
1 篇 苏州兆芯半导体科...
1 篇 展达科技股份有限...
1 篇 中国信息通信科技...
1 篇 中国科学院大学
1 篇 盛科网络有限公司
1 篇 中兴通讯股份有限...
1 篇 上海拜安实业有限...
1 篇 北京奕斯伟计算技...
1 篇 武汉乐芯科技有限...
1 篇 深圳市兆捷科技有...
1 篇 华为技术有限公司
1 篇 海宁奕斯伟集成电...

作者

4 篇 刘旭霞
3 篇 佘磊
3 篇 沈仲汉
3 篇 任文亮
2 篇 连佳彬
2 篇 卜祥元
2 篇 梁冰
2 篇 朱华涛
2 篇 贲世健
2 篇 段有楠
2 篇 宋璟昱
2 篇 黄涛
2 篇 朱理辰
2 篇 陈雁
2 篇 刘昊
2 篇 刘金风
2 篇 苟冠鹏
2 篇 牟卫峰
2 篇 钟岩
2 篇 陈树文

语言

38 篇 中文

检索条件"主题词=时钟数据恢复模块"

共 38 条记录，以下是1-10 订阅

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详细简洁

排序：

高速串行接口时钟数据恢复电路设计研究

高速串行接口时钟数据恢复电路设计研究

引用

作者：李天一中国科学院大学

学位级别：博士

伴随着信息时代的高速发展，大数据时代的来临，网络通信、高密度计算、高速视频图像处理等领域对数据高速传输提出了更高的要求，适应于不同工作情况的高速协议大量推出。深亚微米及纳米工艺下，传统并行通信协议由于数据传输线过多，... 详细信息

伴随着信息时代的高速发展，大数据时代的来临，网络通信、高密度计算、高速视频图像处理等领域对数据高速传输提出了更高的要求，适应于不同工作情况的高速协议大量推出。深亚微米及纳米工艺下，传统并行通信协议由于数据传输线过多，浪费面积，并且线间耦合较重，难以提高工作频率，逐渐被高速串行通信协议替代。高速串行接口由发射机和接收机两部分构成，接收机中最关键的模块是时钟数据恢复(Clock and Data Recovery，CDR)电路，负责从输入的高速差分数据中恢复出同步时钟，用于数据采样。\n 现行的CDR电路主要包含开环结构和闭环结构两大类，其中得到最广泛应用的是传统双环CDR和相位插值CDR两种。传统双环CDR基于锁相环(Pbase Lock Loop，PLL)，实现简单，频偏容限高，但锁定缓慢;相位插值CDR基于相位插值器(Phase Interpo lator，PI)，锁定快，易于数字化和工艺移植，但难以调整时钟频率，从而频偏容限较低，两种结构各有优劣。CDR电路的抖动性能与接收机误码率(Bit Error Rate，BER)关系重大，需要进行系统分析研究。\n 本文首先对PLL和CDR环路进行系统建模，从抖动产生、抖动传输和抖动容限几方面进行考量。针对自偏置PLL,深入分析了其电源噪声敏感度(Supply Noise Sensitivity，SNR)，提出了一种基于系统传输函数的SNR估算方法。该方法分析自偏置锁相环控制电压调节器传输特性，获得自偏置锁相环噪声传递函数，从而计算得出环路SNR曲线。与瞬态仿真结果对比表明电源噪声敏感度曲线趋势吻合，但在SNR最高点的绝对值上有所差异，原因在于本方法忽略了输入抖动时，调节器电路前后两端的微小压差以及电路本身的失配。该方法一定程度上避免了设计中的长时间反复瞬态仿真，为环路抖动性能的优化提供了参考。\n 本文随后在调研前人结构的基础上，设计了一款相位插值CDR芯片，该芯片在130nm CMOS工艺下实现，经过流片验证可覆盖500Mbps至1.7Gbps数据率。二进制鉴相器在输入数据率500Mbps至1Gbps之间采用全速率模式，在1Gbps至***之间采用半速率模式，从而采样时钟频率范围保持在500MHz至1GHz，避免进入相位插值器线性度较差(＜0.925)的区域。相位插值器采用两级结构，7位二进制精度，相位控制码产生电路通过对两级PI的粗调和细调，提升了锁定速度，从而扩大了频偏容限，经测试可达±1466ppm。该CDR单位数据率功耗为32.5mW/Gbps，芯核面积约为0.359mm2。\n 在此相位插值CDR的基础上，本文提出了一种控制码锁存结构。该电路结构检测到CDR环路锁定后将控制码锁存，从而令恢复时钟不再跟踪数据相位，从而消除了系统相位噪声，时钟抖动仅为450fs。当检测到恢复时钟相位超出设定阈值时，为防止环路失锁，相位控制码将解除锁存，输出时钟相位继续跟踪数据相位。数据输入10MHz抖动时，CDR抖动容限可达0.4UI，未受到影响。该控制码锁存电路的核心模块为CDR锁定判断电路，前人结构存在一定问题，如同步头误码率检测不能在数据传输过程中实时判断锁定、眼图扫描电路开销较大等。本文提出了一款新式的CDR锁定判断电路，采用移位寄存器对每个周期中鉴相器输出的超前/滞后脉冲分别计数，实时监控相位是否超过阈值。后续电路进一步计算出控制码平衡点位置，保证恢复时钟保持在最佳采样位置。\n 本文最后设计了一款传统双环CDR芯片，在180nm CMOS工艺下实现并流片，数据率范围500Mbps至6Gbps。采用自适应均衡器结构，可根据数据通道自动调整均衡器高频增益，3GHz最高增益补偿15dB。本CDR单位数据率功耗为21.09mW/Gbps，芯核面积约为0.534mm2。\n 综上所述，本文提出了一种自偏置PLL电源噪声敏感度估算方法，为PLL和CDR的抖动新能优化提供了参考;设计了两款不同结构的CDR芯片，与相同工艺下的其他文献工作进行比较，在相位抖动、频偏容限等指标上有一定优势;提出了一种简便的控制码锁存结构，消除了CDR恢复时钟系统相位噪声，同时不影响抖动容限。

关键词：串行接口时钟数据恢复模块电路设计抖动敏感度误码率

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基于时钟数据恢复的模数混合高速信号时间测量系统

基于时钟数据恢复的模数混合高速信号时间测量系统

引用

作者：宋璟昱朱理辰马永锋刘昊卜祥元安建平 100081 北京市海淀区中关村南大街5号

本发明涉及一种基于时钟数据恢复的模数混合高速信号时间测量系统，属于通信信号处理领域。该系统包括：激光接收模块、时钟数据恢复模块、时钟管理模块、混频模块、低通滤波模块、采样模块、载波跟踪模块、信号捕获模块和测距测速信息... 详细信息

标准号: CN108418671B

本发明涉及一种基于时钟数据恢复的模数混合高速信号时间测量系统，属于通信信号处理领域。该系统包括：激光接收模块、时钟数据恢复模块、时钟管理模块、混频模块、低通滤波模块、采样模块、载波跟踪模块、信号捕获模块和测距测速信息解算模块。本发明能够减少信号处理算法对高速ADC的依赖性，降低对ADC采样率的要求，可使数据通信速率进一步提高，同时可以增加对通信/测距帧的信息利用率，并提高测距测速精度。

关键词：测距测速时钟数据恢复模块低通滤波模块激光接收模块时间测量系统时钟管理模块时钟数据恢复通信信号处理信号捕获模块信号处理算法信息利用率采样模块高速信号混频模块模数混合数据通信载波跟踪高速ADC 采样率解算通信

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基于时钟数据恢复的模数混合高速信号时间测量系统

基于时钟数据恢复的模数混合高速信号时间测量系统

引用

作者：宋璟昱朱理辰马永锋刘昊卜祥元安建平 100081 北京市海淀区中关村南大街5号

标准号: CN108418671A

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时钟数据恢复装置及电子设备

时钟数据恢复装置及电子设备

引用

作者：程昱邓升成郭龙成 518129 广东省深圳市龙岗区坂田华为总部办公楼

本发明实施例公开了一种时钟数据恢复装置以及设有该时钟数据恢复装置的电子设备，属于通信技术领域。解决了现有的时钟数据恢复模块存在输出抖动较大的技术问题。该时钟数据恢复装置，包括时钟数据恢复单元、数控振荡单元和先入先出单... 详细信息

标准号: CN103414452B

本发明实施例公开了一种时钟数据恢复装置以及设有该时钟数据恢复装置的电子设备，属于通信技术领域。解决了现有的时钟数据恢复模块存在输出抖动较大的技术问题。该时钟数据恢复装置，包括时钟数据恢复单元、数控振荡单元和先入先出单元；时钟数据恢复单元用于通过第一输入时钟信号对数据输入信号进行时钟数据恢复，生成初步时钟信号和初步数据信号；数控振荡单元用于以一定的分频系数对第二输入时钟信号进行分频，生成并向外部发送恢复时钟信号，还将初步时钟信号与恢复时钟信号进行比较，如果初步时钟信号超前或滞后于恢复时钟信号，则将分频系数相应的减1或加1。本发明应用于电子设备中收发数据的处理。

关键词：时钟数据恢复装置恢复时钟信号时钟信号时钟数据恢复单元数控振荡单元电子设备分频系数输入时钟时钟数据恢复模块时钟数据恢复数据输入信号通信技术领域收发数据输出抖动数据信号分频超前发送滞后外部应用

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一种固定延迟消息传输方法及相关产品

一种固定延迟消息传输方法及相关产品

引用

作者：杨俊峰曾金瑞 230026 安徽省合肥市包河区金寨路96号

本申请公开了一种固定延迟消息传输方法及相关产品。在执行本申请实施例提供的方法时，利用数据发送端在待传输数据中与第一固定值对应的序列位置嵌入固定延迟消息，并将其转换为串行数据流进行发送。时钟数据恢复模块从恢复出的并行时... 详细信息

标准号: CN117992253A

本申请公开了一种固定延迟消息传输方法及相关产品。在执行本申请实施例提供的方法时，利用数据发送端在待传输数据中与第一固定值对应的序列位置嵌入固定延迟消息，并将其转换为串行数据流进行发送。时钟数据恢复模块从恢复出的并行时钟的第一个时钟边沿开始将串行数据流存储在数据块分割管理模块的数据缓存区中。当串行数据流存储在数据缓存区中时，数据块分割管理模块基于第二固定值对存储在数据缓存区中的串行数据流进行分割得到数据块。输出序列管理模块基于第三固定值和固定延迟消息的序列位置输出数据块和固定延迟消息。如此，使得嵌入待传输串行数据一起传输的固定延迟消息可以在传输过程中保持延迟的固定。

关键词：延迟串行数据流数据缓存区管理模块数据块分割序列位置存储嵌入时钟数据恢复模块待传输数据输出数据块数据发送端传输并行时钟传输过程串行数据时钟边沿输出序列消息传输数据块申请发送分割转换恢复

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一种数字光发射机边沿抖动检测器

一种数字光发射机边沿抖动检测器

引用

作者：黄涛苏君邱琪范志强 611731 四川省成都市高新区(西区)西源大道2006号

一种数字光发射机边沿抖动检测器及检测方法，属于数字信号参数测量技术领域。所述数字光发射机边沿抖动检测器包括1×2光分路器，第三光电探测器，时钟数据恢复模块，时钟分路器，时钟倍频整形模块，光纤延迟线，双端口调制器，第... 详细信息

标准号: CN114726437B

一种数字光发射机边沿抖动检测器及检测方法，属于数字信号参数测量技术领域。所述数字光发射机边沿抖动检测器包括1×2光分路器，第三光电探测器，时钟数据恢复模块，时钟分路器，时钟倍频整形模块，光纤延迟线，双端口调制器，第一光电探测器，第二光电探测器，第一模数转换器，第二模数转换器，边沿抖动测量模块，系统控制及数据处理模块。本发明提供的一种数字光发射机边沿抖动检测器及检测方法，对测量时间段内的所有边沿信号逐一测量，极大地提升了测量有效性，降低了测量过程中的对元器件的参数要求和资源开销，解决了传统测量方法中的技术瓶颈。

关键词：发射机抖动检测器光电探测器数字光转换器测量时钟数据恢复模块数据处理模块光纤延迟线时钟分路器边沿信号参数测量参数要求测量过程传统测量抖动测量光分路器技术瓶颈时钟倍频数字信号系统控制整形模块资源开销第二模第一模调制器时间段双端口检测元器件

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一种数字光发射机边沿抖动检测器及检测方法

一种数字光发射机边沿抖动检测器及检测方法

引用

作者：黄涛苏君邱琪范志强 611731 四川省成都市高新区(西区)西源大道2006号

标准号: CN114726437A

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一种SERDES接收端眼图测量电路

一种SERDES接收端眼图测量电路

引用

作者：王杰高挺挺张强刘家兵 230031 安徽省合肥市高新区望江西路800号创新产业园二期J2栋A座20层

本发明提供一种SERDES接收端眼图测量电路，包括均衡器、时钟数据恢复模块、锁相环和眼图测量模块；均衡器对接入的输入信号进行均衡处理得到均衡信号；均衡信号输入至时钟数据恢复模块恢复出输入信号的数据信息，并将数据信息输入眼图... 详细信息

标准号: CN116933706A

本发明提供一种SERDES接收端眼图测量电路，包括均衡器、时钟数据恢复模块、锁相环和眼图测量模块；均衡器对接入的输入信号进行均衡处理得到均衡信号；均衡信号输入至时钟数据恢复模块恢复出输入信号的数据信息，并将数据信息输入眼图测量模块；锁相环提供初始时钟；眼图测量模块的信号输入端连接均衡器的输出端，眼图测量模块的反馈端连接时钟数据恢复模块的输出端；眼图测量模块对输入信号或均衡信号进行采样以产生观测数据，并将观测数据和数据信息进行按位比对处理后以绘制眼图。本发明可以设定任意码型/输入码流长度，且将时钟数据恢复模块恢复出的数据信息与观测数据进行按位比对处理，从而使重建和绘制出的眼图更加真实。

关键词：测量模块时钟数据恢复模块数据信息观测数据均衡信号比对处理均衡器输出端锁相环绘制信号输入端测量电路均衡处理连接均衡输入码流反馈端接收端采样码型恢复重建

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一种SOC芯片及射频信号处理方法

一种SOC芯片及射频信号处理方法

引用

作者：沈仲汉佘磊任文亮 201203 上海市浦东新区自由贸易试验区张东路1387号10幢101室2层

本发明公开了一种SOC芯片及射频信号处理方法，其中SOC芯片包括：非接模块协处理器和非接通信模块，非接通信模块，与非接模块协处理器电连接，包括初步唤醒模块和时钟数据恢复模块；初步唤醒模块，与非接模块协处理器电连接，用于检测... 详细信息

标准号: CN107918596B

本发明公开了一种SOC芯片及射频信号处理方法，其中SOC芯片包括：非接模块协处理器和非接通信模块，非接通信模块，与非接模块协处理器电连接，包括初步唤醒模块和时钟数据恢复模块；初步唤醒模块，与非接模块协处理器电连接，用于检测SOC芯片所在射频场的场强，于检测到场强大于预设值时，向非接模块协处理器发送第一唤醒指令；非接模块协处理器，与时钟数据恢复模块电连接；时钟数据恢复模块，用于根据第一唤醒指令进入工作状态，提取输入射频信号的时钟信号，并根据时钟信号向非接模块协处理器发送唤醒指示信号；非接模块协处理器，还用于根据唤醒指示信号确定是否对SOC芯片进行唤醒。实现了降低SOC芯片功耗。

关键词：协处理器时钟数据恢复模块电连接唤醒指示信号场强唤醒模块唤醒指令时钟信号与非接通射频信号处理输入射频信号发送射频场检测功耗预设唤醒

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一种高速通信接口芯片的测试系统及方法

一种高速通信接口芯片的测试系统及方法

引用

作者：韩益锋李亮王杨陆陶佳怡 215332 江苏省苏州市昆山市花桥镇双华路388号4号楼二层

本发明公开了一种高速通信接口芯片的测试系统，涉及通信领域，该高速通信接口芯片的测试系统包括：分选机，用于在芯片的自动化量产测试中负责移动待测芯片至装载板上的芯片转接器，等待芯片测试完成后，将芯片按照程序设置放置在对应... 详细信息

标准号: CN116795703A

本发明公开了一种高速通信接口芯片的测试系统，涉及通信领域，该高速通信接口芯片的测试系统包括：分选机，用于在芯片的自动化量产测试中负责移动待测芯片至装载板上的芯片转接器，等待芯片测试完成后，将芯片按照程序设置放置在对应的已测区域中，按照测试合格、不合格，以及不合格对应的不良项目对芯片进行分类存放；装载板，用于放置待测芯片；本发明的有益效果是：本发明通过训练序列得到数据通信信道参数，在接口板到装载板的链路中采用信号预均衡抵消信道损耗，同时确认时钟数据恢复模块的参数以及持续改善，提升接口板预装载板之间通信的信号传输和解码质量，从而达到降低接收误码率、提升测试效率和直通率的效果。

关键词：芯片装载板高速通信接口测试系统待测芯片接口板时钟数据恢复模块数据通信信道测试不良项目测试效率程序设置分类存放通信领域芯片测试信道损耗信号传输训练序列分选机误码率预均衡预装载转接器链路量产抵消自动化移动通信

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