检索结果-内蒙古大学图书馆

微电子学 2022年第4期52卷 539-543页

作者：周前能李恒李红娟张红升杨虹唐政维重庆邮电大学光电工程学院重庆400065 重庆邮电大学计算机科学与技术学院重庆400065

采用0.13μm CMOS工艺,设计了一种用于模数转换器时钟电路的电荷泵。在共源共栅充/放电流源与其偏置电路之间增加传输门,有效地抑制了电荷泵关闭时产生的漏电流。同时,采用电流源提升技术,有效地提高了电荷泵充/放电电流支路的阻抗,抑... 详细信息

采用0.13μm CMOS工艺,设计了一种用于模数转换器时钟电路的电荷泵。在共源共栅充/放电流源与其偏置电路之间增加传输门,有效地抑制了电荷泵关闭时产生的漏电流。同时,采用电流源提升技术,有效地提高了电荷泵充/放电电流支路的阻抗,抑制了沟道长度调制效应的影响,提高了电荷泵的电流匹配性。仿真结果表明,在1.2 V电源电压、20μA输出电流的条件下,输出电压的变化范围为0.13~0.93 V时,该电荷泵的充/放电电流失配低于1%。

关键词：模数转换器时钟管理电路电荷泵

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高精度模数转换器的接口技术

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半导体技术 2003年第3期28卷 58-62页

作者：李素芬李刚孙景发天津大学精密仪器与光电子工程学院天津300072

为了保证高精度模数转换器的性能,在设计和使用高精度ADC的外围接口电路时应考虑到数据输出接口、基准电压模块、输入信号调理、电源管理、数字时序逻辑等多方面的因素,只有严格设计才能保证ADC的正常使用,并减小由于外围接口电路所带... 详细信息

为了保证高精度模数转换器的性能,在设计和使用高精度ADC的外围接口电路时应考虑到数据输出接口、基准电压模块、输入信号调理、电源管理、数字时序逻辑等多方面的因素,只有严格设计才能保证ADC的正常使用,并减小由于外围接口电路所带来的失调误差、增益误差等误差。本文结合具体实例,提出了高精度ADC的接口设计方案。

关键词：模数转换器外围接口失调误差增益误差

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基于0.18μmCMOS工艺的8bit插值结构闪存式模数转换器设计

基于0.18μmCMOS工艺的8bit插值结构闪存式模数转换器设计

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作者：李良御黑龙江大学

学位级别：硕士

在信息化时代的背景下,模数转换器的重要性与日俱增,对于转换速度、功耗、面积额的要求也越来越高。这些性能好坏决定了整个信号处理系统的性能,也同样间接地决定着模数转换技术的水平。插值结构闪存式模数转换器以它高速低功耗、小面... 详细信息

在信息化时代的背景下,模数转换器的重要性与日俱增,对于转换速度、功耗、面积额的要求也越来越高。这些性能好坏决定了整个信号处理系统的性能,也同样间接地决定着模数转换技术的水平。插值结构闪存式模数转换器以它高速低功耗、小面积的特点越来越得到人们的关注。本文基于Cadence平台,运用TSMC 0.18μm CMOS工艺,设计了一种8位1GHz的插值结构闪存式模数转换器,它主要包括:带隙电压基准源、电阻分压网络、前置放大器、插值电阻结构、高速锁存比较器、气泡码消除电路、编码器电路。其中,带隙基准电压源采用PTAT电流生成结构,在-50℃80℃区间进行温度仿真,得出温漂系数为8.3ppm/℃。采用开环正反馈结构作为前置放大器,仿真出其增益为38.4dB,单位增益带宽为743MHz。由动态锁存结构和自偏置差分结构构成的高速锁存比较器,在5GHz的时钟频率下,不仅实现了比较功能,还达到了21ps的响应时间。电阻插值结构,提高了过零点个数,节省了近四分之三的前置放大器,节约面积,降低功耗。整体仿真结果表明:电源电压为1.8V,采样频率为1GHz,输入信号为20MHz正弦波,静态特性INL为0.35LSB,DNL为0.2LSB;动态特性SNR为44.3dB,SNDR为41.6dB,SFDR为54.35d B,ENOB为7.1bit,功耗为234mW,整体版图面积为2.36mm2,并且通过了DRC和LVS验证。

关键词：插值结构闪存高速模数转换器

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16位120MSPS流水线型模数转换器设计

16位120MSPS流水线型模数转换器设计

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作者：王泽源西安电子科技大学

学位级别：硕士

现实世界的绝大多数信号为随时间连续变化的模拟信号,但另一方面随着数字集成电路的飞速发展,数字信号极大提高了人类处理数据的能力,而模数转换器(ADC)则主要是将现实世界的模拟信号转换为能被系统快速处理的数字信号,因此其重要性不... 详细信息

现实世界的绝大多数信号为随时间连续变化的模拟信号,但另一方面随着数字集成电路的飞速发展,数字信号极大提高了人类处理数据的能力,而模数转换器(ADC)则主要是将现实世界的模拟信号转换为能被系统快速处理的数字信号,因此其重要性不言而喻。ADC一直是通信系统的关键模块,尤其在第五代移动通信(5G)中要求ADC具有更高精度、更快速度以及更低功耗。流水线ADC可以通过合理分配各子级精度以达到精度、速度与功耗同时兼顾,因此其在高精度、高速度的通信系统中一直为首选结构。本文将重点研究高精度、中高速、低功耗流水线ADC的系统架构以及其关键电路的设计。本文基于CMOS 0.18μm工艺,设计一种16位120MSPS的开关电容结构流水线ADC,重点研究流水线ADC中3.5位、1.5位流水线子级电路以及溢出校准技术。首先确定流水线ADC系统架构为“3.5+3.5+1.5+1.5+1.5+1.5+1.5+1.5+1.5+3”以兼顾速度与功耗;用MATLAB工具对ADC结构进行行为级建模以验证该架构的有效性。在电路设计方面,流水线子级主要由MDAC与Sub-ADC组成。在MDAC架构上,前两个3.5位子级中MDAC采用带有溢出检测功能的电荷重分配型架构,1.5位子级中MDAC则采用传统的电容翻转型架构;MDAC中余差放大器采用套筒式增益提高级的两级放大器,其增益分别是96d B和88d B;Sub-ADC中的电压比较器采用由预运放与锁存器构成的开关电容型比较器,其失调电压是1.93m V;同时为抑制“气泡”码所带来的量化误差,在3.5位子级中的译码器采用格雷码作为中间编码的译码方式。最后提出一种全新的溢出位检测方式,前两个3.5位子级输出数字码的最高位(MSB)为溢出判断位,通过简单逻辑电路即可实现对溢出情况的判断。在完成模块电路设计后,分别对各个子模块电路的功能以及性能进行仿真验证。仿真表明在输入频率为10.0098MHZ、差分摆幅为2.4V的正弦信号下,前三个流水线子级输出有效位数分别为13.7bit、12.25bit、11.92bit,均满足后续子级对前级精度要求。在输入信号频率为12.1918MHZ、采样频率为120MS/s下,ADC的SFDR为92.4d B,SNR为95.5d B,SNDR为90.7d B,ENOB为14.77bit,满足设计指标要求。

关键词：流水线模数转换器比较器 MDAC 溢出位

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高性能流水线模数转换器关键单元的研究与设计

高性能流水线模数转换器关键单元的研究与设计

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作者：叶栋北京师范大学

学位级别：硕士

随着数字信号处理技术和集成电路技术的迅猛发展，模数转换器（ADC）的应用领域越来越广，人们对ADC的要求越来越高。因此ADC的设计总体上向着速度更快，分辨率更高的趋势发展。随着便携设备的应用越来越多，低功耗成为了设计者们考虑... 详细信息

随着数字信号处理技术和集成电路技术的迅猛发展，模数转换器（ADC）的应用领域越来越广，人们对ADC的要求越来越高。因此ADC的设计总体上向着速度更快，分辨率更高的趋势发展。随着便携设备的应用越来越多，低功耗成为了设计者们考虑的又一大因素。\n 本文首先通过几种常见ADC结构的介绍与比较，阐明了流水线ADC的优势。接着对流水线ADC的传函曲线和数字校正技术进行了探讨，并在此基础上进行了流水线ADC的整体设计，采用每级1．5比特的结构。本文利用SMIC0．13μm CMOS工艺对可满足于10比特100MSPS流水线ADC的关键单元进行了研究与设计。\n 流水线ADC是一个复杂的系统，由多个模块组成，主要包括采样保持电路、各级流水线电路、基准电流源电路、时钟产生电路和数字校正电路等。其中，采样保持电路由采样开关和高性能的运算放大器等单元组成。各级流水线电路由子ADC、子DAC、级间增益放大器等单元组成。本文首先研究了流水线ADC最前端的采样保持电路，它是整个ADC的关键，其采样的速度和精度对整个ADC有着重要的影响。在提出了采样保持电路的整体架构后，本文着重分析了采样开关的必要性，并阐明了栅压自举采样开关的设计思想和注意事项。接着，本文对采样保持电路中的最关键部分即运算放大器进行了分析与设计。首先，对各种常见的运放进行比较分析。根据该工艺电源电压仅为1．2V的特点和需要达到的指标选定了运放的架构为增益自举型。接着，对增益自举型运放进行了详细的设计。在对运放的增益和带宽这两个重要指标产生影响的结构的设计上，先对重点管子的尺寸进行了手工的估算，然后对仿真时的技巧进行了介绍。同时，在考虑运放带宽和增益的前提下，兼顾低功耗的要求，对运放的偏置电路进行了设计并确定了偏置电流。本文对采用的共模反馈技术进行了讨论，更进一步地阐明了共模反馈的意义。最后对运放和采样保持电路整体进行了仿真。\n 本文还对子ADC中的动态比较器进行了研究。动态比较器是子ADC里的一个重要组成部分，其性能的好坏对比较后生成的数字信号的正确性有着重要的影响。本文在比较器的性能参数分析的基础上，提出了对动态比较器的设计方案，完成了对动态比较器的初步研究与设计。

关键词：模数转换器流水线增益自举放大器动态比较器数字校正电路 CMOS工艺

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用于脑电测量的16通道模数转换器芯片设计

用于脑电测量的16通道模数转换器芯片设计

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作者：卢家可哈尔滨工业大学

学位级别：硕士

随着人类对自身探索欲望的日趋强烈以及科学技术的发展,各种生物电信号已经被科学研究者所发现和利用。其中脑电信号是较为重要的信号之一,其在诸多医疗领域都有着巨大的作用,如果结合计算机技术,甚至可以做到用意识来对物体进行操控,... 详细信息

随着人类对自身探索欲望的日趋强烈以及科学技术的发展,各种生物电信号已经被科学研究者所发现和利用。其中脑电信号是较为重要的信号之一,其在诸多医疗领域都有着巨大的作用,如果结合计算机技术,甚至可以做到用意识来对物体进行操控,而脑电测量是其应用的第一步,也是最重要的一步。但是由于脑电测量需要大量的电极来进行检测,传统的模数转换器又十分笨重,为了适应新时代的发展,需要设计多通道的模数转换器,从而进一步提高集成度,减少仪器的重量和体积。本文通过比较各种多通道方案的利弊,选择了采用多通道单模数转换器时间复用的结构。并使用低噪声的仪表放大器来放大微弱的脑电信号,最后使用高精度的Sigma-Delta调制器来进行模数转换,从而得到很高的动态范围。本文设计了通道循环切换的多路选择器,并设计了循环切换的时钟。设计电流反馈型的低噪声仪表放大器,并使用斩波技术了,有效得抑制了低频噪声,并采用纹波抑制回路,极大得减少了输出端的高频波纹。使用了双路径和电阻电容反馈来进行频率补偿,从而展宽了带宽。且使用了电流衰减器,从而获得了更低的等效输入噪声。本文设计的调制器采用单环CIFF结构,为了实现较高的转换精度,阶数采用四阶,并通过matlab来对设计各级积分器的参数。在电路级设计时对第一级运放使用斩波来减少低频噪声,从而进一步维持前级低噪声性能。设计完所有电路后,对电路进行仿真,其前仿结果显示,低噪声仪表放大器在1Hz处的等效输入噪声为13.25 nV/sqrt(Hz),调制器的信噪比可以达到120.9dB,信噪失真比SNDR达到116dB,整个模拟部分的仿真结果显示250Hz动态范围约为132dB。然后进行版图的设计和后仿真,后仿真结果显示,16个通道的单通道输出速率达到600SPS,其1Hz处的等效输入噪声为14.2 nV/sqrt(Hz),其信噪比为119dB,信噪失真比为105dB,250Hz动态范围(不计谐波)达到132dB。

关键词：脑电测量低噪声高精度多通道模数转换器仪表放大器

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高速∑Δ模数转换器的研究与实现

高速∑Δ模数转换器的研究与实现

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作者：严喻冬东南大学

学位级别：硕士

随着无线传感器网络的不断发展,通信模块对模数转换器的要求不断提高,高速、高精度、低功耗成为了模数转换器重要的研究趋势。连续时间∑△模数转换器在精度、带宽和功耗之间较好的折衷,对模拟器件匹配度较低的要求,近年来得到了迅速的... 详细信息

随着无线传感器网络的不断发展,通信模块对模数转换器的要求不断提高,高速、高精度、低功耗成为了模数转换器重要的研究趋势。连续时间∑△模数转换器在精度、带宽和功耗之间较好的折衷,对模拟器件匹配度较低的要求,近年来得到了迅速的发展,对中高速无线传感器网络的进步有着重大意义。本文首先调研了国内外Σ△调制器的发展现状,对比了离散时间∑△调制器和连续时间Σ△调制器之间的优缺点,以及相互之间转换的方法。结合设计指标要求,设计了一款连续时间∑△调制器,该调制器采用2阶1位量化结构,具有10位有效精度；根据设计复杂度的要求,确定采用级联反馈结构；使用SDtoolbox设计出相应的噪声传输函数,应用冲激响应不变法,将得到的离散时间的结构参数转换到连续时间域；使用MATLAB中的simulink工具,对电路各模块的非理想特性进行仿真。在完成系统仿真的基础上,进行电路设计。采用有源RC积分器来满足调制器系统对积分器较高的要求；积分器中的运算放大器创新的采用了折叠共源共栅增益提高型结构,以得到较高的直流增益和足够大的带宽,使其不会对系统性能造成影响。电路仿真结果表明,该设计完全能够满足设计指标,系统工作稳定。论文最后在TSMC 0.18μm CMOS工艺下设计了调制器系统的版图,并进行了相应的仿真验证与测试。在仿真环境下,设置电源电压为1.8V,采样频率大于15MS/s,输入信号频率4.8828125MHz,幅度0.5V,仿真得到系统的SNR为58dB,整个调制器的功耗约为48mW,动态性能基本满足设计指标。

关键词：连续时间模数转换器积分器运算放大器量化器

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用于植入式医疗系统的逐次逼近型模数转换器研究

用于植入式医疗系统的逐次逼近型模数转换器研究

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作者：来晨浙江大学

学位级别：硕士

近年来，生物医学电子学和超大规模集成电路技术的发展使得使用植入式脑电（心电）记录系统提升癫痫病人的医疗体验成为可能，相关研究领域也受到高度关注。本文针对脑电、心电等生物信号记录中的关键技术之一----数据转换电路开展研究... 详细信息

近年来，生物医学电子学和超大规模集成电路技术的发展使得使用植入式脑电（心电）记录系统提升癫痫病人的医疗体验成为可能，相关研究领域也受到高度关注。本文针对脑电、心电等生物信号记录中的关键技术之一----数据转换电路开展研究。根据此类信号的特点，论文选择采用逐次逼近型的模数转换器(SARADC)结构，以利于在保持高精度的同时优化其功耗和面积。\n 本研究重点围绕逐次逼近型模数转换器的整体设计及校正方案展开。为节省功耗和面积，设计采用了整数倍桥电容的拆分电容阵列，配上基于共模电压的电容开关策略。针对电容失配问题引入了数字前场的校正以提升ADC的线性度。该方案使用额外的校正电容阵列测量主电容阵列的失配误差，最后利用数字后端处理技术校正ADC的原始输出。另一个特点是采用了一种带有可选自调零预放大器的时域比较器，时域比较器没有静态电流，功耗小，噪声性能好。自调零预放大器开启时大大提升了后级时域比较器的总体性能。该比较器结构设计能兼顾性能和功耗。设计的SAR ADC在Global Foundry0.13μm CMOS工艺下流片。在0.9V电压，208kS/s采样率下，被校正后的ADC的信噪比为72dB，对应的有效位数是11.6位，而消耗的功耗仅为5.5μW。本设计的校正方案最高能提升ADC原始输出1位的精度。芯片的核心电路面积是550μm×350μm。基于以上结果数据，本设计的SAR ADC很适合于植入式生物医疗系统。

关键词：集成电路模数转换器芯片设计低功耗技术

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1-0 MASH型Pipelined SAR模数转换器的关键技术研究

1-0 MASH型Pipelined SAR模数转换器的关键技术研究

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作者：王慧铭西安电子科技大学

学位级别：硕士

近年来,第五代通信技术日趋成熟,可穿戴设备和便携式设备的应用越来越普及,物联网的蓬勃发展正在将世界带入一个传感器无处不在的环境。模数转换器(ADC)作为连接模拟世界与数字系统的桥梁,普遍应用于各类电子设备中。为了实现整个系统... 详细信息

近年来,第五代通信技术日趋成熟,可穿戴设备和便携式设备的应用越来越普及,物联网的蓬勃发展正在将世界带入一个传感器无处不在的环境。模数转换器(ADC)作为连接模拟世界与数字系统的桥梁,普遍应用于各类电子设备中。为了实现整个系统的低功耗设计,对模数转换器性能和功效的要求也越来越严格。逐次逼近流水线混合型(Pipelined SAR)ADC结合了流水线型(Pipelined)ADC和逐次逼近型(SAR)ADC的优势,在速度、功耗和面积上做了非常好的折中,已成为高速、高精度ADC最常见的实现方式。然而,SAR ADC中的比较器噪声会限制其分辨率,从而降低ADC的能效。为了实现更高的分辨率,同时保持出色的能效,可以在Pipelined SAR ADC中引入Δ-ΣADC所采用的过采样和噪声整形(Noise shaping,NS)技术。本文主要研究了两级Pipelined SAR ADC的基本原理和设计方法,并在第一级子ADC中加入噪声整形技术以提升性能,最终实现了一款1-0 MASH型Pipelined SAR ADC。主要研究内容如下:首先,为了实现有效的噪声传递函数(NTF),本文采用无源方式,利用差分采样、电容积分和电荷共享原理,在第一级子ADC实现了高能效的一阶噪声整形,避免了运算放大器等有源器件,节省了功耗,简化了电路结构;同时采用Coarse SAR和Fine SAR并行工作的方式,提高了第一级SAR ADC的转换速度。Coarse SAR的决策结果直接传给Fine SAR,第一级产生的量化误差在第二级SAR ADC被处理。基于两级Pipelined SAR ADC结构,对量化误差进行了分析,利用比较器的相对放大,消除了传统Pipelined ADC中的余差放大器,提高了ADC的整体速度。其次,在上述研究的基础上,本文搭建了1-0 MASH型Pipelined SAR ADC的数学模型。第一级SAR ADC采用四位结构,第二级SAR ADC采用六位结构,其中冗余一位。利用MATLAB工具完成了Simulink的仿真验证,并进行了数字校准。结果表明,第一级噪声整形环路可以有效提高系统的信噪比。通过建模验证,第一级Coarse SAR的噪声传输函数并不敏感,允许有一定的偏差,这在一定程度上放宽了无源积分环路的设计要求。本设计的1-0 MASH结构不仅可以巧妙地抵消第一级的量化噪声,对第二级的量化噪声进行整形,同时可以利用第一级噪声传输函数NTF整形级间增益误差(gain error shaping),改善性能,解决了由比较器相对放大引起的增益误差难以在数字域进行校准这一问题,从而大大提高整形效率。最后,基于TSMC 28nm标准CMOS工艺,通过Cadence工具完成了1-0 MASH型Pipelined SAR ADC的整体电路设计,具体模块包括采样保持电路、四输入动态比较器、无源积分噪声整形环路、SAR ADC逐次逼近逻辑、异步时钟产生电路等,并进行了仿真验证,绘制了物理版图。电路参数如下:电源电压0.9V,带宽100MHz,采样频率1.6GHz,过采样率为8。仿真测得:SNR达到70.4d B,SNDR达到70.11d B,SFDR达到83.32d B。本设计适用于先进移动通讯(如第五代新无线电)设备,能够满足接收机模数转换器的指标要求。

关键词：逐次逼近流水线混合型模数转换器无源积分噪声整形级间增益误差整形

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高精度低功耗逐次逼近型模数转换器芯片的研究与设计

高精度低功耗逐次逼近型模数转换器芯片的研究与设计

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作者：骆林波电子科技大学

学位级别：硕士

模数转换器(Analog-to-Digital Converter,ADC)作为连接模拟信号和数字信号的桥梁,在各种电子系统中发挥着重要的作用。和几种传统架构的ADC相比,逐次逼近型(Successive Approximation Register,SAR)ADC具有功耗低和面积小的优势,随着... 详细信息

模数转换器(Analog-to-Digital Converter,ADC)作为连接模拟信号和数字信号的桥梁,在各种电子系统中发挥着重要的作用。和几种传统架构的ADC相比,逐次逼近型(Successive Approximation Register,SAR)ADC具有功耗低和面积小的优势,随着集成电路先进工艺的不断发展,其采样速度和精度有了更大的提升空间,使得SAR ADC在中等速度、中高等精度领域中受到了广泛的研究。其中对于高精度低功耗SAR ADC,被广泛应用于精密数据采集系统、仪器仪表以及医疗设备等领域,但由于制造工艺造成电容失配,会严重限制ADC的精度,因此研究校准技术对SAR ADC精度的提升具有重要意义。本论文基于0.35μm CMOS工艺,设计了一款18位的高精度低功耗SAR ADC电路,重点对高精度SAR ADC的关键子模块电路的设计进行了深入分析和研究。对于电容型数模转换器(DAC)的设计,为满足18位量化精度的要求,基于分段电容阵列原理和冗余技术原理的分析,采用“11+7”的分段结构,有效节省DAC的面积和功耗,并加入了三位冗余电容,为SAR ADC的比较过程提供容错空间。以及结合本论文采用的自校准算法,将全差分电容阵列中负端的低位段电容用作校准DAC,使得电容阵列DAC变成伪差分结构,并设计了一种采用单调开关和传统开关相结合的混合开关切换方式。为满足比较器的精度和速度的要求,设计了一种四级预放大器加锁存器级联结构的比较器,对比较器电路进行仿真,得到预放大器的整体增益为67.7 d B,带宽为12.2 MHz,比较器的等效输入噪声为13.5μV。针对电容失配对SAR ADC精度的限制,本论文设计了一种基于自校准的模拟校准技术,即利用伪差分结构的DAC电容阵列负端的低位电容校正高位电容的失配,和传统自校准的SAR ADC对比,不需要额外的电容阵列作校准DAC,有效的节约了芯片面积和功耗,并基于MATLAB工具搭建校准算法模型,进行行为级仿真验证了校准算法。最后对18位SAR ADC的整体电路进行了前仿真分析,以及版图设计和后仿真分析。后仿真结果表明,在典型工艺角下,ADC的有效位数为16.7位,SFDR为109.2 d B,SNDR为102.6 d B,功耗为25 m W。

关键词：模数转换器逐次逼近型分段电容阵列自校准技术

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