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文字说明：

T=题名（书名、题名），A=作者（责任者），K=主题词，P=出版物名称，PU=出版社名称，O=机构（作者单位、学位授予单位、专利申请人），L=中图分类号，C=学科分类号，U=全部字段，Y=年（出版发行年、学位年度、标准发布年）

检索规则说明：

AND代表“并且”；OR代表“或者”；NOT代表“不包含”；(注意必须大写,运算符两边需空一格)

检索范例：

范例一：(K=图书馆学 OR K=情报学) AND A=范并思 AND Y=1982-2016
范例二：P=计算机应用与软件 AND (U=C++ OR U=Basic) NOT K=Visual AND Y=2011-2016

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限定检索结果

文献类型

179 篇 专利

馆藏范围

179 篇 电子文献
0 种 纸本馆藏

日期分布

机构

8 篇 清华大学
8 篇 北京源启先进微电...
7 篇 中国人民解放军海...
7 篇 哈尔滨工程大学
6 篇 光子智能股份有限...
6 篇 西安理工大学
5 篇 电子科技大学
3 篇 东南大学
3 篇 湖南迈克森伟电子...
3 篇 京东方科技集团股...
3 篇 湖北精瑞通流体控...
3 篇 山西大学
3 篇 阿里巴巴集团控股...
2 篇 云南电力试验研究...
2 篇 中国科学院半导体...
2 篇 武汉市康达电气有...
2 篇 卓尔智联研究院有...
2 篇 华中科技大学
2 篇 瑞典爱立信有限公...
2 篇 北京北广科技股份...

作者

7 篇 张文旭
6 篇 罗纳德.加农
6 篇 莫里斯.斯坦曼
6 篇 靖礼
6 篇 阿拉什.侯赛因扎德...
6 篇 井凯
6 篇 马修.高理
6 篇 沈亦晨
6 篇 谢鹏
6 篇 鲁门.丹高夫斯基
6 篇 孟怀宇
6 篇 卢正观
6 篇 吴建华
4 篇 史方明
4 篇 陈亚静
4 篇 曹家博
4 篇 沈祥
3 篇 蔡衡芳
3 篇 湛龙
3 篇 龚高茂

语言

179 篇 中文

检索条件"主题词=求和模块"

共 179 条记录，以下是71-80 订阅

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详细简洁

排序：

一种基于CEM FRM的动态非均匀窄过渡带滤波器组及设计方法

一种基于CEM FRM的动态非均匀窄过渡带滤波器组及设计方法

引用

作者：张文旭姚雨双赵文童张春光郜丽鹏何俊希张恒范晓蕾杜秋影李广琦 150001 黑龙江省哈尔滨市南岗区南通大街145号哈尔滨工程大学科技处知识产权办公室

本发明涉及滤波器组技术领域，具体涉及一种基于CEM FRM的动态非均匀窄过渡带滤波器组及设计方法。本发明包括基于CEM FRM的分析滤波器组部分以及动态综合滤波器组部分。分析滤波器组部分包括延时模块、抽取模块、上支路延时模块、下支... 详细信息

标准号: CN110210101B

本发明涉及滤波器组技术领域，具体涉及一种基于CEM FRM的动态非均匀窄过渡带滤波器组及设计方法。本发明包括基于CEM FRM的分析滤波器组部分以及动态综合滤波器组部分。分析滤波器组部分包括延时模块、抽取模块、上支路延时模块、下支路原型滤波器模块、上支路屏蔽滤波器模块、下支路屏蔽滤波器模块、求和模块及IFFT模块。动态综合滤波器组部分包括：上支路屏蔽滤波器模块、下支路屏蔽滤波器模块、上支路延时模块、下支路原型滤波器模块、K倍插值模块、延时模块、求和模块及IFFT模块。设计方法包括基于CEMFRM的原型滤波器设计和屏蔽滤波器设计。本发明可以实现低复杂度的非均匀窄过渡带滤波器组，有效减少窄过渡带的非均匀滤波器组硬件资源消耗。

关键词：滤波器模块支路延时模块支路屏蔽原型滤波器非均匀窄过渡带滤波器分析滤波器组综合滤波器组滤波器组求和模块硬件资源消耗屏蔽滤波器插值模块抽取模块低复杂度有效减少过渡带

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一种用于构建机器学习建模过程的系统

一种用于构建机器学习建模过程的系统

引用

作者：吴亮盛英杰 518000 广东省深圳市龙华区龙华街道三联社区锦华发工业园3栋硅谷大院T1栋509-510房

本发明公开了一种用于构建机器学习建模过程的系统，具体涉及机器学习建模技术领域，包括数据模块、训练学习模块、求和模块、建模模块与显示模块，所述数据模块包括数据获取单元、数据储存单元与数据分析单元，所述显示模块包括显示器... 详细信息

标准号: CN113705824A

本发明公开了一种用于构建机器学习建模过程的系统，具体涉及机器学习建模技术领域，包括数据模块、训练学习模块、求和模块、建模模块与显示模块，所述数据模块包括数据获取单元、数据储存单元与数据分析单元，所述显示模块包括显示器单元，本发明系统在故意差评判断的应用场景中，目标行为即为故意差评，从而每一个机器学习子模型用于判定对应的中间目标变量所指示的故意差评类型，对各机器学习子模型的概率值进行概率求和就能够获得用于判定属于多种故意差评类型中的至少一种的概率，基于这一概率值所构建的模型便能够对于多种故意差评类型进行判定，提高故意差评的识别效率的目的，实现了网络规范化、购物有序化的目的。

关键词：机器学习判定概率数据模块显示模块子模型构建数据储存单元数据分析单元数据获取单元显示器单元建模过程建模技术建模模块目标行为求和模块训练学习应用场景中间目标求和规范化购物网络

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长短期记忆LSTM网络计算设备以及计算设备

长短期记忆LSTM网络计算设备以及计算设备

引用

作者：李诚杨伟韦恩·诺伯特苏尔达山·奇拉格 518129 广东省深圳市龙岗区坂田华为总部办公楼

本申请公开了一种长短期记忆LSTM网络计算设备以及计算设备，属于神经网络技术领域。该LSTM网络计算设备通过将目标输入向量以及对应的目标权值向量存储在任一存储阵列中，点乘求和模块可以从任一存储阵列内读取目标输入向量以及对应的... 详细信息

标准号: CN112862059A

本申请公开了一种长短期记忆LSTM网络计算设备以及计算设备，属于神经网络技术领域。该LSTM网络计算设备通过将目标输入向量以及对应的目标权值向量存储在任一存储阵列中，点乘求和模块可以从任一存储阵列内读取目标输入向量以及对应的目标权值向量，并获取对任一存储阵列对应的点乘结果的和值，激活运算模块对该和值进行激活操作，得到当前时刻的输出向量，从而在内存中实现了LSTM网络计算，减少了LSTM网络数据在内存和处理器之间的传输，解决了内存墙的问题。

关键词：存储阵列目标权值向量网络计算设备输入向量点乘神经网络技术读取目标激活操作计算设备求和模块输出向量网络计算网络数据运算模块处理器内存存储激活传输申请

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33位加法器及其实现方法、运算电路及芯片

33位加法器及其实现方法、运算电路及芯片

引用

作者：不公告发明人 100080 北京市海淀区丹棱街3号B座14层1-32-1单元

本申请实施例提供了一种33位加法器及其实现方法、运算电路和芯片，该33位加法器包括N个进位模块和求和模块；每个进位模块对应第一加数和第二加数中的多个比特位，且包括预处理单元和多个进位计算单元；第n个进位模块包含的预处理单元... 详细信息

标准号: CN113419703A

本申请实施例提供了一种33位加法器及其实现方法、运算电路和芯片，该33位加法器包括N个进位模块和求和模块；每个进位模块对应第一加数和第二加数中的多个比特位，且包括预处理单元和多个进位计算单元；第n个进位模块包含的预处理单元，用于对对应的第一加数和第二加数中的多个比特位进行预处理；第n个进位模块包含的多个进位计算单元，用于根据预处理的结果和第n‑1个进位模块的级间进位参数进行运算，生成第n个进位模块对应的每个比特位的进位输出和第n个进位模块的级间进位参数，基本上实现了并行计算33位二进制数据中每个比特位的进位输出，以用于求和运算，由此可以缩短整个计算过程的时长，提高计算速度。

关键词：进位加数比特位进位计算单元预处理预处理单元加法器二进制数据并行计算计算过程求和模块求和运算运算电路输出时长运算芯片申请

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光电计算系统

光电计算系统

引用

作者：沈亦晨靖礼鲁门.丹高夫斯基谢鹏孟怀宇马修.高理卢正观罗纳德.加农莫里斯.斯坦曼吴建华阿拉什.侯赛因扎德赫美国马萨诸塞州

系统和方法包括：以电子格式提供输入信息；将至少一部分电子输入信息转换成光输入向量；基于光矩阵乘法将光输入向量光学地转换成光输出向量；将光输出向量转换成电子格式；并且将非线性转换电子地应用于电子转换后的光输出向量，以提... 详细信息

标准号: CN113159305A

系统和方法包括：以电子格式提供输入信息；将至少一部分电子输入信息转换成光输入向量；基于光矩阵乘法将光输入向量光学地转换成光输出向量；将光输出向量转换成电子格式；并且将非线性转换电子地应用于电子转换后的光输出向量，以提供电子格式的输出信息。在一些示例中，一组多个输入值被编码在由光波导所承载的相应光信号上。对于一个或多个光信号的至少两个子集中的每一个，一个或多个复制模块的相应一组将一个或多个光信号的子集分成光信号的两个或更多个副本。对于一个或多个光信号的第一子集的至少两个副本中的每一个，相应的乘法模块使用光幅度调制将第一子集的一个或多个光信号乘以一个或多个矩阵元素值。对于两个或更多个乘法模块的结果，使用求和模块以产生电信号，电信号表示两个或更多个乘法模块的结果的总和。

关键词：向量乘法模块电子格式光输出子集光输入副本非线性转换光幅度调制电子输入电子转换复制模块矩阵元素求和模块输出信息输入信息向量转换信息转换光波导光矩阵乘法承载转换应用

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49位加法器及其实现方法、运算电路及芯片

49位加法器及其实现方法、运算电路及芯片

引用

作者：不公告发明人 100080 北京市海淀区丹棱街3号B座14层1-32-1单元

本申请实施例提供了一种49位加法器及其实现方法、运算电路和芯片，该49位加法器包括N个进位模块和求和模块；每个进位模块对应第一加数和第二加数中的多个比特位，且包括预处理单元和多个进位计算单元；第n个进位模块包含的预处理单元... 详细信息

标准号: CN113419704A

本申请实施例提供了一种49位加法器及其实现方法、运算电路和芯片，该49位加法器包括N个进位模块和求和模块；每个进位模块对应第一加数和第二加数中的多个比特位，且包括预处理单元和多个进位计算单元；第n个进位模块包含的预处理单元，用于对对应的第一加数和第二加数中的多个比特位进行预处理；第n个进位模块包含的多个进位计算单元，用于根据预处理的结果和第n‑1个进位模块的级间进位参数进行运算，生成第n个进位模块对应的每个比特位的进位输出和第n个进位模块的级间进位参数，基本上实现了并行计算49位二进制数据中每个比特位的进位输出，以用于求和运算，由此可以缩短整个计算过程的时长，提高计算速度。

关键词：进位加数比特位进位计算单元预处理预处理单元加法器二进制数据并行计算计算过程求和模块求和运算运算电路输出时长运算芯片申请

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一种多比特计算装置

一种多比特计算装置

引用

作者：乔树山陶皓尚德龙周玉梅 211100 江苏省南京市江宁区创研路266号麒麟人工智能产业园1号楼5层

本发明涉及一种多比特计算装置。该装置中存算单元阵列与字线驱动模块、位线驱动模块及输入模块连接；存算单元阵列与求和模块一一对应连接；求和模块与乘累加读出计算模块连接；存算单元阵列包括：72个存算单元，并划分为6组结构，每... 详细信息

标准号: CN114882921B

本发明涉及一种多比特计算装置。该装置中存算单元阵列与字线驱动模块、位线驱动模块及输入模块连接；存算单元阵列与求和模块一一对应连接；求和模块与乘累加读出计算模块连接；存算单元阵列包括：72个存算单元，并划分为6组结构，每组结构进行4个2bit的输入数据和1bit带符号的权重的运算；字线驱动模块通过控制字线WL的电平控制权重的存储；位线驱动模块通过控制位线BL、位线BLB的电平进行权重的存储；输入模块根据输入的数据大小产生不同的In信号；求和模块对每个存算单元阵列产生的位线RBL和位线RBLB信号进行求差计算；乘累加读出计算模块将计算结果转换为数字信号。本发明能够提高计算效率。

关键词：位线单元阵列求和模块计算模块驱动模块输入模块字线驱动累加组结构权重读出存储比特计算装置计算效率数字信号控制位控制字求差控制权运算转换

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应用于过热汽温控制系统的控制装置

应用于过热汽温控制系统的控制装置

引用

作者：陈凤兰来长胜 030006 山西省太原市小店区坞城路92号

本实用新型提供一种应用于过热汽温控制系统的控制装置，属于超临界直流锅炉的汽温控制领域，以解决目前装置当燃料侧出现扰动时，不能及时对过热汽温控制系统的温度进行控制，导致易造成过热汽温超出允许范围及对过热汽温的控制效果差... 详细信息

标准号: CN212841530U

本实用新型提供一种应用于过热汽温控制系统的控制装置，属于超临界直流锅炉的汽温控制领域，以解决目前装置当燃料侧出现扰动时，不能及时对过热汽温控制系统的温度进行控制，导致易造成过热汽温超出允许范围及对过热汽温的控制效果差的问题。由于炉膛折焰角温度能提前反应燃料侧扰动，通过设置第一定值模块、第二定值模块、求和模块、低值模块、高值模块、RS触发器和切换模块，使得当燃料侧出现扰动时，RS触发器能及时控制切换模块切换至第二定制模块来增加减温水量，实现了对温度的提前控制，从而能够有效减小过热汽温的偏差，以及时对燃料侧的扰动进行响应，从而不易因燃料侧扰动而造成过热汽温超出允许范围，提高了对过热汽温的控制质量。

关键词：扰动过热汽燃料过热汽温控制系统超临界直流锅炉控制切换模块炉膛本实用新型定制模块反应燃料减温水量控制效果控制装置求和模块折焰角减小响应应用

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16位加法器、运算电路及芯片

16位加法器、运算电路及芯片

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作者：不公告发明人 100080 北京市海淀区丹棱街3号B座14层1-32-1单元

本实用新型提供了一种16位加法器、运算电路和芯片，该16位加法器包括N个进位模块和求和模块；每个进位模块对应第一加数和第二加数中的多个比特位，且包括预处理单元和多个进位计算单元；第n个进位模块包含的预处理单元，用于对对应的... 详细信息

标准号: CN215068205U

本实用新型提供了一种16位加法器、运算电路和芯片，该16位加法器包括N个进位模块和求和模块；每个进位模块对应第一加数和第二加数中的多个比特位，且包括预处理单元和多个进位计算单元；第n个进位模块包含的预处理单元，用于对对应的第一加数和第二加数中的多个比特位进行预处理；第n个进位模块包含的多个进位计算单元，用于根据预处理的结果和第n‑1个进位模块的级间进位参数进行运算，生成第n个进位模块对应的每个比特位的进位输出和第n个进位模块的级间进位参数，基本上实现了并行计算16位二进制数据中每个比特位的进位输出，以用于求和运算，由此可以缩短整个计算过程的时长，提高计算速度。

关键词：进位加数比特位进位计算单元预处理预处理单元加法器本实用新型二进制数据并行计算计算过程求和模块求和运算运算电路输出时长运算芯片

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33位加法器、运算电路及芯片

33位加法器、运算电路及芯片

引用

作者：不公告发明人 100080 北京市海淀区丹棱街3号B座14层1-32-1单元

本实用新型提供了一种33位加法器、运算电路和芯片，该33位加法器包括N个进位模块和求和模块；每个进位模块对应第一加数和第二加数中的多个比特位，且包括预处理单元和多个进位计算单元；第n个进位模块包含的预处理单元，用于对对应的... 详细信息

标准号: CN215068204U

本实用新型提供了一种33位加法器、运算电路和芯片，该33位加法器包括N个进位模块和求和模块；每个进位模块对应第一加数和第二加数中的多个比特位，且包括预处理单元和多个进位计算单元；第n个进位模块包含的预处理单元，用于对对应的第一加数和第二加数中的多个比特位进行预处理；第n个进位模块包含的多个进位计算单元，用于根据预处理的结果和第n‑1个进位模块的级间进位参数进行运算，生成第n个进位模块对应的每个比特位的进位输出和第n个进位模块的级间进位参数，基本上实现了并行计算33位二进制数据中每个比特位的进位输出，以用于求和运算，由此可以缩短整个计算过程的时长，提高计算速度。

关键词：进位加数比特位进位计算单元预处理预处理单元加法器本实用新型二进制数据并行计算计算过程求和模块求和运算运算电路输出时长运算芯片

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