检索结果-内蒙古大学图书馆

作者：刘昕宇淡江大学

学位级别：硕士

一.摘要随着半导体产业的发展IC的进步日新月异，借由3D-IC的发展大幅减少了晶片的体积，3D-IC的成功主要仰赖于TSV的使用，TSV为直接贯穿晶片及晶圆的一种技术，借此减少晶片与晶片之间的间隙，使晶片整体体积缩小，但在TSV制造过程中... 详细信息

一.摘要随着半导体产业的发展IC的进步日新月异，借由3D-IC的发展大幅减少了晶片的体积，3D-IC的成功主要仰赖于TSV的使用，TSV为直接贯穿晶片及晶圆的一种技术，借此减少晶片与晶片之间的间隙，使晶片整体体积缩小，但在TSV制造过程中可能会产生填充不完全、中间有空隙亦或是填充过程中混入杂质等状况发生，以及TSV的测试过程不容易，造成原因有以下几点。1)TSV大多埋没在矽晶片里面。2)TSV的尺寸非常小，根据近期的文献指出直径多为10μm彼此的间距大约40μm。3)一个3D-IC中的TSV数量庞大。正因为以上原因，造成预接合测试中不容易对TSV进行检测，特别是侵入式检测方式，更是困难，因此我们选择了现有非侵入之检测方式，使用环形震荡器对TSV进行检测并对其进行改良。相较于其他检测方法，使用环形震荡器有以下3点处。1)此方法为非侵入式，不会对晶片造成外力伤害。2)可以借由更改电压等等参数，达到更好的结果。3)面积成本小本篇文章致力于使用环形震荡器对TSV预接合测试，更正现有的错误模型[16]，使其更加贴近现实，并且改良现有的测试模型[18]，使其更加容易分辨错误，若其TSV发生开孔错误，则产生波形的频率将会较正常情况快，另外可以借由增加电压的方式来大幅提升错误分辨率；若其TSV发生漏电流错误，则产生波形的频率将会较正常情况快且震幅较正常情况小，另外可以借由调整固定电压来提升错误分辨率，此外，本篇文章的测试模型之测试所需时间与面积成本皆在适当范围内，所增加的成本则在可以忽略的程度。

关键词： TSV 预接合测试环形震荡器

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一种补偿环形震荡器工艺角变化的电流结构

一种补偿环形震荡器工艺角变化的电流结构

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作者：吴汉明周航 100176 北京市大兴区北京经济技术开发区荣华中路10号1幢A座17层1717

本发明提供一种补偿环形震荡器工艺角变化的电流结构，其包括运算放大器A1、与该运算放大器A1相连的与工艺角无关的基准电压Vref、与运算放大器A1相连的PMOS管M1、与所述PMOS管M1串联相连的PMOS管M5和NMOS管M6、PMOS管M2、运算放大器A2... 详细信息

标准号: CN110995158A

本发明提供一种补偿环形震荡器工艺角变化的电流结构，其包括运算放大器A1、与该运算放大器A1相连的与工艺角无关的基准电压Vref、与运算放大器A1相连的PMOS管M1、与所述PMOS管M1串联相连的PMOS管M5和NMOS管M6、PMOS管M2、运算放大器A2、PMOS管M3、PMOS管M4、NMOS管M7、NMOS管M8、电阻R1、NMOS管M9以及NMOS管M1O；本方案通过上述电流结构，使得震荡器的输出电流随工艺角变化，以此来补偿震荡器的输出频率，进而使得震荡器输出频率在不同工艺角下都能保持稳定的输出频率。

关键词：工艺角运算放大器输出频率震荡器电流结构放大器环形震荡器基准电压输出电流与运算电阻串联

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利用震荡环频率特性提取多位可靠信息熵的物理不可克隆函数研究

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电子与信息学报 2021年第1期43卷 234-241页

作者：孙子文叶乔江南大学物联网工程学院无锡214122 物联网技术应用教育部工程研究中心无锡214122

针对传统物理不可克隆函数(PUF)产生信息熵少、易受环境因素干扰等问题,该文设计一种产生多位稳定信息熵的PUF方案。该方案通过对FPGA上环形震荡器所产生频率数据的分析,从每个震荡环中提取能够代表震荡环特性的特征位作为信息熵。通过... 详细信息

针对传统物理不可克隆函数(PUF)产生信息熵少、易受环境因素干扰等问题,该文设计一种产生多位稳定信息熵的PUF方案。该方案通过对FPGA上环形震荡器所产生频率数据的分析,从每个震荡环中提取能够代表震荡环特性的特征位作为信息熵。通过对逆变器温度特性的研究,利用电流饥饿逆变器和常规逆变器组成新的震荡环来降低温度对产生的信息熵的可靠性的影响。通过Cadence IC仿真和进行赛灵思zynq 7000系列FPGA开发平台上的实验,结果表明改进的PUF结构使用相同数量的震荡环产生更多的信息熵,并且其可靠性、唯一性均得到提升。

关键词： FPGA 物理不可克隆函数环形震荡器信息熵逆变器

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實現可配置環震盪器及鄰近比較策略於FPGA的物理不可仿製功能

實現可配置環震盪器及鄰近比較策略於FPGA的物理不可仿製功能

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作者：徐子翔成功大學

学位级别：碩士

物理不可仿制功能(PUF)用於设备的身分验证及密钥生成，可在晶片上生成秘密资讯而不需要储存关键资讯。其中环形震荡器(Ring Oscillaor)因其在现场可程式化逻辑闸阵列(FPGA)上易於实现而备受关注。但是基於结构上的不同以及区域性的潜... 详细信息

物理不可仿制功能(PUF)用於设备的身分验证及密钥生成，可在晶片上生成秘密资讯而不需要储存关键资讯。其中环形震荡器(Ring Oscillaor)因其在现场可程式化逻辑闸阵列(FPGA)上易於实现而备受关注。但是基於结构上的不同以及区域性的潜在偏差，不是所有的挑战与回应对(CRPs)都适合使用，而当我们选择了高唯一性的回应後，由於操作环境变化又会导致其稳定性不好同时满足。环震荡器基於邻近比较且使用配合的架构再利用可编程延迟线(Programmable Delay line)来配置环形震荡器，在不影响比较策略下所获得的回应的前提下，让选择的环形震荡器对两者的频率差异更加明显，以同时满足独特性及可靠性，提高FPGA PUF的性能。方法的结果间汉明距离为49.3%，在温度0℃到70℃间平均内汉明距离为0.4%。

关键词：環形震盪器現場可程式化邏輯閘陣列可配置延遲線密鑰安全物理不可複製函數

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近阈值超低功耗数字标准单元库设计

近阈值超低功耗数字标准单元库设计

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作者：杜皓宇安徽大学

学位级别：硕士

伴随着国家对集成电路产业的越发重视,集成电路设计的发展越来越快,尤其在物联网类应用中,其中大量运用到集成电路设计。随着物联网智能电子产品的发展,其所具有的功能越加复杂,产品越加精巧,但为其所供电的电池却并没有重大突破,因此... 详细信息

伴随着国家对集成电路产业的越发重视,集成电路设计的发展越来越快,尤其在物联网类应用中,其中大量运用到集成电路设计。随着物联网智能电子产品的发展,其所具有的功能越加复杂,产品越加精巧,但为其所供电的电池却并没有重大突破,因此为了让这些智能电子产品具有可观的续航能力,低功耗集成电路设计就显得至关重要。并且为更好的满足很多低速、低功耗的物联网类应用,设计一套符合其标准的数字标准单元库,就显得意义非凡。本文基于国内商用XXXnm工艺设计了一套全定制的近阈值超低功耗数字标准单元库,并成功流片。本文的设计运用电源电压缩放和凹凸阱技术,在已有的电路基础上做出结构调整和尺寸改进,以达到低速低功耗的设计目标。同时也完成了用于测试标准单元性能的验证芯片。本文设计的测试芯片主要从器件、单元和电路这三个方面对所设计的标准单元进行评估。从后仿真和实际测试结果来看,器件方面,通过比较MOS管阵列后仿真结果和所测得的I-V特性曲线发现,发现使用匹配LOD效应的MOS管阵列中的MOS管偏向SS工艺角;单元方面,通过比较5种不同基本逻辑单元所构成的环形振荡器的后仿真结果和所测得的输出结果发现,基本单元的性能和功耗基本符合设计目标中对低速和低功耗的要求;电路方面,通过比较分别使用商用和本文所建立的标准单元库进行设计的ALU(Arithmetic and Logic Unit)数字电路的仿真结果可知,对比处于同在亚阈值电压0.65V下的商用标准单元库而言,使用本文设计的低功耗标准单元库,其电路中的总功耗降低25.8%左右。

关键词：近阈值低功耗标准单元库环形震荡器 ALU

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深亚微米CMOS环形放大器研究

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天津职业技术师范大学学报 2019年第2期29卷 13-18页

作者：裴志军王雅欣韩蕾天津职业技术师范大学电子工程学院

随着CMOS工艺技术的持续进步,模拟集成电路中能耗有效的放大器设计面临着严峻挑战。CMOS环形放大器具有与环形振荡器相似的简单结构,能够随现代CMOS工艺特征尺寸的缩小而改善性能,且以低功耗获得高增益。文章分析了环形放大器转换、稳... 详细信息

随着CMOS工艺技术的持续进步,模拟集成电路中能耗有效的放大器设计面临着严峻挑战。CMOS环形放大器具有与环形振荡器相似的简单结构,能够随现代CMOS工艺特征尺寸的缩小而改善性能,且以低功耗获得高增益。文章分析了环形放大器转换、稳定和锁定放大的工作机理,研究了CMOS环形放大器的设计技术,提出了三级反相器的增益分配方法。研究结果表明:基于浮动采样的伪差分环形放大器结构可应用于信号的差分处理,而自偏置的环形放大器结构能够改善电源变化的影响。

关键词：环形放大器深亚微米环形震荡器反相器模拟集成电路

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重对齐方法、重对齐装置以及重对齐系统

重对齐方法、重对齐装置以及重对齐系统

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作者：蔡宗宪沈瑞滨张智贤谢正祥中国台湾新竹市新竹科学工业园区力行六路八号

本揭示文章揭露了一种可程序化调节器压控环形振荡器的重对齐方法、重对齐装置以及重对齐系统。重对齐方法包含以下步骤。基于一个或多个调控字串对电阻器组阵列的可变电阻进行设定。从锁相回路电路接收一个电压，此电压由耦合到电阻器... 详细信息

标准号: CN115499001A

本揭示文章揭露了一种可程序化调节器压控环形振荡器的重对齐方法、重对齐装置以及重对齐系统。重对齐方法包含以下步骤。基于一个或多个调控字串对电阻器组阵列的可变电阻进行设定。从锁相回路电路接收一个电压，此电压由耦合到电阻器组阵列的运算放大器接收。基于锁相回路电路与电阻器组阵列之间电压的比较，由电阻器组阵列产生第一信号。基于第一信号控制耦接至电阻器组阵列的环形振荡器的操作。重对齐电路以第一信号重对齐环形震荡器的波形相位。

关键词：电阻器组对齐锁相回路电路压控环形振荡器环形震荡器环形振荡器运算放大器调节器波形相位对齐系统对齐装置可变电阻可程序化调控字耦合到耦接电路

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一种处理器性能分级方法、供电方法及装置

一种处理器性能分级方法、供电方法及装置

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作者：张宝金赵峰 100029 北京市朝阳区安定路5号院1号楼9层(09)901号901室

本公开提供一种处理器性能分级方法、供电方法及装置，其中处理器上部署有N个环形震荡器；针对若干测试处理器中的每一测试处理器，使该测试处理器在目标工作模式下运行，获取在多种工作温度和工作电压的组合下，所述测试处理器的工作... 详细信息

标准号: CN117971628A

本公开提供一种处理器性能分级方法、供电方法及装置，其中处理器上部署有N个环形震荡器；针对若干测试处理器中的每一测试处理器，使该测试处理器在目标工作模式下运行，获取在多种工作温度和工作电压的组合下，所述测试处理器的工作频率、所述测试处理器上每个环形震荡器的输出值；基于所述多种工作温度和工作电压的组合下，全部测试处理器的工作频率，以及全部测试处理器上每个环形震荡器的输出值，确定M个目标震荡器；所述目标震荡器为N个环形震荡器中与测试处理器工作频率变化最相关的M个环形震荡器；利用所述M个目标震荡器对待分级的处理器进行性能分级。

关键词：测试处理器环形震荡器震荡器工作电压工作频率处理器分级工作频率变化目标工作模式处理器性能性能分级输出供电部署

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变频环形振荡器PUF电路及其控制方法

变频环形振荡器PUF电路及其控制方法

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作者：谢小东任子木 610000 四川省成都市高新区(西区)西源大道2006号

变频环形振荡器PUF电路，涉及集成电路，本发明包括下述部分：一个选择信号控制寄存器，n个振荡器，n为大于4的自然数，每个振荡器的控制端与选择信号控制器连接；第一多路选择器，每个振荡器的输出端都连接到第一多路选择器；第二多路... 详细信息

标准号: CN106372539B

变频环形振荡器PUF电路，涉及集成电路，本发明包括下述部分：一个选择信号控制寄存器，n个振荡器，n为大于4的自然数，每个振荡器的控制端与选择信号控制器连接；第一多路选择器，每个振荡器的输出端都连接到第一多路选择器；第二多路选择器，每个振荡器的输出端都连接到第二多路选择器；与第一多路选择器的输出端连接的第一计数器，与第二多路选择器的输出端连接的第二计数器，一个比较器，其两个输入端分别与第一计数器的输出端和第二计数器的输出端连接，其输出端连接选择信号寄存器。本发明所设计的变频环形震荡器PUF的安全性优于传统的环形振荡器PUF，可以用于对安全性要求较高的场景。

关键词：多路选择器计数器输出端连接振荡器输出端环形振荡器选择信号变频选择信号寄存器安全性要求环形震荡器控制寄存器控制器连接比较器传统的控制端输入端集成电路场景

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一种基于FPGA的可配置RO PUF

一种基于FPGA的可配置RO PUF

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作者：韦子伟崔益军刘伟强王成华陈云鹏黎江 211106 江苏省南京市秦淮区御道街29号

本发明提出一种基于FPGA的可配置RO PUF，包括基于FPGA实现的至少两个环形震荡器、两个计数器和一个比较器。环形振荡器包括一个与门和n+1阶可以配置的延迟单元，通过激励信号配置这些延迟单元，可以将RO PUF配置为不同结构，从而使得... 详细信息

标准号: CN111835525A

本发明提出一种基于FPGA的可配置RO PUF，包括基于FPGA实现的至少两个环形震荡器、两个计数器和一个比较器。环形振荡器包括一个与门和n+1阶可以配置的延迟单元，通过激励信号配置这些延迟单元，可以将RO PUF配置为不同结构，从而使得本发明提出的RO PUF有更多种的振荡情况，从而产生更多的激励响应对。另一方面，也使得ROPUF的数学延迟模型更加复杂，导致机器学习建模难度增加，提高CRO PUF对机器学习算法攻击的抵抗性。

关键词：延迟单元机器学习算法计数器环形震荡器环形振荡器机器学习激励响应激励信号难度增加延迟模型比较器抵抗性可配置配置的振荡建模与门配置数学攻击

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