检索结果-内蒙古大学图书馆

机助滤波器设计中电路结构的确定方法

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天津大学学报 1993年第1期26卷 82-91页

作者：滕建辅天津大学电子工程系

给出一种在机助LC滤波器设计中确定电路结构的系统方法。用户可据滤波器的传输函数,用文中给出的图表方便地画出满足要求的电路结构,然后可以利用滤波器综合程序计算出相应的元件值。

关键词：滤波器电路设计电路结构 CAD

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开关电容电路结构的神经网络优化设计

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大庆石油学院学报 1997年第4期21卷 119-122页

作者：王秀芳高丙坤曾龙伟蔡百周大庆石油学院自动化与控制工程系大庆石油管理局采油八厂牡丹江大学

基于神经网络解决优化组合问题原理，将计算能量函数与罚函数有机地进行了统一。构造了期望的罚函数，因而设计了结构非常简单的开关电容电路，并讨论了其特点，给出了其寻优步骤。计算机仿真结果表明，无论起点在何处，均能找到理论上... 详细信息

基于神经网络解决优化组合问题原理，将计算能量函数与罚函数有机地进行了统一。构造了期望的罚函数，因而设计了结构非常简单的开关电容电路，并讨论了其特点，给出了其寻优步骤。计算机仿真结果表明，无论起点在何处，均能找到理论上的优化值；另外，目标函数的一些参数随时间随意变化时，变量可实时优化。

关键词：神经网络开关电容电路结构优化设计

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无约束非线性优化的开关电容电路结构

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大庆石油学院学报 1997年第4期21卷 115-118页

作者：王秀芳高丙坤陈广义张双成大庆石油学院自动化与控制工程系大庆设计院

建立了梯度法的开关电容电路结构，分析了最速下降法、牛顿方法和拟牛顿法的共同特点，研究无约束差分优化的开关电容电路结构。通过计算机仿真实例，证明了该电路收敛速度较快，且随着有关参数的改变，可在不同初始条件下达到各自的局... 详细信息

建立了梯度法的开关电容电路结构，分析了最速下降法、牛顿方法和拟牛顿法的共同特点，研究无约束差分优化的开关电容电路结构。通过计算机仿真实例，证明了该电路收敛速度较快，且随着有关参数的改变，可在不同初始条件下达到各自的局部最小值；许多情况下，该电路可以避免一些局部最小值，而找到一个全局最小值。

关键词：开关电容电路结构非线性优化

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基于电路结构的测试移位功耗优化方法

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高技术通讯 2019年第6期29卷 523-529页

作者：许超孟祥刚陈华军卢新元计算机体系结构国家重点实验室(中国科学院计算技术研究所) 北京100190 中国科学院计算技术研究所北京100190 中国科学院大学北京100049 龙芯中科技术有限公司北京100190 南开大学电子信息与光学工程学院天津300350

研究了扫描结构和测试功耗优化技术,考虑到现有的修改扫描单元结构降低测试移位功耗的方法存在冗余开销的问题,提出一种新的基于电路结构的测试移位功耗优化方法。该方法充分利用芯片内部的电路结构,通过分析扫描单元的扇出结构及其控制... 详细信息

研究了扫描结构和测试功耗优化技术,考虑到现有的修改扫描单元结构降低测试移位功耗的方法存在冗余开销的问题,提出一种新的基于电路结构的测试移位功耗优化方法。该方法充分利用芯片内部的电路结构,通过分析扫描单元的扇出结构及其控制值,并根据分析结果和权重分配规则动态规划扫描单元的优化顺序,减少处理扫描单元的数量,避免产生冗余的测试开销。同时保证组合逻辑在移位过程中保持不翻转或者尽量不翻转,从而达到降低测试移位功耗的目的。在ITC’99基准电路上的实验结果表明,采用上述优化方法后组合逻辑的移位功耗降低了8.18%到96.98%,时序逻辑的移位功耗降低了41.92%到71.74%,与现有修改扫描单元的方法相比,面积开销节省了6.71%到20.95%。

关键词：扫描单元电路结构测试移位功耗动态规划测试开销

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基于电路结构的测试捕获功耗优化方法

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高技术通讯 2019年第5期29卷 413-422页

作者：许超陈华军郝守青卢新元章隆兵计算机体系结构国家重点实验室(中国科学院计算技术研究所) 北京100190 中国科学院计算技术研究所北京100190 中国科学院大学北京100049 龙芯中科技术有限公司北京100190

研究了扫描结构和测试捕获功耗优化技术,考虑到现有的测试捕获功耗优化技术会降低单个测试向量覆盖的故障点或存在硬件开销过大的问题,提出一种新的基于电路结构的测试捕获功耗优化方法。该方法充分利用芯片内部的电路结构,分析扫描单... 详细信息

研究了扫描结构和测试捕获功耗优化技术,考虑到现有的测试捕获功耗优化技术会降低单个测试向量覆盖的故障点或存在硬件开销过大的问题,提出一种新的基于电路结构的测试捕获功耗优化方法。该方法充分利用芯片内部的电路结构,分析扫描单元之间扇入扇出的关系,并根据分析结果规划扫描单元在捕获阶段的捕获顺序以及需要修改结构的扫描单元。根据扫描链的条数添加相应的时钟控制结构,并提出一种新的扫描单元结构来避免数据捕获违例问题,在不增加测试向量的前提下降低测试捕获功耗。在ITC’99基准电路上的实验结果表明,采用上述优化方法后扫描单元的替换率在50%左右,捕获阶段的功耗能降低40%以上,扫描链条数越多,优化效果越明显。

关键词：扫描单元电路结构测试捕获功耗时钟控制结构数据捕获违例

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一种快速的分数位平面编码方法及其电路结构

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计算机学报 2005年第10期28卷 1650-1656页

作者：许超韩彦菊北京大学视觉与听觉信息处理国家重点实验室北京100871

JPEG2000是新一代图像压缩国际标准.它在位平面编码技术的基础上,进一步采用了分数位平面编码技术.分数位平面编码使编码输出的码流具有更高的渐进性和抗干扰性,但是,它使编码的运算量大幅度增加.为实现快速编码,该文提出一种位平面、... 详细信息

JPEG2000是新一代图像压缩国际标准.它在位平面编码技术的基础上,进一步采用了分数位平面编码技术.分数位平面编码使编码输出的码流具有更高的渐进性和抗干扰性,但是,它使编码的运算量大幅度增加.为实现快速编码,该文提出一种位平面、过程双重并行编码方法,可以大幅度提高编码速度.另外,为降低大数量并行编码消耗的电路资源量,文中提出一种局部模块并行电路结构.实验结果显示,该文方法的编码速度约为每时钟编码一个系数,比已有技术提高约15倍.在FPGA电路平台上,只需要约4·2K的逻辑单元,因此它是一种可以通过低成本集成电路实现的快速分数位平面编码技术.

关键词： JPEG2000 分数位平面编码电路结构

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斯坦福大学成功研制出具备较复杂电路结构的碳纳米管集成电路

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化工新型材料 2010年第1期38卷 115-116页

最近斯坦福大学研制出了首个三维碳纳米管结构电路，这项成果可能标志着科学家在研制纳米管计算机方面又取得了一项重要的进展，纳米管计算机相比现有的硅半导体计算机在运算速度和省电性能方面拥有较大的优势。

关键词：斯坦福大学碳纳米管集成电路电路结构纳米管结构计算机运算速度硅半导体

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现场可编程门阵列电路结构评估算法与系统实现技术的研究

现场可编程门阵列电路结构评估算法与系统实现技术的研究

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作者：李智华中国科学院大学

学位级别：博士

为了开发高质量FPGA结构，第一步就是使用FPGA结构评估系统来评估各种各样的架构设计方案。而日益复杂和更加灵活的FPGA结构，对FPGA评估系统提出了新的挑战。在面对各种不同的FPGA结构时，FPGA评估系统必须能够针对FPGA结构进行灵活的... 详细信息

为了开发高质量FPGA结构，第一步就是使用FPGA结构评估系统来评估各种各样的架构设计方案。而日益复杂和更加灵活的FPGA结构，对FPGA评估系统提出了新的挑战。在面对各种不同的FPGA结构时，FPGA评估系统必须能够针对FPGA结构进行灵活的建模处理。\n 本论文实现了基于CAD实验方法的FPGA结构评估系统，该系统有以下特点:(1)支持评估各种规模、结构不同的FPGA结构;(2)能高效完成针对特定FPGA结构的评估工作;(3)能高效完成FPGA结构参数优化设计。\n 首先，本论文引入了一个新型的FPGA结构描述模型对FPGA的架构进行建模，该模型的描述语言采用YAML通用格式，从而实现了对包含任意类型逻辑块和通道的详细FPGA结构描述。针对提出的FPGA结构描述模型，本论文提出了一个通用的FPGA结构资源图生成算法。并将上述模型和结构资源图生成算法应用于FPGA结构评估系统中，通过实验验证了结构描述模型的灵活性和有效性。\n 其次，本论文提出了一种高效的从现有FPGA结构中自动提取互连资源的FPGA结构描述模型的算法。该算法作为通用的FPGA互连资源结构描述模型的提取方法，可以极大缩短从现有FPGA结构中提取FPGA结构描述模型的时间。并且所提出的方法可以应用于不同结构、各种规模的FPGA芯片。在缩短FPGA结构描述模型提取时间的同时，提高了FPGA结构描述模型提取的准确性。\n 最后，实现了基于MapReduce的分布式FPGA结构评估优化系统。由于基于实验方法的FPGA结构评估系统在进行评估工作时通常非常耗时，本论文采用MapReduce分布式算法来加速FPGA的结构评估、优化设计过程。传统的基于设计参数进行暴力枚举的实验方法运行效率低下，本论文提出使用MapReduce遗传算法来为FPGA结构优化设计建模，从而减小结构设计参数的优化搜索空间，大大提高了FPGA结构优化效率。\n 综上所述，本论文针对FPGA结构优化设计的需求，提出了四种应用于FPGA结构评估的算法:1）基于文中提出的FPGA结构描述模型，提出了一个通用的FPGA结构资源图生成算法，2）一种高效的从现有FPGA结构中自动提取互连资源结构描述模型的算法，3）基于MapReduce的分布式FPGA结构评估系统实现算法，4）为FPGA结构优化设计建模的MapReduce遗传算法。

关键词：现场可编程门阵列电路结构评估算法系统实现

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适用于高输入输出电压差的降压稳压器电路结构

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电子技术应用 2006年第9期32卷 I0001-I0007页

作者： Bob Bell David Pace 美国国家半导体公司

隆压稳压器可以有效地将未经稳压的高输入电压步降为稳定的输出电压。在输入电压较高的直流变换应用中，降压稳压器相对于线性稳压器具有更高的转换效率。但是，在具有高输入输出阡压比的应用中，使用降压稳压器对脉宽调制（PWM）控制... 详细信息

隆压稳压器可以有效地将未经稳压的高输入电压步降为稳定的输出电压。在输入电压较高的直流变换应用中，降压稳压器相对于线性稳压器具有更高的转换效率。但是，在具有高输入输出阡压比的应用中，使用降压稳压器对脉宽调制（PWM）控制器会提出更高的要求。

关键词：输入输出稳压器电路结构降压电压差输入电压输出电压直流变换

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基于电路结构的扫描链诊断技术研究

基于电路结构的扫描链诊断技术研究

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作者：陈华军中国科学院大学

学位级别：博士

数字集成电路在制造过程中受到制造工艺、技术以及外围环境等因素的影响，可能会导致芯片中存在缺陷。在芯片上市之前，必须找出这些存在缺陷的芯片。但随着芯片规模及复杂度的不断增大，传统的测试方法已经无法满足芯片的测试需求，于... 详细信息

数字集成电路在制造过程中受到制造工艺、技术以及外围环境等因素的影响，可能会导致芯片中存在缺陷。在芯片上市之前，必须找出这些存在缺陷的芯片。但随着芯片规模及复杂度的不断增大，传统的测试方法已经无法满足芯片的测试需求，于是在电路中加入辅助测试的电路，这就是可测性设计。扫描设计作为最常用的一种可测性设计，为芯片提供了良好的可控性和可观测性，因此被广泛应用于数字集成电路的设计中。扫描链为芯片的测试提供了很大的帮助，但扫描链结构也为扫描链故障诊断带来了一定困难。研究扫描链故障的诊断对于故障机理分析和解决芯片良率问题都具有重要意义。目前扫描链诊断主要面临以下问题:一方面，由于扫描链自身的扫描移位会使链上的传输数据被故障信息“污染”，致使故障信息不易分辨，从而导致故障诊断的质量不高;另一方面，扫描链固有的可诊断性不强导致故障诊断的质量不高。此外，现有的扫描链构建方法在构建扫描链时，很少考虑扫描触发器的物理位置，以至于扫描链结构对芯片性能造成不利的影响，尤其不利于以追求性能为主要目标的高性能处理器设计。\n 针对扫描链诊断面临的问题，本文从电路逻辑结构、物理位置和扫描链全局结构三个角度，研究了如何提高扫描链诊断的质量及如何降低扫描链结构对芯片性能的影响。本文的主要贡献和创新点包括:\n 1.提出了一种基于电路逻辑结构的扫描链优化方法。该方法建立了扇入相关度和扇出相关度模型，并在此基础上根据扫描触发器的扇入和扇出结构优化扫描触发器至扫描链的分配，在不需要改造扫描单元和扫描链结构的前提下，充分挖掘扫描链本身所隐藏的可诊断性。该方法在ITC\'99基准电路上的实验结果表明，采用该方法的可疑故障数比采用工具默认方法减少了40％～90％。\n 2.提出了一种基于物理位置的扫描链优化方法。该方法建立了扫描触发器的物理位置相关度模型，并在此基础上根据扫描触发器的物理位置优化扫描触发器至扫描链的分配，来降低扫描链结构对布线拥塞的影响。该方法在ITC\'99基准电路上的实验结果表明，采用该方法在故障诊断的质量上损失了约15％的提升空间，但采用该方法的布线拥塞平均降低了82.11％。\n 3.提出了一种基于扫描链全局结构的扫描链优化方法。该方法根据不同扫描触发器在扫描链故障诊断中的不同作用，从扫描链全局结构中提取出对故障诊断具有关键作用的关键扫描触发器，并通过提升这些关键扫描触发器的可观测性，来进一步提升扫描链固有的可诊断性。该方法在ITC\'99基准电路上的实验结果表明，采用该方法的单故障诊断的可疑故障数平均又减少了9.45％，多故障诊断的可疑故障数平均又减少了约30％。\n 4.根据本文所提扫描触发器相关度模型实现了一套完整的自动化的扫描链优化系统。该系统从工程实践的角度出发，通过脚本程序的形式实现了本文所提的扫描链优化方法，并结合至商用EDA工具现有的扫描链构建流程中，自动完成扫描链的优化和构建。该系统很好地解决了现有大多数扫描链诊断技术通用性差、不易推广应用的问题。

关键词：数字集成电路扫描链故障诊断电路结构芯片性能

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