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文字说明：

T=题名（书名、题名），A=作者（责任者），K=主题词，P=出版物名称，PU=出版社名称，O=机构（作者单位、学位授予单位、专利申请人），L=中图分类号，C=学科分类号，U=全部字段，Y=年（出版发行年、学位年度、标准发布年）

检索规则说明：

AND代表“并且”；OR代表“或者”；NOT代表“不包含”；(注意必须大写,运算符两边需空一格)

检索范例：

范例一：(K=图书馆学 OR K=情报学) AND A=范并思 AND Y=1982-2016
范例二：P=计算机应用与软件 AND (U=C++ OR U=Basic) NOT K=Visual AND Y=2011-2016

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文献类型

417 篇 专利
3 篇 学位论文
2 篇 期刊文献

馆藏范围

422 篇 电子文献
0 种 纸本馆藏

日期分布

学科分类号

4 篇 工学
- 2 篇 控制科学与工程
- 1 篇 动力工程及工程热...
- 1 篇 电子科学与技术（可...
- 1 篇 计算机科学与技术...
- 1 篇 软件工程
2 篇 管理学
- 2 篇 管理科学与工程(可...
1 篇 理学
- 1 篇 数学

主题

5 篇 硬件电路实现
1 篇 模拟滤波器
1 篇 传递函数
1 篇 遗传算法
1 篇 卫星导航信号
1 篇 分段线性激活函数
1 篇 mlwe格密码方案
1 篇 神经网络算法
1 篇 模拟电路故障
1 篇 hopfield神经网络
1 篇 巴特沃兹型滤波器
1 篇 最大功率点追踪
1 篇 故障注入
1 篇 crystal-kyber协议...
1 篇 数论变换算法
1 篇 忆阻突触
1 篇 多稳定性

机构

15 篇 北京国科欣翼科技...
14 篇 广东美的制冷设备...
9 篇 中科寒武纪科技股...
9 篇 珠海格力电器股份...
7 篇 东南大学
5 篇 安图实验仪器有限...
5 篇 郑州云海信息技术...
5 篇 深圳市华思旭科技...
5 篇 中国航空工业集团...
5 篇 浙江大学
4 篇 北京中科寒武纪科...
4 篇 华帝股份有限公司
4 篇 北京理工大学
3 篇 华中科技大学
3 篇 上海铁路通信有限...
3 篇 南京大学
3 篇 深圳市优必选科技...
3 篇 北京富迪广通科技...
3 篇 浙江众合科技股份...
3 篇 深圳光峰科技股份...

作者

15 篇 赵秀冕
14 篇 李洪涛
9 篇 张潇
9 篇 陈云霁
9 篇 陈天石
9 篇 刘少礼
7 篇 王聪
5 篇 王超
5 篇 刘道福
5 篇 刘敏通
5 篇 刘聪
5 篇 雷云
5 篇 吴永根
5 篇 张智锋
4 篇 卜祥元
4 篇 李建国
4 篇 尹雪
4 篇 丁旭辉
4 篇 林建平
4 篇 程铭

语言

422 篇 中文

检索条件"主题词=硬件电路实现"

共 422 条记录，以下是1-10 订阅

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详细简洁

排序：

图像处理的硬件电路实现方法、设备及集成电路

图像处理的硬件电路实现方法、设备及集成电路

引用

作者：刘仁沛 518000 广东省深圳市南山区深南路科技园工业厂房24栋南段1层、3-5层、28栋北段1-4层

本申请实施例适用于图像处理技术领域，提供了一种图像处理的硬件电路实现方法、设备及集成电路，该方法应用于图像信号处理装置，图像信号处理装置包括第一缓存器、第二缓存器、第一处理模块和第二处理模块，包括：从第一缓存器中确定... 详细信息

标准号: CN117710188A

本申请实施例适用于图像处理技术领域，提供了一种图像处理的硬件电路实现方法、设备及集成电路，该方法应用于图像信号处理装置，图像信号处理装置包括第一缓存器、第二缓存器、第一处理模块和第二处理模块，包括：从第一缓存器中确定第一处理模块的第一输入数据；基于第一输入数据，使用第一处理模块对第一像素点进行图像信号处理；从第一缓存器中，确定第二处理模块的第二输入数据；并从第二缓存器中，确定第二处理模块的第三输入数据；基于第二输入数据和第三输入数据，使用第二处理模块对第二像素点进行图像信号处理，第一处理模块和第二处理模块并行进行图像信号处理。通过上述方法，在并行进行图像信号处理的同时，减少存储器的资源消耗。

关键词：处理模块缓存器图像信号处理图像信号处理装置像素点并行图像处理技术硬件电路实现图像处理资源消耗存储器集成电路申请

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一种面向高速硬件电路实现的GII码译码算法

一种面向高速硬件电路实现的GII码译码算法

引用

作者：王中风李文杰林军 210023 江苏省南京市栖霞区仙林大道163号南京大学电子楼229

本发明公开了一种面向高速硬件电路实现的GII码译码算法。修改了传统译码算法的顶层结构，使得译码结构更加规则，因此更加利于硬件电路实现。相比于传统GII译码算法中的iBM算法，本发明采用的riBM算法有着更短的关键路径，这使得更高... 详细信息

标准号: CN110875745A

本发明公开了一种面向高速硬件电路实现的GII码译码算法。修改了传统译码算法的顶层结构，使得译码结构更加规则，因此更加利于硬件电路实现。相比于传统GII译码算法中的iBM算法，本发明采用的riBM算法有着更短的关键路径，这使得更高速的硬件实现成为可能。riBM算法中多项式系数的高效更新方法首次被提出，他允许之前译码阶段的结果可以在后面译码过程中被复用。本发明只在相应阶段计算需要的高阶嵌套校正子，因此消除了传统算法的冗余操作，免去了对高嵌套阶校正子的存储。本发明为GII码提供了面向高速硬件电路实现的译码算法，使得在例如以太网通信等多种要求译码器有高性能高吞吐率的场景中，GII码可以成为一种有竞争力的编码方案。

关键词：译码算法电路实现高速硬件校正子译码器嵌套硬件电路实现多项式系数以太网通信传统算法高阶嵌套高吞吐率关键路径冗余操作译码过程译码阶段译码结构硬件实现顶层复用存储场景更新

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一种快速多目标多任务分配的硬件电路实现方法

一种快速多目标多任务分配的硬件电路实现方法

引用

作者：钱家祥石小刚黄光新 210000 江苏省南京市江宁区天域互联科技中心C1座5楼

本发明公开了一种快速多目标多任务分配的硬件电路实现方法，包括构建分配器电路模块，锁定当前目标任务的分配结果；构建数据传输控制电路模块，依据获取的分配结果信号以及几何加速模块PCV请求信号生成写数据信号；构建读地址产生电... 详细信息

标准号: CN115344307A

本发明公开了一种快速多目标多任务分配的硬件电路实现方法，包括构建分配器电路模块，锁定当前目标任务的分配结果；构建数据传输控制电路模块，依据获取的分配结果信号以及几何加速模块PCV请求信号生成写数据信号；构建读地址产生电路模块，根据获取的读数据使能信号产生计数器，输出读数据地址；构建写地址产生电路模块；进行多目标任务同时传输，直到数据传输结束，再进行下一轮数据的调度。通过将4个几何加速模块PCV产生的结果数据快速分配到4个光栅化模块的方式，使得硬件电路只要使用一个节拍时钟周期就可以完成多个目标多个任务的分配，且当分配结束，具备自动在多任务多目标之间建立数据传输通道，多个目标多个任务同时进行数据传输的优点。

关键词：构建多目标产生电路多个目标分配结果加速模块分配数据传输控制电路数据传输结束数据传输通道硬件电路实现计数器分配器电路光栅化模块写数据信号节拍时钟结果数据请求信号任务分配使能信号输出读数数据传输硬件电路读地址读数据轮数据写地址锁定调度传输

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一种由硬件电路实现的简易除湿机控制器

一种由硬件电路实现的简易除湿机控制器

引用

作者：李业昊沈国华 528225 广东省佛山市南海区狮山镇松岗松厦工业城华高空调(模具车间)

本实用新型公开了一种由硬件电路实现的简易除湿机控制器，包括主控芯片、三极管、继电器、二极管和电阻，二极管为多个，主控芯片的引脚“12”为复位脚，主控芯片的引脚“10”、第十一电阻、第三电容、第四电容和主控芯片的第9引脚依... 详细信息

标准号: CN213119454U

本实用新型公开了一种由硬件电路实现的简易除湿机控制器，包括主控芯片、三极管、继电器、二极管和电阻，二极管为多个，主控芯片的引脚“12”为复位脚，主控芯片的引脚“10”、第十一电阻、第三电容、第四电容和主控芯片的第9引脚依次连接组成RC振荡电路，主控芯片的引脚“4”、“6”、“13”、“14”和“15”分别与相应二极管串联后，再并联，再与三极管的基极连接，三极管的集电极与继电器连接。设有二极管，可以保证主控芯片的引脚只要有一路输出高电平，就可以使得三极管导通，且这五个引脚全部为低电平时，三极管才不导通，有效的控制了除湿机的运行周期，使得除湿机停止运行后，除湿机能够自动除霜，整体电路简单，成本低，运行可靠。

关键词：主控芯片引脚三极管二极管除湿机继电器电容电阻除湿机控制器硬件电路实现本实用新型二极管串联三极管导通基极连接停止运行依次连接运行周期整体电路自动除霜复位脚高电平集电极并联导通低电简易输出保证

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面向PUF的BCH纠错码硬件电路实现方法及BCH译码器

面向PUF的BCH纠错码硬件电路实现方法及BCH译码器

引用

作者：宋敏特吴昊张迎飞 215123 江苏省苏州市苏州工业园区独墅湖高教区若水路398号

本发明公开一种面向PUF的BCH纠错码硬件电路实现方法及BCH译码器，利用二进制BCH纠错码的对数表和反对数表，将采用有限域乘法器实现的有限域乘法功能转换到实数域实现。本发明对数表/反对数表主要借助组合逻辑电路实现，在满足算法要... 详细信息

标准号: CN113972917A

本发明公开一种面向PUF的BCH纠错码硬件电路实现方法及BCH译码器，利用二进制BCH纠错码的对数表和反对数表，将采用有限域乘法器实现的有限域乘法功能转换到实数域实现。本发明对数表/反对数表主要借助组合逻辑电路实现，在满足算法要求的基础上尽可能减小芯片面积，不需要占用flash等结构的存储(使用存储的方案也可以实现)，通过对求余和负数的处理，进一步达到了减小芯片面积和功耗的目的。

关键词：减小译码器存储芯片二进制硬件电路实现组合逻辑电路乘法功能算法要求乘法器面积和实数域功耗占用转换

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基于忆阻器阵列的PageRank算法硬件电路实现方法

基于忆阻器阵列的PageRank算法硬件电路实现方法

引用

作者：程泽智赵洪霄韩础均国洪轩 211102 江苏省南京市江宁区东南大学路2号

本发明提供了一种基于忆阻器阵列的PageRank算法硬件电路实现方法。该方法包括：设置忆阻器阵列各忆阻单元电导值，将对应于网站链接跳转的状态转移矩阵写入忆阻器阵列中；将(表征网页受欢迎程度的)初始PR值向量以电压的形式输入忆阻器... 详细信息

标准号: CN114664350A

本发明提供了一种基于忆阻器阵列的PageRank算法硬件电路实现方法。该方法包括：设置忆阻器阵列各忆阻单元电导值，将对应于网站链接跳转的状态转移矩阵写入忆阻器阵列中；将(表征网页受欢迎程度的)初始PR值向量以电压的形式输入忆阻器阵列的列信号输入端，在忆阻器阵列的行信号输出端得到第一次矩阵向量积运算结果；将忆阻器阵列的行信号输出端经过电流电压变换接回该阵列输入端，PR值计算结果为输出行信号的稳定分布。另外，由于本发明采用模拟域的存内计算方式，能够提高计算速度的同时降低能耗。

关键词：忆阻器阵列信号输出端电流电压变换硬件电路实现状态转移矩阵信号输入端计算方式网站链接运算结果次矩阵模拟域输出行输入端向量积电导跳转向量写入网页

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一种基于硬件电路实现485收发自动切换的实现方法

一种基于硬件电路实现485收发自动切换的实现方法

引用

作者：彭涛黄保伟 215000 江苏省苏州市高新区竹园路209号4号楼8楼811-4

本发明公开了一种基于硬件电路实现485收发自动切换的实现方法，包括三极管Q1、电阻R1、电阻R2、电阻R3、电阻R4、TVS管D1、TVS管D2、TVS管D3、电容C1和485收发器U1，本发明无需修改现有软件，轻松实现485相关功能；由于通过IO口软件切... 详细信息

标准号: CN111796548A

本发明公开了一种基于硬件电路实现485收发自动切换的实现方法，包括三极管Q1、电阻R1、电阻R2、电阻R3、电阻R4、TVS管D1、TVS管D2、TVS管D3、电容C1和485收发器U1，本发明无需修改现有软件，轻松实现485相关功能；由于通过IO口软件切换收发控制存在延时，导致响应速度不够，所以本专利存在收发控制切换速度快的特点；由于本方案只需要增加一个三极管和一个电阻，相比其他硬件方案具有成本低的优点；于使用的是硬件485切换电路，具有可靠性高的优点；开发速度快。

关键词：电阻收发控制三极管收发自动切换硬件电路实现软件切换收发器电容延时电路响应开发

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一种图像匹配描述子生成尺度空间的硬件电路实现方法

一种图像匹配描述子生成尺度空间的硬件电路实现方法

引用

作者：李广朱传杰朱恩邱晓冬朱方杰 211100 江苏省南京市江宁区东南大学路2号

本发明公开了一种图像匹配描述子生成尺度空间的硬件电路实现方法，包括如下步骤：在具体应用场合下，载入需做匹配的图像；对该图像做高斯平滑生成第一组图像；采用下采样结合高斯滤波的方法生成下一组图像；根据得到的高斯金字塔生成... 详细信息

标准号: CN108960251A

本发明公开了一种图像匹配描述子生成尺度空间的硬件电路实现方法，包括如下步骤：在具体应用场合下，载入需做匹配的图像；对该图像做高斯平滑生成第一组图像；采用下采样结合高斯滤波的方法生成下一组图像；根据得到的高斯金字塔生成高斯差分金字塔。本发明通过对SIFT图像匹配算法的尺度空间生成方法进行重新设计，以适应FPGA运算定点、并行、流水线的特点，加快了尺度空间生成的速度并节省了硬件资源，从而有效地优化了整个特征匹配模块的性能。

关键词：尺度空间组图像图像特征匹配模块图像匹配算法硬件电路实现高斯金字塔方法生成高斯滤波高斯平滑图像匹配硬件资源重新设计描述子下采样有效地高斯金字塔流水线匹配运算并行载入优化

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一种基于S盒优化的AES算法硬件电路实现方法

一种基于S盒优化的AES算法硬件电路实现方法

引用

作者：杨家昌熊晓明陈晓斌 510006 广东省广州市越秀区东风东路729号

本发明涉及了一种基于S盒优化的AES算法硬件电路实现方法，包括：调整AES解密算法中轮函数的运算顺序、采用复合域降阶结合费马小定理的方式对AES算法字节替换层S盒设计优化、AES字节替换层S盒与逆S盒的合并及优化、通过矩阵分解对列混... 详细信息

标准号: CN109274482A

本发明涉及了一种基于S盒优化的AES算法硬件电路实现方法，包括：调整AES解密算法中轮函数的运算顺序、采用复合域降阶结合费马小定理的方式对AES算法字节替换层S盒设计优化、AES字节替换层S盒与逆S盒的合并及优化、通过矩阵分解对列混淆变换层优化。本发明调整优化后，组成了一条新的加密/解密数据通路，共享部分资源，降低了硬件资源开销，同时采用有限域降阶方法设计优化合并S盒运算单元，大大降低了硬件面积。

关键词：设计优化字节替换优化降阶加密/解密数据硬件电路实现硬件资源开销解密算法矩阵分解运算单元运算顺序合并变换层复合域轮函数混淆共享

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基于MLWE的格密码算法硬件电路设计和实现

基于MLWE的格密码算法硬件电路设计和实现

引用

作者：姚衎南京航空航天大学

学位级别：硕士

在大数据时代,密码技术已经成为信息安全的重要基石。随着量子计算机技术的成熟,现有的公钥密码算法如RSA、椭圆曲线等将变得不再安全,因此研究能够抵抗量子计算机攻击的后量子密码(Post-quantum Cryptography,PQC)对当前密码学发展具... 详细信息

在大数据时代,密码技术已经成为信息安全的重要基石。随着量子计算机技术的成熟,现有的公钥密码算法如RSA、椭圆曲线等将变得不再安全,因此研究能够抵抗量子计算机攻击的后量子密码(Post-quantum Cryptography,PQC)对当前密码学发展具有深远的意义。格密码(Lattice-based Cryptography,LBC)是极具发展前景的一类后量子密码方案,其中基于模误差学习问题(Module Learning With Errors,MLWE)的格密码兼顾安全性与灵活性,在NIST PQC标准化决赛中占据主流地位,硬件实现时能够发挥MLWE算法的高效性。本文在FPGA平台上对基于MLWE的格密码硬件电路提出了不同类型的高性能设计,以适用多种实际应用场景。首先,从MLWE公钥加密算法中核心模块环多项式乘法出发,采用基于频域的快速数论变换(Number Theoretic Transform,NTT)算法实现了两种不同模数=7681和3329时的多项式乘法,对参数7681提出了小面积的迭代型NTT结构和高效的多路时延转接(Multi-path Delay Commutator,MDC)的流水型NTT结构。迭代型NTT电路资源开销小但控制复杂,流水型NTT串联多个处理单元进行NTT变换吞吐率高。对新参数3329定义下的NTT算法,使用了拆分奇偶项的方法将其转为常规的两个128点NTT变换,在硬件实现时分别对迭代型和流水型NTT采用并行化增加处理单元的策略提高矩阵-向量多项式乘法速度。其次,在不同的NTT结构基础上,对密文在NTT域传输的MLWE方案提出了两种方案,一种是基于迭代型NTT的面积-性能折中的均衡型设计,适合资源受限设备;另一种是基于MDCNTT的高性能设计,适合需要快速和持续通信的设备。然后,综合简易的MLWE不同电路结构的优缺点,对NIST公布的最新参数3329下的Crystal-Kyber协议公钥加密电路采用单个MDCNTT模块进行NTT变换和INTT变换,合理规划散列函数采样和矩阵运算时序,完成了高效的整体电路的实现。最后,将本文提出的格密码电路与现有的设计进行对比与分析。结果表明,所提出的两种简易的MLWE电路各有优势,面积-性能折中型设计资源利用更合理,ATP降低了31.4%以上;高性能设计完成加解密时间仅为4.53s,吞吐率最高可达221Mbps。Crystal-Kyber协议公钥加密电路仅需3168个时钟周期执行,时延相比较已有的最好设计减少了50-88%,硬件效率提升了1.9-11.7倍,最大运行频率也达到了225MHZ,更适合实时数据传输。

关键词： MLWE格密码方案 Crystal-Kyber协议数论变换算法硬件电路实现

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