检索结果-内蒙古大学图书馆

信息通信 2018年第12期31卷 132-135页

作者：刘铎马小博程俊强段小虎航空工业西安航空计算技术研究所陕西西安710068

传统的飞控计算机接口模块一般采用DSP作为模块的主控制器进行接口数据管理。通过分析接口数据管理的工作流程,文章提出一种基于FPGA的高集成度接口模块设计方法。采用FPGA代替DSP作为主控制器、采用硬件逻辑代替接口软件进行数据管理... 详细信息

传统的飞控计算机接口模块一般采用DSP作为模块的主控制器进行接口数据管理。通过分析接口数据管理的工作流程,文章提出一种基于FPGA的高集成度接口模块设计方法。采用FPGA代替DSP作为主控制器、采用硬件逻辑代替接口软件进行数据管理。此方法不仅省去使用DSP时必需的外围电路从而缩减了模块重量和体积并提高了可靠性,同时硬件逻辑的稳固性和并行执行特性也极大提高了接口数据管理的可靠性和效率,实现了具有更高性能和可靠性的高集成度接口模块设计。

关键词： FPGA 高集成度 ARINC659 硬件逻辑

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一种光线路终端设计验证系统、方法、设备以及存储介质

一种光线路终端设计验证系统、方法、设备以及存储介质

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作者：杨思龙 519000 广东省珠海市横琴新区宝华路6号105室-74030

本申请提供了一种光线路终端设计验证系统、方法、设备以及存储介质。所述系统包括：待测试设计，用于提供OLT的硬件逻辑；仿真器，用于提供OLT的软件逻辑、第一模拟设备以及第二模拟设备，软件逻辑用于模拟与OLT的硬件逻辑相关的软硬... 详细信息

标准号: CN116781152B

本申请提供了一种光线路终端设计验证系统、方法、设备以及存储介质。所述系统包括：待测试设计，用于提供OLT的硬件逻辑；仿真器，用于提供OLT的软件逻辑、第一模拟设备以及第二模拟设备，软件逻辑用于模拟与OLT的硬件逻辑相关的软硬件交互，第一模拟设备用于对ONU的逻辑功能进行模拟，第二模拟设备用于对ONU的逻辑功能进行模拟；参考信号生成器，用于提供验证OLT的逻辑功能的参考标准；光线路终端设计验证系统基于待测试设计的上行方向的逻辑功能的第一验证结果以及待测试设计的下行方向的逻辑功能的第二验证结果生成联合验证结果，联合验证结果包括待测试设计的硬件逻辑、软件逻辑的验证结果。

关键词：逻辑功能验证结果测试设计模拟设备软件逻辑硬件逻辑设计验证系统光线路终端参考信号生成器软硬件交互参考标准存储介质上行方向下行方向仿真器联合验证申请

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带自聚焦透镜的数字式光纤阵列高速摄像装置

带自聚焦透镜的数字式光纤阵列高速摄像装置

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作者：陈德桂刘洪武袁海文李志鹏李兴文耿英三 710049 陕西省西安市咸宁路28号

本发明公开了一种带自聚焦透镜的数字式光纤阵列高速摄像装置，由光纤阵列模块、光电转换模块、实时AD转换模块、全硬件逻辑控制模块、数据缓冲模块、通讯模块、后处理PC机以及具有图形组态功能的软件系统组成，提供了4个转换精度为12... 详细信息

标准号: CN100370357C

本发明公开了一种带自聚焦透镜的数字式光纤阵列高速摄像装置，由光纤阵列模块、光电转换模块、实时AD转换模块、全硬件逻辑控制模块、数据缓冲模块、通讯模块、后处理PC机以及具有图形组态功能的软件系统组成，提供了4个转换精度为12位的模拟通道及相应的控制逻辑与数据缓冲区，用以记录处理与观察对象同步发生的物理量变化信息。具有图形组态功能的后处理软件根据被观察对象的位置形状等图元特征进行编辑，观察结果之间的数据链接，动态地重现与实际光纤阵列观察位置相对应的各点的亮度变化情况，其拍摄速度达到10⁶幅/秒。可应用于电器科研领域中电弧运动的观察，也可应用于导弹、火箭的点火及爆炸过程等强光源瞬态过程的拍摄。

关键词：光纤阵列图形组态物理量变化信息透镜高速摄像装置光电转换模块光纤阵列模块数据缓冲模块后处理软件数据缓冲区后处理数字式爆炸过程电弧运动对象同步科研领域控制模块亮度变化模拟通道软件系统通讯模块图元特征位置形状硬件逻辑转换精度转换模块拍摄动态地强光源自聚焦点火火箭重现电器导弹

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用于对神经网络中的卷积层执行通道均衡的方法和系统

用于对神经网络中的卷积层执行通道均衡的方法和系统

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作者： T·盖尔 D·霍格英国赫特福德郡

本申请涉及用于对神经网络中的卷积层执行通道均衡的方法和系统。用于根据神经网络处理数据的方法和系统，该神经网络包括层序列，该层序列包括第一卷积层、第二卷积层以及该第一卷积层与该第二卷积层之间的零个、一个或多于一个中间层... 详细信息

标准号: CN117808045A

本申请涉及用于对神经网络中的卷积层执行通道均衡的方法和系统。用于根据神经网络处理数据的方法和系统，该神经网络包括层序列，该层序列包括第一卷积层、第二卷积层以及该第一卷积层与该第二卷积层之间的零个、一个或多于一个中间层。该方法包括：使用硬件逻辑，在第一卷积层之后和第二卷积层之前，通过一组每通道激活缩放因子在每通道的基础上对神经网络中的张量进行缩放；以及使用硬件逻辑，利用已经通过一组每通道激活缩放因子的倒数在每输入通道的基础上缩放的权重来实现第二卷积层。

关键词：卷积神经网络缩放因子通道激活硬件逻辑缩放神经网络处理输入通道通道均衡中间层倒数申请

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用于视频编码器的帧内预测电路及其实现方法

用于视频编码器的帧内预测电路及其实现方法

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作者：胡子一王新安彭建宏张兴 518055 广东省深圳市南山区西丽深圳大学城北大校区

本发明公开了一种用于视频编码器的帧内预测电路的实现方法，所述方法包括：将高级程序语言算法描述的视频编码器的帧内预测电路的各个函数映射成由算子单元构成的硬件逻辑描述；由所述算子单元构成的硬件逻辑描述生成帧内预测电路的硬... 详细信息

标准号: CN102055980B

本发明公开了一种用于视频编码器的帧内预测电路的实现方法，所述方法包括：将高级程序语言算法描述的视频编码器的帧内预测电路的各个函数映射成由算子单元构成的硬件逻辑描述；由所述算子单元构成的硬件逻辑描述生成帧内预测电路的硬件集成电路。应用本发明，使得系统工程师在保证不损伤数字高清视频编码的前提下，根据足以支撑描述高级语言算法的完备算子单元库，通过设计表示硬件逻辑的算子单元，能够以较快的速度设计出帧内预测电路的硬件集成电路。并且，该种帧内预测电路还可以与视频编码器内的其它专用集成电路ASIC部分进行并行流水操作，加快了视频编码器的ASIC的设计速度。

关键词：帧内预测视频编码器算子单元电路硬件逻辑硬件集成电路专用集成电路ASIC 高级程序语言高级语言算法并行流水高清视频函数映射设计速度算法描述损伤工程师支撑

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一种适用于RISC-V处理器的故障攻击检测方法

一种适用于RISC-V处理器的故障攻击检测方法

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作者：刘强李一可 300072 天津市南开区卫津路92号

本发明公开了一种适用于RISC‑V处理器的故障攻击检测方法，确定RISC‑V处理器自定义指令的操作；确定步骤1‑1中的自定义指令及其32位指令编码格式；确定自定义控制和状态寄存器的地址和功能；修改RISC‑V处理器微架构的译码单元，添加指... 详细信息

标准号: CN116796378A

本发明公开了一种适用于RISC‑V处理器的故障攻击检测方法，确定RISC‑V处理器自定义指令的操作；确定步骤1‑1中的自定义指令及其32位指令编码格式；确定自定义控制和状态寄存器的地址和功能；修改RISC‑V处理器微架构的译码单元，添加指令译码单元实现对自定义指令的译码，对译码单元进行自定义译码单元扩展后，在RISC‑V处理器微架构中添加自定义硬件逻辑，进行检测模式可配置的故障检测，包括冗余信息模式和时间冗余模式的硬件实现，以及冗余模式控制硬件实现，得到扩展后的RISC‑V处理器微结构。与现有技术相比，本发明有效提高了RISC‑V处理器电路故障检测功能的灵活性、可配置性。

关键词：处理器自定义指令译码单元自定义微架构故障攻击检测故障检测功能指令编码格式指令译码单元处理器电路状态寄存器故障检测检测模式可配置的可配置性控制硬件冗余模式冗余信息时间冗余硬件逻辑硬件实现微结构译码

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一种多节点主备仲裁方法、装置及相关设备

一种多节点主备仲裁方法、装置及相关设备

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作者：刘晓辉马保飞张方 518129 广东省深圳市龙岗区坂田华为总部办公楼

本发明实施例公开了一种多节点主备仲裁方法、装置及相关设备，其中多节点主备仲裁方法包括：获取多个节点各自的主备信号、单板在位信号和单板好坏信号，多个节点各自的主备信号、各自的单板在位信号和各自的单板好坏信号中至少一种是... 详细信息

标准号: CN116166592A

本发明实施例公开了一种多节点主备仲裁方法、装置及相关设备，其中多节点主备仲裁方法包括：获取多个节点各自的主备信号、单板在位信号和单板好坏信号，多个节点各自的主备信号、各自的单板在位信号和各自的单板好坏信号中至少一种是通过串行总线进行传输的。进一步根据第一节点以及多个节点各自的主备信号、单板在位信号和单板好坏信号确定第一节点是主用节点还是备用节点。本发明实施例通过串行总线获取多个节点的不同类型的信号，通过单个节点自身的硬件逻辑进行主备仲裁，实现快速主备仲裁。

关键词：主备单板在位信号主备信号仲裁单板串行总线多节点备用节点单个节点信号确定硬件逻辑主用节点传输

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旁路硬件乘法器中的零值乘法

旁路硬件乘法器中的零值乘法

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作者：阿卜杜勒卡迪尔·乌特库·迪里尔托马斯·马克·乌尔里希汪钊美国加利福尼亚州

本申请涉及旁路硬件乘法器中的零值乘法。一种设备(例如，集成电路芯片)包括第一操作数寄存器、第二操作数寄存器、乘法单元和硬件逻辑组件。第一操作数寄存器被配置为存储第一操作数值。第二操作数寄存器被配置为存储第二操作数值。乘... 详细信息

标准号: CN113626761A

本申请涉及旁路硬件乘法器中的零值乘法。一种设备(例如，集成电路芯片)包括第一操作数寄存器、第二操作数寄存器、乘法单元和硬件逻辑组件。第一操作数寄存器被配置为存储第一操作数值。第二操作数寄存器被配置为存储第二操作数值。乘法单元被配置为至少将第一操作数值与第二操作数值相乘。硬件逻辑组件被配置为检测是否提供了零值，并且响应于检测到提供了零值，使得至少第一操作数寄存器的更新被禁用，并且使得第一操作数值与第二操作数值的相乘结果是零值结果。

关键词：操作数寄存器乘法单元硬件逻辑配置存储集成电路芯片硬件乘法器数值相乘相乘结果乘法检测禁用旁路响应更新申请

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PWM全桥移相集成控制电路

PWM全桥移相集成控制电路

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作者：范承钟元海杨惠黄炅霞李克鹏潘未香钟玉保 528000 广东省佛山市禅城区汾江北路91号二、三、四座

PWM移相全桥集成控制电路适用于高频脉冲开关电源。本发明应用了1个或门电路，4个异或门电路，2个D型触发器，4个施密特触发器，4个或非门电路，10个电压变换电路，对外接的系统时钟信号SYN‑1，脉冲宽度调节电平信号EA，故障保护关断电... 详细信息

标准号: CN115912910B

PWM移相全桥集成控制电路适用于高频脉冲开关电源。本发明应用了1个或门电路，4个异或门电路，2个D型触发器，4个施密特触发器，4个或非门电路，10个电压变换电路，对外接的系统时钟信号SYN‑1，脉冲宽度调节电平信号EA，故障保护关断电平信号SD等3个信号，进行相位变换、逻辑变换、脉冲边沿变换；最终输出相位4路可调的PWM全桥驱动信号。本电路使用外部时钟，共用外部时钟信号的电源，输出脉冲严格同步；可实现多个电源设备串联或并联；交流脉冲电源与直流脉冲电源均可并联增加输出功率，且不会增加电源内部环流。本发明采用硬件逻辑与硬件电压变换电路，其逻辑关系、电压转换关系是刚性的，在工作过程中，不会出现全桥开关误触发现象。

关键词：电压变换电路电源高频脉冲开关集成控制电路交流脉冲电源脉冲宽度调节施密特触发器外部时钟信号系统时钟信号增加输出功率直流脉冲电源或非门电路异或门电路电路使用电平信号电压转换电源设备故障保护或门电路逻辑变换逻辑关系脉冲边沿全桥开关全桥驱动输出脉冲输出相位外部时钟相位变换硬件逻辑环流可并联可调的误触发并联全桥断电串联应用

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一种复位电路模块、复位电路装置及车辆

一种复位电路模块、复位电路装置及车辆

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作者：杨轩辛培王腾严平锋洪有敏 201206 上海市浦东新区中国(上海)自由贸易试验区榕桥路555号

本申请提供一种复位电路模块、复位电路装置及车辆，包括：电源电路单元，包括至少两路电源电路，每路电源电路用于提供第一电平信号或第二电平信号；复位电路，与电源电路单元连接；当电源电路单元中至少一路电源电路提供第二电平信号... 详细信息

标准号: CN118276660A

本申请提供一种复位电路模块、复位电路装置及车辆，包括：电源电路单元，包括至少两路电源电路，每路电源电路用于提供第一电平信号或第二电平信号；复位电路，与电源电路单元连接；当电源电路单元中至少一路电源电路提供第二电平信号时，复位电路输出复位信号，被测复位电路基于复位信号执行复位；其中，第一电平信号表示逻辑真值为真或有效的逻辑电平信号，第二电平信号表示逻辑真值为假或无效的逻辑电平信号。本申请在域控制器、跨域控制器复杂系统中能够有效解决多复位源、不同电压的复位问题。而且本申请对于不同电压的单路复位信号，不用额外增加电平转换芯片，节省了硬件成本。本申请硬件逻辑简单，能够降低软件开发成本。

关键词：电平信号电源电路单元电源电路复位电路逻辑电平信号复位信号申请电平转换芯片复位电路模块复位电路装置软件开发成本复位问题复杂系统输出复位硬件成本硬件逻辑有效解决域控制器控制器复位源单路复位跨域两路

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