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T=题名（书名、题名），A=作者（责任者），K=主题词，P=出版物名称，PU=出版社名称，O=机构（作者单位、学位授予单位、专利申请人），L=中图分类号，C=学科分类号，U=全部字段，Y=年（出版发行年、学位年度、标准发布年）

检索规则说明：

AND代表“并且”；OR代表“或者”；NOT代表“不包含”；(注意必须大写,运算符两边需空一格)

检索范例：

范例一：(K=图书馆学 OR K=情报学) AND A=范并思 AND Y=1982-2016
范例二：P=计算机应用与软件 AND (U=C++ OR U=Basic) NOT K=Visual AND Y=2011-2016

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文献类型

8 篇 专利

馆藏范围

8 篇 电子文献
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日期分布

机构

5 篇 浪潮电子信息产业...
2 篇 深圳市芯启源科技...
1 篇 北京威视锐科技有...

作者

3 篇 王彦伟
2 篇 王威
2 篇 张闯
2 篇 侯啸林
2 篇 郝锐
2 篇 冷伟民
1 篇 王江为
1 篇 黄伟
1 篇 高成超
1 篇 刘晓斌
1 篇 姚远
1 篇 张静东
1 篇 赵谦谦
1 篇 刘伟
1 篇 肖麟阁
1 篇 沈艳梅
1 篇 宿栋栋
1 篇 李辰

语言

8 篇 中文

检索条件"主题词=硬核模块"

共 8 条记录，以下是1-10 订阅

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详细简洁

排序：

一种FPGA加速卡高速存储系统

一种FPGA加速卡高速存储系统

引用

作者：张闯 100085 北京市海淀区上地信息路2号2-1号C栋1层

本发明公开了一种FPGA加速卡高速存储系统，包括PCIe硬核模块、FPGA模块以及DDR3存储模块；其中，所述FPGA模块用于将待存储数据进行同步缓存与格式转换，并将所述待存储数据存入至所述DDR3存储模块，所述DDR3存储模块为高速大容量缓存... 详细信息

标准号: CN105224482A

本发明公开了一种FPGA加速卡高速存储系统，包括PCIe硬核模块、FPGA模块以及DDR3存储模块；其中，所述FPGA模块用于将待存储数据进行同步缓存与格式转换，并将所述待存储数据存入至所述DDR3存储模块，所述DDR3存储模块为高速大容量缓存；所述PCIe硬核模块通过IO接口与所述DDR3存储模块的接口相连，用于以直接内存访问的方式将所述待存储数据高速上传到系统内存中，以进行后续处理。本发明通过FPGA作为控制中心，以FPGA中提供的PCIe硬核实现高速DMA读写，同时以DDR3作为大容量缓存，具有较高的数据带宽和良好的性能。

关键词：存储模块待存储数据硬核模块缓存高速存储系统直接内存访问大容量缓存高速大容量格式转换后续处理接口相连控制中心数据带宽同步缓存系统内存加速卡一种硬核存入进行公开

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一种FPGA加速卡高速存储系统

一种FPGA加速卡高速存储系统

引用

作者：张闯 100085 北京市海淀区上地信息路2号2-1号C栋1层

标准号: CN105224482B

关键词：存储模块待存储数据大容量缓存硬核模块高速存储系统直接内存访问格式转换后续处理控制中心数据带宽同步缓存系统内存硬核

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一种网卡设备及数据传输系统

一种网卡设备及数据传输系统

引用

作者：刘伟沈艳梅宿栋栋王彦伟黄伟 100085 北京市海淀区上地信息路2号2-1号C栋1层

本发明公开了一种网卡设备及数据传输系统，涉及数据处理领域，为解决数据传输占用主机内存的访问带宽的问题，该网卡设备包括存储模块；描述符队列地址寄存器；计算高速链路硬核模块，用于将主机发送的数据传输至第一数据存储区域，将... 详细信息

标准号: CN117648264A

本发明公开了一种网卡设备及数据传输系统，涉及数据处理领域，为解决数据传输占用主机内存的访问带宽的问题，该网卡设备包括存储模块；描述符队列地址寄存器；计算高速链路硬核模块，用于将主机发送的数据传输至第一数据存储区域，将主机发送的描述符传输至第一描述符存储区域，将主机发送的触发指令传输至网络数据处理模块；网络数据处理模块，用于当接收到触发指令，从描述符队列地址寄存器中获取基地址，基于基地址和触发指令读取第一描述符存储区域中的目标描述符，在第一数据存储区域中读取目标描述符对应的目标数据，将目标数据输出至网络。本发明能够把主机内存的访问带宽留给主机上运行的其他功能使用，提高了主机的整体运行效率。

关键词：存储区域触发指令主机发送描述符网络数据处理模块地址寄存器描述符队列第一数据目标数据数据传输网卡设备主机内存基地址主机带宽读取数据处理领域数据传输系统整体运行效率描述符传输目标描述符存储模块读取目标高速链路功能使用硬核模块访问占用传输输出网络

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一种加速设备及计算加速系统

一种加速设备及计算加速系统

引用

作者：肖麟阁王彦伟郝锐赵谦谦 100085 北京市海淀区上地信息路2号2-1号C栋1层

本发明公开了一种加速设备及计算加速系统，涉及加速计算领域，为解决计算过程数据传输延迟较大的问题，该加速设备包括计算高速链路硬核模块，用于接收主机发送的计算请求并转发；部署有非对称加密算法的加速计算模块，用于当接收到计... 详细信息

标准号: CN117608849A

本发明公开了一种加速设备及计算加速系统，涉及加速计算领域，为解决计算过程数据传输延迟较大的问题，该加速设备包括计算高速链路硬核模块，用于接收主机发送的计算请求并转发；部署有非对称加密算法的加速计算模块，用于当接收到计算请求，按计算请求访问统一编址后的地址空间中主机生成的待计算数据，基于非对称加解密算法对待计算数据进行非对称加密计算得到结果数据，将结果数据写入统一编址后的地址空间，以便主机访问统一编址后的地址空间中的结果数据。本发明能够减少加速过程中的数据搬移次数，降低数据传输延迟。

关键词：地址空间计算请求结果数据统一编址计算数据加速设备非对称加密算法计算过程数据数据传输延迟非对称加密加解密算法传输延迟高速链路计算模块加速过程加速系统接收主机数据搬移硬核模块主机访问非对称主机写入转发发送部署访问

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一种数据处理装置、系统及电子设备

一种数据处理装置、系统及电子设备

引用

作者：张静东王江为王彦伟郝锐 100085 北京市海淀区上地信息路2号2-1号C栋1层

本发明公开了一种数据处理装置、系统及电子设备，涉及数据处理领域，为解决主机无法直接、高效地读写网卡设备的大容量内存的问题，该数据处理装置包括计算高速链路硬核模块，用于获取主机发送的任务请求，确定任务请求对应的目标内存... 详细信息

标准号: CN117555836A

本发明公开了一种数据处理装置、系统及电子设备，涉及数据处理领域，为解决主机无法直接、高效地读写网卡设备的大容量内存的问题，该数据处理装置包括计算高速链路硬核模块，用于获取主机发送的任务请求，确定任务请求对应的目标内存访问模块，将任务请求下发至目标内存访问模块；支持计算高速链路协议的第一内存访问模块，用于直接对存储模块执行任务请求对应的操作；第二内存访问模块，用于根据任务请求从主机的内存中请求对应的数据帧，并基于接收到的数据帧对存储模块执行对应的操作。本发明能够使主机直接访问电子设备中的存储模块的传输层，无需映射到主机内存空间，降低对主机内存和带宽以及总线链路的带宽的占用。

关键词：任务请求存储模块主机内存访问模块数据处理装置电子设备访问模块高速链路目标内存主机内存数据帧带宽数据处理领域大容量内存网卡设备硬核模块直接访问主机发送总线链路传输层读写映射内存占用

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一种基于fpga加速卡的光纤高速采集存储系统

一种基于fpga加速卡的光纤高速采集存储系统

引用

作者：刘晓斌高成超姚远李辰 100192 北京市海淀区后屯路28号院1号楼2层215室

本实用新型公开了一种基于fpga加速卡的光纤高速采集存储系统，包括光纤模块、fpga模块、PCIe硬核模块和DDR存储模块，所述光纤模块与fpga模块交互传输电连接，所述fpga模块与PCIe硬核模块PCIe总线标准的接口传输电连接，所述pga模块和... 详细信息

标准号: CN211479105U

本实用新型公开了一种基于fpga加速卡的光纤高速采集存储系统，包括光纤模块、fpga模块、PCIe硬核模块和DDR存储模块，所述光纤模块与fpga模块交互传输电连接，所述fpga模块与PCIe硬核模块PCIe总线标准的接口传输电连接，所述pga模块和DDR存储模块传输电连接，所述fpga模块，所述PCIe硬核模块通过所述fpga模块与所述DDR存储模块传输电连接。本实用新型以DDR4存储器为基础，设计一套内部DDR4控制器，并对外提供通用FIFO控制信号的完整逻辑，并且用aurora协议代替常用的网路协议作为光纤的接口协议设计，降低了成本，提高了速率。

关键词：电连接硬核模块本实用新型光纤模块光纤存储器传输存储系统高速采集交互传输接口传输接口协议控制信号网路协议控制器通用

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信号发生装置

信号发生装置

引用

作者：王威侯啸林冷伟民 518000 广东省深圳市宝安区新安街道创业二路宝安新一代信息技术产业园C座525

本实用新型公开了一种信号发生装置，该信号发生装置基于FPGA实现，该信号发生装置包括：信号源输入接口、信号输出接口、闪存器接口、PCI‑E硬核模块、数据交互模块接口、可局部重构标准核心算法模块、控制逻辑模块、以及配置逻辑模块... 详细信息

标准号: CN205945981U

本实用新型公开了一种信号发生装置，该信号发生装置基于FPGA实现，该信号发生装置包括：信号源输入接口、信号输出接口、闪存器接口、PCI‑E硬核模块、数据交互模块接口、可局部重构标准核心算法模块、控制逻辑模块、以及配置逻辑模块，其中，PCI‑E硬核模块、数据交互模块接口、和可局部重构标准核心算法模块依次连接在信号源输入接口与信号输出接口之间；控制逻辑模块与数据交互接口、可局部重构标准核心算法模块、以及配置逻辑模块分别连接；闪存器接口与配置逻辑模块连接。本实用新型能够提高FPGA的使用率和工作稳定性，并保证不同标准的配置效率和成功率，以及提高不同标准的测试信号的切换效率。

关键词：信号发生装置标准核心局部重构配置逻辑算法模块信号源输入接口控制逻辑模块数据交互模块信号输出接口本实用新型硬核模块闪存器数据交互接口工作稳定性测试信号模块连接依次连接使用率成功率配置保证

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信号发生装置

信号发生装置

引用

作者：王威侯啸林冷伟民 518000 广东省深圳市宝安区新安街道创业二路宝安新一代信息技术产业园C座525

本实用新型公开了一种信号发生装置，该信号发生装置包括：FPGA和射频电路，其中，所述FPGA包括信号输入接口和信号输出接口，所述FPGA通过信号输出接口与所述射频电路连接，其中，所述信号输入接口为PCI‑E接口，所述信号输出接口为IQ... 详细信息

标准号: CN206024011U

本实用新型公开了一种信号发生装置，该信号发生装置包括：FPGA和射频电路，其中，所述FPGA包括信号输入接口和信号输出接口，所述FPGA通过信号输出接口与所述射频电路连接，其中，所述信号输入接口为PCI‑E接口，所述信号输出接口为IQ数据接口；所述FPGA包括：在所述PCI‑E接口和所述IQ数据接口之间依次连接的PCI‑E硬核模块、码流处理模块、核心物理层模块以及频谱形成模块。本实用新型通过本实用新型通过采取PCI‑Express总线协议来进行信号发生装置与计算机之间的连接和通讯，能够使TS码流直接通过PCI‑E接口输入至FPGA，减少了信号输入接口与FPGA之间的电路结构，从而降低了信号发生装置的成本以及体积，并简化了结构、易于维护、信号稳定性和传输速率都较好。

关键词：信号发生装置信号输出接口信号输入接口本实用新型射频电路物理层模块信号稳定性电路结构码流处理依次连接硬核模块频谱传输计算机通讯维护

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