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T=题名（书名、题名），A=作者（责任者），K=主题词，P=出版物名称，PU=出版社名称，O=机构（作者单位、学位授予单位、专利申请人），L=中图分类号，C=学科分类号，U=全部字段，Y=年（出版发行年、学位年度、标准发布年）

检索规则说明：

AND代表“并且”；OR代表“或者”；NOT代表“不包含”；(注意必须大写,运算符两边需空一格)

检索范例：

范例一：(K=图书馆学 OR K=情报学) AND A=范并思 AND Y=1982-2016
范例二：P=计算机应用与软件 AND (U=C++ OR U=Basic) NOT K=Visual AND Y=2011-2016

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7 篇 专利

馆藏范围

7 篇 电子文献
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日期分布

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3 篇 杭州中天微系统有...
2 篇 杭州电子科技大学
1 篇 威盛电子股份有限...

作者

2 篇 崔炳煜
2 篇 崔晓夏
2 篇 高顶冲
2 篇 谢澄扬
2 篇 陈安馨
2 篇 陈理
2 篇 侯光恩
2 篇 李春强
2 篇 章复嘉
1 篇 宋涛
1 篇 陈晨
1 篇 刘畅
1 篇 朱涛涛
1 篇 于欣
1 篇 威廉·v·米勒
1 篇 保罗·j·佩特承
1 篇 郭娟
1 篇 梁时英
1 篇 杨丹子

语言

7 篇 中文

检索条件"主题词=程序状态寄存器"

共 7 条记录，以下是1-10 订阅

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详细简洁

排序：

程序状态寄存器处理状态改变的系统与方法

程序状态寄存器处理状态改变的系统与方法

引用

作者：保罗·J·佩特承威廉·V·米勒台湾省台北县新店市中正路533号8楼

一种程序状态寄存器处理状态改变的系统与方法。包含：一时钟脉冲；至少一更新数值，用于在接收一更新致能讯号时将程序状态寄存器由一第一数值更新为一第二数值；一取样程序状态寄存器储存该取样状态寄存器的第一数值；一状态改变取样... 详细信息

标准号: CN1301460C

一种程序状态寄存器处理状态改变的系统与方法。包含：一时钟脉冲；至少一更新数值，用于在接收一更新致能讯号时将程序状态寄存器由一第一数值更新为一第二数值；一取样程序状态寄存器储存该取样状态寄存器的第一数值；一状态改变取样寄存器，根据一状态改变指示讯号与该时钟脉冲来产生一同步状态改变讯号。当在第一个时钟脉冲周期内接收到该更新致能讯号，且更进一步接收到该状态改变指示讯号时，藉由被该同步状态改变讯号触发的一第一选择模块，在接着第一时钟脉冲周期后的一第二个时钟脉冲周期内将程序状态寄存器的更新输出还原为该第一数值。

关键词：讯号程序状态寄存器时钟脉冲周期同步状态取样寄存器状态寄存器取样程序取样状态时钟脉冲寄存器脉冲触发还原储存

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一种处理器及内核切换处理方法

一种处理器及内核切换处理方法

引用

作者：朱涛涛陈晨刘畅 310012 浙江省杭州市西湖区西斗门路3号天堂软件园A幢15楼C座

本发明公开了一种处理器，具有可信内核和非可信内核。该处理器包括程序状态寄存器、切换状态寄存器和切换控制单元。程序状态寄存器适于存储当前内核标识位和起始内核标识位。当前内核标识位指示处理器的当前内核为可信内核还是非可信... 详细信息

标准号: CN112231072A

本发明公开了一种处理器，具有可信内核和非可信内核。该处理器包括程序状态寄存器、切换状态寄存器和切换控制单元。程序状态寄存器适于存储当前内核标识位和起始内核标识位。当前内核标识位指示处理器的当前内核为可信内核还是非可信内核，以及起始内核标识位指示处理器在切换到当前内核之前的内核为可信内核还是非可信内核。切换状态寄存器适于存储切换状态标识位。切换状态标识位指示内核切换方式。切换控制单元适于接收内核切换请求，并根据当前内核标识位、起始内核标识位和切换状态标识位来处理内核切换请求以进行内核切换。本发明还公开了一种在该处理器中执行的内核切换请求处理方法和包含该处理器的片上系统。

关键词：内核标识位处理器可信切换状态程序状态寄存器寄存器状态标识位处理内核存储切换片上系统请求处理存储

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用于ARMv7处理器仿真系统内的中断嵌套的实现系统及方法

用于ARMv7处理器仿真系统内的中断嵌套的实现系统及方法

引用

作者：章复嘉崔炳煜陈安馨谢澄扬高顶冲 310018 浙江省杭州市下沙高教园区2号大街

本发明属于ARMv7处理器仿真系统领域，公开了一种用于ARMv7处理器仿真系统内的中断嵌套的实现系统及方法，包括中断信号获取解析模块、程序状态寄存器获取分割模块、中断信号判断设置模块、寄存器信息保护模块、处理器模式更新模块、中... 详细信息

标准号: CN113377511B

本发明属于ARMv7处理器仿真系统领域，公开了一种用于ARMv7处理器仿真系统内的中断嵌套的实现系统及方法，包括中断信号获取解析模块、程序状态寄存器获取分割模块、中断信号判断设置模块、寄存器信息保护模块、处理器模式更新模块、中断服务程序执行模块和中断返回模块。本发明在中断处理过程中多重中断的嵌套，即支持高优先级的中断打断当前低优先级中断的执行，当高优先级中断执行完成之后，能够返回低优先级的中断服务程序继续执行，在中断处理过程中，能够正确地保护中断发生前的中断现场的各个寄存器信息，在中断完成之后，能够正确地恢复中断发生前中断现场的各个寄存器信息，并且继续按指令的顺序执行ARMv7指令的仿真程序。

关键词：中断寄存器信息中断处理过程中断服务程序优先级中断仿真系统中断信号处理器程序状态寄存器嵌套指令处理器模式保护模块多重中断仿真程序分割模块更新模块继续执行解析模块设置模块顺序执行嵌套的返回打断恢复

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用于ARMv7处理器仿真系统内的中断嵌套的实现系统及方法

用于ARMv7处理器仿真系统内的中断嵌套的实现系统及方法

引用

作者：章复嘉崔炳煜陈安馨谢澄扬高顶冲 310018 浙江省杭州市下沙高教园区2号大街

标准号: CN113377511A

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用于教学实验的计算机中央处理器

用于教学实验的计算机中央处理器

引用

作者：于欣宋涛杨丹子郭娟梁时英 050081 河北省石家庄市中山西路12号石家庄职业技术学院教务处

本实用新型公开了一种用于教学实验的计算机中央处理器，包括控制器、运算器和总线，运算器包括算术逻辑单元ALU、通用寄存器GR、程序状态寄存器PSW和算术逻辑单元输入端的选择器，所述控制器包括程序计数器PC、指令寄存器IR、地址寄存... 详细信息

标准号: CN206133556U

本实用新型公开了一种用于教学实验的计算机中央处理器，包括控制器、运算器和总线，运算器包括算术逻辑单元ALU、通用寄存器GR、程序状态寄存器PSW和算术逻辑单元输入端的选择器，所述控制器包括程序计数器PC、指令寄存器IR、地址寄存器MAR、数据寄存器MDR、指令译码器、时序系统和组合逻辑信号发生器，所述总线包括地址总线AB、数据总线AD和控制总线CB，所述总线用于连接主存储器与CPU，本实用新型的所涉及的中央处理器为开放式结构，在进行教学实验过程中可以根据不同需求进行个性化定义，方便实用，简单易行，而且指令系统和指令格式更加简单，便于调试，方便学生进行计算机硬件实验。

关键词：总线教学实验本实用新型控制器运算器计算机中央处理器算术逻辑单元ALU 程序状态寄存器计算机硬件实验程序计数器PC 算术逻辑单元组合逻辑信号地址寄存器开放式结构数据寄存器通用寄存器指令寄存器指令译码器中央处理器地址总线控制总线时序系统数据总线指令格式指令系统主存储器发生器选择器个性化调试学生

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一种基于可信内核的防攻击数据处理器

一种基于可信内核的防攻击数据处理器

引用

作者：崔晓夏李春强侯光恩陈理 310012 浙江省杭州市西湖区西斗门路3号天堂软件园A幢15楼

本发明提供一种基于可信内核的防攻击数据处理器，包括：可信内核异常向量表，用于提供内核切换的处理入口；可信内核堆栈指针寄存器，用于存储指向可信内核堆栈空间的可信内核堆栈指针；可信内核堆栈空间中的可信现场，可信现场包括用... 详细信息

标准号: CN107463856A

本发明提供一种基于可信内核的防攻击数据处理器，包括：可信内核异常向量表，用于提供内核切换的处理入口；可信内核堆栈指针寄存器，用于存储指向可信内核堆栈空间的可信内核堆栈指针；可信内核堆栈空间中的可信现场，可信现场包括用于存储内核切换的起始内核标志位的程序状态寄存器、程序指针和通用寄存器；其中，数据处理器在执行非可信内核向可信内核的内核切换时，所述可信内核寻址到所述内核切换的处理入口并执行切换。本发明能够对可信内核切换入口提供底层软件保护机制，使得可信内核和非可信内核切换时更加安全。

关键词：内核可信内核堆栈指针数据处理器内核堆栈程序状态寄存器通用寄存器异常向量表程序指针存储内核底层软件标志位防攻击寄存器寻址存储指向安全

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一种基于可信内核的防攻击数据处理器

一种基于可信内核的防攻击数据处理器

引用

作者：崔晓夏李春强侯光恩陈理 310012 浙江省杭州市西湖区西斗门路3号天堂软件园A幢15楼

标准号: CN107463856B

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