检索结果-内蒙古大学图书馆

作者：杨海波徐志国 100098 北京市海淀区北三环西路31号院18号平房A235室

本实用新型提出了一种基于RISC嵌入式操作系统的密码装置，包括：用于存储密钥口令的密钥存储设备，密钥存储设备为USB设备；用于对密钥口令进行验证和对交易数据进行数字签名的主机设备，主机设备包括本体、电源线插座、串行接口、管... 详细信息

标准号: CN205507774U

本实用新型提出了一种基于RISC嵌入式操作系统的密码装置，包括：用于存储密钥口令的密钥存储设备，密钥存储设备为USB设备；用于对密钥口令进行验证和对交易数据进行数字签名的主机设备，主机设备包括本体、电源线插座、串行接口、管理接口和电源开关，其中，密钥存储设备与管理接口连接，管理接口为USB接口，主机设备采用精简指令集计算机RISC嵌入式操作系统。本实用新型具有安全性高、多核运算，高并发、高性能、高稳定性，运算处理效率高和存储容量大的特点。

关键词：密钥存储设备管理接口主机设备嵌入式操作系统本实用新型口令精简指令集计算机电源线插座串行接口存储密钥存储容量电源开关高稳定性交易数据密码装置运算处理对密钥多核运算并发验证

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一种基于激光器的信号源装置的伺服模块及信号源装置

一种基于激光器的信号源装置的伺服模块及信号源装置

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作者：漆为民贾茜周俊 430056 湖北省武汉市沌口经济技术开发区新江大路8号江汉大学

本实用新型公开了一种基于激光器的信号源装置的伺服模块及信号源装置，属于光电技术领域。所述信号源装置包括激光器、声光调制器AOM、同位素吸收室、伺服模块，所述伺服模块包括压控晶振、直接数字频率合成器DDS、先进精简指令集计算... 详细信息

标准号: CN205248611U

本实用新型公开了一种基于激光器的信号源装置的伺服模块及信号源装置，属于光电技术领域。所述信号源装置包括激光器、声光调制器AOM、同位素吸收室、伺服模块，所述伺服模块包括压控晶振、直接数字频率合成器DDS、先进精简指令集计算机微处理器ARM、同步鉴相器，所述压控晶振、所述DDS、所述AOM、所述同位素吸收室、所述同步鉴相器依次连接，所述ARM分别与所述压控晶振、所述DDS、所述同步鉴相器、所述激光器连接。本实用新型通过ARM根据光检信号产生作用于激光器的压控信号和作用于压控晶振的反馈信号，两者同时调节信号源的信号，利用基于激光器外围电路对激光器进行频率的稳定，提高了激光器的输出频率稳定度。

关键词：激光器压控晶振信号源装置伺服模块同步鉴相同位素吸收室直接数字频率合成器精简指令集计算机声光调制器微处理器反馈信号光电技术输出频率同时调节外围电路信号产生压控信号依次连接稳定度信号源实用光检一种连接公开先进稳定进行

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16位RISC处理器的设计和FPGA实现

16位RISC处理器的设计和FPGA实现

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作者：何惊昱兰州大学

学位级别：硕士

精简指令集计算机(Reduced Instruction Set Computer, RISC)是1979年提出的一种先进的处理器设计思想,其特点为优先选取处理器中使用频率最高的指令,并将指令的格式固定,指令的寻址方式减少。由于RISC简单高效的优点,使其在提出之后就... 详细信息

精简指令集计算机(Reduced Instruction Set Computer, RISC)是1979年提出的一种先进的处理器设计思想,其特点为优先选取处理器中使用频率最高的指令,并将指令的格式固定,指令的寻址方式减少。由于RISC简单高效的优点,使其在提出之后就得到了业界的广泛关注。目前在高性能服务器和嵌入式领域,90%的处理器都是采用RISC架构进行设计的。但是,在RISC处理器经典的五级流水线结构中,执行阶段存在的逻辑众多,可能会产生拥堵现象,从而影响流水线的执行速率。为了避免逻辑拥堵现象的发生,进一步提高流水线的数据处理速度及扩展处理器功能,本文对处理器的流水线结构重新进行划分,提出了一种由指令取出单元(IF)、指令译码单元(ID)、控制逻辑执行单元(FLE)、运算单元(AU)和寄存器组(REF)五部分组成的新型五级流水线结构。其中,在流水线的运算单元添加了新型的乘累加器来拓展RISC处理器的功能,与普通乘累加器相比,此新型乘累加器注重电路结构的简化,并且其执行速度提升了三倍。本论文研究了流水线结构引入的结构相关、数据相关和控制相关问题,并使用哈佛结构、数据前推技术以及软件编程的方法分别解决了这三种相关性问题。在新型流水线结构的具体实现时使用Verilog HDL完成了流水线的逻辑设计,利用Modelsim软件对流水线各级以及整体结构进行了功能仿真,然后使用Quartus Ⅱ软件对处理器进行了逻辑综合以及静态时序分析。从仿真综合的结果可以看出：处理器可以平稳快速地执行,并且流水线中的每一条指令都可以在一个时钟周期内执行完毕。时序报告显示：该处理器没有发生任何时序违规现象,满足时序设计要求,并且流水线结构的最大工作频率可以达到172.95MHz,与同类设计相比,提高了15.2%。最后,在FPGA实验板上对其进行硬件调试,达到了本设计预期的目标。

关键词：精简指令集计算机流水线乘累加器静态时序分析 FPGA

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研华科技推出嵌入式RISC/ARM平台系列产品

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军民两用技术与产品 2014年第8期 23-23页

研华利＋技股份有限公司将推出全系列嵌入式精简指令集计算机（RISC）／高级精简指令集计算机（ARM）平台解决方案，包括ROM-3420RTX2．O模块、ROM-5420SMARC模块、ROM-7420Qseven模块等产品。

关键词：平台系列嵌入式 RISC 研华科技产品精简指令集计算机 ARM 模块

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基于ARMv4指令集的32位RISC微控制器的设计与实现

基于ARMv4指令集的32位RISC微控制器的设计与实现

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作者：孙永琦浙江理工大学

学位级别：硕士

嵌入式系统在很多领域有着广泛的应用，包括个人消费、通信、工业控制以及军事等。嵌入式系统的核心是微控制器，其性能直接影响到整个系统的性能。本文基于开源IP核设计并实现了一款具备基本功能的微控制器，该微控制器用于一款小型射... 详细信息

嵌入式系统在很多领域有着广泛的应用，包括个人消费、通信、工业控制以及军事等。嵌入式系统的核心是微控制器，其性能直接影响到整个系统的性能。本文基于开源IP核设计并实现了一款具备基本功能的微控制器，该微控制器用于一款小型射频SOC芯片。该微控制器的核心是一个基于ARMv4指令集微处理器内核，外围设备包括SPI控制器、通用串口、定时器、通用IO接口和外部中断以及中断控制器。本文设计的微处理器是在一款基于ARMv2a指令集架构的开源IP核的基础上，进行深度修改得到。ARM作为目前RISC（Reduced Instruction Set Computer），即精简指令集计算机的代表，在嵌入式领域有着广泛的应用，本文选择ARM指令集有着深远意义。本文设计的微处理器内核兼容ARMv4指令集48条指令中的43条，5条协处理器指令除外。该微处理器内核拥有三级流水线结构和Wishbone系统总线，而且能够很好的兼容现有编译器，方便应用调试。外围设备也是微控制器的重要组成部分，微处理器影响着微控制器的性能，而外围设备则关系到整个微控制器功能的丰富性。本文设计的微控制器包括了五个外围设备，其中SPI控制器和通用串口是参考现有案例自主重点设计，定时器、通用IO接口及外部中断和中断控制器只具备简单功能，为满足射频SOC基本需求而设置。SPI控制器符合SPI通信协议标准；通用串口具有最基本的数据帧结构，即1位起始位、8位宽的数据位、没有校验位，停止位位2位。所有外设都基于Wishbone系统总线从设备而设计，不仅应用于本文的微控制器，还可以应用于其他任何基于Wishbone系统总线的设计。仿真验证是数字系统设计的重要流程，包括功能仿真和布局布线后的仿真。本文设计的微控制器从整体到各个功能模块都进行了完整的仿真，功能仿真所使用的仿真工具是Modelsim6.5f版本；由于没有目标工艺库，因此布局布线后的仿真是针对Altera公司的CycloneII系列FPGA进行的。通过最后微控制器在FPGA上的测试，证明整个设计实现了完整的微控制器功能，能够满足射频SOC对微控制器的需求。

关键词：微控制器精简指令集计算机 ARM指令集片上系统片上总线

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RISC微处理器软核的研究与设计

RISC微处理器软核的研究与设计

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作者：朱双兵湖北大学

学位级别：硕士

随着集成电路技术的迅速发展,片上系统SoC随之兴起,促使系统向微型化、智能化和高效率方向发展,这对微处理器的结构、效率和速度等性能提出了更高的要求,因此,RISC微处理器成为研究的热点。而FPGA/SOPC技术的发展又为微处理器设计提供... 详细信息

随着集成电路技术的迅速发展,片上系统SoC随之兴起,促使系统向微型化、智能化和高效率方向发展,这对微处理器的结构、效率和速度等性能提出了更高的要求,因此,RISC微处理器成为研究的热点。而FPGA/SOPC技术的发展又为微处理器设计提供了更加灵活快捷的平台,因此,本文从RISC微处理器的微结构研究入手,以FPGA为实现平台,采用自顶向下的方法设计完成了一个16位的RISC微处理器。 (1)研究了RISC微处理器的体系结构和逻辑模型,介绍了FPGA自顶向下的设计思想和开发流程,给出了FPGA的功能验证方法。 (2)设计了微处理器的顶层架构和操作空间。分析并设计了该处理器的指令集,从指令名称、运算、汇编语言格式、执行描述等方面对每条指令进行了详细阐述,并设计出了微处理器的中断触发和响应流程。 (3)设计了微处理器的微结构总体框图,采用自顶向下的设计方法对微处理器进行了系统级设计,使用Verilog硬件描述语言设计了微处理器的内部运算控制单元,并以所设计的指令为例进行了数据和控制通路的分析。 (4)使用ModelSim仿真工具对微处理器的RTL实现进行了功能验证,通过验证后采用Altera公司的FPGA搭建了微处理器的测试系统,最后在硬件测试系统上进行了板级测试,测试结果与仿真验证结果一致,证明了所设计出的16位RISC结构微处理器的正确性。

关键词：微处理器精简指令集计算机微结构 Verilog硬件描述语言现场可编程逻辑阵列

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TKScope嵌入式仿真开发平台讲座(36) TKScope发布富士通ARM芯片完整编程和仿真组件

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单片机与嵌入式系统应用 2012年第2期12卷 84-85页

广州周立功单片机发展有限公司成为富士通（Fujitsu）公司中国区合作伙伴，将富士通先进的ARM芯片引入中国。富士通（Fujitsu）是面向全球市场提供行业解决方案的优秀的ICT综合服务供应商。为满足对灵活性日益增长的需求，富士通提供高... 详细信息

广州周立功单片机发展有限公司成为富士通（Fujitsu）公司中国区合作伙伴，将富士通先进的ARM芯片引入中国。富士通（Fujitsu）是面向全球市场提供行业解决方案的优秀的ICT综合服务供应商。为满足对灵活性日益增长的需求，富士通提供高性能的32位精简指令集计算机（RISC）控制器。

关键词： ARM芯片富士通仿真组件精简指令集计算机编程服务供应商合作伙伴全球市场

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TKScope发布富士通ARM芯片完整编程和仿真组件

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单片机与嵌入式系统应用 2012年第2期12卷 84-85页

关键词： ARM芯片富士通仿真组件精简指令集计算机编程服务供应商合作伙伴全球市场

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基于FPGA的32位RISC微处理器设计

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数据采集与处理 2011年第3期26卷 367-373页

作者：刘览郑步生施慧彬南京航空航天大学电子信息工程学院南京210016 南京航空航天大学计算机科学与技术学院南京210016

提出了一种与MIPS32指令集兼容的32位RISC微处理器(HP-MIPS)的设计方法。在对经典的MIPS体系结构分析之后,对处理器的整体结构进行重新划分,通过增加流水线级数设计出一种拥有8级流水线的微处理器数据路径结构,并且对设计中由于增加流... 详细信息

提出了一种与MIPS32指令集兼容的32位RISC微处理器(HP-MIPS)的设计方法。在对经典的MIPS体系结构分析之后,对处理器的整体结构进行重新划分,通过增加流水线级数设计出一种拥有8级流水线的微处理器数据路径结构,并且对设计中由于增加流水线级数而引入的流水线数据冲突问题给出了完整的解决方案。此外还设计了一种流水线结构的动态分支预测器用以解决微处理器分支冒险问题,其优点在于既能降低微处理器的CPI,同时又不会使流水线出现局部逻辑拥堵从而降低微处理器的主频。最后给出了设计的综合结果,并对该设计进行了软件仿真和硬件验证。在FPGA芯片上的运行时钟频率可达146.628 MHz。

关键词：精简指令集计算机微处理器流水线分支预测

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ARM微处理器中断响应时间的实验研究

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计算机工程 2011年第4期37卷 252-254,263页

作者：尹旭峰苑士华胡纪滨北京理工大学机械与车辆学院北京100081

介绍ARM微处理器S3C2440A的中断处理机制,设计一种实验测定中断响应时间的方法,实测了理想状态下S3C2440A的快速中断FIQ和标准中断IRQ的响应时间,并对实验数据进行分析处理,给出实测数据的拟合函数,从而得出以下结论:FIQ与IRQ的中断响... 详细信息

介绍ARM微处理器S3C2440A的中断处理机制,设计一种实验测定中断响应时间的方法,实测了理想状态下S3C2440A的快速中断FIQ和标准中断IRQ的响应时间,并对实验数据进行分析处理,给出实测数据的拟合函数,从而得出以下结论:FIQ与IRQ的中断响应时间基本相等,中断响应时间与CPU的运行时钟无关,只与中断控制器的运行时钟频率呈反比关系,启用高速缓存时的中断响应时间不到禁用高速缓存时的1/3。

关键词：中断响应微处理器精简指令集计算机

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