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AND代表“并且”；OR代表“或者”；NOT代表“不包含”；(注意必须大写,运算符两边需空一格)

检索范例：

范例一：(K=图书馆学 OR K=情报学) AND A=范并思 AND Y=1982-2016
范例二：P=计算机应用与软件 AND (U=C++ OR U=Basic) NOT K=Visual AND Y=2011-2016

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文献类型

9 篇 专利

馆藏范围

9 篇 电子文献
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日期分布

机构

6 篇 无锡江南计算技术...
1 篇 天津国芯科技有限...
1 篇 中国科学院计算技...
1 篇 中国航天科技集团...
1 篇 华为技术有限公司

作者

5 篇 郑方
3 篇 许勇
3 篇 唐勇
3 篇 张清波
3 篇 高红光
2 篇 郑卫华
2 篇 胡苏太
2 篇 郝子宇
2 篇 李宏亮
2 篇 谢向辉
2 篇 王梦嘉
1 篇 张立博
1 篇 郑茳
1 篇 高剑刚
1 篇 李楠
1 篇 姜小成
1 篇 王雯
1 篇 吴龙胜
1 篇 陈庆宇
1 篇 刘月吉

语言

9 篇 中文

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共 9 条记录，以下是1-10 订阅

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详细简洁

排序：

多核处理器的数据管理方法及装置

多核处理器的数据管理方法及装置

引用

作者：李宏亮郑方谢向辉郝子宇胡苏太唐勇 214083 江苏省无锡市滨湖区军东新村030号

一种多核处理器的数据管理方法及装置，所述多核处理器包括处理器核心阵列和处理器核心互连结构，所述处理器核心阵列包括多个处理器核心，所述处理器核心包括具有多个存储单元的核内存储器，所述处理器核心互连结构用于所述处理器核心... 详细信息

标准号: CN102446159A

一种多核处理器的数据管理方法及装置，所述多核处理器包括处理器核心阵列和处理器核心互连结构，所述处理器核心阵列包括多个处理器核心，所述处理器核心包括具有多个存储单元的核内存储器，所述处理器核心互连结构用于所述处理器核心阵列中任意两处理器核心间的通信，所述方法包括：对所述处理器核心的核内存储器的存储单元分配存储地址；根据所述存储单元的存储地址在至少一个处理器核心的核内存储器和主存之间进行数据传输。本发明提高了数据的读写效率，利用批量化的访存方式，将多次数据访问合并，避免了零散访问主存的效率损失问题，并提供了多种编址方式和相应的数据传输方式，能够满足多种计算过程的应用需要。

关键词：处理器核心存储单元内存储器存储地址互连结构处理器多核数据传输方式数据管理方法访问主存计算过程数据传输数据访问效率损失编址读写主存量化合并通信

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Cache一致性协议派生处理方法

Cache一致性协议派生处理方法

引用

作者：郑卫华王梦嘉张清波许勇郑方高红光 214083 江苏省无锡市滨湖区军东新村030号

本发明提供了一种Cache一致性协议派生处理方法。针对每一个一次请求的一致性处理流程依次执行目录访问以及派生请求判断；在目录访问中，查询一次请求地址对应的数据在CPU内部是否有比主存更新的副本，如有，则一次请求访问最新副本；... 详细信息

标准号: CN102929800A

本发明提供了一种Cache一致性协议派生处理方法。针对每一个一次请求的一致性处理流程依次执行目录访问以及派生请求判断；在目录访问中，查询一次请求地址对应的数据在CPU内部是否有比主存更新的副本，如有，则一次请求访问最新副本；否则判定主存中数据是最新的，一次请求直接访问主存；而且，对于CPU内部有最新副本的情况，生成作为所述一次请求的派生请求的二次请求，所述二次请求或将最新副本回写主存，并且将该最新副本置为无效，或将CPU内最新副本置为无效；在派生请求判断中，判断一次请求是否有派生请求，如果一次请求有派生请求，则使该一次请求不能从一次请求队列释放。

关键词：副本主存目录访问二次一致性处理一致性协议访问主存队列内部

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多核处理器的数据管理方法及装置

多核处理器的数据管理方法及装置

引用

作者：李宏亮郑方谢向辉郝子宇胡苏太唐勇 214083 江苏省无锡市滨湖区军东新村030号

标准号: CN102446159B

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对称式多核处理器维护二级缓存一致性的装置及其方法

对称式多核处理器维护二级缓存一致性的装置及其方法

引用

作者：李楠王忠海肖佐楠郑茳 300457 天津市滨海新区经济技术开发区第四大街天大科技园软件大厦南楼三层309室

本发明提供对称式多核处理器维护二级缓存一致性的装置及其方法，由二级缓存监控单元，共享数据缓存状态机单元，干涉接口单元，监听接口单元和主设备接口单元五个部分组成，共享数据缓存状态机单元分别与二级缓存监控单元、监听接口单... 详细信息

标准号: CN102662885A

本发明提供对称式多核处理器维护二级缓存一致性的装置及其方法，由二级缓存监控单元，共享数据缓存状态机单元，干涉接口单元，监听接口单元和主设备接口单元五个部分组成，共享数据缓存状态机单元分别与二级缓存监控单元、监听接口单元和主设备接口单元相连，监听接口单元与干涉接口单元相连。本发明的有益效果是以硬件方式自动完成缓存一致性处理，软件干预很少，同时利用PLB6协议的干涉总线规范，在对共享数据进行读访问时，可以从其它处理器缓存该数据的二级缓存中读取数据，通过干涉接口将读数据返回，这样减小了访问主存的开销，提高了系统性能。

关键词：缓存监听接口干涉主设备接口共享数据缓存状态监控单元接口单元装置及其方法处理器缓存一致性处理访问主存硬件方式总线规范读数据对称式对共享处理器多核开销干预软件协议

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代码处理的方法及其装置

代码处理的方法及其装置

引用

作者：尤洪涛张立博王淼姜小成孙俊金星毛智辉 214083 江苏省无锡市滨湖区军东新村030号

本发明的实施例提供了一种代码处理方法，所述方法包括：将第一代码拆分成多块第二代码，每一块第二代码对应一个从处理器核，且每一块第二代码需要的数据存储空间比对应的从处理器核的局部存储空间小；根据所述第一代码中的运算逻辑关... 详细信息

标准号: CN102929581A

本发明的实施例提供了一种代码处理方法，所述方法包括：将第一代码拆分成多块第二代码，每一块第二代码对应一个从处理器核，且每一块第二代码需要的数据存储空间比对应的从处理器核的局部存储空间小；根据所述第一代码中的运算逻辑关系在每一块第二代码中插入通讯语句，用于在执行所述第二代码时从处理器核之间相互通讯；以及将每一块插入通讯语句的第二代码分别调度至对应的从处理器核上。所述方法不仅能有效和综合地利用多个从处理器核的局部存储空间，而且能减少从处理器核访问主存的时间开销。

关键词：处理器核存储空间通讯语句数据存储空间代码处理访问主存时间开销相互通讯运算逻辑调度

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Cache一致性协议派生处理方法

Cache一致性协议派生处理方法

引用

作者：郑卫华王梦嘉张清波许勇郑方高红光 214083 江苏省无锡市滨湖区军东新村030号

标准号: CN102929800B

关键词：副本主存目录访问二次一致性处理一致性协议访问主存队列内部

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高速存储区的访问方法以及访问装置

高速存储区的访问方法以及访问装置

引用

作者：高剑刚许勇唐勇李媛张清波郑方高红光 214083 江苏省无锡市滨湖区军东新村030号

一种高速存储区的访问方法及访问装置，其中所述访问方法包括：在处理器核心请求访问主存时，基于所述Cache数据在主存首地址、Cache行数据量、Cache行条目总数和Cache行有效位判断请求主存地址是否命中Cache；若所述请求主存地址命中Ca... 详细信息

标准号: CN103377141A

一种高速存储区的访问方法及访问装置，其中所述访问方法包括：在处理器核心请求访问主存时，基于所述Cache数据在主存首地址、Cache行数据量、Cache行条目总数和Cache行有效位判断请求主存地址是否命中Cache；若所述请求主存地址命中Cache，则基于所述Cache数据在局部存储器首地址确定与所述请求主存地址对应的局部存储器地址，并基于所述局部存储器地址加载Cache数据；若所述请求主存地址未命中Cache，则基于所述不命中入口跳转至不命中处理例程。本技术方案简化了高速存储区的逻辑设计开销，提高了处理器的易编程性和适应性。

关键词：主存地址局部存储器地址访问方法高速存储逻辑设计处理器核心局部存储器访问主存访问装置条目总数数据量处理器加载开销跳转主存编程

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一种面向SRAM的抗SEU错误累积的控制器及方法

一种面向SRAM的抗SEU错误累积的控制器及方法

引用

作者：陈庆宇艾刁王雯唐威吴龙胜 710054 陕西省西安市太乙路189号

本发明公开了一种面向SRAM的抗SEU错误累积的控制器及方法，包括：寄存器组、访存信息生成电路、访存状态转移控制电路、校验码解码模块、rdata寄存器、多路选择器、EDAC编码模块、pdata寄存器、wdata寄存器。当处理器进行访问主存之外... 详细信息

标准号: CN103700396A

本发明公开了一种面向SRAM的抗SEU错误累积的控制器及方法，包括：寄存器组、访存信息生成电路、访存状态转移控制电路、校验码解码模块、rdata寄存器、多路选择器、EDAC编码模块、pdata寄存器、wdata寄存器。当处理器进行访问主存之外的其它操作时，由处理器的存储器控制器自主的对所有的存储单元进行遍历式的读→校验→回写操作，遍历式刷新操作以最基本的SRAM存储单元为单位，每当完成一个存储单元的刷新操作，刷新地址递增，控制状态机回到空闲态，重新检测处理器是否存在访存操作。本发明充分利用系统的空闲时间，在不影响处理器性能的基础上，避免了SRAM存储单元的SEU错误累积。

关键词：存储单元寄存器处理器刷新遍历累积存储器控制器控制器及方法信息生成电路状态转移控制影响处理器编码模块访存操作访问主存寄存器组解码模块空闲时间校验校验码写操作选择器状态机多路空闲电路检测

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访存优化方法和装置

访存优化方法和装置

引用

作者：张立新刘月吉陈凯 518129 广东省深圳市龙岗区坂田华为总部办公楼

本发明实施例提供一种访存优化方法和装置。本发明访存优化方法，包括：确定处理器核的缓存访问是否未命中缓存块，在缓存访问未命中缓存块的情况下，在缓存中通过块存储指令为访问地址分配一个缓存块，并将块存储指令指示的地址标识字... 详细信息

标准号: CN104899158A

本发明实施例提供一种访存优化方法和装置。本发明访存优化方法，包括：确定处理器核的缓存访问是否未命中缓存块，在缓存访问未命中缓存块的情况下，在缓存中通过块存储指令为访问地址分配一个缓存块，并将块存储指令指示的地址标识字段的地址单元写入到分配的缓存块的地址标识字段，将块存储指令指示的数据写入到分配的缓存块的第一数据位置上，本发明实施例在CPU执行写指令且缓存未命中的时，减少了访问主存的次数，提高了程序执行效率。

关键词：缓存存储指令地址标识优化方法程序执行处理器核地址单元访问地址访问主存数据写入指令

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