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文字说明：

T=题名（书名、题名），A=作者（责任者），K=主题词，P=出版物名称，PU=出版社名称，O=机构（作者单位、学位授予单位、专利申请人），L=中图分类号，C=学科分类号，U=全部字段，Y=年（出版发行年、学位年度、标准发布年）

检索规则说明：

AND代表“并且”；OR代表“或者”；NOT代表“不包含”；(注意必须大写,运算符两边需空一格)

检索范例：

范例一：(K=图书馆学 OR K=情报学) AND A=范并思 AND Y=1982-2016
范例二：P=计算机应用与软件 AND (U=C++ OR U=Basic) NOT K=Visual AND Y=2011-2016

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限定检索结果

文献类型

111 篇 专利

馆藏范围

111 篇 电子文献
0 种 纸本馆藏

日期分布

机构

6 篇 北京兆易创新科技...
4 篇 长鑫存储技术有限...
3 篇 深圳市鼎阳科技股...
3 篇 中国科学院微电子...
3 篇 华为技术有限公司
3 篇 北京物芯科技有限...
2 篇 华南师范大学
2 篇 南京芯驰半导体科...
2 篇 烽火通信科技股份...
2 篇 深圳市同盛绿色科...
2 篇 东南大学
2 篇 山东华芯半导体有...
2 篇 桂林电子科技大学
2 篇 北京百度网讯科技...
2 篇 西安微电子技术研...
2 篇 上海集成电路研发...
2 篇 国民技术股份有限...
2 篇 上海奎芯集成电路...
2 篇 宁波大学
2 篇 清华大学

作者

6 篇 苏志强
4 篇 王永添
4 篇 周玉梅
4 篇 丁冲
3 篇 王瑞
3 篇 刘奇浩
2 篇 刘尚
2 篇 丁新宇
2 篇 陈晓龙
2 篇 林建辉
2 篇 刘大铕
2 篇 李维森
2 篇 王资川
2 篇 张坤
2 篇 陈立刚
2 篇 华璐
2 篇 高波
2 篇 许川佩
2 篇 王东琳
2 篇 胡佳俊

语言

111 篇 中文

检索条件"主题词=读使能信号"

共 111 条记录，以下是31-40 订阅

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详细简洁

排序：

一种OTN中实现GMP映射的方法及系统

一种OTN中实现GMP映射的方法及系统

引用

作者：黄正刘福 430000 湖北省武汉市东湖高新技术开发区高新四路6号

一种OTN中实现GMP映射的方法，涉及GMP(通用映射规程)映射领域，方法包括：通过FIFO缓存模块缓存客户侧的数据，通过承载侧时钟采样客户侧时钟，得到两个otn_fp信号之间的业务时钟采样个数N；根据业务时钟采样个数N和otn_fp信号计算GMP... 详细信息

标准号: CN114826476A

一种OTN中实现GMP映射的方法，涉及GMP(通用映射规程)映射领域，方法包括：通过FIFO缓存模块缓存客户侧的数据，通过承载侧时钟采样客户侧时钟，得到两个otn_fp信号之间的业务时钟采样个数N；根据业务时钟采样个数N和otn_fp信号计算GMP开销中的C_m和ΣC_nD值；根据C_m值产生承载侧读使能信号给FIFO缓存模块，从FIFO缓存模块读取数据，填充在OTN帧的净荷区域，加上OTN帧规定的开销，完成OTN成帧。本发明降低业务的传输时延，不需要占用OTN的保留开销，可以与别的厂家设备对通，并能满足CPRI业务指标的苛刻要求。

关键词：业务时钟采样映射承载缓存通用映射规程读使能信号厂家设备传输时延净荷区域苛刻要求时钟采样信号计算业务指标客户成帧填充占用保留

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基于FPGA的LTE-V收端CCH信道解速率匹配的系统及方法

基于FPGA的LTE-V收端CCH信道解速率匹配的系统及方法

引用

作者：葛骋翔曹姗姜之源江立旻彭飞张晨浩 200444 上海市宝山区上大路99号

一种基于FPGA的LTE‑V收端CCH信道解速率匹配的系统及方法，包括：状态机控制单元、输入控制单元、块随机存储器单元和输出控制单元，其中：状态机控制单元根据开始信号，分别向输入控制单元和输出控制单元传输数据计数的信息以控制数据... 详细信息

标准号: CN116707702A

一种基于FPGA的LTE‑V收端CCH信道解速率匹配的系统及方法，包括：状态机控制单元、输入控制单元、块随机存储器单元和输出控制单元，其中：状态机控制单元根据开始信号，分别向输入控制单元和输出控制单元传输数据计数的信息以控制数据的输入和输出；输入控制单元接收解扰数据并填充补满至432bit后输出至BRAM单元，输出控制单元通过产生读地址和读使能信号读取BRAM单元中的数据，从BRAM单元中读取数据的同时并进行比特重排后输出。本发明利用CCH信道解速率匹配每次比特变换规则相同的规律，避免了交织和解交织的计算并显著简化了系统结构。

关键词：输出控制单元输入控制单元状态机控制单元解速率匹配输出信道随机存储器单元读取读使能信号比特变换比特重排传输数据开始信号控制数据系统结构读地址解扰收端填充

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报错电路及芯片设备

报错电路及芯片设备

引用

作者：张坤何学文时鹏 215000 江苏省苏州市姑苏区锦堂街8号6F

本发明公开了一种报错电路及芯片设备，电路包括：错误接口逻辑单元，用于根据接收到的N个功能安全逻辑单元发送的N个错误信息，生成先进先出FIFO写使能信号、待写入数据和N个错误状态；FIFO存储逻辑单元，FIFO存储逻辑单元包括FIFO寄... 详细信息

标准号: CN116107795B

本发明公开了一种报错电路及芯片设备，电路包括：错误接口逻辑单元，用于根据接收到的N个功能安全逻辑单元发送的N个错误信息，生成先进先出FIFO写使能信号、待写入数据和N个错误状态；FIFO存储逻辑单元，FIFO存储逻辑单元包括FIFO寄存器，FIFO存储逻辑单元用于根据FIFO写使能信号将待写入数据存储至FIFO寄存器；错误计数逻辑单元，用于根据N个错误状态分别对各功能安全逻辑单元的错误信息进行计数，并在有计数值达到相应的中断预设值时，输出状态标志至控制逻辑单元以进行错误处理，以及从FIFO寄存器中读取FIFO读使能信号，以将计数值清零。由此，该电路，能够增加FIFO寄存器空间利用率，自主定义每个错误产生中断时的错误次数。

关键词：逻辑单元待写入数据写使能信号错误信息错误状态功能安全电路读取计数逻辑单元控制逻辑单元读使能信号空间利用率报错电路错误产生错误处理错误接口输出状态芯片设备中断清零预设存储发送

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RAM访问冲突的验证方法及验证装置

RAM访问冲突的验证方法及验证装置

引用

作者：李光宇 100086 北京市海淀区知春路1号1幢15层1514室

本申请公开RAM访问冲突的验证方法及验证装置。该验证方法，确认待测RAM的读延迟，所述读延迟包括所述RAM的读使能信号到读返回数据信号的N个时钟周期；选取待测RAM的测试地址；针对所述测试地址随机产生读操作或写操作；当所述写操作... 详细信息

标准号: CN115732025A

本申请公开RAM访问冲突的验证方法及验证装置。该验证方法，确认待测RAM的读延迟，所述读延迟包括所述RAM的读使能信号到读返回数据信号的N个时钟周期；选取待测RAM的测试地址；针对所述测试地址随机产生读操作或写操作；当所述写操作在所述读操作的读延迟上发生时，获得读返回数据与写操作的数据、读操作的地址与写操作的地址的对应关系；当所述对应关系包括指定情况时，确定所述待测RAM的访问冲突已验证。如此，实现了针对RAM访问冲突的通用方法，提供了标准且统一的访问冲突验证流程，能够快速准确地验证访问冲突。

关键词：访问冲突写操作验证读操作延迟测试地址返回数据信号读使能信号返回数据时钟周期随机产生验证装置通用申请统一

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一种控制电路及存储器

一种控制电路及存储器

引用

作者：马亚奇刘湖云刘扬帆 510660 广东省广州市黄埔区护林路1008号201室

本发明提供一种控制电路及存储器包括：使能模块生成对应的写使能信号、第一读使能信号及第二读使能信号；控制模块生成对应的第一控制信号及第二控制信号；在写使能信号生效时，对SRAM单元的写数据操作进行控制；在第一读使能信号生效... 详细信息

标准号: CN117095719B

本发明提供一种控制电路及存储器包括：使能模块生成对应的写使能信号、第一读使能信号及第二读使能信号；控制模块生成对应的第一控制信号及第二控制信号；在写使能信号生效时，对SRAM单元的写数据操作进行控制；在第一读使能信号生效时，对SRAM单元的读数据操作进行控制；在第二读使能信号生效时，对SRAM单元的读数据操作进行控制。通过设置使能模块及控制模块生成第一控制信号与第二控制信号，使静态随机存取存储器具备同时进行的双端口读写操作甚至多端口读写操作的能力，极大地提升了静态随机存取存储器的读写效率，降低了静态随机存取存储器的功耗，极大地提高了静态随机存取存储器进行读写数据的稳定性与可靠性。

关键词：静态随机存取存储器读使能信号第二控制信号第一控制信号读数据操作写使能信号读写操作控制模块使能写数据操作读写数据控制电路存储器多端口双端口读写功耗

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数据选通信号的门控信号生成电路及其信号生成方法

数据选通信号的门控信号生成电路及其信号生成方法

引用

作者：古城何亚军 230088 安徽省合肥市高新区中国(安徽)自由贸易试验区创新大道2800号创新产业园二期G3栋C座2层

本申请提供一种数据选通信号的门控信号生成电路及其信号生成方法，所述电路包括：初始门控信号生成单元、训练单元和目标门控信号生成单元；初始门控信号生成单元用于基于读指令和读使能信号生成初始门控信号；训练单元与初始门控信号... 详细信息

标准号: CN115547381B

本申请提供一种数据选通信号的门控信号生成电路及其信号生成方法，所述电路包括：初始门控信号生成单元、训练单元和目标门控信号生成单元；初始门控信号生成单元用于基于读指令和读使能信号生成初始门控信号；训练单元与初始门控信号生成单元连接，用于基于预设步长逐步延迟初始门控信号以得到更新的门控信号，并基于初始门控信号以及更新的门控信号对闪存设备返回的数据选通信号进行采样以确定数据选通信号的第一个上升沿以及对应的第一门控信号；目标门控信号生成单元与所述训练单元连接，用于基于闪存设备的预热模式关联信息以及第一门控信号生成目标门控信号，能避免主设备接收数据紊乱和功耗增大的问题。

关键词：门控信号生成单元数据选通信号训练单元闪存设备读使能信号功耗增大关联信息接收数据生成电路信号生成预热模式读指令上升沿主设备采样更新预设紊乱延迟电路返回申请

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QSPI控制器、芯片及数据读取方法

QSPI控制器、芯片及数据读取方法

引用

作者：周春良王连成宋亚超陆春光宋磊刘斌肖衍陈永利 100192 北京市海淀区西小口路66号中关村东升科技园A区3号楼

本发明公开了一种QSPI控制器、芯片及数据读取方法，延迟测量电路在指令发送阶段，测量芯片管脚处理电路的IO延迟值，基于IO延迟值确定目标延迟值，并将目标延迟值发送至延迟补偿电路。延迟补偿电路在将读使能信号延迟目标延迟值后，向... 详细信息

标准号: CN117407335A

本发明公开了一种QSPI控制器、芯片及数据读取方法，延迟测量电路在指令发送阶段，测量芯片管脚处理电路的IO延迟值，基于IO延迟值确定目标延迟值，并将目标延迟值发送至延迟补偿电路。延迟补偿电路在将读使能信号延迟目标延迟值后，向数据采集电路的输入端传输延迟后的读使能信号，将时钟发生器提供的时钟信号延迟时钟延迟值后，向数据采集电路的时钟端传输延迟后的时钟信号，该时钟延迟值是基于QSPI控制器当前的PVT条件所确定。由此可以根据测量的延迟值对闪存中的数据延迟采样，从而自适应地匹配PVT条件引起的延迟变化，达到在不同PVT条件均能够准确读取到数据的目的，保证了在高速XIP模式读数据的可靠性。

关键词：延迟目标延迟数据采集电路延迟补偿电路读使能信号传输延迟时钟延迟控制器测量读取时钟信号延迟延迟测量电路时钟发生器处理电路时钟信号数据读取数据延迟芯片管脚延迟变化指令发送读数据时钟端输入端自适应采样闪存匹配芯片发送保证

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一种用于芯片间传输的多数据通道的选择方法及系统

一种用于芯片间传输的多数据通道的选择方法及系统

引用

作者：韩银和杨军许浩博闵丰王颖王郁杰 100190 北京市海淀区中关村科学院南路6号

一种用于芯片间传输的多数据通道选择系统，包括：多个缓存队列，与多个数据输入通道、路由选择模块以及数据打包模块相连，用于缓存所述数据输入通道的输入数据，并基于路由选择模块的控制信号将数据发送给数据打包模块；多通道仲裁模... 详细信息

标准号: CN117973315A

一种用于芯片间传输的多数据通道选择系统，包括：多个缓存队列，与多个数据输入通道、路由选择模块以及数据打包模块相连，用于缓存所述数据输入通道的输入数据，并基于路由选择模块的控制信号将数据发送给数据打包模块；多通道仲裁模块，与所述多个数据输入通道以及路由选择模块相连，基于通道仲裁策略进行仲裁，并将仲裁结果发送给路由选择模块；路由选择模块，根据所述仲裁结果进行路由选择，并向被选中通道对应的缓存队列发送读使能信号，同时将所述通道的序号发送给数据打包单元；以及数据打包单元，与所述缓存队列相连，根据所述仲裁结果从对应通道的缓存队列读出数据并根据数据位宽打包为固定位宽的数据包。

关键词：路由选择模块缓存队列数据输入通道仲裁结果数据打包单元数据打包模块缓存读使能信号多数据通道多通道仲裁读出数据控制信号路由选择选择系统仲裁策略固定位数据包数据发选中芯片仲裁发送传输

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一种时间敏感网络中信用值流量调度系统及方法

一种时间敏感网络中信用值流量调度系统及方法

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作者：王天林林海教金伟江童庆刘国安 310053 浙江省杭州市六和路309号中控科技园

本发明涉及通信技术领域，提供了一种时间敏感网络中信用值流量调度系统，包括：CBS读取数据缓存单元，用于产生读使能信号控制读取CBS核心功能块中已经缓存的流量；信用值控制单元，用于定义CBS的参数值，并输出电平信号至队列选择传... 详细信息

标准号: CN115865810B

本发明涉及通信技术领域，提供了一种时间敏感网络中信用值流量调度系统，包括：CBS读取数据缓存单元，用于产生读使能信号控制读取CBS核心功能块中已经缓存的流量；信用值控制单元，用于定义CBS的参数值，并输出电平信号至队列选择传输单元用于判断队列传输的条件；信用值更新单元，用于控制队列中数据帧传输时队列信用值的变化；队列选择传输单元，用于判断各队列是否满足传输条件，并产生读使能信号反馈至CBS读取数据缓存单元读取缓存中的流量数据。突破目前流量整形算法CBS对音视频两个队列数量的限制，将其扩展至多个队列并应用于工业控制领域，同时采用FPGA主控芯片实现CBS的核心机制从而达到对业务的共网传输。

关键词：队列读取缓存信用读使能信号传输单元队列选择缓存单元工业控制领域通信技术领域核心功能块数据帧传输传输条件队列传输更新单元共网传输核心机制流量调度流量数据流量整形时间敏感输出电平芯片实现音视频算法反馈应用网络

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一种基于空闲时隙准实时刷新的星载接口系统

一种基于空闲时隙准实时刷新的星载接口系统

引用

作者：胡西阁宋宝相张伟赵俊艺王瑞王宇华璐 710100 陕西省西安市长安区西街150号

本发明公开了一种基于空闲时隙准实时刷新的星载接口系统，包括：写指针控制及数据输入模块、第一FIFO、第二FIFO、读指针控制及数据输出模块和空闲时隙刷新控制模块；写指针控制及数据输入模块，用于从第一FIFO开始，将第一FIFO和第二F... 详细信息

标准号: CN112241381B

本发明公开了一种基于空闲时隙准实时刷新的星载接口系统，包括：写指针控制及数据输入模块、第一FIFO、第二FIFO、读指针控制及数据输出模块和空闲时隙刷新控制模块；写指针控制及数据输入模块，用于从第一FIFO开始，将第一FIFO和第二FIFO的写使能信号交替设置为周期高电平；根据两个FIFO的写使能信号的有效性进行输入数据的写入；读指针控制及数据输出模块，用于从第一FIFO开始，将第一FIFO和第二FIFO的读使能信号交替设置为高电平；根据两个FIFO的读使能信号的有效性进行输出数据的读取；空闲时隙刷新控制模块，用于在第一FIFO和第二FIFO没有读写操作时进行复位。本发明可在保证数据流不中断的前提下，实现对缓存的准实时刷新，从而提高数据接收的可靠性和安全性，增强了数据接口对空间环境的适应性，提高了系统对异常情况的自主响应能力。

关键词：空闲时隙数据输出模块数据输入模块刷新控制模块读使能信号写使能信号交替设置读指针高电平写指针准实时读取缓存数据流读写操作接口系统空间环境输出数据数据接口数据接收响应能力复位星载写入中断保证

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