检索结果-内蒙古大学图书馆

微电子学 2020年第6期50卷 771-776页

作者：刘杨祁楠刘力源刘剑吴南健中国科学院半导体研究所半导体超晶格国家重点实验室北京100083 中国科学院大学材料科学与光电技术学院北京100049

采用40 nm CMOS工艺,设计了一个工作在40 Gbit/s数据速率的高速低噪声跨阻放大器(TIA)。为了同时兼顾噪声和带宽性能,创造性提出了一种多级串联跨阻放大器结构。输入级采用基于反相器结构的伪差分跨阻放大器,通过增加反馈电阻来减小输... 详细信息

采用40 nm CMOS工艺,设计了一个工作在40 Gbit/s数据速率的高速低噪声跨阻放大器(TIA)。为了同时兼顾噪声和带宽性能,创造性提出了一种多级串联跨阻放大器结构。输入级采用基于反相器结构的伪差分跨阻放大器,通过增加反馈电阻来减小输入电流噪声,第二级的前向运放用来抑制后级均衡器的噪声,第三级用连续时间线性均衡器(CTLE)对前级不足的带宽进行补偿,后面的三级限幅放大器(LA)对电压信号进一步放大。限幅放大器利用并联电感峰化技术和负跨导技术来提高带宽和增益。最终,信号由输出驱动器(OD)输出到片外,输出驱动器采用T-COIL技术。仿真结果表明,整条链路可以实现84 dBΩ和63 dBΩ的跨阻增益,带宽分别为31 GHz和34 GHz,输入电流积分噪声(rms)为1.75μA。

关键词：光接收机模拟前端低噪声跨阻放大器连续时间线性均衡器限幅放大器

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应用于光通信的激光驱动器和跨阻放大器设计

应用于光通信的激光驱动器和跨阻放大器设计

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作者： Ahmed Wahba Abdalla Elsayed 中国科学技术大学

学位级别：博士

在用于光通信链路的各种调制方案中,开关键控(OOK)由于其简单性和成本效益而被广泛应用于接入网和城域网。然而,数据流量的快速增长促进了其他具有更高频谱效率的调制方案的应用。其中,四电平脉冲幅度调制(PAM4)由于在相同带宽下传输比... 详细信息

在用于光通信链路的各种调制方案中,开关键控(OOK)由于其简单性和成本效益而被广泛应用于接入网和城域网。然而,数据流量的快速增长促进了其他具有更高频谱效率的调制方案的应用。其中,四电平脉冲幅度调制(PAM4)由于在相同带宽下传输比特率比OOK调制提高了一倍,现已被用于高数据速率标准。OOK和PAM4调制方案中最常用的数据编码格式是不归零码(NRZ)和归零码(RZ)。相比50%占空比的RZ编码,NRZ编码仅需一半的带宽便可传输相同的比特率。然而由于光纤色散的影响,会使传输的脉冲变宽并引起符号间干扰(ISI),因此不推荐在长距离传输中使用NRZ编码。与此相反,RZ编码在长距离应用中具有更好的性能,因为它具有较短的脉冲,因此可以减轻色散效应。本文主要研究激光二极管驱动器(LDD)电路和跨阻放大器(TIA)的设计和实现,该电路同时支持NRZ或RZ数据编码格式的OOK和PAM4调制方案。OOK/PAM4双模操作使得所设计的模块适用于不同标准的光通信系统。本文设计了四种不同的LDD集成电路,其中三个应用ROGERS RO4350B印刷电路板(PCB)制作了测试板并进行了板上测试,而第四种电路则是对版图作后仿真进行了评估。第一个LDD IC支持NRZ-OOK和NRZ-PAM4两种模式,数据速率分别高达15 Gbps和30 Gbps,并采用0.15 μm增强型PHEMT工艺实现。其中30 Gbps NRZ-PAM4 LDD通过组合两个分别作为高、低放大路径的15 Gbps NRZ-OOK LDD来实现,实现在驱动25Ω激光器时产生幅度为0、40、80和120 mA的PAM4输出电流信号。其中高、低两种放大路径作为15 Gbps NRZLDD时可以单独使用或同时使用。电路通过在输出级使用交叉耦合的中和电容提高了驱动器带宽。输出传输线的无源反向终端匹配使用片上50 Ω电阻实现,可吸收因负载不匹配引起的信号反射。测量结果显示,NRZ-OOK和NRZ-PAM4驱动电路的输出眼图清晰,速度分别高达15 Gbps和30 Gbps。在电压为-5.2V单电源供电、最大输出电流为120mA的情况下,驱动器功耗为1.228W。该驱动器具有很高的电流驱动能力和较好的功耗比,适用于驱动大电流分布式反馈(DFB)激光器,芯片的总面积为0.7×1.3mm2。第二个LDD IC同样采用0.15μm增强型PHEMT工艺,它分别以2.5 Gbps和5 Gbps的数据速率支持RZ-OOK和RZ-PAM4模式。设计的RZ-LDD提供一种将NRZ-RZ转换电路和大电流LDD相结合的单芯片解决方案来提高集成度。输出的RZ信号占空比为33%(132 ps),适用于长距离光通信系统。最大输出电流高达120 mA,使得该驱动器成为驱动大电流DFB激光器的理想选择。该激光器可以偏置在增益切换模式工作,以进一步改善传输距离。测量结果显示出清晰的输出电气眼图,上升/下降时间低于38 ps。NRZ-RZ转换器的电源电压为-1.9 V,LDD的电源电压为-5 V,总功耗为1.3 W。芯片总面积为1.2×2.7mm2。第三个LDD IC采用0.13μm SOI CMOS工艺设计并做了测试。与第二个LDD设计相似,该驱动器还支持2.5 Gbps RZ-OOK和5 Gbps RZ-PAM4工作模式。但是,其输出电流被提升到135 mA,并且通过使用压控延迟线实现在25-50%的范围内调整输出RZ信号的占空比。此外,驱动器利用有源反向端接(ABT)电路来吸收由于激光器端负载不匹配而产生的信号反射。在上升/下降时间低于50 ps的情况下测量到清晰的输出电气眼图。在135 mA的最大输出电流下,RZ-LDD消耗1.455 W。总芯片面积为1.8×2.6mm2。第四个LDD电路以10 Gbps NRZ-OOK方式工作,采用0.13μm SOI CMOS工艺设计。该驱动器利用交叉耦合的中和电容,并集成了可调负电容电路以扩展带宽。由于采用分段输出驱动方案,LDD可以在25Ω激光器上提供10-150 mA调制电流范围,并保证动态性能。驱动器支持直流耦合和交流耦合两种耦合方式驱动25Ω激光器,在最大输出电流下功耗分别为1.06 W和0.72 W。芯片面积0.84×0.9 mm2。最后,本文探讨了 40 nm CMOS工艺下高灵敏度高动态范围的25 Gbps NRZ-OOK/50 Gbps NRZ-PAM4跨阻放大器(TIA)的设计。电路采用高增益低带宽跨阻级和三个连续时间线性均衡器(CTLE)级联来修复带宽,从而优化了噪声和带宽。所提出的TIA采用两个独立的自动增益控制(AGC)环路来控制基于反相器的跨阻级和随后的四个可变增益放大器(VGA)的增益,以实现低噪声和高线性度。本文提出的TIA还采用了自动失调消除(AOC)环

关键词：大电流驱动器有源反向端接光发射机 NRZ-RZ转换器开关键控四电平脉冲幅度调制跨阻放大器自动增益控制可变增益放大器自动失调消除负电容连续时间线性均衡器

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一款基于码型检测SS-LMS算法的自适应均衡接收器

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复旦学报（自然科学版） 2019年第4期58卷 441-453页

作者：冯琪琛俞剑徐烈伟陈更生复旦大学专用集成电路与系统国家重点实验室上海201203 上海复旦微电子集团股份有限公司上海200433

本文提出了一种新型的基于码型检测SS-LMS算法的自适应均衡接收器,所采用的7抽头判决反馈均衡器(DFE)和连续时间线性均衡器(CTLE)组合设计,可以有效消除信道传输中码间干扰的短距离后标分量,以及长拖尾后标分量和前标分量;同时,改进设... 详细信息

本文提出了一种新型的基于码型检测SS-LMS算法的自适应均衡接收器,所采用的7抽头判决反馈均衡器(DFE)和连续时间线性均衡器(CTLE)组合设计,可以有效消除信道传输中码间干扰的短距离后标分量,以及长拖尾后标分量和前标分量;同时,改进设计的基于码型检测SS-LMS算法,使均衡器可以动态补偿多种信道损耗,具有更快速稳定的收敛特性.本文所设计实现的自适应均衡接收器,采用TSMC28nmCMOS工艺完成了芯片的设计和流片,流片的测试结果表明,在12.5Gb/s的传输速率下,接收器可以最大补偿-25dB的半波特率通道衰减,均衡器系数在接收2×105 UI数据内收敛,收敛后接收误码率(BER)可以低于10^-12.

关键词：符号最小均方根算法连续时间线性均衡器判决反馈均衡器接收器

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高速光通信接收机前端与时钟数据恢复电路研究与实现

高速光通信接收机前端与时钟数据恢复电路研究与实现

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作者：张震东南大学

学位级别：博士

自20世纪80年代光通信系统被广泛部署以来,人均全球电信容量和人均世界数据存储容量分别以每34个月和每40个月的速度翻倍。由于超大规模数据中心、云计算、物联网、5G通信等应用的推动,全球年度数据总量预计将在2025年达到175 ZB;另一方... 详细信息

自20世纪80年代光通信系统被广泛部署以来,人均全球电信容量和人均世界数据存储容量分别以每34个月和每40个月的速度翻倍。由于超大规模数据中心、云计算、物联网、5G通信等应用的推动,全球年度数据总量预计将在2025年达到175 ZB;另一方面,数据中心内部流量仍占全球数据中心IP流量的绝大部分。因此,多种格式、海量、频繁更新的数据对数据中心机架间和机架内光互连接口设计（覆盖超过100米的传输距离）提出更高要求,其中传输容量即将超过当前的100-Gb/s标准。论文研究了高速光互连接口,特别是光接收机前端（包括线性均衡器）以及时钟和数据恢复电路的设计难点和指标权衡。在此基础上提出若干新技术和电路结构,并设计了三款芯片进行流片验证。论文从理论上分析了SiGe HBT的fT、fMAX和MIN对偏置电流密度的依赖关系,并进行仿真验证,从而提出了一种综合优化晶体管偏置电流的方法。此外,还研究了电感、传输线和电容等高速互连结构的损耗机制和集总参数模型,提出了精确提取互连结构寄生参数的方法。论文研究了高速、高增益和低噪声光接收机前端设计的技术难点,比较了现有拓扑结构的优缺点,重点推导了共基-并联反馈跨阻放大器的输入参考噪声电流功率谱密度的完整解析表达式,并提出了一种噪声优化方法。此外,提出了一种新型可变增益放大器,并辅以自动增益控制环路,自适应地提升了后置放大级的线性度。在此基础上,设计了一款基于0.13-m SiGe工艺的56-Gb/s高增益、低噪声接收机前端芯片,芯片已成功流片并通过测试验证,其中裸片面积0.9×0.6 mm2。实测结果显示平均输入参考噪声电流密度为14.54 pA/（?）,带宽为31 GHz,最大跨阻增益为71 dBΩ。结果表明,该芯片不仅减轻了带宽和稳定性对输入电容的依赖性,从而同时满足宽带宽和高跨阻增益的要求,而且实现了低噪声设计。论文研究了连续时间线性均衡器的频率特性和自适应均衡方法,综合了基于高/低通滤波的频谱平衡自适应技术以及功率检测与误差比较技术,提出一种新型自适应电路结构,简化了自适应环路,并节省了芯片版图面积和功耗。研究了利用带隙基准和低压差稳压器组成的片上电源管理电路进行电源噪声抑制技术。在此基础上,设计了一款基于0.13-m SiGe工艺的高电源抑制10-Gb/s连续时间线性自适应均衡器芯片。后仿真结果表明,在4-MHz带宽内,片上电源管理电路使得电源噪声抑制有超过30 dB的显著提升。芯片已成功流片并通过封装测试,其中裸片面积0.9×0.85 mm2,采用12-引脚QFP封装。实测结果显示均衡后的眼宽为0.6 UI,并且误码率小于10-3时,光灵敏度达到-30 dBm。论文研究了二阶与三阶Bang-bang环路滤波器参数对稳定因子及抖动容限的影响,并以此为依据综合优化环路参数。讨论了发射极耦合与电流模逻辑单元的设计方法。研究了版图设计中高速信号路径的延时控制与高速信号反射降低技术。与传统螺旋电感相比,在VCO中使用RF传输线构造谐振腔可以减小VCO以及整个芯片的版图面积,且不会牺牲性能。在此基础上,针对100-Gb/s光互连接口应用,研究了三阶II型Bang-bang锁相环结构,实现了基于0.13-m SiGe工艺的超低抖动25-Gb/s全速率时钟与数据恢复芯片,其中核心电路版图面积为0.48 mm2。芯片实测恢复出时钟RMS抖动为750 fs,峰峰值抖动仅为3.46 ps。

关键词：跨阻放大器可变增益放大器低噪声连续时间线性均衡器自适应均衡电源噪声抑制 Bang-bang锁相环低抖动时钟与数据恢复

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一种面向112 Gb/s PAM4接收机的自适应均衡设计方案

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电讯技术 2024年第6期64卷 960-966页

作者：刘雪娜李振松闻豪缪旻北京信息科技大学信息与通信系统信息产业部重点实验室北京100101 北京信息科技大学光电测试技术及仪器教育部重点实验室北京100101

提出了一种适用于超短距离(Very Short Reach,VSR)信道、面向112 Gb/s PAM4(Pulse Amplitude Modulation 4)接收机的自适应均衡设计方案。在该方案中,接收机前端利用3个连续时间线性均衡器(Continuous Time Linear Equalizer,CTLE)对信号分别在高频、中频和低频进行补偿,可变增益放大器(Variable Gain Amplifier,VGA)和饱和放大器(Saturation Amplifier,SatAmp)则用于对信号幅值的缩放。除了3个数据采样器外,引入4个辅助采样器用于进一步改善阈值自适应算法性能。同时,采用符号最小均方算法,利用接收端数据采样器和辅助采样器之间的偏移推动辅助参考电压收敛到信号星座电平,从而确保PAM4接收信号的眼图在垂直方向上3个眼睛具有相等的间隔和恒定的信噪比(Signal-to-Noise Ratio,SNR)。仿真结果表明,所提出的112 Gb/s PAM4接收机能够在损耗为15 dB的信道上实现小于10~(-12)的误码率,并且具有良好的眼图性能,其最差眼高为75 mV,眼宽为0.34 UI(Unit Interval),与传统方案相比具有显著的性能提升。

关键词： PAM4接收机判决反馈均衡器超短距离信道连续时间线性均衡器自适应算法

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基于TAS-TIS结构和前馈路径的两级CTLE的设计

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半导体光电 2023年第5期44卷 736-740页

作者：张春茗徐阳臻张璇西安邮电大学电子工程学院西安710061

在高速接口电路中,接收机通常采用连续时间线性均衡器(Continuous-Time Linear Equalizer,CTLE)消除符号间干扰(Inter-Symbol Interference,ISI)对信号传输的影响。为提高CTLE电路的高频增益和减少芯片面积,基于UMC(United Microelectronics Corporation)28 nm工艺,设计了一款最大速率为50 Gbps的CTLE电路,其主体电路由跨导级联跨阻抗(Trans-Admittance Trans-impedance,TAS-TIS)结构和前馈路径的两级CTLE电路构成。在传统CTLE的基础上,使用有源电感做负载,以反相器为基础构建跨阻放大器和在输入管增加前馈通路等方式,有效地扩展了电路的工作频率。仿真结果显示,均衡后40 Gbps PAM4(4-Level Pulse Amplitude Modulation)信号、50 Gbps PAM4信号和28 Gbps NRZ(Non Return Zero Code)信号的眼图眼宽分别达到了0.68,0.5,0.92个码元间隔(UI),可满足后级电路对于输入信号的要求,对提升整体传输数据速率具有重要的意义。

关键词：连续时间线性均衡器跨导级联跨阻抗跨阻放大器前馈通路

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采用负电容结构的新型CTLE均衡器设计

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电光与控制 2022年第4期29卷 68-71,94页

作者：陆德超郑旭强吕方旭王和明陈江吴苗苗刘涛空军工程大学防空反导学院西安710000 中国科学院微电子研究所北京100000

随着数据传输的速率不断提高,信道对数据的损耗愈发严重,采用传统的连续时间线性均衡器(CTLE)对信号的均衡补偿已无法抵消信道对信号的严重衰减。为了更好地补偿衰减,对传统的CTLE均衡器做了进一步的改进,提出了基于负电容的新型CTLE。... 详细信息

随着数据传输的速率不断提高,信道对数据的损耗愈发严重,采用传统的连续时间线性均衡器(CTLE)对信号的均衡补偿已无法抵消信道对信号的严重衰减。为了更好地补偿衰减,对传统的CTLE均衡器做了进一步的改进,提出了基于负电容的新型CTLE。在传统的CTLE基础上,使用两个交叉耦合的MOS管构成负电容,将其叠加在传统一级CTLE的输出端,形成二级结构,可以增加高频增益和实现更大的带宽,以便更好地补偿信道的衰减。仿真结果显示,在25 Gibit/s的数据传输速率下,负电容结构的均衡器具有良好的补偿能力,经过均衡后,眼图的水平张开度达到了0.9个码元间隔(UI)以上,采用负电容结构的新型CTLE,对于提升整体传输数据速率具有重要意义。

关键词：连续时间线性均衡器负电容信道零极点眼图

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基于高速信号传输系统的新型CTLE均衡器

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电光与控制 2020年第10期27卷 109-112页

作者：阎芳张美琴王鹏刘金枝中国民航大学天津市民用航空器适航与维修重点实验室天津300300 中国民航大学民航航空器适航审定技术重点实验室天津300300 中国民航大学适航学院天津300300

随着航空电子系统模块化、集成化的程度越来越高,采用ARINC818协议使新一代航空电子系统能够高速、实时地传输大容量数字视频信息,其对传输的信号质量要求更高。基于ARINC818协议的高速信号传输系统,设计了新型连续时间线性均衡器(CTLE... 详细信息

随着航空电子系统模块化、集成化的程度越来越高,采用ARINC818协议使新一代航空电子系统能够高速、实时地传输大容量数字视频信息,其对传输的信号质量要求更高。基于ARINC818协议的高速信号传输系统,设计了新型连续时间线性均衡器(CTLE)。在传统CTLE的基础上,将折叠式共源共栅型拓扑结构叠加在传统一级CTLE的输出端,形成二级结构,可以增加高频增益,达到信道补偿的目的。仿真结果显示在2.125 Gibit/s的速率下,二级均衡器结构有良好的补偿能力,均衡后的眼图水平张开度达到0.87UI。

关键词：航空电子系统 ARINC818 CMOS 连续时间线性均衡器折叠式共源共栅

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高速发射机均衡器和驱动器的研究及设计

高速发射机均衡器和驱动器的研究及设计

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作者：付家翰中国科学技术大学

学位级别：硕士

随着全球Internet的飞速发展,数据速率呈现爆炸式增长。对于高速收发系统,其发射端需要补偿信道的损耗。一般在发射端采用前馈均衡器(Feed Forward Equalization,FFE)补偿信道的损耗。目前使用的FFE电路一般针对特定的信道均衡,不同的... 详细信息

随着全球Internet的飞速发展,数据速率呈现爆炸式增长。对于高速收发系统,其发射端需要补偿信道的损耗。一般在发射端采用前馈均衡器(Feed Forward Equalization,FFE)补偿信道的损耗。目前使用的FFE电路一般针对特定的信道均衡,不同的信道还需要不同的FFE电路进行补偿,这在一定程度上增加了产品的成本。基于此本文提出了一种延迟可变的分数型FFE电路,其补偿对象不局限于特定的信道,降低了高速I/O串口的成本。此外高速电路需要大功率驱动器来驱动信道。目前的高速发射机一般采用差分结构,在输出端连接差分对的信道。如果其输出端只连接一个信道,这将极大的降低成本。基于此本文设计了一种差分转单端(Differential to Single,D2S)发射机。本文首先提出了一种延迟可变的分数型FFE电路,其包括延迟电路、抽头系数调节电路以及数字寄存器电路。延迟电路是由反相器与可调交叉耦合锁存器所构成,其能实现1/4UI～3/4UI的时间延迟。此外由于锁存器的再生特性,对比其他结构,该结构的抖动非常低,其保证了针对不同的信道损耗做出合理的调整以达到最优补偿;抽头系数调节电路是预、主以及后抽头所构成,同时预和后抽头的输入电流分成5bit位。占主抽头电流的5%、10%、20%、40%一直到80%,形成32种情况。根据不同的信道损耗选择合适的比例。此外本文提出了一种D2S发射机电路,其包括输入缓冲器、均衡器以及输出D2S驱动器。输入缓冲器包括片上DC偏置、50欧姆阻抗匹配以及共基级放大器;均衡器采用连续时间线性均衡器(Continuous Time Linear Equalization,CTLE)结构;高速驱动器采用差分转单端的方式,将来自CTLE的差分信号转换为单端信号输出,同时该驱动器采用了负电容的技术,在中高频段引入一个零点,使得系统带宽得到了极大的提高。该结构连接单通道信道,使得传输数据密度增加一倍,极大的降低生产成本。分数型FFE电路基于40nm CMOS工艺设计,完成了原理图设计、版图设计以及后仿真,核心电路的版图面积为150um*250um。仿真结果表明,分数型FFE可以实现对信道的损耗补偿,在56Gb/s速率下得到张开度很好的眼图。另一款D2S发射机电路基于130nm BiCMOS工艺设计,完成了原理图设计、版图设计以及后仿真,核心电路的版图面积为150um*300um。该电路在112Gb/s的速率下得到张开度很好的眼图,同时发射机在典型工作状态下的能量效率为0.66pJ/bit。

关键词：前馈均衡器差分转单端电路连续时间线性均衡器驱动器

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2.5Gbps串行接口接收机前端设计

2.5Gbps串行接口接收机前端设计

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作者：安鹏北京理工大学

学位级别：硕士

近十几年来，随着有线通信的迅猛发展，数据的传输速率几乎在成指数的增长，尤其是数字计算和信号处理技术的日渐成熟，高速通信能够实现的数据传输速率已经成为限制系统整体性能的一个关键的瓶颈，为了满足日益增长的高速数据传输需求... 详细信息

近十几年来，随着有线通信的迅猛发展，数据的传输速率几乎在成指数的增长，尤其是数字计算和信号处理技术的日渐成熟，高速通信能够实现的数据传输速率已经成为限制系统整体性能的一个关键的瓶颈，为了满足日益增长的高速数据传输需求，串行接口（Serdes）技术正在逐步取代传统并行总线，成为高速接口技术的主流。Serdes是一种将速率较低的并行信号转化为高速率串行信号进行传输的多路复用技术，作为一种点对点的通信手段Serdes技术可以有效的减少传输信道以及芯片管脚的数量，大大降低通信成本。接收机是Serdes系统的重要组成部分之一，其主要功能是将接收到的数据采样重建，并完成串并转换，接收端抖动容忍能力、信号完整性以及采样的精确性都是制约SerDes性能的关键因素。因此如何实现高性能接收机具有十分重要的研究意义。文章首先介绍了Serdes相关的背景知识，包括发展概况、Serdes架构类型以及相关性能指标；然后对Serdes接收机的工作原理进行了详细的介绍，其中包括接收机时钟恢复的工作过程、信道补偿原理以及数据信号的采样与重建过程，并运用关键路径法对接收机前端的时序延时进行分析设计，从理论上保证系统的稳定性；最后采用SMIC180nm CMOS工艺，完成了Serdes接收机前端的电路图以及版图的设计与仿真。本设计可实现2.5Gbps的数据传输速率，电源电压1.8V，功耗为171mW。

关键词：串行接口接收机前端连续时间线性均衡器采样器

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