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AND代表“并且”；OR代表“或者”；NOT代表“不包含”；(注意必须大写,运算符两边需空一格)

检索范例：

范例一：(K=图书馆学 OR K=情报学) AND A=范并思 AND Y=1982-2016
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文献类型

2 篇 学位论文

馆藏范围

2 篇 电子文献
0 种 纸本馆藏

日期分布

学科分类号

2 篇 工学
- 1 篇 电子科学与技术（可...
- 1 篇 信息与通信工程

主题

2 篇 aisc设计
1 篇 覆盖率
1 篇 64b/66b链路层
1 篇 apb总线
1 篇 jesd204c标准协议
1 篇 64b/80b链路层
1 篇 modbus通讯协议
1 篇 通用验证方法学

机构

1 篇 东南大学
1 篇 辽宁科技大学

作者

1 篇 何浚豪
1 篇 常子厚

语言

2 篇 中文

检索条件"主题词=AISC设计"

共 2 条记录，以下是1-10 订阅

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详细简洁

排序：

基于JESD204C协议的接收端关键电路设计

基于JESD204C协议的接收端关键电路设计

引用

作者：何浚豪东南大学

学位级别：硕士

随着现代数字化技术的不断发展,各个领域对数据高速率传输提出越来越高的要求,高速数模转换器(ADC)和模数转换器(DAC)技术作为数字信号和模拟信号的沟通媒介始终再进步,转换器的分辨率、采样速率和带宽等不断提高。随着单位时间内数据... 详细信息

随着现代数字化技术的不断发展,各个领域对数据高速率传输提出越来越高的要求,高速数模转换器(ADC)和模数转换器(DAC)技术作为数字信号和模拟信号的沟通媒介始终再进步,转换器的分辨率、采样速率和带宽等不断提高。随着单位时间内数据的吞吐量的增加,高速转换器已经不能适配传统的低速率通信接口。为了满足日渐提高的数据传输需求,JEDEC协会提出了一种高速串行接口标准JESD204,由于该协议低功耗,引脚少灵活度高的特点,近年来逐渐普及在各个领域中。经过多年的发展,最新版本JESD204C具有更高的串行传输速率,并且更加灵活,提供多通道传输、可重复和确定性延迟等功能特点。本文研究JESD204C接收端电路的ASIC实现,设计了接收端4通道64B/66B和64B/80B链路层电路,单通道速率最高可达高24.75Gbps。该设计中,接收端链路层主要包括变速箱,头锁定模块,块同步模块,解扰模块,CRC12编码模块,多通道同步模块等模块。其中,变速箱模块实现了64B/66B和64B/80B位宽转换,头锁定模块实现了数据块同步头的锁定及移位、以及块同步模块实现了数据块的寻找锁定,解扰模块和CRC12编码模块实现链路对数据流的复原与检错,同步模块消除了不同通道间的延时。本文基于0.18μm CMOS工艺,采用Verilog HDL进行了RTL设计,采用VCS进行仿真,结果显示设计能够实现JESD204C接收端链路层电路的功能。在此基础上,本文完成了逻辑综合、布局布线、时钟树综合以及静态时序分析等ASIC后端设计工作,最终生成版图,并对布局布线后的电路进行静态时序分析,给出了芯片的测试方案。仿真结果表明电路在375MHz时钟下能正常工作,单通道速率达到24.75Gbps。本文的研究对于JESD204C协议的实现具有一定的应用价值。

关键词： JESD204C标准协议 64B/66B链路层 64B/80B链路层 aisc设计

来源：评论

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APB-ModBus模块设计与自动化验证

APB-ModBus模块设计与自动化验证

引用

作者：常子厚辽宁科技大学

学位级别：硕士

计算机技术的飞速发展使得工业由电气化与自动化时代进入了电子信息化时代以及将来的工业4.0时代,工厂大量采用由嵌入式系统等自动化信息技术装备,以提高生产效率和产品质量。这些装备之间有着大量的信息传输,其中Modbus通信协议广泛被... 详细信息

计算机技术的飞速发展使得工业由电气化与自动化时代进入了电子信息化时代以及将来的工业4.0时代,工厂大量采用由嵌入式系统等自动化信息技术装备,以提高生产效率和产品质量。这些装备之间有着大量的信息传输,其中Modbus通信协议广泛被采用。目前工业上使用Modbus协议的设备与SOC之间的通信主要通过软件编程实现Modbus,需要使用处理器内部定时器等资源来满足通信的时序要求。这一方案占用处理器资源较多,且设计较为繁琐,增加了开发难度。本课题设计了APB-Modbus的IP模块,并搭建了UVM验证平台对设计进行了验证。主要工作如下:(1)对课题背景进行了概述,对Modbus总线和验证语言发展进行了简要论述;对Modbus协议的传输方式、报文帧结构和主、从机通信模式进行了研究;对APB总线的状态转移与读写时序进行了分析;并介绍了通用验证方法UVM方法学的核心思想与平台结构。(2)采用Verilog HDL语言实现Modbus协议编解码部分和与APB总线通信部分用RTL级硬件电路实现,IP模块的一端通过APB总线与So C处理器进行通信,一端与现场设备直接相连。论文中详细介绍了该IP模块设计思路,包括APB数据处理与配置模块、CRC校验模块、波特率发生模块、Modbus数据帧处理模块、串行数据发送模块和串行数据接收六个子模块的功能实现方法;文中说明了接口电路时许、控制信号传递方法,给出了模块间数据传递的时序同步方案、APB总线与Modbus总线数据收发流程、数据错误时错误信号的与中断信号的产生方案等。(3)根据验证要求搭建基于UVM的验证平台,阐述了验证平台的实现细节,包括APB验证组件、Modbus验证组件的设计;scordboard中结果自动化对比的实现流程;env组件的封装方法。(4)提取出IP模块功能点,编写测试用例对所用功能点进行大量的随机化测试,收集覆盖率。验证结果表明,设计的IP模块所有的功能点均被测试,整体覆盖率达到了96.18%,符合预期要求。设计的IP模块提供了SOC处理器与现场设备间Modbus通信的另外一种解决方案,该方案占用微处理器资源少,有较高的可靠性。

关键词： aisc设计通用验证方法学 APB总线 Modbus通讯协议覆盖率

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