检索结果-内蒙古大学图书馆

基于FPGA和MSP430的SPI接口设计与实现

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仪器仪表用户 2007年第5期14卷 100-102页

作者：麦胤柳沁重庆邮电大学光电工程学院重庆邮电大学自动化学院重庆400065

本文介绍了用FPGA实现串行外设接口(SPI)的原理与过程,并在Altera公司的Stratix系列的FPGA和MSP430的基础上搭建了通信测试平台,实现了MCU与基于FPGA的SPI接口进行通信,实验结果良好。

关键词： SPI接口 FPGA MSP430 verilog硬件描述语言

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基于FPGA的液晶显示测频器设计

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微处理机 2008年第6期29卷 28-30页

作者：苏彬徐宏祥耿爽蔡阳中国电子科技集团公司第四十七研究所沈阳110032 辽宁武警总队沈阳110034

针对测频器的特点,利用EDA工具设计了一个基于FPGA的分频、采集与处理的微系统,实现了测频器的自动换档和液晶显示功能,并给出了软件设计流程及使用说明。利用自动化设计工具可以大大方便电路的调试,缩短开发时间,具有一定的实用价值。

关键词：现场可编程门阵列电子设计自动化 verilog硬件描述语言下载

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16*16位Wallace乘法器测试激励文件设计

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科技传播 2014年第11期6卷 210-211页

作者：刘贝尔黑龙江大学电子工程学院黑龙江哈尔滨161000

课题首先要深入分析和掌握Wallace加法树的基本原理,Wallace树是对部分积规约,减小乘法器关键路径时延的一种算法。设计的思想是为了加快乘法器的运行速度并减少芯片面积开销,采用阵列累加原理实现乘法运算。本课题设计采用加法器阵列... 详细信息

课题首先要深入分析和掌握Wallace加法树的基本原理,Wallace树是对部分积规约,减小乘法器关键路径时延的一种算法。设计的思想是为了加快乘法器的运行速度并减少芯片面积开销,采用阵列累加原理实现乘法运算。本课题设计采用加法器阵列结构来完成部分积相加的,相加的研究和应用方法有多种,本课题基于Wallace加法树结构,并在Wallace加法树算法的基础上进行基于Wallace加法树的16位乘法器的verilog设计与实现。功能验证通过后,采用Synopsys公司EDA综合工具Design Compiler进行设计综合。在此过程中,首先要对工具应用进行综合脚本文件的编写。然后采用脚本文件对RTL代码进行设计综合,得到门级网表与电路实现。

关键词：乘法器 Wallace加法树 verilog硬件描述语言

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基于PCF8563的数字钟FPGA设计与实现

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计算机测量与控制 2020年第6期28卷 231-235页

作者：付永乐王崇中国电子科技集团公司第二十七研究所郑州450047

针对基于时钟芯片的数字钟系统进行了研究,采用FPGA作为主控芯片通过I2 C总线实现对实时时钟芯片PCF8563的读写控制,实现了时钟/日历切换显示,对时钟/日历手动调校;在调校状态下,实现了数据移位时数码管闪烁指示功能;给出了系统设计以及... 详细信息

针对基于时钟芯片的数字钟系统进行了研究,采用FPGA作为主控芯片通过I2 C总线实现对实时时钟芯片PCF8563的读写控制,实现了时钟/日历切换显示,对时钟/日历手动调校;在调校状态下,实现了数据移位时数码管闪烁指示功能;给出了系统设计以及FPGA各模块详细设计,通过SignalTap逻辑分析仪,验证了系统功能实现的技术可行性,并在开发板上完成调试,对FPGA开发人员有一定的借鉴意义。

关键词：数字钟 PCF8563 FPGA I2C总线 verilog硬件描述语言

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寄存器堆设计方法研究

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科技信息 2010年第33期 I0033-I0033,I0068页

作者：方卓红青岛科技大学信息科学技术学院山东青岛266061

本文利用verilog硬件描述语言设计了一个寄存器堆,并对其进行了仿真测试。该寄存器堆包含32个32位的寄存器,具有2个读端口和1个写端口,仿真结果表明该寄存器堆的功能是正确的。

关键词：集成电路设计寄存器堆 verilog硬件描述语言仿真

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基于PetriNets的ASIP流水线研究

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武汉纺织大学学报 2013年第3期26卷 61-63页

作者：赵谦朱勇武汉纺织大学数学与计算机学院湖北武汉430073

探讨了将CPU中流水线用PetriNets模型进行描述设计的一种方法,为了分析验证PetriNets流水线模型描述的正确与否,搭建了一个用verilog语言实现的模型CPU运行环境,该CPU的CU单元用PetriNets描述,对其做了仿真验证,对这项研究的可行性进行... 详细信息

探讨了将CPU中流水线用PetriNets模型进行描述设计的一种方法,为了分析验证PetriNets流水线模型描述的正确与否,搭建了一个用verilog语言实现的模型CPU运行环境,该CPU的CU单元用PetriNets描述,对其做了仿真验证,对这项研究的可行性进行了验证,为以后进一步研究提出了一个可行的指导思想。

关键词： Petri网专用指令集处理器 verilog硬件描述语言可编程门阵列

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基于verilogHDL的小波滤波器的设计与实现

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现代电子技术 2009年第3期32卷 119-121,126页

作者：高冲何云斌哈尔滨理工大学计算机学院黑龙江哈尔滨150080

verilogHDL是EDA领域中电路设计必不可少的工具,利用它设计数字滤波器的最大优点就是可使设计更加灵活,它具有良好的结构化设计和行为建模能力。首先利用verilogHDL对小波滤波器复杂算法电路建立结构化模型,然后根据改进的分布式算法(... 详细信息

verilogHDL是EDA领域中电路设计必不可少的工具,利用它设计数字滤波器的最大优点就是可使设计更加灵活,它具有良好的结构化设计和行为建模能力。首先利用verilogHDL对小波滤波器复杂算法电路建立结构化模型,然后根据改进的分布式算法(是一项重要的FPGA技术)和滤波电路结构图对小波滤波器进行行为建模。最后,利用QuartusⅡ内部的波形仿真软件进行波形仿真和验证,并根据仿真结果对模型进行修改以达到设计要求。

关键词： verilog硬件描述语言改进的分布式算法小波滤波器

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基于FPGA的UART IP核的设计实现

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通信技术 2009年第5期42卷 177-179,182页

作者：赵海登刘晓文胡景军汤晓蕾中国矿业大学信息与电气工程学院江苏徐州221008 中国石化浙江金嘉湖油品储运分公司浙江嘉兴314033

随着IC设计技术的发展,IP已经成为SOC设计的关键技术,利用已有IP可大大提高SOPC设计的效率和能力。UART是广泛使用的串行数据通信电路,一般说来,该接口由硬件(UART专用芯片)实现。采用verilogHDL语言,结合有限状态机的设计方法来实现UAR... 详细信息

随着IC设计技术的发展,IP已经成为SOC设计的关键技术,利用已有IP可大大提高SOPC设计的效率和能力。UART是广泛使用的串行数据通信电路,一般说来,该接口由硬件(UART专用芯片)实现。采用verilogHDL语言,结合有限状态机的设计方法来实现UART的IP核,将其核心功能集成到FPGA上,使整体设计紧凑、小巧,实现的UART功能稳定、可靠。

关键词：现场可编程门阵列 UART IP verilog硬件描述语言

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用verilog HDL开发生物芯片的探讨

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江南大学学报（自然科学版） 2003年第6期2卷 585-588,592页

作者：张基温黄可望江南大学信息工程学院江苏无锡214036

为了降低生物芯片的制作成本,使其能批量生产,可采用一种优秀的硬件描述语言Ver ilogHDL进行开发用verilogHDL开发生物芯片,根据自身的设计思路形式化抽象表示电路的结构和行为能提高电路设计效率、缩短芯片制作周期、降低芯片的制作成... 详细信息

为了降低生物芯片的制作成本,使其能批量生产,可采用一种优秀的硬件描述语言Ver ilogHDL进行开发用verilogHDL开发生物芯片,根据自身的设计思路形式化抽象表示电路的结构和行为能提高电路设计效率、缩短芯片制作周期、降低芯片的制作成本,并为大规模批量生产提供有利的条件。

关键词：生物芯片硬件描述语言 verilog硬件描述语言数字电路

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USB2.0设备控制器IP软核的设计与实现

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舰船电子工程 2008年第3期28卷 151-153,183页

作者：凌怀奇陈勇电子科技大学微电子与固体电子学院成都610054

介绍一款USB2.0设备控制器IP软核的设计与实现。论文首先介绍USB2.0设备控制器结构原理,然后对各模块设计进行说明,最后采用硬件描述语言verilogHDL实现了各模块的编码及功能仿真。

关键词： USB2.0设备控制器 IP软核 verilog硬件描述语言

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