检索结果-内蒙古大学图书馆

verilog到Java翻译器VtoJ的设计与实现

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计算机与数字工程 2005年第7期33卷 100-103页

作者：董鑫宋国新华东理工大学计算机科学与工程系上海200237

提出了一种将硬件描述语言verilog转换到Java代码的设计方法,给出一组从verilog到Java的转换规则。通过设计一个VtoJ翻译器完成自动转换功能,实现软硬件系统的协同仿真。

关键词： verilog硬件描述语言 Java 翻译器

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VoIP语音网关中TDM控制模块的设计

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今日电子 2007年第5期 85-87页

作者：孙榕同济大学微电子中心

用verilog硬件描述语言实现VoIP语音网关芯片上的TDM(时分复用)控制模块,包括模块的结构设计和FIFO缓存机制。

关键词： IP语音网关控制模块结构设计 TDM verilog硬件描述语言 VoIP 关中时分复用

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基于FPGA的雷达模拟器控制系统中分频模块的设计与实现

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科学技术与工程 2006年第14期6卷 2054-2056,2064页

作者：李毅陆昉中国航天科技集团公司五院510研究所兰州730000

以Xilinx公司Spartan_Ⅱ系列XC2S200芯片为FPGA控制单板的核心,设计必要的外围扩展电路,包括A/D、D/A、液晶显示、二极管指示、串行通讯、按键等模块来构成雷达模拟器控制系统。重点阐述了控制系统中的重复频率设置及多站触发控制和指... 详细信息

以Xilinx公司Spartan_Ⅱ系列XC2S200芯片为FPGA控制单板的核心,设计必要的外围扩展电路,包括A/D、D/A、液晶显示、二极管指示、串行通讯、按键等模块来构成雷达模拟器控制系统。重点阐述了控制系统中的重复频率设置及多站触发控制和指示这一主要功能模块的设计方法及实现过程。控制系统运用verilog硬件描述语言编程,在ModelSimSE平台下进行功能的仿真,实现了硬件设计软件化。经过仿真及硬件测试表明:基于FPGA技术的硬件设计方案能够实现控制系统分频功能,实时性好,可靠性高。

关键词：雷达模拟器控制系统现场可编程门阵列 verilog硬件描述语言分频

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基于FPGA时域有限差分算法的设计与实现

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上海电力学院学报 2017年第1期33卷 69-72,96页

作者：赵倩上海电力学院电子与信息工程学院上海200090

以时域有限差分法的二维形式为例,用verilog HDL语言加以实现.采用32位单精度浮点数进行加减法和乘法运算,以保证计算的精度.通过modelsim软件仿真,以Altera FPGA的硬件实现来确保设计的正确性.实验结果显示,基于FPGA的时域有限差分法... 详细信息

以时域有限差分法的二维形式为例,用verilog HDL语言加以实现.采用32位单精度浮点数进行加减法和乘法运算,以保证计算的精度.通过modelsim软件仿真,以Altera FPGA的硬件实现来确保设计的正确性.实验结果显示,基于FPGA的时域有限差分法硬件实现方法对提高速度效果明显,是提高算法性能的有效途径.

关键词：时域有限差分法可编程逻辑器件 verilog硬件描述语言二维TM波

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基于FPGA的DDR SDRAM控制器的设计和实现

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自动化信息 2008年第11期 31-33页

作者：李东风徐建南李力电子科技大学自动化工程学院成都610054

DDR SDRAM，因其拥有较之SDRAM为两倍的数据读、写速率，已经成为存储器的主流，并得到了广泛的应用，尤其在高速、高精度、高存储深度的数据采集系统中。本文在分析了DDR SDRAM工作原理的基础上，预先在FPGA上利用verilog硬件描述语言... 详细信息

DDR SDRAM，因其拥有较之SDRAM为两倍的数据读、写速率，已经成为存储器的主流，并得到了广泛的应用，尤其在高速、高精度、高存储深度的数据采集系统中。本文在分析了DDR SDRAM工作原理的基础上，预先在FPGA上利用verilog硬件描述语言设计实现了DDR SDRAM的读、写以及刷新，给出了DDR SDRAM控制器的状态转换图及结构框图，为进一步与微控制器或数字信号处理器的连接创造条件。目前该控制器已经研制完毕，进一步还可以集成到数据采集系统中。

关键词： DDR SDRAM FPGA DDR控制器 verilog硬件描述语言

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基于FPGA的多种分频设计与实现

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电子元器件应用 2007年第6期9卷 47-48,52页

作者：陈英梅席亮亮西安通信学院陕西西安710106

简要介绍了FPGA设计中各种分频器的设计方法,给出了分别利用verilog硬件描述语言和原理图对整数分频、半整数分频等多种分频方式进行设计的方法,同时给出了通过QuartusⅡ5.0开发平台并使用Altera公司的FPGA进行实现的具体方案。

关键词： verilog硬件描述语言 FPGA 半整数分频器

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基于FPGA的半导体分立器件分选机控制系统计

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电子质量 2010年第8期 18-20页

作者：卜小帷詹惠琴电子科技大学自动化学院四川成都611731

介绍了批量生产流程中半导体分立元件测试系统的结构组成,以及半导体分立元件分选机的基本工作方式,在此基础之上研究并设计了接口信号可随意设定的分选机控制系统。该系统具有较强的适用性,可以应用于各种不同种类的半导体分立元件分选... 详细信息

介绍了批量生产流程中半导体分立元件测试系统的结构组成,以及半导体分立元件分选机的基本工作方式,在此基础之上研究并设计了接口信号可随意设定的分选机控制系统。该系统具有较强的适用性,可以应用于各种不同种类的半导体分立元件分选机;同时该系统还具有一定的功能扩展性。实验表明该分选机控制系统可以适用于不同类型分选机,通信质量有效可靠,达到预期设计目的。

关键词：半导体分立元件测试半导体分立元件分选机现场可编程逻辑阵列 verilog硬件描述语言

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一种用于光盘伺服控制系统的通用滤波器的设计

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电子工程师 2003年第4期29卷 42-43,46页

作者：贾宇然李红霞应建华邹雪城华中科技大学电子科学与技术系湖北武汉430074

介绍了一种通用 FIR/ IIR滤波器的设计与实现。该滤波器主要用于光盘伺服系统中 ,以数字化方式完成传统的 PID闭环控制。文中通过对其原理和实际应用的分析 ,给出其最终实现方案。并用 verilog硬件描述语言完成整个滤波器的设计工作。... 详细信息

介绍了一种通用 FIR/ IIR滤波器的设计与实现。该滤波器主要用于光盘伺服系统中 ,以数字化方式完成传统的 PID闭环控制。文中通过对其原理和实际应用的分析 ,给出其最终实现方案。并用 verilog硬件描述语言完成整个滤波器的设计工作。经波形仿真和 FPGA验证表明。

关键词：光盘伺服控制系统滤波器 FIR/IIR verilog硬件描述语言 FPGA验证波形仿真

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基于ARM7TDMI的cache控制器电路

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电子工程师 2004年第12期30卷 11-14页

作者：薛骏潘江涛杨军东南大学国家专用集成电路系统工程技术研究中心江苏省南京市210096

针对ARM7TDMI内核的特点,提出了一种高速缓存(cache)控制器的电路实现方案。主要应用verilog硬件描述语言对cache控制器进行了行为级描述,通过了前端仿真和综合后的联合仿真,比较了嵌入式系统中有无cache的工作效率,并给出了实验结果。... 详细信息

针对ARM7TDMI内核的特点,提出了一种高速缓存(cache)控制器的电路实现方案。主要应用verilog硬件描述语言对cache控制器进行了行为级描述,通过了前端仿真和综合后的联合仿真,比较了嵌入式系统中有无cache的工作效率,并给出了实验结果。实验结果表明,系统中加入cache电路以后存储性能会有显著提高。

关键词：前端 verilog硬件描述语言电路实现 ARM7TDMI内核存储性能控制器仿真高速缓存嵌入式系统方案

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数据采集系统中SDRAM控制器的FPGA设计

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电子设计工程 2017年第15期25卷 137-140页

作者：雷能芳渭南师范学院数理学院陕西渭南714000

针对SDRAM时序控制复杂等设计难点,提出了一种基于现场可编程门阵列(FPGA)设计SDRAM控制器的方法。使用状态机的设计思想,采用verilog硬件描述语言对时序控制程序进行了设计。通过Modelsim SE 6.0开发平台进行了时序仿真,得到的SDRAM读... 详细信息

针对SDRAM时序控制复杂等设计难点,提出了一种基于现场可编程门阵列(FPGA)设计SDRAM控制器的方法。使用状态机的设计思想,采用verilog硬件描述语言对时序控制程序进行了设计。通过Modelsim SE 6.0开发平台进行了时序仿真,得到的SDRAM读写仿真波形图时序合理、逻辑正确。

关键词： SDRAM控制器状态机 verilog硬件描述语言时序仿真

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