检索结果-内蒙古大学图书馆

ON MINIMIZING MEMORY IN SYSTOLIC ARRAYS FOR THE DYNAMIC TIME WARPING ALGORITHM

INTEGRATION-THE VLSI JOURNAL 1986年第2期4卷 155-173页

作者： DIJKSTRA, E PIGUET, C CTR SUISSE ELECTR & MICROTECHN SA CH-2000 NEUCHATELSWITZERLAND

New systolic architectures have been evaluated for the Dynamic Time Warping (DTW) algorithm. This algorithm is a non-linear pattern matching technique used in isolated and continuous speech recognition systems. The proposed systolic decomposition for the DTW algorithm combines simultaneously (1) simple and regular systolic communication schemes and (2) a decomposition strategy which aims at a minimum amount of memory. This approach has led to a systolic architecture which is relatively flexible, compact and easy to test. Several arrays can be built up by keeping the same decomposition of the DTW-algorithm. This allows an easy exchange, depending on the desired application, of execution speed against chip-area.

关键词： Speech recognition arrays of systolic processors Dynamic Time Warping algorithm bit-serial computation testability of systolic arrays area-saving decompositions of algorithms

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