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范例一：(K=图书馆学 OR K=情报学) AND A=范并思 AND Y=1982-2016
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2 篇 video decoder
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1 篇 h.264/avc
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1 篇 beijing inst tec...
1 篇 pattern recognit...
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排序：

An Efficient VLSI Architecture and Implementation of Motion Compensation for Video Decoder

An Efficient VLSI Architecture and Implementation of Motion ...

引用

1st International Conference on Communications and Information Processing (ICCIP 2012)

作者： Cao, Chao Yu, Li-zhen Zhang, Yanjun NanChang Univ Informat Engn Acad Dept Elect Nanchang 330031 Peoples R China Beijing Inst Technol Sch Informat & Elect Beijing 100081 Peoples R China

ISBN: (纸本)9783642319679

Motion compensation calculation of video decoder frequently access the video data which are stored in external memory, thus efficient memory access is critical in the design of decoder. An advanced parallel multi-pipe line architecture of Motion compensation is proposed in this paper, which fulfilled different of picture prediction modes employed by multi standard video decoder. In this architecture, buffering mechanism for the reference data is used to reduce external memory access, and DMA is used to control data transformation between modules. Compared with traditional memory fetch module, the proposed architecture reduces 30%similar to 40% video decoding cycle in H.264 decoding. Synthetically result shows that timing and the area of this design are both satisfied the requirement of video decoder.

关键词： component Video decoder reference data fetch Motion Compensation

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HIGH EFFICIENT MEMORY fetch ARCHITECTURE FOR MOTION COMPENSATION OF VIDEO DECODER

HIGH EFFICIENT MEMORY FETCH ARCHITECTURE FOR MOTION COMPENSA...

引用

2010 2nd IEEE International Conference on Network Infrasturcture & Digital Content(2010年第二届IEEE网络基础设施与数字内容国际会议 IC-NIDC 2010)

作者： Ming Wu Chuang Zhang Jun Guo Pattern Recognition and Intelligence System Laboratory (PRIS Lab) Beijing University of Posts and Te Pattern Recognition and Intelligence System Laboratory (PRIS Lab) Beijing University of Posts and T

To improve the performance of the real-time video decoding under the power-constrained environment, an efficient memory fetch architecture for accessing the motion compensation memory is proposed. According to the feature of accessing the motion compensation memory, the architecture adopts the cache mechanism to buffer the reference data and chooses DMA to access external memories. The architecture can be applied for H.264/AVC, MPEG-4, AVS and other video decoding systems. Compared to the conventional memory fetch module, experimental results show that the proposed architecture reduces 12.8％~16.7％ video decoding cycles in H.264 decoding. The timing and the area of this design are both satisfied after synthesized.

关键词： H.264/AVC video decoder motion compensation reference data fetch cache

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