检索结果-内蒙古大学图书馆

计算机辅助设计与图形学学报 2014年第3期26卷 364-369页

作者：董君朱恒亮曾璇复旦大学专用集成电路与系统国家重点实验室上海201203

针对传统的艺术画廊模型及其模型的变形在实际应用中无法处理诸如可用守卫数受限、只需监控离散目标点等情形,提出一种基于带权值目标点的可见覆盖的变形模型及其求解算法.首先利用角扫描技术得到每个目标点的可见多边形,然后通过对这... 详细信息

针对传统的艺术画廊模型及其模型的变形在实际应用中无法处理诸如可用守卫数受限、只需监控离散目标点等情形,提出一种基于带权值目标点的可见覆盖的变形模型及其求解算法.首先利用角扫描技术得到每个目标点的可见多边形,然后通过对这些可见多边形进行几何求交、几何求差操作来得到若干等价目标可见区域,再依据每个区域对应的可见目标点集将所提出的变形模型转化为经典的集合最大权值覆盖问题,最后利用整数线性规划方法对其求解,得到最终需要的守卫数及放置位置.大量的实验结果表明,该算法是正确和有效的.

关键词：艺术画廊问题可见多边形带权值目标点计算几何整数线性规划

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65nm CMOS工艺中的高速多标准FPGA I/O接口设计

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固体电子学研究与进展 2014年第4期34卷 381-386,402页

作者：景行赵琦柯可人易婷洪志良复旦大学专用集成电路与系统国家重点实验室上海201203

设计了一种现场可编程门阵列(FPGA)中使用的高速可配置的输入输出(I/O)接口电路。通过使用电平移位电路、互补自偏置差分放大电路(CSDA)等,该电路实现了包括低压差分信号(LVDS)在内的多种常见的接口协议标准。该电路同时具备可编程配置... 详细信息

设计了一种现场可编程门阵列(FPGA)中使用的高速可配置的输入输出(I/O)接口电路。通过使用电平移位电路、互补自偏置差分放大电路(CSDA)等,该电路实现了包括低压差分信号(LVDS)在内的多种常见的接口协议标准。该电路同时具备可编程配置压摆率和可编程配置输出驱动电流的功能,同时为保证信号完整性,设计了数字阻抗匹配(DCI)模块。芯片使用SMIC 1P10M65nm CMOS工艺流片。测试结果表明,芯片核心电路在1.2V电压下能保证各种协议工作正常,输入输出信号延时、最大输出电流、最高工作速率等与仿真结果吻合,均达到设计指标要求。

关键词：现场可编程门阵列输入输出接口互补自偏置差分放大电路高速低压差分信号数字阻抗匹配

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适用于软件无线电的高线性度、低功耗无源下变频混频器的设计

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复旦学报（自然科学版） 2014年第1期53卷 29-36页

作者：陈烨昕闫娜许建飞复旦大学专用集成电路与系统国家重点实验室上海201203

设计了一个用于软件无线电的高线性度、低功耗的无源下变频混频器,采用TSMC 65 nm CMOS工艺实现,芯片面积为0.2 mm^2,总功耗为8 mW@1.2 V.混频器中采用了改进的Gm单元,结合源级负反馈技术和MGTR技术,在提高混频器IIP_3的同时,拓宽了输... 详细信息

设计了一个用于软件无线电的高线性度、低功耗的无源下变频混频器,采用TSMC 65 nm CMOS工艺实现,芯片面积为0.2 mm^2,总功耗为8 mW@1.2 V.混频器中采用了改进的Gm单元,结合源级负反馈技术和MGTR技术,在提高混频器IIP_3的同时,拓宽了输入线性区域的范围.测试结果表明:线性区域的范围得到一定程度的提高,即使输入RF信号的功率为-12 dBm.混频器的IIP_3≥10.9 dBm,IIP_2≥45 dBm;在900 MHz处,混频器获得最大转换增益13.2 dB,此时NF为13.8 dB.

关键词：高线性度低功耗无源下变频混频器软件无线电

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一种应用于DC-OFDM系统的FFT处理器设计

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复旦学报（自然科学版） 2014年第4期53卷 452-457页

作者：刘珍奇叶凡李宁任俊彦复旦大学专用集成电路与系统国家重点实验室上海201203

设计了一种应用于双载波正交频分复用(DC-OFDM)无线通信系统的高速、低功耗快速傅里叶变换(FFT)处理器.为降低传统并行架构带来的硬件实现开销,提出了一种新型的结合FFT分解的多路并行架构,有效减少了实现所需的乘法器和加法器数目,在... 详细信息

设计了一种应用于双载波正交频分复用(DC-OFDM)无线通信系统的高速、低功耗快速傅里叶变换(FFT)处理器.为降低传统并行架构带来的硬件实现开销,提出了一种新型的结合FFT分解的多路并行架构,有效减少了实现所需的乘法器和加法器数目,在提高处理器数据吞吐率的同时,进行了芯片面积的优化.另外,采用提出的处理单元实现不同的基运算,并对基-2、基-22、基-23、基-24不同架构下的定点FFT运算所需的硬件开销进行定量分析,以选择最优的基结构.最后,介绍了旋转因子乘法器的设计.设计实现的128点FFT处理器采用SMIC 0.13μm CMOS工艺,芯片面积为1.44 mm2,最大数据吞吐率达到1GS/s,在典型工作频率500MS/s下的功耗为39.5mW.与现有其他128点FFT处理器相比,减小了面积,节约了功耗.

关键词： FFT处理器并行双载波正交频分复用低功耗

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一种应用于超高速ADC中6G/8GHz的高精度正交时钟产生电路

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复旦学报（自然科学版） 2014年第4期53卷 458-465,474,F0002页

作者：蒋健兵马顺利周光耀叶凡任俊彦复旦大学专用集成电路与系统国家重点实验室上海201203

正交时钟被广泛地用在正交频分复用（OFDM）通信系统的时间交织模拟数字转换器（ADC）中.正交信号的相位偏差和时钟抖动对整个系统都有着重要的影响.针对时间交织ADC的应用需求,提出一种宽带的输出相位可调的正交注入锁定分频器,通过调... 详细信息

正交时钟被广泛地用在正交频分复用（OFDM）通信系统的时间交织模拟数字转换器（ADC）中.正交信号的相位偏差和时钟抖动对整个系统都有着重要的影响.针对时间交织ADC的应用需求,提出一种宽带的输出相位可调的正交注入锁定分频器,通过调节注入信号和耦合信号的能量来改善因器件失配和工艺偏差等造成的正交信号的相位误差.在此基础上设计了一个基于LC压控振荡器的电荷泵型锁相环.该锁相环采用TSMC65nm工艺设计,正交时钟的频率输出范围是5.8-6.5GHz和7.1-8.3GHz,正交相位的平均误差小于0.26°,满足系统设计的预设指标.

关键词：锁相环正交时钟相位可调注入锁定分频器

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AlO_x/WO_y阻变存储结构的转换特性和机理研究

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复旦学报（自然科学版） 2014年第1期53卷 24-28,36页

作者：刘易宋雅丽王艳良林殷茵复旦大学专用集成电路与系统国家重点实验室上海200433

通过构造AlO_x/WO_y双层结构实现了阻变存储器的均匀性、低功耗等特性,该器件阻变层中的AlO_x为氧空位渐变的梯度膜,从而使得形成的导电细丝更加稳定,在反复擦写过程中导电细丝断开和接上的位置基本不变,对应器件电学性能参数分布集中.... 详细信息

通过构造AlO_x/WO_y双层结构实现了阻变存储器的均匀性、低功耗等特性,该器件阻变层中的AlO_x为氧空位渐变的梯度膜,从而使得形成的导电细丝更加稳定,在反复擦写过程中导电细丝断开和接上的位置基本不变,对应器件电学性能参数分布集中.采用阶梯脉冲信号结合Verify算法的方法对基于0.18μm CMOS工艺的Al/AlO_x/WO_y/W结构的阻变存储单元进行转换特性、可靠性的测试,统计结果表明:器件电学性能参数R_(on)、R_(off)和_(sct)等具有良好的均匀性,且无需高电压的初始置位过程;复位过程中复位电流小于15μA,远远小于单层器件Reset电流,很好地满足了存储器件的低功耗要求;在小电压长时间作用下,高低阻态仍保持不变,能有效地防止误擦写操作;通过高温烘烤测试,验证了器件的数据保持能力.同时,分析了WO_y薄膜在器件高低阻态转换过程中作为串联电阻降低复位电流的作用.

关键词：阻变转换 AIOx WOy 参数均匀性导电细丝阻变存储器

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Skein树形哈希算法的并行实现与性能评估(英文)

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复旦学报（自然科学版） 2014年第1期53卷 37-50页

作者：翁新钎韩军窦仁峰曾晓洋复旦大学专用集成电路与系统国家重点实验室上海200433

Skein算法提供一种树形哈希模式,方便了并行硬件资源的充分利用.提出一种并行计算平台,用以评估树形哈希算法与传统线性哈希算法相比的性能提升.该平台通过开关网络连接多个运算单元和多个存储单元,允许并行运算和并发的存储器访问.平... 详细信息

Skein算法提供一种树形哈希模式,方便了并行硬件资源的充分利用.提出一种并行计算平台,用以评估树形哈希算法与传统线性哈希算法相比的性能提升.该平台通过开关网络连接多个运算单元和多个存储单元,允许并行运算和并发的存储器访问.平台中包含一个控制器,负责动态地向运算单元调度任务,支持算法参数的灵活配置.为了确定最优配置参数,根据平台特征建立了性能模型.实验结果显示,加速比趋近于理论上限,即平台中运算单元的数量.该平台的硬件原型通过台积电65 nm工艺进行综合,工作频率达到833 MHz,对应吞吐率为38.091 Gbps.

关键词： SHA-3 Skein算法树形哈希并行硬件实现性能模型

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适用DC-OFDM超宽带系统的低复杂度同步器设计

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复旦学报（自然科学版） 2014年第3期53卷 371-379页

作者：井冰陈昊叶凡李宁任俊彦复旦大学专用集成电路与系统国家重点实验室上海201203

提出了一种包括符号同步模块,自动增益控制模块以及对非理想因素的估计补偿模块的同步器.在符号同步模块中,采用相关和阈值搜索的联合判断算法确定前导符的起止位置;在自动增益模块中,采用双闭环的AGC算法来提高调节范围和收敛速度;在... 详细信息

提出了一种包括符号同步模块,自动增益控制模块以及对非理想因素的估计补偿模块的同步器.在符号同步模块中,采用相关和阈值搜索的联合判断算法确定前导符的起止位置;在自动增益模块中,采用双闭环的AGC算法来提高调节范围和收敛速度;在非理想因素的估计补偿模块中,针对接收机中出现的载波频偏和IQ失配进行估计补偿.用0.13μm CMOS工艺综合,在相同的工作频率132 MHz下,面积和功耗约为传统方法的50%.

关键词：双载波超宽带同步器符号同步自动增益控制 IQ失配载波频偏

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一种应用于时间交织模数转换器的低抖动延迟锁定环

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复旦学报（自然科学版） 2014年第3期53卷 380-386页

作者：汪雨雯叶凡任俊彦复旦大学专用集成电路与系统国家重点实验室上海201203

设计了一种适用于时间交织模数转换器的低抖动延迟锁定环，实现了12相时钟输出和6倍频输出功能．论文提出了一种基于信号通路切换的鉴频鉴相器，有效减小了工艺、电压、温度等对延迟锁定环性能的影响，优化了环路的抖动性能．延迟锁定... 详细信息

设计了一种适用于时间交织模数转换器的低抖动延迟锁定环，实现了12相时钟输出和6倍频输出功能．论文提出了一种基于信号通路切换的鉴频鉴相器，有效减小了工艺、电压、温度等对延迟锁定环性能的影响，优化了环路的抖动性能．延迟锁定环采用65nmCMOS工艺设计，芯片面积90μm×110μm，版图仿真验证其工作频率范围40～110MHz，电路整体功耗1．6mW，锁定时间小于1．2μs，均方根抖动为8．1μs，可满足模数转换器对时钟的要求．论文所采用的切换型鉴频鉴相器，相比于传统的鉴频鉴相器，其输出时钟的均方根抖动减小了19．3ps．

关键词：时间交织模数转换器延迟锁定环鉴频鉴相器多相位时钟

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针对植入式应用的8位100kS/s的逐次逼近型模数转换器设计

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复旦学报（自然科学版） 2014年第3期53卷 359-364页

作者：闫潇王俊宇复旦大学专用集成电路与系统国家重点实验室上海201203

针对植入式医疗电子的应用需求设计了一个8位100 kS/s的低功耗逐次逼近型模数转换器(SAR ADC),并且基于0.13μm 1P8M工艺进行了流片(tape-out)验证.为了达到降低功耗的设计目标,对SAR ADC的子模块进行了仔细的分析设计:采用满足精度和... 详细信息

针对植入式医疗电子的应用需求设计了一个8位100 kS/s的低功耗逐次逼近型模数转换器(SAR ADC),并且基于0.13μm 1P8M工艺进行了流片(tape-out)验证.为了达到降低功耗的设计目标,对SAR ADC的子模块进行了仔细的分析设计:采用满足精度和速度要求的无源互补开关;采用失调(offset)优化的无静态电流的动态比较器;采用无静态功耗的电容阵列子数模转化器.测试结果表明,当输入测试信号为9.37 kHz时,该SAR ADC的信号噪声失真比(SNDR)为49.2 dB,动态无杂散范围(SFDR)为63 dB,有效位(ENOB)为7.8位.其微分非线性(DNL)和积分非线性(INL)分别为-0.15/+0.15 LSB和-0.35/+0.23 LSB,功耗为3.2μW,优值(FoM)为143 fJ/conversion-step.

关键词： SAR ADC 植入式医疗电子低功耗

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