检索结果-内蒙古大学图书馆

2011年全国高性能计算学术年会(HPC china2011)

作者：孙发强韩银和谭光明李晓维计算机体系结构国家重点实验室（筹）中国科学院计算技术研究所中国科学院中国科学院研究生院

云计算的蓬勃发展，引起了数据中心规模的不断增大，从而对数据中心的能源消耗提出了严峻的挑战。针对这一问题，本文探索低功耗处理器在数据中心的适用性来缓解数据中心能源缺乏的现状。文中根据数据中心的两种典型应用——Web 搜索和... 详细信息

云计算的蓬勃发展，引起了数据中心规模的不断增大，从而对数据中心的能源消耗提出了严峻的挑战。针对这一问题，本文探索低功耗处理器在数据中心的适用性来缓解数据中心能源缺乏的现状。文中根据数据中心的两种典型应用——Web 搜索和社交网络的应用特点，使用Linpack 和Graph500来评估系统的性能。在此基础上，我们发现ATOM机群在数据中心计算密集型应用（比如PageRank计算）中应用潜力较低;在数据密集型应用中，并行程度高、通信量低的应用（比如数据收集）有较强的应用潜力。本文还指出多核低功耗处理器在数据密集型的数据中心应用中有研究价值。

关键词：数据中心处理器适用性分析云计算 Web搜索

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多线程共享缓存中冗余路访问消除机制研究

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高性能计算技术 2014年第1期 20-24页

作者：范灵俊徐远超唐士斌杜坤王达中国科学院计算技术研究所计算机体系结构国家重点实验室北京 100190 中国科学院大学北京 100049 中国科学院计算技术研究所计算机体系结构国家重点实验室北京 100190 首都师范大学信息工程学院北京 100048 南京邮电大学宽带无线通信技术教育部工程研究中心南京210003 中国科学院计算技术研究所计算机体系结构国家重点实验室北京 100190

近年来,功耗是处理器设计领域的关键问题之一.由于片上缓存占用了越来越多的CPU芯片面积和功耗,本文提出了一种针对多线程共享缓存通过过滤不必要缓存路(Way)访问来降低CPU动态功耗的缓存结构,称为Thread id Cache.通过设置和预先访问Th... 详细信息

近年来,功耗是处理器设计领域的关键问题之一.由于片上缓存占用了越来越多的CPU芯片面积和功耗,本文提出了一种针对多线程共享缓存通过过滤不必要缓存路(Way)访问来降低CPU动态功耗的缓存结构,称为Thread id Cache.通过设置和预先访问Thread id 过滤器(Thread id Filter)来排除每次访问发生时不同线程对组相联缓存同一组(Set)中其它线程私有数据块的访问.本文在128KB 8路Thread id Cache上对传统并行程序和大数据处理并行程序进行了测试,实验结果表明,对于不同应用、不同执行线程数,69.8％-87.5％的缓存路访问可以得到消除,相应地,由于访问操作产生的同等动态功耗可以被有效降低.

关键词：组相联缓存动态功耗多线程 Thread id表

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一种保护买家隐私的网上交易协议设计

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信息与电脑（理论版） 2014年第11期 14-16页

作者：吴林蒋东辰西北师范大学计算机科学与工程学院中国科学院计算技术研究所计算机体系结构国家重点实验室

通过分析支付宝交易流程,发现基于该平台的交易方式无法有效保护买家购物的隐私信息。为此,本文提出了一种保护买家隐私的网上购物解决方案。该方案即能有效解决隐私泄露问题,又能解决电子商务中信息监管的问题。最后,还对新交易框架的... 详细信息

通过分析支付宝交易流程,发现基于该平台的交易方式无法有效保护买家购物的隐私信息。为此,本文提出了一种保护买家隐私的网上购物解决方案。该方案即能有效解决隐私泄露问题,又能解决电子商务中信息监管的问题。最后,还对新交易框架的安全协议属性规范进行了分析。

关键词：隐私保护协议设计支付宝隐私信息信息监管第三方支付注册信息收货电子支付信息描述

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Thread id Cache:一种多线程共享的低功耗高速缓存结构

Thread id Cache:一种多线程共享的低功耗高速缓存结构

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2013全国高性能计算学术年会

作者：范灵俊徐远超唐士斌郑亚松范东睿中国科学院计算技术研究所计算机体系结构国家重点实验室北京100190 中国科学院计算技术研究所计算机体系结构国家重点实验室北京100190 首都师范大学信息工程学院北京100048

近年来,功耗是处理器设计领域的关键问题之一.本文提出了一种针对多线程共享缓存通过过滤不必要缓存路(Way)访问来降低CPU动态功耗的缓存结构,称为Thread id Cache.通过设置和预先访问Thread id过滤器来排除每次访问发生时不同线程对组... 详细信息

近年来,功耗是处理器设计领域的关键问题之一.本文提出了一种针对多线程共享缓存通过过滤不必要缓存路(Way)访问来降低CPU动态功耗的缓存结构,称为Thread id Cache.通过设置和预先访问Thread id过滤器来排除每次访问发生时不同线程对组相联缓存同一组(Set)中其它线程私有数据块的访问.在128KB 8路Thread id Cache上对传统并行程序和大数据处理并行程序进行的测试表明,对于不同应用、不同执行线程数,69.8％-87.5％的缓存路访问可以得到消除,相应地,由于访问操作产生的同等的动态功耗可以被有效降低.

关键词：处理器设计多线程共享缓存结构动态功耗访问操作

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一种基于指令模板的通用处理器约束随机指令生成方法

一种基于指令模板的通用处理器约束随机指令生成方法

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第八届全国测试学术会议

作者：刘婧王天成王健李华伟湘潭大学信息工程学院湘潭411105 中国科学院计算技术研究所计算机体系结构国家重点实验室北京100190 中国科学院计算技术研究所计算机体系结构国家重点实验室北京100190 中国科学院大学北京100049

通用处理器是集成电路中功能最为复杂的设计之一,这对其功能验证提出了巨大的挑战.本文提出了一种基于指令模板的通用处理器约束随机指令生成方法,针对一款ARMv8处理器进行了模拟验证.此指令生成方法基于从指令集中提炼的指令模板,通过... 详细信息

通用处理器是集成电路中功能最为复杂的设计之一,这对其功能验证提出了巨大的挑战.本文提出了一种基于指令模板的通用处理器约束随机指令生成方法,针对一款ARMv8处理器进行了模拟验证.此指令生成方法基于从指令集中提炼的指令模板,通过约束的调整即可支持各种功能场景的验证.基于结果自动比对的验证环境,对处理器进行了充分的验证,发现了58处设计错误,为处理器进入后续的FPGA硬件仿真奠定了良好的基础.

关键词：集成电路通用处理器指令模板生成机制

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基于离线关键站点和路径阻抗的地铁路线推荐方法

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数据挖掘 2022年第3期12卷 246-258页

作者：戴政君宋莹北京信息科技大学数字文化重点实验室北京计算机体系结构国家重点实验室中国科学院计算技术研究所北京

目前主流的路线推荐方法先通过寻径算法在满足各种约数条件下寻找K条可行路线,然后根据乘客的出行偏好从K条可行路线中选择一条路线推荐给乘客。然而,由于寻径算法的约束条件只能通过实时计算得到K条可行路线,当同时进行大量乘客的路线... 详细信息

目前主流的路线推荐方法先通过寻径算法在满足各种约数条件下寻找K条可行路线,然后根据乘客的出行偏好从K条可行路线中选择一条路线推荐给乘客。然而,由于寻径算法的约束条件只能通过实时计算得到K条可行路线,当同时进行大量乘客的路线推荐时,由于无法快速获得推荐路线从而影响乘客的用户体验。因此本文提出基于离线关键站点的K最短时间算法,通过构造关键站点图和哈希表离线辅助查找K条最短路径,从而降低算法的时间复杂度。此外,通过分析发现,乘客对出行的负面感受与地铁换乘次数及拥挤度间并不是简单的线性关系,随着换乘次数和拥挤度的增加,乘客对出行的满意度会迅速衰减,所以,目前通过最大最小值方法计算出的乘客偏好路线并不一定是最佳路线。因此,本文设计了基于路径阻抗的地铁路线推荐方法,其中路径阻抗由不同权重的地铁时间成本和拥挤成本组成,通过计算K条最短时间路径的路径阻抗,从中选出符合乘客偏好的出行线路推荐给乘客。通过理论分析,随着查询次数的增多,本文提出的基于离线关键站点的K最短时间算法时间复杂度要远小于其他约数条件下的寻径算法。最后通过具体的实验示例验证本方法完全可以满足不同乘客的路线推荐需求。

关键词：地铁刷卡数据寻径算法路线推荐

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性能不对称多核处理器负载均衡调度研究

性能不对称多核处理器负载均衡调度研究

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2013全国高性能计算学术年会

作者：徐远超谭旭范灵俊张志敏首都师范大学信息工程学院北京100048 中国科学院计算技术研究所计算机体系结构国家重点实验室北京100190 中国科学院计算技术研究所计算机体系结构国家重点实验室北京100190

在同等面积条件下,性能不对称异构多核处理器比同构多核处理器能具有更好的性能功耗比,实现这一目标的前提是操作系统要能够进行合理的任务分配和负载均衡.针对已有负载均衡调度算法存在的不足,基于现有Linux调度框架提出了一种全面的... 详细信息

在同等面积条件下,性能不对称异构多核处理器比同构多核处理器能具有更好的性能功耗比,实现这一目标的前提是操作系统要能够进行合理的任务分配和负载均衡.针对已有负载均衡调度算法存在的不足,基于现有Linux调度框架提出了一种全面的异构感知负载均衡策略,保证了处理器核负载均衡优先原则,无需定义阈值区分程序类别.在DVFS异构多核环境下测试表明,本文算法要优于现有部分算法,既能做到负载均衡又能实现异构感知.

关键词：性能不对称异构多核处理器负载均衡调度算法优化设计性能测试

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渗透缓存命中率诱导的缓存区域动态分配机制研究

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软件导刊 2020年第4期19卷 1-8页

作者：李灵枝胡九川叶笑春范东睿严龙北京交通大学计算机与信息技术学院北京100044 中国科学院计算技术研究所计算机体系结构国家重点实验室北京100190

为解决计算机体系结构性能瓶颈——存储墙问题,在依赖硬件技术和体系结构创新的同时,还需优化程序算法。传统算法主要以时间和空间复杂度作为衡量指标,未考虑计算机存储结构设置。延迟避免和延迟容忍机制是解决"存储墙"问题... 详细信息

为解决计算机体系结构性能瓶颈——存储墙问题,在依赖硬件技术和体系结构创新的同时,还需优化程序算法。传统算法主要以时间和空间复杂度作为衡量指标,未考虑计算机存储结构设置。延迟避免和延迟容忍机制是解决"存储墙"问题的新途径。借助一种新型缓存结构——渗透缓存可缓解该问题。利用延迟容忍机制,通过研究渗透缓存模型在处理器片上数据调配方式,提出一种依据历史访存命中率变化情况动态调控渗透缓存容量机制(以下简称动态渗透机制)。通过改进数据在渗透缓存上的调配策略,使缓存容量动态适应程序的数据特征,经过调整得出命中率更高的缓存结构配置方案。阐述了动态渗透机制原理与仿真实验模型架构。仿真实验结果表明,在SPLASH-2的部分测试集下,与传统缓存命中率相比较,平均提高了7.629%;以动态渗透机制得出的缓存容量配置方案命中率比传统缓存平均提高31.003%。即在缓存结构改进的动态渗透机制下,访存命中率得到提高,从而缓解了"存储墙"问题。

关键词：渗透缓存存储墙动态缓存分区缓存容量

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抗板级物理攻击的持久存储方法研究

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计算机工程 2022年第2期48卷 132-139页

作者：李闽张倩颖王国辉施智平关永首都师范大学信息工程学院北京100048 高可靠嵌入式系统北京市工程研究中心北京100048 中国科学院计算技术研究所计算机体系结构国家重点实验室北京100190 电子系统可靠性技术北京市重点实验室北京100048 北京成像理论与技术高精尖创新中心北京100048

为保护文件系统的安全性,提出一种抗板级物理攻击的持久存储方法。利用ARM TrustZone技术构建持久存储架构,实现内存保护机制和持久存储保护服务,提高文件系统的物理安全性。基于片上内存(OCM)在可信执行环境(TEE)中的内核层建立内存保... 详细信息

为保护文件系统的安全性,提出一种抗板级物理攻击的持久存储方法。利用ARM TrustZone技术构建持久存储架构,实现内存保护机制和持久存储保护服务,提高文件系统的物理安全性。基于片上内存(OCM)在可信执行环境(TEE)中的内核层建立内存保护机制,保证TEE的可信应用能够抵抗板级物理攻击。基于TEE的内存保护机制实现保护文件系统中敏感数据的持久存储保护服务,确保文件系统的机密性和完整性。在物理开发板上实现持久存储架构的原型系统,使用基准测试工具对原型系统进行性能评估,并分析性能损耗的原因。测试结果表明,内存保护机制在保护TEE系统物理安全性时引入的时间开销会随着OCM的增大而减小,持久存储保护服务在保护数据量较小的敏感数据时产生的时间开销在用户可接受范围内。

关键词： ARM TrustZone技术可信执行环境板级物理攻击片上内存持久存储保护

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移动设备应用程序的体系结构特征分析

移动设备应用程序的体系结构特征分析

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2013全国高性能计算学术年会

作者：张坤黄永兵陈明宇北京航空航天大学软件学院移动云计算系北京100191 中国科学院计算技术研究所计算机体系结构国家重点实验室北京100190 中国科学院计算技术研究所计算机体系结构国家重点实验室北京100190

云计算的成熟以及移动互联网的兴起,移动设备为用户提供了丰富的高质量及高可靠的服务.移动智能终端如智能手机、平台电脑已经成为最主要的电子消费品,且呈现快速增长的趋势.移动设备上运行的应用程序种类丰富多样,对硬件平台的需求也... 详细信息

云计算的成熟以及移动互联网的兴起,移动设备为用户提供了丰富的高质量及高可靠的服务.移动智能终端如智能手机、平台电脑已经成为最主要的电子消费品,且呈现快速增长的趋势.移动设备上运行的应用程序种类丰富多样,对硬件平台的需求也大不相同:而移动设备的硬件平台在性能和功耗上有其自身的局限性.因而,分析移动设备上的应用程序运行过程中体现出的体系结构特征,对于硬件平台如处理器的设计,以及指导应用程序的优化,具有指导性的意义. 本文分析了现代移动设备上应用程序的体系结构特征,为应用程序优化提供依据.在应用市场中挑选了测试程序集,它覆盖了整个用户需求空间,包括社交、娱乐、办公、学习等等.随后测试这些应用的体系结构特征并做出分析.这些程序都存在较高的指令缓存和指令旁路转换缓冲器未命中率,并且由于程序自身的设计,分支预测失败率也较高.

关键词：移动通讯设备应用程序体系架构数据存储

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