检索结果-内蒙古大学图书馆

电子器件 2008年第3期31卷 814-816页

作者：张标陈岚中国科学院计算技术研究所中国科学院计算机系统结构重点实验室北京100080 中国科学院微电子研究所北京100080 中国科学院研究生院北京100080

压控振荡器是锁相环电路的关键的组成部分之一,采用新的电流复用结构,可以明显降低该电路的功耗,而且由于没有尾电流,新结构还能有效改善电路的相位噪声。在TSMC 0.18 CMOS 1P6M工艺下的仿真结果表明:在1.25 V供电电压下振荡器的调节范... 详细信息

压控振荡器是锁相环电路的关键的组成部分之一,采用新的电流复用结构,可以明显降低该电路的功耗,而且由于没有尾电流,新结构还能有效改善电路的相位噪声。在TSMC 0.18 CMOS 1P6M工艺下的仿真结果表明:在1.25 V供电电压下振荡器的调节范围是2.26 GHz到2.76 GHz,在频偏1 MHz处的相位噪声为-130 dBc/Hz,平均功耗不超过1.2 mW。

关键词：压控振荡器低功耗电流复用相位噪声锁相环

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HPP交换芯片逻辑验证设计

HPP交换芯片逻辑验证设计

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第十二届计算机工程与工艺全国学术年会(NCCET'08)

作者：王达伟刘力轲刘兴奎中国科学院计算技术研究所北京 100190 中国科学院计算机系统结构重点实验室北京 100190 中国科学院研究生院北京 100039 中国科学院计算技术研究所北京 100190 中国科学院计算机系统结构重点实验室北京 100190

HPP交换芯片,作为曙光5000系统互联网络的重要组成部件,同时具有单播,多播和同步功能,此外还能够支持带外监控和配置管理功能.芯片功能的增加带来了芯片面积增大和状态空间急剧膨胀,大大增加芯片验证难度.本文重点讨论了HPP交换芯片验... 详细信息

HPP交换芯片,作为曙光5000系统互联网络的重要组成部件,同时具有单播,多播和同步功能,此外还能够支持带外监控和配置管理功能.芯片功能的增加带来了芯片面积增大和状态空间急剧膨胀,大大增加芯片验证难度.本文重点讨论了HPP交换芯片验证过程中采用的高级验证方法,并提出加快功能验证的策略.

关键词： HPP交换芯片功能验证逻辑验证覆盖率

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基于矩阵的动态优先级仲裁器设计

基于矩阵的动态优先级仲裁器设计

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第十二届计算机工程与工艺全国学术年会(NCCET'08)

作者：曹政沈华中国科学院计算技术研究所北京 100190 中国科学院计算机系统结构重点实验室北京 100190 中国科学院研究生院北京 100039 中国科学院计算技术研究所北京 100190

本文设计实现了一种可由上层逻辑动态调整优先级的仲裁器.本文的设计采用两级仲裁,第一级对拥有相同优先级的请求进行公平仲裁;第二级对第一级的输出进行优先级仲裁.两级仲裁中均使用矩阵结构来存储优先级比较的结果,进而将优先级比较... 详细信息

本文设计实现了一种可由上层逻辑动态调整优先级的仲裁器.本文的设计采用两级仲裁,第一级对拥有相同优先级的请求进行公平仲裁;第二级对第一级的输出进行优先级仲裁.两级仲裁中均使用矩阵结构来存储优先级比较的结果,进而将优先级比较的过程,排除在仲裁的关键路径之外,提高了仲裁器的工作频率。验证结果表明本文的设计能满足大多数应用的需求.

关键词：仲裁器优先级仲裁两级仲裁矩阵结构工作频率

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多核处理器上基于程序访存阶段的独立任务调度

多核处理器上基于程序访存阶段的独立任务调度

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2008年全国高性能计算机学术年会

作者：张超王蕾中国科学院计算技术研究所计算机系统结构重点实验室北京 100190 中国科学院研究生院北京 100190 zhangchao@*** wlei@*** 中国科学院计算技术研究所计算机系统结构重点实验室北京 100190 中国科学院研究生院北京 100190 zhangchao@*** wlei@***

随着多核处理器的发展，片外访存带宽逐渐成为影响程序性能的主要因素。为了解决这个问题，很多研究工作通过提高cache利用率来降低程序执行过程中的片外访存数量。本文提出了一种任务调度算法来解决同时执行的多个独立任务竞争片外访... 详细信息

随着多核处理器的发展，片外访存带宽逐渐成为影响程序性能的主要因素。为了解决这个问题，很多研究工作通过提高cache利用率来降低程序执行过程中的片外访存数量。本文提出了一种任务调度算法来解决同时执行的多个独立任务竞争片外访存带宽的问题。该调度算法根据程序的访存阶段调度同时执行的多个独立任务，避免了“爆发式”的片外访存请求，改善了片外访存带宽的利用率，提高了系统吞吐率。本文基于函数调用和循环体执行轨迹识别程序访存阶段，然后计算各个访存阶段的片外访存带宽需求。根据上述信息，本文在访存阶段的边界实施任务调度并基于一个简单的运行时系统实现了该调度算法。该算法对SPEC CPU2006和SPEC CPU2000中的部分具有明显访存“波动性”特征的测试用例在Intel 双核处理器和Intel四核处理器上平均有3.3％和4.7％的吞吐率提高。

关键词：多核处理器片外访存调度程序函数调用

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大规模机群系统日志的多维失效分析

大规模机群系统日志的多维失效分析

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2008年全国高性能计算机学术年会

作者：周伟詹剑锋刘旭孟丹中国科学院计算技术研究所国家智能计算机研究开发中心北京 100190 中国科学院计算机系统结构重点实验室北京 100190 中国科学院研究生院北京 100049 zhouwei@ncic.ac. 中国科学院计算技术研究所国家智能计算机研究开发中心北京 100190 中国科学院计算机系统结构重点实验室北京 100190

大规模机群因其良好的易构建性和可扩展性，已广泛应用于科学计算和商业应用中。通过分析大规模机群系统中的日志，可以预测失效、侦测失效、定位故障根源，提高系统和应用的可靠性和可用性。本文提出了一种基于图挖掘的多维失效分析方... 详细信息

大规模机群因其良好的易构建性和可扩展性，已广泛应用于科学计算和商业应用中。通过分析大规模机群系统中的日志，可以预测失效、侦测失效、定位故障根源，提高系统和应用的可靠性和可用性。本文提出了一种基于图挖掘的多维失效分析方法来分析多源的系统日志，以获得更加完整和准确的失效知识。通过曙光4000A高性能计算机系统中系统日志的多维失效分析，实验结果证明了这种方法的有效性。

关键词：计算机群系统日志失效分析图挖掘技术

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大规模数据密集型系统中的去重查询优化

大规模数据密集型系统中的去重查询优化

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2008年全国高性能计算机学术年会

作者：宋怀明安明远王洋袁春阳孙凝晖中国科学院计算技术研究所计算机系统结构重点实验室北京 100190 中国科学院研究生院北京 100049 家计算机网络应急技术处理协调中心北京 100029 shm@*** 中国科学院计算技术研究所计算机系统结构重点实验室北京 100190

在大规模数据密集型系统中，海量数据分布存储在多节点，给去重查询提出了新的挑战。本文针对去重查询中可能出现的不同情况，提出了一种有效地数据分布策略和并行处理方法：即散列和直方图相结合的数据分布策略，以及异步式并行查询引... 详细信息

在大规模数据密集型系统中，海量数据分布存储在多节点，给去重查询提出了新的挑战。本文针对去重查询中可能出现的不同情况，提出了一种有效地数据分布策略和并行处理方法：即散列和直方图相结合的数据分布策略，以及异步式并行查询引擎，对多节点的去重查询进行优化。异步式并行查询引擎充分发掘了海量数据处理中流水级的并行，消除了多节点同步等待的开销，能够尽早地返回用户结果，降低去重查询的响应时间。在真实系统DBroker上的实验表明，数据分布策略能极大地改善相关属性的去重查询性能，而异步式并行查询引擎能够充分发掘并行性，对不相关属性的去重查询具有明显的性能提升。

关键词：数据挖掘信息检索去重查询并行引擎

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United-FS 的数据放置策略研究

United-FS 的数据放置策略研究

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2008年全国高性能计算机学术年会

作者：陈欢熊劲孙凝晖国家智能计算机研究开发中心，中科院计算机系统结构重点实验室，中科院计算技术研究所北京 100190 中国科学院研究生院北京 100049 huanchen@*** 国家智能计算机研究开发中心，中科院计算机系统结构重点实验室，中科院计算技术研究所北京 100190

存储服务器是机群系统中的重要组成部分。随着硬件的发展，集中式的存储服务器可以提供更大的容量和带宽，可以同时为更多的高性能计算应用提供存储服务。然而，每个应用具有不同的负载特征，不同的存储部件以及本地文件系统也具有不同... 详细信息

存储服务器是机群系统中的重要组成部分。随着硬件的发展，集中式的存储服务器可以提供更大的容量和带宽，可以同时为更多的高性能计算应用提供存储服务。然而，每个应用具有不同的负载特征，不同的存储部件以及本地文件系统也具有不同的特征，单一的存储模式难以为多样的I/O负载提供高效的存储。因此如何根据负载特征及存储部件的特征，将数据放置在合适的存储部件上成为一个关键问题。本文提出了并且在United-FS文件系统中实现了一种面向负载特征及存储特征的灵活的放置策略。该策略将不同特征的负载相分离，将数据放置在最适合于该负载特征的底层存储上，同时能够充分利用存储的并发性。实验结果表明，这种灵活的数据放置策略对不同的负载类型均能表现出很好的性能。

关键词：高性能计算并行计算机存储服务器数据存贮

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一种向分支指令后插入冗余指令的容错微结构

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计算机学报 2007年第10期30卷 1674-1680页

作者：张仕健胡伟武中国科学院计算技术研究所计算机系统结构重点实验室北京100080 中国科学院研究生院北京100039

随着深亚微米工艺的广泛应用，瞬态故障已成为芯片失效的主要原因．文中提出了一种向分支指令后插入冗余指令的容错微结构，利用分支误预测浪费的处理带宽，降低了冗余执行导致的性能损失．实验结果表明，该技术的性能损失在6％～31％... 详细信息

随着深亚微米工艺的广泛应用，瞬态故障已成为芯片失效的主要原因．文中提出了一种向分支指令后插入冗余指令的容错微结构，利用分支误预测浪费的处理带宽，降低了冗余执行导致的性能损失．实验结果表明，该技术的性能损失在6％～31％之间，平均为21％，明显低于MBI技术而和DIE技术的性能损失相当．该技术能够检测流水线上各阶段发生的瞬态故障并能恢复处理器状态，故障检测延时短，需要的硬件开销也较小，非常适合提高带有简单预测机制的嵌入式微处理器的容错能力．

关键词：瞬态故障时间冗余容错分支预测嵌入式微处理器

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龙芯1号处理器结构级功耗评估有效性分析

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计算机辅助设计与图形学学报 2007年第9期19卷 1190-1195页

作者：冯子军肖俊华胡伟武中国科学院计算技术研究所计算机系统结构重点实验室中国科学院研究生院北京100049

结合龙芯1号处理器实际设计过程,介绍了处理器功耗评估的方法和功耗模型,分别对结构级、电路级功耗评估和实际芯片3种情况进行测试程序仿真.经过量化分析和比较表明:结构级功耗评估具有仿真速度快、评估结果误差和测试程序相关,并且同... 详细信息

结合龙芯1号处理器实际设计过程,介绍了处理器功耗评估的方法和功耗模型,分别对结构级、电路级功耗评估和实际芯片3种情况进行测试程序仿真.经过量化分析和比较表明:结构级功耗评估具有仿真速度快、评估结果误差和测试程序相关,并且同一测试程序误差能够追随电路级功耗评估等特点,说明了龙芯1号处理器进行结构级功耗评估的有效性.采用该方法可显著提高低功耗处理器结构的设计效率.

关键词：功耗评估功耗模型有效性集成电路处理器设计

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同时多微线程体系结构研究

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计算机研究与发展 2007年第5期44卷 768-774页

作者：李祖松许先超胡伟武唐志敏中国科学院计算技术研究所计算机系统结构重点实验室中国科学院研究生院北京100049

随着生产工艺的提高,芯片上能集成越来越多的晶体管,多线程技术也逐步成为一种主流的处理器体系结构技术.提出一种融合同时多线程技术和微线程技术的新型体系结构同时多微线程(simul-taneous multi-microthreading,SMMT),并给出同时多... 详细信息

随着生产工艺的提高,芯片上能集成越来越多的晶体管,多线程技术也逐步成为一种主流的处理器体系结构技术.提出一种融合同时多线程技术和微线程技术的新型体系结构同时多微线程(simul-taneous multi-microthreading,SMMT),并给出同时多微线程体系结构的实现方案.SMMT有效结合同时多线程技术硬件代价小和微线程技术能够加速单进程应用的优点,通过软硬件协同的方式充分挖掘单进程程序的微线程级并行性.通过在设计的龙芯2号同时多微线程处理器上进行性能评测,结果表明,同时多微线程体系结构能够有效地加速单进程的程序,以很小的硬件代价显著地提高了处理器的性能.

关键词：同时多微线程龙芯2 同时多线程微线程体系结构

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