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T=题名（书名、题名），A=作者（责任者），K=主题词，P=出版物名称，PU=出版社名称，O=机构（作者单位、学位授予单位、专利申请人），L=中图分类号，C=学科分类号，U=全部字段，Y=年（出版发行年、学位年度、标准发布年）

检索规则说明：

AND代表“并且”；OR代表“或者”；NOT代表“不包含”；(注意必须大写,运算符两边需空一格)

检索范例：

范例一：(K=图书馆学 OR K=情报学) AND A=范并思 AND Y=1982-2016
范例二：P=计算机应用与软件 AND (U=C++ OR U=Basic) NOT K=Visual AND Y=2011-2016

分类表

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文献类型

134 篇 期刊文献
68 篇 会议

馆藏范围

202 篇 电子文献
0 种 纸本馆藏

日期分布

学科分类号

195 篇 工学
- 153 篇 计算机科学与技术...
- 42 篇 软件工程
- 34 篇 电子科学与技术（可...
- 9 篇 仪器科学与技术
- 7 篇 机械工程
- 7 篇 信息与通信工程
- 5 篇 网络空间安全
- 4 篇 建筑学
- 2 篇 控制科学与工程
- 1 篇 材料科学与工程（可...
- 1 篇 化学工程与技术
17 篇 管理学
- 17 篇 管理科学与工程(可...
4 篇 理学
- 2 篇 系统科学
- 1 篇 生物学
4 篇 艺术学
- 4 篇 设计学（可授艺术学...
1 篇 军事学
- 1 篇 军队指挥学

主题

8 篇 集成电路
7 篇 无线传感器网络
7 篇 片上网络
7 篇 功能验证
7 篇 高性能计算
7 篇 功耗评估
6 篇 容错
6 篇 多核处理器
6 篇 性能优化
5 篇 虚拟机
5 篇 芯片组
5 篇 覆盖率
5 篇 小时延缺陷
4 篇 验证
4 篇 多核
4 篇 体系结构
4 篇 高性能计算机
4 篇 片上多核处理器
4 篇 寄存器重命名
4 篇 时延测试

机构

94 篇 中国科学院研究生...
87 篇 中国科学院计算技...
72 篇 中国科学院计算机...
51 篇 中国科学院计算技...
12 篇 中国科学院计算技...
11 篇 北京龙芯中科技术...
9 篇 中国科学院大学
8 篇 龙芯中科技术有限...
8 篇 中国科学院计算机...
7 篇 计算机系统结构国...
7 篇 中国科学技术大学
6 篇 中国科学院研究生...
5 篇 北京交通大学
5 篇 中国科学院计算技...
5 篇 合肥工业大学
3 篇 北京控制工程研究...
3 篇 中国科学院微电子...
2 篇 中国科学院计算技...
2 篇 中国科学院计算技...
2 篇 清华大学

作者

51 篇 李晓维
22 篇 李华伟
19 篇 孙凝晖
18 篇 韩银和
17 篇 胡瑜
16 篇 章隆兵
15 篇 胡伟武
13 篇 沈海华
10 篇 张戈
9 篇 陈明宇
9 篇 安学军
9 篇 徐勇军
8 篇 张兆庆
8 篇 刘奇
7 篇 陈云霁
7 篇 吕涛
7 篇 冯晓兵
6 篇 陈岚
6 篇 王剑
6 篇 宋风龙

语言

202 篇 中文

检索条件"机构=中国科学院计算机系统结构重点实验室中国科学院计算技术研究所，北京 100190"

共 202 条记录，以下是51-60 订阅

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详细简洁

排序：

ESDQL:一种评估小时延缺陷覆盖率的度量标准

ESDQL:一种评估小时延缺陷覆盖率的度量标准

引用

第十四届全国容错计算学术会议

作者：朱雪峰李华伟李晓维中国科学院计算机系统结构重点实验室中国科学院计算技术研究所北京 100190 中国科学院研究生院北京 100039 中国科学院计算机系统结构重点实验室中国科学院计算技术研究所北京 100190

随着工艺的不断发展，越来越多的因素会在电路中引入小时延缺陷，因此检测小时延缺陷变的非常必要。本文首先回顾已有的几个评估小时延缺陷覆盖情况的度量标准并分析它们的优缺点。这些度量标准由于没有排除已经被测到的大时延缺陷的干... 详细信息

随着工艺的不断发展，越来越多的因素会在电路中引入小时延缺陷，因此检测小时延缺陷变的非常必要。本文首先回顾已有的几个评估小时延缺陷覆盖情况的度量标准并分析它们的优缺点。这些度量标准由于没有排除已经被测到的大时延缺陷的干扰而不能准确反映测试集对于小时延缺陷的覆盖情况。进而提出了一种用来准确评估小时延缺陷覆盖率的新的度量标准：扩展统计时延质量等级（Extended Statistical Delay Quality Level，ESDQL）。实验结果表明ESDQL在评估测试集的时延测试质量以及对测试向量自动生成（Automatic Test Pattern Generation, ATPG）的指导方面都优于已有的度量标准。

关键词：集成电路小时延缺陷跳变故障电路测试

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基于存储级并行的同时多线程电压紧急容错技术

基于存储级并行的同时多线程电压紧急容错技术

引用

第十四届全国容错计算学术会议

作者：胡杏胡瑜李晓维中国科学院计算机系统结构重点实验室中国科学院计算技术研究所北京100190 中国科学院研究生院北京100049 中国科学院计算机系统结构重点实验室中国科学院计算技术研究所北京100190

时钟门控技术引起的电流波动以及供电网络上的寄生阻抗效应，共同形成感应噪声(dI/dt)并引起供电电压波动。供电电压波动过大可能引发时延故障并最终影响系统正确运行，这类电压波动被称为电压紧急。相比于单线程处理器，同时多线程处... 详细信息

时钟门控技术引起的电流波动以及供电网络上的寄生阻抗效应，共同形成感应噪声(dI/dt)并引起供电电压波动。供电电压波动过大可能引发时延故障并最终影响系统正确运行，这类电压波动被称为电压紧急。相比于单线程处理器，同时多线程处理器随着线程数的增多，其电压紧急呈现频度大和幅度高的特点。本文分析了同时多线程处理器中的电压紧急特性，并结合程序的存储级并行性，提出了一种线程调度策略以避免发生资源拥塞，从而减少电压紧急对系统性能的影响。

关键词：多线程处理器存储级并行感应噪声容错技术

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冷冻电镜三维重构在CPU-GPU系统中的并行性

冷冻电镜三维重构在CPU-GPU系统中的并行性

引用

第三届中国国家网格学术年会

作者：李兴建李临川谭光明张佩珩中国科学院计算技术研究所计算机系统结构重点实验室，北京100190 中国科学院研究生院，北京100049 中国科学院计算技术研究所计算机系统结构重点实验室，北京100190

为了有效地发掘和利用异构系统在应用和体系结构上的并行性，以冷冻电镜三维重构为例展示如何利用应用程序潜在的并行性。通过分析重构计算所有的并行性，实现了将动态自适应的划分算法用于任务在异构系统上高效的分发。在曙光星云系统... 详细信息

为了有效地发掘和利用异构系统在应用和体系结构上的并行性，以冷冻电镜三维重构为例展示如何利用应用程序潜在的并行性。通过分析重构计算所有的并行性，实现了将动态自适应的划分算法用于任务在异构系统上高效的分发。在曙光星云系统的部分节点系统(32节点)上评估并行化的程序性能。实验证明：多层次的并行化是CPU与GPU异构系统上开发并行性的有效模式;CPU-GPU混合程序在给定问题规模上相对单纯CPU程序获得2.4倍加速比。

关键词：并行策略高性能计算统一计算设备架构冷冻电镜

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1U9P异构多核服务器节点设计

1U9P异构多核服务器节点设计

引用

计算机学会第十五届计算机工程与工艺年会暨第一届微处理器技术论坛

作者：吴冬冬解利伟安学军中国科学院计算技术研究所计算机系统结构重点实验室

为应对高性能计算的技术挑战,设计了一种符合超并行体系结构的HPP控制器,可以直接连接一个X86架构的AMD多核处理器和八个MIPS架构的龙芯多核处理器组成一个异构服务器节点,并为节点设计了一款1U机架式机箱,已完成的超龙一号服务器验证了... 详细信息

为应对高性能计算的技术挑战,设计了一种符合超并行体系结构的HPP控制器,可以直接连接一个X86架构的AMD多核处理器和八个MIPS架构的龙芯多核处理器组成一个异构服务器节点,并为节点设计了一款1U机架式机箱,已完成的超龙一号服务器验证了1U9P异构多核服务器节点设计的可行性。

关键词：超并行异构龙芯

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一种面向差错容忍应用的数字系统故障关键性评估方法

一种面向差错容忍应用的数字系统故障关键性评估方法

引用

第十四届全国容错计算学术会议

作者：方运潭李华伟李晓维中国科学院计算机系统结构重点实验室北京 100190 中国科学院计算技术研究所北京 100190 中国科学院研究生院北京 100049 中国科学院计算机系统结构重点实验室北京 100190 中国科学院计算技术研究所北京 100190

随着集成电路工艺尺寸的进一步缩小，制造出可靠或功能完全正确的数字电路越来越困难，设计成本越来越高，系统可扩展性也面临着挑战。同时，多媒体和通信领域的应用以及一些新型应用本身可以容忍部分差错，这使得差错容忍的计算成为一... 详细信息

随着集成电路工艺尺寸的进一步缩小，制造出可靠或功能完全正确的数字电路越来越困难，设计成本越来越高，系统可扩展性也面临着挑战。同时，多媒体和通信领域的应用以及一些新型应用本身可以容忍部分差错，这使得差错容忍的计算成为一种新的计算模式。不同于缺陷容忍和故障容忍，差错容忍依据应用特性放松了对电路输出的正确性要求。
　　本文从差错容忍的角度提出了一种跨层次故障关键性评估方法。以一款H.264/AVC视频解码器为例，评估发现不同的功能模块内的故障由于其产生的差错对应用的影响程度不同而具有不同的重要程度，同一个模块内的故障也具有不同的重要程度。故障关键性的评估能够指导测试以提高成品率，并减少可靠性设计所需的成本。

关键词：集成电路差错容忍电路测试故障评估

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基于存储级并行的同时多线程电压紧急容错技术

基于存储级并行的同时多线程电压紧急容错技术

引用

第十四届全国容错计算学术会议(CFTC'2011)

作者：胡杏胡瑜李晓维中国科学院计算机系统结构重点实验室中国科学院计算技术研究所中国科学院研究生院

时钟门控技术引起的电流波动以及供电网络上的寄生阻抗效应,共同形成感应噪声（dI/dt）并引起供电电压波动。供电电压波动过大可能引发时延故障并最终影响系统正确运行,这类电压波动被称为电压紧急。相比于单线程处理器,同时多线程处理... 详细信息

时钟门控技术引起的电流波动以及供电网络上的寄生阻抗效应,共同形成感应噪声（dI/dt）并引起供电电压波动。供电电压波动过大可能引发时延故障并最终影响系统正确运行,这类电压波动被称为电压紧急。相比于单线程处理器,同时多线程处理器随着线程数的增多,其电压紧急呈现频度大和幅度高的特点。本文分析了同时多线程处理器中的电压紧急特性,并结合程序的存储级并行性,提出了一种线程调度策略以避免发生资源拥塞,从而减少电压紧急对系统性能的影响。

关键词：电压紧急感应噪声同时多线程存储级并行

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HPP控制器的系统级功能验证

HPP控制器的系统级功能验证

引用

计算机学会第十五届计算机工程与工艺年会暨第一届微处理器技术论坛

作者：刘涛柴双勇蔺建邦弓睿安学军中国科学院计算技术研究所中国科学院计算机系统结构重点实验室中国科学院研究生院

HPP（Hyper Parallel Processing）控制器应用在超龙一号和曙光6000节点中,提供了CPU之间的互连通路,实现了节点内统一地址空间和节点内数据通信功能。为了对HPP控制器进行有效的功能验证,设计了系统级功能验证平台HPPVP,采用基于层次... 详细信息

HPP（Hyper Parallel Processing）控制器应用在超龙一号和曙光6000节点中,提供了CPU之间的互连通路,实现了节点内统一地址空间和节点内数据通信功能。为了对HPP控制器进行有效的功能验证,设计了系统级功能验证平台HPPVP,采用基于层次结构的模拟方法进行系统建模,通过插件机制来实现动态扩展能力。采用了并行验证与自动化工具来加速验证迭代过程,最终发现了HPP控制器中的69处错误,确保了其功能正确性。

关键词： HPP控制器功能验证建模插件覆盖率

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ESDQL:一种评估小时延缺陷覆盖率的度量标准

ESDQL:一种评估小时延缺陷覆盖率的度量标准

引用

第十四届全国容错计算学术会议(CFTC'2011)

作者：朱雪峰李华伟李晓维中国科学院计算机系统结构重点实验室中国科学院计算技术研究所中国科学院研究生院

随着工艺的不断发展,越来越多的因素会在电路中引入小时延缺陷,因此检测小时延缺陷变的非常必要。本文首先回顾己有的几个评估小时延缺陷覆盖情况的度量标准并分析它们的优缺点。这些度量标准由于没有排除己经被测到的大时延缺陷的干扰... 详细信息

随着工艺的不断发展,越来越多的因素会在电路中引入小时延缺陷,因此检测小时延缺陷变的非常必要。本文首先回顾己有的几个评估小时延缺陷覆盖情况的度量标准并分析它们的优缺点。这些度量标准由于没有排除己经被测到的大时延缺陷的干扰而不能准确反映测试集对于小时延缺陷的覆盖情况。进而提出了一种用来准确评估小时延缺陷覆盖率的新的度量标准:扩展统计时延质量等级(Extended Statistical DelayQuality Level,ESDQL)。实验结果表明ESDQL在评估测试集的时延测试质量以及对测试向量自动生成(Automatic Test Pattern Generation,ATPG)的指导方面都优于己有的度量标准。

关键词：小时延缺陷跳变故障测试生成覆盖率

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一种面向差错容忍应用的数字系统故障关键性评估方法

一种面向差错容忍应用的数字系统故障关键性评估方法

引用

第十四届全国容错计算学术会议(CFTC'2011)

作者：方运潭李华伟李晓维中国科学院计算机系统结构重点实验室中国科学院计算技术研究所中国科学院研究生院

随着集成电路工艺尺寸的进一步缩小,制造出可靠或功能完全正确的数字电路越来越困难,设计成本越来越高,系统可扩展性也面临着挑战。同时,多媒体和通信领域的应用以及一些新型应用本身可以容忍部分差错,这使得差错容忍的计算成为一种新... 详细信息

随着集成电路工艺尺寸的进一步缩小,制造出可靠或功能完全正确的数字电路越来越困难,设计成本越来越高,系统可扩展性也面临着挑战。同时,多媒体和通信领域的应用以及一些新型应用本身可以容忍部分差错,这使得差错容忍的计算成为一种新的计算模式。不同于缺陷容忍和故障容忍,差错容忍依据应用特性放松了对电路输出的正确性要求。本文从差错容忍的角度提出了一种跨层次故障关键性评估方法。以一款H.264/AVC视频解码器为例,评估发现不同的功能模块内的故障由于其产生的差错对应用的影响程度不同而具有不同的重要程度,同一个模块内的故障也具有不同的重要程度。故障关键性的评估能够指导测试以提高成品率,并减少可靠性设计所需的成本。

关键词：显示存储器图像缓存成品率故障容忍功能模块存储器模块系统故障

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MPIAlltoall通信在多核机群中的优化

MPIAlltoall通信在多核机群中的优化

引用

2011年全国高性能计算学术年会(HPC china2011)

作者：李强孙凝晖霍志刚马捷中国科学院计算技术研究所高性能计算机研究中心北京 100190 中国科学院计算机系统结构重点实验室北京 100190 中国科学院研究生院北京 100039 中国科学院计算技术研究所高性能计算机研究中心北京 100190 中国科学院计算机系统结构重点实验室北京 100190 中国科学院计算技术研究所高性能计算机研究中心北京 100190

MPI Alltoall通信作为一种重要的集合通信，在高性能应用中广泛使用。在多核机群中，一个结点内的多个进程同时参与Alltoall通信。一方面，这些进程可以利用共享内存优化通信性能。虽然当前基于首进程（Leader-based）的方法利用共享内... 详细信息

MPI Alltoall通信作为一种重要的集合通信，在高性能应用中广泛使用。在多核机群中，一个结点内的多个进程同时参与Alltoall通信。一方面，这些进程可以利用共享内存优化通信性能。虽然当前基于首进程（Leader-based）的方法利用共享内存提高了Alltoall小消息通信的性能，但由于采用固定数目的首进程，这些方法不能使所有的Alltoall小消息通信都获得最优性能。另一方面，这些进程需要竞争结点内有限的网络资源。在Alltoall大消息通信中，存在许多个同步消息，然而竞争导致这些同步消息的延迟增大了数十倍，同步开销占整个Alltoall通信的很大比例。在本文中，我们针对这些问题提出了不同的优化方法。对于Alltoall小消息通信，PLP方法根据小消息的长度采用不同数目的首进程;对于Alltoall大消息通信，LSS方法将同步消息的总数从减少到。通过实验，我们验证了这两种方法。对于Alltoall小消息通信，PLP方法总是可以获得最优的性能。对于Alltoall大消息通信，LSS方法获得的性能提升比例几乎为常数，其与系统的规模无关;对于32K和64K字节的消息，它们的性能提高了25％。

关键词：首进程数目同步开销集合通信多核机群共享内存

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