检索结果-内蒙古大学图书馆

光学精密工程 2011年第1期19卷 51-55页

作者：金鹏喻春雨周奇峰王一峰吴娜北京大学深圳研究生院集成微系统科学工程与应用重点实验室广东深圳518055

选择路灯时,需基于恰当的光度测量模型对不同类型路灯的发光效率进行比较。以两种常用路灯光源和两种LED路灯光源为研究对象,对道路照明环境中人眼处于的视觉状态进行了分析,进而通过MOVE模型求得这4种路灯在中间视觉状态下的发光效率... 详细信息

选择路灯时,需基于恰当的光度测量模型对不同类型路灯的发光效率进行比较。以两种常用路灯光源和两种LED路灯光源为研究对象,对道路照明环境中人眼处于的视觉状态进行了分析,进而通过MOVE模型求得这4种路灯在中间视觉状态下的发光效率。与明视觉状态下的发光效率比较,LED路灯和金属卤素路灯在中间视觉状态下的发光效率大大提高,而高压钠灯有所降低。中间视觉状态下,当环境照明亮度从0.03 cd/m2变化到0.1 cd/m2再变化到0.3cd/m2时,标准LED路灯的发光效率首先从131.2 lm/W降到122.7 lm/W,然后又上升到140.5 lm/W。结果表明,由于人眼视觉响应是随环境照明变化的,在中间视觉状态下LED路灯比常用路灯的发光效率高,通过光谱加强等优化方法可以得到发光效果令人满意的LED光源。

关键词：中间视觉暗视觉明视觉发光二极管发光效率

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基于部分传输序列抽样的PAPR抑制技术

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江苏大学学报（自然科学版） 2010年第5期31卷 576-580页

作者：焦玉中倪学文王新安刘雪娇许应北京大学深圳研究生院集成微系统科学工程与应用重点实验室广东深圳518055

为了降低部分传输序列法(PTS)峰值平均功率比(PAPR)抑制技术的复杂度,通过研究OFDM时域信号序列的最大峰值与部分传输序列相应位置峰值(包括最大峰值和次峰值)之间的关联性,提出一种在相位旋转因子优化过程中利用抽样序列替代部分传输... 详细信息

为了降低部分传输序列法(PTS)峰值平均功率比(PAPR)抑制技术的复杂度,通过研究OFDM时域信号序列的最大峰值与部分传输序列相应位置峰值(包括最大峰值和次峰值)之间的关联性,提出一种在相位旋转因子优化过程中利用抽样序列替代部分传输序列的简化方法,并给出两种可行的抽样策略.由部分传输序列峰值点样值所构造的PTS抽样序列具有较少的样值数目,因此可以极大地降低PTS优化处理过程的计算复杂度.仿真结果表明,与未经抽样的PTS方法相比,新方法仅有微弱的性能损失.

关键词：多载波调制正交频分复用信号处理优化算法复杂度

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ReSim:一个面向可重构处理器的仿真平台

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北京大学学报（自然科学版） 2011年第2期47卷 231-237页

作者：戴鹏魏来辛灵轩王新安张兴北京大学深圳研究生院集成微系统科学工程与应用重点实验室深圳518055

针对可重构处理器ReMAP(reconfigurable multimedia array processor)面向视频高清编解码提出的灵活互联、计算资源密集、易于扩展的结构优化需求,提出了一个基于模块化分层设计、时钟周期精确的可重构处理器仿真平台ReSim。该仿真器基... 详细信息

针对可重构处理器ReMAP(reconfigurable multimedia array processor)面向视频高清编解码提出的灵活互联、计算资源密集、易于扩展的结构优化需求,提出了一个基于模块化分层设计、时钟周期精确的可重构处理器仿真平台ReSim。该仿真器基于3级软件框架层次搭建,设计了可快速仿真多种互联结构的互联模块、多种计算模型的控制模块等模块化功能单元,结合时钟驱动模块对全局系统结构的运行驱动,可快速搭建可重构处理器的目标仿真模型,验证其正确性和有效性,精确评估计算性能,具有可视化、易于调试的特点。经实际测试表明,ReSim对可重构处理器ReMAP-2架构的系统评估与验证予以良好的支持。

关键词：仿真器时钟精确可重构处理器指令集计算模型

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一种具有新型解调电路和安全功能的超高频RFID标签芯片(英文)

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北京大学学报（自然科学版） 2014年第2期50卷 214-220页

作者：沈劲鹏王新安刘珊李守成胡桐宁北京大学深圳研究生院集成微系统科学工程与应用重点实验室深圳518055

设计一种具有新型解调电路和安全功能的超高频RFID标签芯片。该解调电路不需要单独的包络检测电路,而是利用标签芯片已有的整流器的第一级作为包络检测电路。同时还设计了一种特殊的均值检测电路,输出电压和包络信号之间有很大的电压差... 详细信息

设计一种具有新型解调电路和安全功能的超高频RFID标签芯片。该解调电路不需要单独的包络检测电路,而是利用标签芯片已有的整流器的第一级作为包络检测电路。同时还设计了一种特殊的均值检测电路,输出电压和包络信号之间有很大的电压差,使得比较器的设计更加容易。受标签和读写器距离的变化影响,包络信号的直流电压在很大范围内变化,因此还设计了具有轨到轨共模输入范围的比较器。为了保证标签和读写器之间通信的安全,在数字基带处理器中集成了128位的高级加密标准算法(AES)。整个标签芯片采用0.18μm工艺实现,芯片面积为880μm×950μm。测试结果表明,标签芯片可以解调出的射频输入信号最小幅度为100 mV,最大的数据率为160 kb/s。

关键词：超高频RFID标签解调电路高级加密标准(AES)

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MASH21 Sigma-Delta调制器的自顶向下设计

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北京大学学报（自然科学版） 2011年第4期47卷 593-598页

作者：葛彬杰王新安张兴冯晓星汪清勤北京大学深圳研究生院集成微系统科学工程与应用重点实验室深圳518055

提出MASH21调制器的自顶向下设计方法。在系统级,通过系数缩放对积分器的输出进行限制;在电路级,通过积分器的瞬态建模分析运放非理想因素对调制器的影响,并得到SNR和面积功耗最优的设计区域。通过一个数字音频MASH21调制器的设计对此... 详细信息

提出MASH21调制器的自顶向下设计方法。在系统级,通过系数缩放对积分器的输出进行限制;在电路级,通过积分器的瞬态建模分析运放非理想因素对调制器的影响,并得到SNR和面积功耗最优的设计区域。通过一个数字音频MASH21调制器的设计对此方法进行了验证。该调制器基于TSMC18MMRF工艺实现,在1.8 V的单电压下工作,测试显示调制器的SNDR达到91 dB。

关键词： MASH21 自顶向下 Sigma-Delta 建模

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一种超高频RFID读写器基带发射机的设计与实现(英文)

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北京大学学报（自然科学版） 2014年第4期50卷 753-760页

作者：雍珊珊王新安张芳妮史小龙刘彬郭朝阳吕伟曹颖苏吉婷北京大学深圳研究生院集成微系统科学工程与应用重点实验室深圳518055

设计了一个超高频射频识别读写器的基带发射机，该读写器基带芯片工作在840～960MHz频段，支持ISO18000-6B＆6C协议。为了增强安全性同时保证与协议的兼容，采用2-bits类PIE编码和PIE编码方式，前者相对后者安全性提高了6倍。针对单边... 详细信息

设计了一个超高频射频识别读写器的基带发射机，该读写器基带芯片工作在840～960MHz频段，支持ISO18000-6B＆6C协议。为了增强安全性同时保证与协议的兼容，采用2-bits类PIE编码和PIE编码方式，前者相对后者安全性提高了6倍。针对单边带调制中由于两路正交信号幅度不相等而产生的双频带对标签接收信号产生干扰的问题，在基带发射机中增加了幅度匹配模块，尽量消除幅度差异。还在基带部分增加了功率放大模块，使得到达PA的输入信号幅度增强，从而得到更高的输出功率。整个读写器芯片在0．18μmCMOS工艺下，电路规模为209461个门，功耗为102．609mW,其中发射机部分占面积的22％。与当前的一些设计相比，该设计并没有带来较大的面积和功耗损失。

关键词：超高频RFID读写器基带发射机编码器功率调节

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可重构视频编解码处理器ReMAP设计

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北京大学学报（自然科学版） 2011年第3期47卷 418-426页

作者：戴鹏雍珊珊王新安张兴北京大学深圳研究生院集成微系统科学工程与应用重点实验室深圳518055

针对当前视频高清编解码的计算密集性、并行性和数据局部性的特点,提出一个粗粒度的可重构处理器ReMAP-2。该处理器由一个可重构的计算单元阵列构成,通过由临近直联和分段式总线组成的互联网络完成数据通信任务,具有良好的扩展性。计算... 详细信息

针对当前视频高清编解码的计算密集性、并行性和数据局部性的特点,提出一个粗粒度的可重构处理器ReMAP-2。该处理器由一个可重构的计算单元阵列构成,通过由临近直联和分段式总线组成的互联网络完成数据通信任务,具有良好的扩展性。计算阵列针对不同应用,通过加载不同配置信息流实时改变运算单元的计算功能和连接方式,支持多种格式的视频编解码应用。仿真验证表明,可重构处理器ReMAP-2在视频编解码应用时较常用的媒体处理器具有较大幅度的性能加速,处理性能达到或接近于ASIC水平,同时具有较高的应用灵活性。

关键词：可重构处理器 H.264 编解码 DCT 动态重构

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可重构算子阵列的结构和建模

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北京大学学报（自然科学版） 2014年第4期50卷 761-767页

作者：雍珊珊王新安曹颖张芳妮史小龙谢峥北京大学深圳研究生院集成微系统科学工程与应用重点实验室深圳518055

提出一种由多种粗粒度、功能可配置的可重构算子组成的新型FPGA结构——可重构算子阵列结构,能完全替代细粒度的基于查找表的可编程逻辑单元,降低配置加载时间,同时电路速度具有可比性。可重构算子分为运算类、控制类、路径类和存储类,... 详细信息

提出一种由多种粗粒度、功能可配置的可重构算子组成的新型FPGA结构——可重构算子阵列结构,能完全替代细粒度的基于查找表的可编程逻辑单元,降低配置加载时间,同时电路速度具有可比性。可重构算子分为运算类、控制类、路径类和存储类,像电路指令集一样可支撑所有电路的实现。互连结构分为全局互连、局部互连和IO互连,分别承载远距离、邻近和系统外部的数据传输,互连开关采用通用开关阵列的形式。互连线段分为组线和单线两种,其中组线的位宽大于1比特,其行为一致,从而减小开关数目,提高传输速度。为了对该阵列结构进行性能分析和结构探索,还针对该结构进行建模,通过结构文件快速生成不同的结构,可作为深入研究的有效手段。

关键词： FPGA 可重构算子结构建模互连结构

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一种具有新型时钟产生器的无源超高频RFID标签(英文)

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北京大学学报（自然科学版） 2011年第3期47卷 404-410页

作者：冯晓星王新安张兴葛彬杰北京大学深圳研究生院集成微系统科学工程与应用重点实验室深圳518055

给出一种符合ISO/IEC 18000-6B协议的超低功耗的无源超高频RFID标签。为了能够给标签数字基带处理提供准确的时钟,使用了一种超低功耗、自校正的时钟产生器,产生的时钟在-50℃-120℃或者0.7-1.6 V电源电压的范围内,偏差小于4%。此自校... 详细信息

给出一种符合ISO/IEC 18000-6B协议的超低功耗的无源超高频RFID标签。为了能够给标签数字基带处理提供准确的时钟,使用了一种超低功耗、自校正的时钟产生器,产生的时钟在-50℃-120℃或者0.7-1.6 V电源电压的范围内,偏差小于4%。此自校正时钟模块的功耗在0.7 V的电源电压下仅为364 nW。一个低压输出参考电压源也集成到了该标签芯片中,该模块产生0.96 V的基准且只消耗100 nA的电流。采用门控时钟和模块复用使功耗降低至1.17μW。该设计采用0.18μm的混合信号CMOS工艺,整个面积为0.75 mm×0.75 mm。测试结果显示该标签的灵敏度达到-10 dBm。

关键词：超低功耗自校正门控时钟功率管理

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手机RFID读写器的基带新解码器

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北京大学学报（自然科学版） 2010年第1期46卷 48-54页

作者：钟金丝王新安冯晓星曹伟齐永珍北京大学深圳研究生院集成微系统科学工程与应用重点实验室深圳518055

设计了一个超高频射频识别读写器的基带接收机,该芯片既支持UHF频段的ISO18000-6B标准,也能支持ISO18000-6C标准。该数字基带接收机主要包括抽取滤波、去直流、相位恢复等基本单元,在解码部分体现了一种新的数字基带解码器。该解码器在... 详细信息

设计了一个超高频射频识别读写器的基带接收机,该芯片既支持UHF频段的ISO18000-6B标准,也能支持ISO18000-6C标准。该数字基带接收机主要包括抽取滤波、去直流、相位恢复等基本单元,在解码部分体现了一种新的数字基带解码器。该解码器在过零检测解码方法的基础上进行了"零点"的修复,从而可以更加有效地实现解码。和相关器解调解码相比,这种方法所需硬件更少,解码的实时性更强。不包括测试管脚,该数字芯片在0.18μmCMOS工艺下的总面积为730μm×3375μm,其中解码部分占总面积的1%;整个数字芯片的功耗为32.89mW,解码部分的功耗为0.23mW。

关键词：射频识别技术读写器数字基带接收机解码器 CIC滤波器

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