检索结果-内蒙古大学图书馆

微电子学 2015年第2期45卷 153-156,163页

作者：雍珊珊王新安谢峥曹颖北京大学深圳研究生院集成微系统科学工程与应用重点实验室深圳518055

介绍了一种面向新型FPGA结构—可重构算子阵列的功耗评估方法。分析了可重构算子阵列结构的功耗构成,同现有的功耗评估方法进行对比,提出基于最大功耗的评估策略。可重构算子和互连单元采用自动测试矢量生成(ATPG)方法计算最大功耗,互... 详细信息

介绍了一种面向新型FPGA结构—可重构算子阵列的功耗评估方法。分析了可重构算子阵列结构的功耗构成,同现有的功耗评估方法进行对比,提出基于最大功耗的评估策略。可重构算子和互连单元采用自动测试矢量生成(ATPG)方法计算最大功耗,互连线段的功耗则通过RC等效模型得到。将所有被使用的资源功耗相加,得到该设计所对应的最大功耗值,作为结构探索和在实际应用中阵列规模选取、布局布线优化的指导。

关键词：功耗评估可重构算子阵列自动测试矢量生成 FPGA

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PKU-DSPII中SPI接口与Bootrom程序设计

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微电子学与计算机 2012年第12期29卷 80-83页

作者：王腾周芝丽陈英瑞王新安北京大学深圳研究生院集成微系统科学工程与应用重点实验室深圳518055

针对PKU-DSPII芯片,设计了具有AMBA AXI 3.0接口的SPI主机接口,支持四种传输模式、可变传输帧长度、频率可编程时钟输出和五种中断;同时,针对该SPI接口设计了RISC DSP的bootrom程序,包括从FLASH正常启动和对FLASH系统程序进行升级两种... 详细信息

针对PKU-DSPII芯片,设计了具有AMBA AXI 3.0接口的SPI主机接口,支持四种传输模式、可变传输帧长度、频率可编程时钟输出和五种中断;同时,针对该SPI接口设计了RISC DSP的bootrom程序,包括从FLASH正常启动和对FLASH系统程序进行升级两种工作模式.通过功能仿真和FPGA原型验证,PKU-DSPII可以利用该设计的SPI接口成功通过外部FLASH启动或进行系统升级,证明了硬件设计和bootrom程序的正确性.该设计已提交华润上华0.18μm CMOS工艺流片.

关键词： DSP SPI接口 AMBA AXI协议 Bootrom程序 FLASH

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基于3G SIM卡SoC芯片设计的AMBA总线的精简策略

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微电子学与计算机 2008年第3期25卷 104-106,110页

作者：封君蒲智星王新安北京大学深圳研究生院集成微系统科学工程与应用重点实验室广东深圳518055

AMBA总线是SoC设计中普遍采用的总线架构,它对许多具体的设计项目往往显得过于庞大,结合3G SIM卡SoC芯片的设计,研究了AMBA总线架构的若干精简策略,提出了一些对总线进行裁剪的参考方法,经过AHB VIP验证环境表明结果可行.该方法对基于A... 详细信息

AMBA总线是SoC设计中普遍采用的总线架构,它对许多具体的设计项目往往显得过于庞大,结合3G SIM卡SoC芯片的设计,研究了AMBA总线架构的若干精简策略,提出了一些对总线进行裁剪的参考方法,经过AHB VIP验证环境表明结果可行.该方法对基于AMBA架构的SoC芯片设计有着一定的参考意义.

关键词： AMBA总线 SIM卡 AHB VIP 验证

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软件测试过程中的参与方关系分析

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微电子学与计算机 2008年第8期25卷 52-55页

作者：崔小乐周豪北京大学深圳研究生院集成微系统科学工程与应用重点实验室广东深圳518055

针对典型的第三方测试和内部测试情形进行建模,重点分析测试过程中参与方的合作关系问题.通过混合策略的贝叶斯纳什均衡给出第三方测试过程适用条件,采用沙普利值对参与方合作可能性进行探讨.根据内部测试与第三方测试过程的内在差别,... 详细信息

针对典型的第三方测试和内部测试情形进行建模,重点分析测试过程中参与方的合作关系问题.通过混合策略的贝叶斯纳什均衡给出第三方测试过程适用条件,采用沙普利值对参与方合作可能性进行探讨.根据内部测试与第三方测试过程的内在差别,利用重复博弈方法对其进行分析,提出了软件测试过程博弈分析的基本研究过程框架.

关键词：博弈论贝叶斯纳什均衡软件测试过程

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一种新型DVD激光读取头光电检测集成电路的研制

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半导体光电 2008年第6期29卷 839-843页

作者：胡海军李挥张政操安杰马建设程雪岷林家用北京大学深圳研究生院集成微系统科学与工程重点实验室广东深圳518055 清华大学光盘国家工程研究中心北京100084

在介绍DVD光学头工作原理和伺服检测方法的基础上,提出了一种芯片面积小、输出失调电压低的单片集成的PDIC(Photo Detecting Integrated Circuit)的设计方案。芯片采用0.6μm CMOS工艺来实现,用于光检测的四象限PIN光电二极管阵列,在入... 详细信息

在介绍DVD光学头工作原理和伺服检测方法的基础上,提出了一种芯片面积小、输出失调电压低的单片集成的PDIC(Photo Detecting Integrated Circuit)的设计方案。芯片采用0.6μm CMOS工艺来实现,用于光检测的四象限PIN光电二极管阵列,在入射光波长为650nm情况下,响应度为0.32A/W。互阻放大器的-3dB带宽可达到100MHz,单个通道灵敏度可达到25mV/μW,平均直流偏置失调电压可减小到10mV。

关键词：光存储光电检测光电二极管模拟集成电路

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一种新颖的可编程电压监测芯片

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微电子学 2010年第1期40卷 54-57页

作者：葛彬杰王新安张兴冯晓星汪清勤北京大学深圳研究生院集成微系统科学工程与应用重点实验室广东深圳518055

提出了一种新颖的可编程电压监测芯片设计。该芯片无需任何外部元件,仅对3个编程管脚采取不同的连接方式,即可实现36种不同的编程状态,一颗芯片可以覆盖1.5V到5.0V的电压范围。同时,特殊时序的采样保持电路和数字限流模块的设计使其具... 详细信息

提出了一种新颖的可编程电压监测芯片设计。该芯片无需任何外部元件,仅对3个编程管脚采取不同的连接方式,即可实现36种不同的编程状态,一颗芯片可以覆盖1.5V到5.0V的电压范围。同时,特殊时序的采样保持电路和数字限流模块的设计使其具有极低的静态功耗。该芯片基于0.5μm的混合信号工艺实现,芯片面积为0.24mm2,仅消耗3μA静态电流。

关键词：可编程电压监测集成电路

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基于S3C2410的WMA开源解码程序优化

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计算机工程与设计 2009年第1期30卷 13-15,34页

作者：张海滨李挥北京大学深圳研究生院集成微系统科学工程与应用重点实验室广东深圳518055

针对MPlayer中WMA解码程序在S3C2410平台上解码效率低的问题,根据S3C2410平台的特性提出并分析了浮点运算转定点运算、以空间换时间以及手工汇编3种优化方案。详细介绍了定点化原理,并提出了模块化的优化方式,对MPlayer中的WMA解码程序... 详细信息

针对MPlayer中WMA解码程序在S3C2410平台上解码效率低的问题,根据S3C2410平台的特性提出并分析了浮点运算转定点运算、以空间换时间以及手工汇编3种优化方案。详细介绍了定点化原理,并提出了模块化的优化方式,对MPlayer中的WMA解码程序进行优化。实验的结果表明了优化后的WMA解码程序在S3C2410平台上的解码效率已得到显著提高,已经能够流畅播放单通道的WMA文件。

关键词：嵌入式系统浮点转定点 MPlayer WMA解码优化 S3C2410

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流量管理中基于事件的事务级建模方法

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微电子学与计算机 2010年第12期27卷 30-33页

作者：宋俊存王新安北京大学深圳研究生院集成微系统科学工程与应用重点实验室广东深圳518055

提出了流量管理中基于事件的事务级建模方法,包括通信接口函数封装,流水线和调度结构建模方法.同时实现了通用的事件延时队列,方便对延时和吞吐率控制.以流量管理中包调度为例,对非基于事件和基于事件两种事务级模型的仿真性能进行比较... 详细信息

提出了流量管理中基于事件的事务级建模方法,包括通信接口函数封装,流水线和调度结构建模方法.同时实现了通用的事件延时队列,方便对延时和吞吐率控制.以流量管理中包调度为例,对非基于事件和基于事件两种事务级模型的仿真性能进行比较.基于事件的事务级建模大大提高了仿真速度,缩短了产品开发周期.

关键词：流量管理基于事件的事务级建模事件延时队列吞吐率

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利用峰值抵消策略的PTS方法

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微电子学与计算机 2010年第7期27卷 35-39页

作者：焦玉中王新安倪学文许应刘雪娇北京大学深圳研究生院集成微系统科学工程与应用重点实验室广东深圳518055

利用预留载波法峰值抑制原理,提出了一种采用峰值抵消策略的PTS方法.该方法把一些部分传输序列看作PAPR抑制载波所对应的时域序列,通过选择部分传输序列和相位旋转因子进行逐步叠加将潜在的峰值消除,最后构成待发送的OFDM符号.由于总的... 详细信息

利用预留载波法峰值抑制原理,提出了一种采用峰值抵消策略的PTS方法.该方法把一些部分传输序列看作PAPR抑制载波所对应的时域序列,通过选择部分传输序列和相位旋转因子进行逐步叠加将潜在的峰值消除,最后构成待发送的OFDM符号.由于总的迭代次数有所减少,并且每次迭代过程中只需要处理少数波峰点的样值,因此复杂度较低.仿真结果显示,新的PTS方法具有良好的PAPR抑制性能.

关键词：峰平比抑制 PTS 峰值抵消复杂度

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一种峰值功耗约束下的SoC蚁群测试调度算法

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微电子学与计算机 2011年第7期28卷 5-8页

作者：崔小乐程伟李崇仁北京大学深圳研究生院集成微系统科学工程与应用重点实验室广东深圳518055

基于扫描链技术的SoC芯片测试可产生比正常使用模式下更大的功耗,这将会对器件可靠性产生不利影响,故在测试时需要将芯片测试功耗控制在允许峰值功耗之下.文中采用蚁群优化思路设计SoC测试调度算法,用于在峰值功耗和TAM总线最大宽度约... 详细信息

基于扫描链技术的SoC芯片测试可产生比正常使用模式下更大的功耗,这将会对器件可靠性产生不利影响,故在测试时需要将芯片测试功耗控制在允许峰值功耗之下.文中采用蚁群优化思路设计SoC测试调度算法,用于在峰值功耗和TAM总线最大宽度约束下降低SoC测试时间.实验结果表明,本方法优于先前已发表的相关方法.

关键词：测试调度测试功耗蚁群优化

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