检索结果-内蒙古大学图书馆

复旦学报（自然科学版） 2014年第3期53卷 387-392,402页

作者：林楠东尚清洪志良复旦大学专用集成电路与系统国家重点实验室上海201203

设计了一款适用于高速硬盘读取通道模拟前端,具有大带宽和大截止频率可调范围的低通滤波器.提出了具有高低带宽两种工作模式的滤波器架构.在高带宽和低带宽两种工作模式之间切换可以提供超过100倍的截止频率变化范围.该低通滤波器采用SM... 详细信息

设计了一款适用于高速硬盘读取通道模拟前端,具有大带宽和大截止频率可调范围的低通滤波器.提出了具有高低带宽两种工作模式的滤波器架构.在高带宽和低带宽两种工作模式之间切换可以提供超过100倍的截止频率变化范围.该低通滤波器采用SMIC 0.13μm CMOS工艺进行设计,仿真结果表明滤波器带宽为30 MHz^3.1 GHz可调,最大功耗为35 mW,信噪比为56.5 dB.

关键词：高速硬盘读取通道宽带低通滤波器带宽调节

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AlO_x/WO_y阻变存储结构的转换特性和机理研究

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复旦学报（自然科学版） 2014年第1期53卷 24-28,36页

作者：刘易宋雅丽王艳良林殷茵复旦大学专用集成电路与系统国家重点实验室上海200433

通过构造AlO_x/WO_y双层结构实现了阻变存储器的均匀性、低功耗等特性,该器件阻变层中的AlO_x为氧空位渐变的梯度膜,从而使得形成的导电细丝更加稳定,在反复擦写过程中导电细丝断开和接上的位置基本不变,对应器件电学性能参数分布集中.... 详细信息

通过构造AlO_x/WO_y双层结构实现了阻变存储器的均匀性、低功耗等特性,该器件阻变层中的AlO_x为氧空位渐变的梯度膜,从而使得形成的导电细丝更加稳定,在反复擦写过程中导电细丝断开和接上的位置基本不变,对应器件电学性能参数分布集中.采用阶梯脉冲信号结合Verify算法的方法对基于0.18μm CMOS工艺的Al/AlO_x/WO_y/W结构的阻变存储单元进行转换特性、可靠性的测试,统计结果表明:器件电学性能参数R_(on)、R_(off)和_(sct)等具有良好的均匀性,且无需高电压的初始置位过程;复位过程中复位电流小于15μA,远远小于单层器件Reset电流,很好地满足了存储器件的低功耗要求;在小电压长时间作用下,高低阻态仍保持不变,能有效地防止误擦写操作;通过高温烘烤测试,验证了器件的数据保持能力.同时,分析了WO_y薄膜在器件高低阻态转换过程中作为串联电阻降低复位电流的作用.

关键词：阻变转换 AIOx WOy 参数均匀性导电细丝阻变存储器

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一种应用于时间交织模数转换器的低抖动延迟锁定环

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复旦学报（自然科学版） 2014年第3期53卷 380-386页

作者：汪雨雯叶凡任俊彦复旦大学专用集成电路与系统国家重点实验室上海201203

设计了一种适用于时间交织模数转换器的低抖动延迟锁定环，实现了12相时钟输出和6倍频输出功能．论文提出了一种基于信号通路切换的鉴频鉴相器，有效减小了工艺、电压、温度等对延迟锁定环性能的影响，优化了环路的抖动性能．延迟锁定... 详细信息

设计了一种适用于时间交织模数转换器的低抖动延迟锁定环，实现了12相时钟输出和6倍频输出功能．论文提出了一种基于信号通路切换的鉴频鉴相器，有效减小了工艺、电压、温度等对延迟锁定环性能的影响，优化了环路的抖动性能．延迟锁定环采用65nmCMOS工艺设计，芯片面积90μm×110μm，版图仿真验证其工作频率范围40～110MHz，电路整体功耗1．6mW，锁定时间小于1．2μs，均方根抖动为8．1μs，可满足模数转换器对时钟的要求．论文所采用的切换型鉴频鉴相器，相比于传统的鉴频鉴相器，其输出时钟的均方根抖动减小了19．3ps．

关键词：时间交织模数转换器延迟锁定环鉴频鉴相器多相位时钟

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单层二维Ta2O5中电子缺陷能级的研究

单层二维Ta2O5中电子缺陷能级的研究

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上海市激光学会2015年学术年会

作者：李大海宋雄飞胡林枫王子仪张荣君周鹏陈良尧张卫复旦大学信息学院光科学与工程系复旦大学专用集成电路与系统国家重点实验室复旦大学材料科学与工程系

二维原子层状材料是近期的研究热点,但是这些研究多数集中于场效应晶体管的沟道材料如单层MoS、单层WS等,单层栅极绝缘层材料如TiO、TaO等极少得到报道。我们利用TaO纳米片集聚形成单层FaO,其电学性能受到存在于TaO中的电子缺陷非常严... 详细信息

二维原子层状材料是近期的研究热点,但是这些研究多数集中于场效应晶体管的沟道材料如单层MoS、单层WS等,单层栅极绝缘层材料如TiO、TaO等极少得到报道。我们利用TaO纳米片集聚形成单层FaO,其电学性能受到存在于TaO中的电子缺陷非常严重的影响。因此,椭圆偏振光谱测量（椭偏法）被用于计算两个不同的氧空位的跃迁能量及对应的几率,X射线光电子能谱分析揭示了氧空位的存在。椭偏拟合同样计算出了单层TaO

关键词：单层电子缺陷椭偏

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基于自适应增强的静态随机存储单元失效率快速仿真算法

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复旦学报（自然科学版） 2014年第3期53卷 350-358,364页

作者：韦峰朱恒亮曾璇复旦大学专用集成电路与系统国家重点实验室上海201203

随着纳米工艺的不断推进,由随机工艺参数偏差引起的电路稳定性问题日益突出.静态存储器由大规模高度重复性电路单元结构组成,要保证整个芯片工作正常,要求单个单元电路失效的概率极低,相关的失效事件属于极端概率事件.传统的蒙特卡洛采... 详细信息

随着纳米工艺的不断推进,由随机工艺参数偏差引起的电路稳定性问题日益突出.静态存储器由大规模高度重复性电路单元结构组成,要保证整个芯片工作正常,要求单个单元电路失效的概率极低,相关的失效事件属于极端概率事件.传统的蒙特卡洛采样在产生足够的有效采样点和精确捕捉实际失效区域分布方面存在诸多缺陷.本文采用的自适应增强(AdaBoost)方法是一种新的统计学习技术,通过样本学习构建一个强分类器,可以过滤掉大量无效的采样点,使采样点更集中的分布在失效区域中.另外,本文引入交叉熵方法改进传统的重要性采样算法,达到更快的收敛速度.该方法综合了数据挖掘和极值理论的思想,能够快速精确地捕捉失效区域实际分布,相比于标准的蒙特卡洛采样方法,在不损失精度的情况下效率提高了1000倍以上.

关键词：静态随机存储器深亚微米蒙特卡洛采样随机工艺偏差重要性采样 AdaBoost方法

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考虑悬浮哑元的结构化随机行走电容提取算法

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复旦学报（自然科学版） 2014年第1期53卷 9-16,23页

作者：孙泽武朱恒亮曾璇复旦大学专用集成电路与系统国家重点实验室上海201203

为了解决化学机械抛光(CMP)工艺带来的芯片平整性问题,集成电路制造工艺越来越多地选择向电路版图中填充金属哑元.然而,电路中的大量金属哑元大幅增加了互连线的寄生电容值.在提取含大量哑元电路的寄生电容时,传统寄生电容提取算法的效... 详细信息

为了解决化学机械抛光(CMP)工艺带来的芯片平整性问题,集成电路制造工艺越来越多地选择向电路版图中填充金属哑元.然而,电路中的大量金属哑元大幅增加了互连线的寄生电容值.在提取含大量哑元电路的寄生电容时,传统寄生电容提取算法的效率会受到明显影响.提出了一种基于随机行走的寄生电容提取算法,利用区域分解技术,将哑元区域划分为多个子区域,通过对具有相同结构的标准子区域建立宏模型,并计算其马尔可夫转移矩阵,利用转移概率实现哑元区域内的"行走".同传统算法相比,在保证提取精度的前提下,方法具有更快的提取速度.此外,宏模型的建立可以避免对标准哑元结构的重复计算,提高计算结果的复用率.

关键词：电容提取悬浮哑元随机行走区域分解

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一种基于OFDM和比特分配技术的改善低压电力线通信性能的方法

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复旦学报（自然科学版） 2014年第1期53卷 17-23页

作者：刘轰俞晓雪闵昊复旦大学专用集成电路与系统国家重点实验室上海201203

现有电力线通信技术由于受到信道频率选择性衰减以及窄带噪声等特性的影响，限制了其更广泛的应用．通过对PLC系统的分析，提出了采用基于OFDM和比特分配技术的PLC系统方案，并在Matlab平台上建立了OFDM低压窄带（3-500kHz）电力线通信... 详细信息

现有电力线通信技术由于受到信道频率选择性衰减以及窄带噪声等特性的影响，限制了其更广泛的应用．通过对PLC系统的分析，提出了采用基于OFDM和比特分配技术的PLC系统方案，并在Matlab平台上建立了OFDM低压窄带（3-500kHz）电力线通信系统模型，完成系统仿真，并分析了方案的可行性．同时，基于此方案完成了硬件系统的设计，并在实际电力线信道环境下进行测试，实验结果表明：OFDM和比特分配技术非常适合应用在PLC系统中，可以实现高速可靠的通信．

关键词：电力线通信信道 OFDM 比特分配智能电网

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一种具有2-bit/cycle结构的400-MS/s 8-bit逐次逼近型模数转换器设计

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复旦学报（自然科学版） 2014年第4期53卷 446-451,F0002页

作者：代国宪陈迟晓叶凡任俊彦复旦大学专用集成电路与系统国家重点实验室上海201203

设计了一种高速的逐次逼近型模数转换器(Successive Approximated Register Analog-Digital Converter,SAR ADC),与传统SAR ADC相比,该ADC除了采样电容阵列,额外使用了一个辅助数模转换器(Auxiliary Digital-Analog Converter,AUX-DAC)来实现2-bit/cycle.系统设计的SAR ADC使用了一个共享的内插预放大器,可以将输入信号和比较器隔离开,减小了比较器的回踢噪声.为了进一步提高转换速度,采用比较器交替工作模式,其输出结果直接送给电容阵列进行处理,与传统SAR ADC相比大大减小了逻辑延时.由于架构中使用了多路比较器,因此采用前台校准技术用来校正比较器的失调电压.后仿结果表明该ADC在400M采样速率和1.2V的电源电压下,可以实现48dB的SNDR,功耗为5.6mW,优值FoM为67fJ/conversion-step.

关键词： 2-bit/cycle SAR ADC 内插预放大器交替工作比较器前台校准

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一种用于数模混合电路的可测试性设计IP核

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固体电子学研究与进展 2014年第6期34卷 550-554页

作者：冯泽民王晶晶陈迟晓许俊任俊彦复旦大学专用集成电路与系统国家重点实验室上海201203

介绍了一种用于数模混合电路的可测试性设计IP核。该IP核可作为辅助测试的模块嵌入到数模混合电路中,利用串口通信技术,由单片机(MCU)或FPGA向IP内部串行输入控制信号,完成对待测数模混合电路的数字校正和模拟校正或者输出待测电路中的... 详细信息

介绍了一种用于数模混合电路的可测试性设计IP核。该IP核可作为辅助测试的模块嵌入到数模混合电路中,利用串口通信技术,由单片机(MCU)或FPGA向IP内部串行输入控制信号,完成对待测数模混合电路的数字校正和模拟校正或者输出待测电路中的部分静态电压节点,由此提高测试的成功率。电路采用TSMC 65nm工艺设计并流片,功耗为600μW,核心面积为110μm×80μm,适合数模混合电路的片上集成。

关键词：可测试性设计数模混合电路串口通信

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一种可扩展高速FPGA嵌入式ECC电路设计

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复旦学报（自然科学版） 2014年第4期53卷 441-445页

作者：叶海江来金梅复旦大学专用集成电路与系统国家重点实验室上海201203

针对当前现场可编程门阵列(FPGA)嵌入式帧检错与纠错(ECC)电路速度低、可扩展性差的不足,设计了一种新型可扩展的高速流水线型帧ECC电路.它充分利用FPGA回读数据的特征,在FPGA回读数据的同时完成单帧数据的ECC校验,不占用额外的存储资源... 详细信息

针对当前现场可编程门阵列(FPGA)嵌入式帧检错与纠错(ECC)电路速度低、可扩展性差的不足,设计了一种新型可扩展的高速流水线型帧ECC电路.它充分利用FPGA回读数据的特征,在FPGA回读数据的同时完成单帧数据的ECC校验,不占用额外的存储资源.每一级流水线的延时相对于整个FPGA配置电路的延时而言是非常小的,不会影响到整个FPGA配置电路的速度.实验结果表明,和Xilinx设计的ECC电路相比,本设计的平均最高工作频率是其1.5倍,平均资源占用率仅为其10%.此外,该帧ECC电路具有良好的扩展性,通过调整流水线的级数就能够很好地适应FPGA配置位流结构的改变.

关键词：现场可编程逻辑门阵列(FPGA) ECC 流水线

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