检索结果-内蒙古大学图书馆

电子与信息学报 2017年第10期39卷 2487-2494页

作者：戴紫彬易肃汶李伟南龙梅解放军信息工程大学郑州450000 复旦大学专用集成电路与系统国家重点实验室上海201203

为了解决当前椭圆曲线密码处理器普遍存在灵活性低、资源占用大的问题,该文采用统计建模的方式,以面积-时间(AT)综合性能指标为指导,提出了一种面向椭圆曲线密码并行处理架构的量化评估方式,并确定3路异构并行处理架构可使处理器综合性... 详细信息

为了解决当前椭圆曲线密码处理器普遍存在灵活性低、资源占用大的问题,该文采用统计建模的方式,以面积-时间(AT)综合性能指标为指导,提出了一种面向椭圆曲线密码并行处理架构的量化评估方式,并确定3路异构并行处理架构可使处理器综合性能达到最优。其次,该文提出一个分离分级式存储结构和一个运算资源高度复用的模运算单元,可增强存储器的访问效率和运算资源的利用率。在90 nm CMOS工艺下综合,该文处理器的面积为1.62 mm^2,完成一次GF(2^(571))和GF(p^(521))上的点乘运算分别需要2.26 ms/612.4μJ和2.63 ms/665.4μJ。与同类设计相比,该文处理器不仅具有较高的灵活性、可伸缩性,而且其芯片面积和运算速度达到了很好的折中。

关键词：椭圆曲线密码并行处理架构量化评估分离分级式存储结构资源复用

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可重构非线性布尔函数利用率模型研究与硬件设计

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电子与信息学报 2017年第5期39卷 1226-1232页

作者：戴紫彬王周闯李伟李嘉敏南龙梅解放军信息工程大学郑州450001 复旦大学专用集成电路与系统国家重点实验室上海200433

为解决序列密码中非线性布尔函数(Non-Linear Boolean Function,NLBF)硬件资源利用率低的问题,该文对以查找表(Look-Up Table,LUT)为基本构件的利用率模型进行研究,并结合适配算法的前期处理结果确定影响硬件利用率的3个基本参数(LUT大... 详细信息

为解决序列密码中非线性布尔函数(Non-Linear Boolean Function,NLBF)硬件资源利用率低的问题,该文对以查找表(Look-Up Table,LUT)为基本构件的利用率模型进行研究,并结合适配算法的前期处理结果确定影响硬件利用率的3个基本参数(LUT大小、单元规模和输入端口数目);在此基础上,以变量频次为约束实现NLBF的映射,完成非线性运算单元的设计,单元支持多路并行处理。在SMIC 180 nm下进行逻辑综合,并行度为32时,工作频率达到241 MHz,吞吐率为7.71 Gb/s;对不同NLBF进行利用率评估,利用率均达到91.14%以上,并且随着并行度增加,利用率不断增大。

关键词：序列密码可重构计算非线性布尔函数查找表

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一种特殊数字滤波器的优化结构

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微电子学 2018年第4期48卷 429-432页

作者：张幸幸陆继承李夏禹俞军复旦大学专用集成电路与系统国家重点实验室上海200433 复旦大学微电子学院上海200433 上海复旦微电子集团股份有限公司上海200433

提出一种特殊数字滤波器的结构优化方案,可以简化滤波器结构、节省电路面积。将该方案应用于解调ISO/IEC 14443协议规定的PICC到PCD的副载波调制信号。在此基础上,改变子滤波器的位置,将长延迟链前移,减少了长延时链的数据位宽。综合结... 详细信息

提出一种特殊数字滤波器的结构优化方案,可以简化滤波器结构、节省电路面积。将该方案应用于解调ISO/IEC 14443协议规定的PICC到PCD的副载波调制信号。在此基础上,改变子滤波器的位置,将长延迟链前移,减少了长延时链的数据位宽。综合结果表明,该滤波器的面积仅为传统滤波器的50%。

关键词： FIR滤波器匹配滤波器 ISO/IEC14443协议

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基于Amdahl定律扩展的多核处理器性能模型研究

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电子学报 2017年第6期45卷 1424-1430页

作者：冯晓戴紫彬蔡路亭李伟解放军信息工程大学河南郑州450000 复旦大学专用集成电路与系统国家重点实验室上海200137

通过引入应用程序并行特征、通信开销、资源限制等因素,建立了基于Amdahl定律扩展的多核处理器性能模型.通过模型参数仿真,搜索面向特定应用的多核处理器设计空间,得出如下规律:增大计算核心规模可实现超线性加速比;结构应优先选择异构... 详细信息

通过引入应用程序并行特征、通信开销、资源限制等因素,建立了基于Amdahl定律扩展的多核处理器性能模型.通过模型参数仿真,搜索面向特定应用的多核处理器设计空间,得出如下规律:增大计算核心规模可实现超线性加速比;结构应优先选择异构结构;设计多进程、大容量的共享通信区可降低核间通信开销;计算核心数目和规模由应用程序并行度和各并行部分比例及设计规模决定.

关键词：多核处理器性能模型 Amdahl定律并行计算加速比

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面向分组密码的可重构异构多核并行处理架构

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电子学报 2017年第6期45卷 1311-1320页

作者：冯晓李伟戴紫彬马超李功丽解放军信息工程大学河南郑州450000 复旦大学专用集成电路与系统国家重点实验室上海20123

现有的可重构分组密码实现结构中,专用指令处理器吞吐率不高,阵列结构资源利用率低、算法映射过程复杂.为此,设计了分组密码可重构异构多核并行处理架构RAMCA(Reconfigurable Asymmetrical Multi-Core Architecture),分析了典型SP(AES-1... 详细信息

现有的可重构分组密码实现结构中,专用指令处理器吞吐率不高,阵列结构资源利用率低、算法映射过程复杂.为此,设计了分组密码可重构异构多核并行处理架构RAMCA(Reconfigurable Asymmetrical Multi-Core Architecture),分析了典型SP(AES-128)、Feistel(SMS4)、L-M(IDEA)及MISTY(KASUMI)结构算法在RAMCA上的映射过程.在65nm CMOS工艺下完成了逻辑综合和功能仿真.实验表明,RAMCA工作频率可达到1GHz,面积约为1.13mm2,消除工艺影响后,对各分组密码算法的运算速度均高于现有专用指令处理器以及Celator、RCPA和BCORE等阵列结构密码处理系统.

关键词：分组密码异构多核可重构并行处理密码处理器

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用于多比特正交发射机的基于图形转换的全自动预失真技术

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复旦学报（自然科学版） 2017年第6期56卷 725-731页

作者：沈逸磊薛盼叶峰洪志良复旦大学专用集成电路与系统国家重点实验室上海201203

多比特正交架构是全数字发射机方案中最有前景的一种,但因为存在着显著的非线性,而需要复杂的二维预失真,并且前人提出的迭代测量法建立预失真表时间长约1ms.本文提出了图样转换的方案来解决预失真表建立时间过长的问题.本文方案将预失... 详细信息

多比特正交架构是全数字发射机方案中最有前景的一种,但因为存在着显著的非线性,而需要复杂的二维预失真,并且前人提出的迭代测量法建立预失真表时间长约1ms.本文提出了图样转换的方案来解决预失真表建立时间过长的问题.本文方案将预失真表的建立时间缩短到20μs之内,同时对7.2dB PAPR和40MHz带宽的长期演进(Long Term Evolation,LTE)信号,布局前仿真中预失真后信号带内误差能减少到-30.07dB.本文方案不仅节省了预失真过程的时间和功耗,也使多比特正交发射机预失真表的实时建立首次成为可能.

关键词：全数字发射机多比特正交功放二维预失真图样转换

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一种基于分水岭分割的快速图像修复算法

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复旦学报（自然科学版） 2017年第1期56卷 57-70页

作者：屠昕钮圣虓陈更生许薇复旦大学专用集成电路与系统国家重点实验室上海201203

为快速准确地对破损图像进行修复,提高传统算法的修复质量和速度,本文提出了一种改进的基于分水岭分割的快速图像修复算法.首先针对传统算法在修复速度上的不足,采用改进的匹配区域搜索方法以缩小搜索区域,然后通过分水岭分割结果筛选... 详细信息

为快速准确地对破损图像进行修复,提高传统算法的修复质量和速度,本文提出了一种改进的基于分水岭分割的快速图像修复算法.首先针对传统算法在修复速度上的不足,采用改进的匹配区域搜索方法以缩小搜索区域,然后通过分水岭分割结果筛选匹配块以进一步加速图像修复,最后利用分水岭分割结果提出了新的分类修复方法来改进图像修复质量.实验结果表明,相较于现有算法,本文提出的算法在修复质量上有明显的改进,并且修复速度平均提升了40%左右.

关键词：图像修复匹配区域缩小分水岭分割分类比较

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一种全数字正交发射机中数字前端电路的设计

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复旦学报（自然科学版） 2017年第3期56卷 336-345页

作者：叶峰沈逸磊薛盼张宏广洪志良复旦大学专用集成电路与系统国家重点实验室上海201203

本文设计了一种应用于全数字正交发射机的数字前端电路(DFE).DFE主要由I/Q 2路插值倍数为24的高速升采样数字滤波器构成,将基带带宽为20MHz的信号从100MHz升采样至2.4GHz,同时能够有效滤除镜像信号.其中第1级滤波器采用转置结构实现,并... 详细信息

本文设计了一种应用于全数字正交发射机的数字前端电路(DFE).DFE主要由I/Q 2路插值倍数为24的高速升采样数字滤波器构成,将基带带宽为20MHz的信号从100MHz升采样至2.4GHz,同时能够有效滤除镜像信号.其中第1级滤波器采用转置结构实现,并通过对过渡带的优化而将滤波器阶数从41降低至18.后3级半带滤波器则通过结构的变换,巧妙地将插值与滤波器过程结合起来,降低了部分单元的工作频率,优化了功耗;另外,在高频部分,为了满足时序要求,对关键路径进行流水线处理,并使用低阈值管提高工作频率.此外,在DFE中还增加了低功耗的串行外设接口(SPI)可配置的预失真查找表,从而实现数字预失真(DPD)的功能,并通过对称性将查找表存储量优化17×***的总体版图面积为0.34mm2,包括时钟分频模块在内的总功耗估算为34.8mW,其中数字预失真表部分的功耗为3.5mW.仿真结果表明,本文带有预失真查找表的DFE能够将发射机的误差矢量幅度(EVM)从31.6%降低至3.26%.

关键词：数字前端插值滤波器数字预失真误差矢量幅度

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基于BIST方法的新型FPGA芯片CLB功能测试方法

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复旦学报（自然科学版） 2017年第4期56卷 488-494页

作者：石超王健来金梅复旦大学专用集成电路与系统国家重点实验室上海201203

新型FPGA普遍使用了6输入查找表以实现可编程逻辑,如Xilinx公司的Virtex 5系列、Ultrascale系列等.由于I/O数量有限,针对这些芯片的CLB功能测试,可选择ILA级联测试法并利用位流回读进行故障定位,但由于CLB存在路径互斥,覆盖所有故障所... 详细信息

新型FPGA普遍使用了6输入查找表以实现可编程逻辑,如Xilinx公司的Virtex 5系列、Ultrascale系列等.由于I/O数量有限,针对这些芯片的CLB功能测试,可选择ILA级联测试法并利用位流回读进行故障定位,但由于CLB存在路径互斥,覆盖所有故障所需配置较多,而位流回读较为缓慢,限制了定位速度.BIST测试法通过直接检测CLB的输出来发现故障,所需配置数量少于ILA级联法,但需要将测试激励传递到所有BUT导致端口负载大,布线存在困难.本文提出了一种将ORA中闲置资源配置为锁存器链,以便传递测试激励的方法.该方法降低了端口负载.同时利用剩余的逻辑资源建立扫描链,大幅加快了故障定位速度.在Xilinx 7系列FPGA上的实验结果表明,与其他文献所用测试方案比较,测试所需配置次数由30次降低到26次,故障定位所需时间在2.4MHz时钟驱动下可达61.35ns.

关键词：现场可编程门阵列可编程逻辑块功能测试内建自测试

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用于超高频射频识别读写器Mixer-First接收机的新型直流分量消除技术

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复旦学报（自然科学版） 2017年第4期56卷 495-502页

作者：郑凡凡谈熙闵昊复旦大学专用集成电路与系统国家重点实验室上海201203

由于收发隔离度有限,超高频射频识别读写器的接收机面临着发射机载波泄漏的问题,基于MixerFirst结构的接收机,提出了一种新型的直流分量消除技术.在无源混频器的中频输出端设计一个由电感、电容等器件组成的带通滤波器,滤除泄漏载波经... 详细信息

由于收发隔离度有限,超高频射频识别读写器的接收机面临着发射机载波泄漏的问题,基于MixerFirst结构的接收机,提出了一种新型的直流分量消除技术.在无源混频器的中频输出端设计一个由电感、电容等器件组成的带通滤波器,滤除泄漏载波经过下变频产生的直流分量.同时相比于传统的交流耦合方式,该技术可以缩短直流分量的稳定时间.仿真结果表明,当标签返回信号数据率为400kb/s时,该结构的带通滤波器的直流衰减约为-50dB,同时直流分量的稳定时间约为6μs,只有传统交流耦合方式的一半左右.该技术可以扩展接收机的动态范围.

关键词：射频识别读写器接收机载波泄漏直流分量消除带通滤波器

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